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全加器

用VHDL編的兩位BCD加法器用VHDL編的兩位BCD加法器

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VHDL的一些實例。有加法器。存儲器之類的。基本模塊

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一個超前進位加法器（及其testbench) .v文件

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一個帶overflow功能的加法器的實現

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一個基于Matlab+Simulink的帶Rounding功能的加法器實現

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一個基于Matlab+Simulink的復數加法器實現

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兩個浮點數相加的加法器

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VHDL編寫的四位加法計數器

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VHDL的N位加法器

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60進制加法器本人自己編的

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