TMS3205402Verilog HDL源碼
標簽： 3205402 Verilog TMS HDL
上傳時間： 2013-08-17
上傳用戶：shizhanincc
基于FPGA的交通燈的設計 有Verilog HDL 源碼、仿真圖與引腳配置圖，已下載實現\r\n
標簽： Verilog FPGA HDL 交通燈
上傳時間： 2013-08-18
上傳用戶：BOBOniu
實現基于CPLD的CCD采集系統設計源碼
標簽： CPLD CCD 采集 系統設計
上傳用戶：pkzz021
基于FPGA的多功能數字鐘的設計與實現 內附有詳盡的Verilog HDL源碼，其功能主要有：時間設置，時間顯示，跑表，分頻，日期設置，日期顯示等
標簽： Verilog FPGA HDL 多功能
上傳用戶：問題問題
s3c2410開發板cpld源碼，希望有些參考價值
標簽： s3c2410 cpld 開發板 源碼
上傳時間： 2013-08-20
上傳用戶：wtrl
FPGA設計全流程：Modelsim>>Synplify.Pro>>ISE\\r\\n第一章 Modelsim編譯Xilinx庫\\r\\n第二章 調用Xilinx CORE-Generator\\r\\n第三章 使用Synplify.Pro綜合HDL和內核\\r\\n第四章 綜合后的項目執行\\r\\n第五章 不同類型結構的仿真
標簽： FPGA 流程
上傳用戶：cuibaigao
使用QUARTUS做FPGA開發全流程，適用于初學者
標簽： QUARTUS FPGA 流程
上傳時間： 2013-08-21
上傳用戶：feifei0302
FPGA RSIC CPU設計文檔和源碼是EDA中對CPU設計非常好用的程序
標簽： CPU FPGA RSIC EDA
上傳用戶：cppersonal
通過fpga產生時鐘的VHDL源碼，QII7.1下調試通過
標簽： fpga VHDL 時鐘 源碼
上傳時間： 2013-08-24
fpga功能實現有限字長響應FIR，用verilog編寫
標簽： fpga FIR 有限字長
上傳用戶：hz07104032
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