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兼容性

實驗開發評估板設計與實現

信號與信息處理是信息科學中近幾年來發展最為迅速的學科之一,隨著片上系統(SOC,System On Chip)時代的到來,FPGA正處于革命性數字信號處理的前沿。基于FPGA的設計可以在系統可再編程及在系統調試,具有吞吐量高,能夠更好地防止授權復制、元器件和開發成本進一步降低、開發時間也大大縮短等優點。然而,FPGA器件是基于SRAM結構的編程工藝,掉電后編程信息立即丟失,每次加電時,配置數據都必須重新下載,并且器件支持多種配置方式,所以研究FPGA器件的配置方案在FPGA系統設計中具有極其重要的價值,這也給用于可編程邏輯器件編程的配置接口電路和實驗開發設備提出了更高的要求。本論文基于IEEE1149.1標準和USB2.0技術,完成了FPGA配置接口電路及實驗開發板的設計與實現。作者在充分理解IEEE1149.1標準和USB技術原理的基礎上,針對Altcra公司專用的USB數據配置電纜USB-Blaster,對其內部工作原理及工作時序進行測試與詳細分析,完成了基于USB配置接口的FPGA芯片開發實驗電路的完整軟硬件設計及功能時序仿真。作者最后進行了軟硬件調試,完成測試與驗證,實現了對Altera系列PLD的配置功能及實驗開發板的功能。本文討論的USB下載接口電路被驗證能在Altera的QuartusII開發環境下直接使用,無須在主機端另行設計通信軟件,其兼容性較現有設計有所提高。由于PLD(Programmable Logic Device)廠商對其知識產權嚴格保密,使得基于USB接口的配置電路應用受到很大限制,同時也加大了自行對其進行開發設計的難度。與傳統的基于PC并口的下載接口電路相比,本設計的基于USB下載接口電路及FPGA實驗開發板具有更高的編程下載速率、支持熱插拔、體積小、便于攜帶、降低對PC硬件傷害,且具備其它下載接口電路不具備的SignalTapII嵌入式邏輯分析儀和調試NiosII嵌入式軟核處理器等明顯優勢。從成本來看,本設計的USB配置接口電路及FPGA實驗開發板與其同類產品相比有較強的競爭力。

標簽： 實驗評估板

上傳時間： 2013-06-07

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可重構24bit音頻過采樣DAC的FPGA

基于過采樣和∑-△噪聲整形技術的DAC能夠可靠地把數字信號轉換為高精度的模擬信號(大于等于16位)。采用這一架構進行數模轉換具有諸多優點，例如極低的失配噪聲和更高的可靠性，便于實現嵌入式集成等，最重要的是可以得到其他DAC結構所無法達到的精度和動態范圍。在高精度測量，音頻轉換，汽車電子等領域有著廣泛的應用價值。本文采用∑-△結構以FPGA方式實現了一個具有高精度的數模轉換器，在24比特的輸入信號下，達到了約150dB的信噪比。作為一個靈活的音頻DAC實現方案。該DAC可以對CD/DVD/HDCD/SACD等多種制式下的音頻信號進行處理，接受并轉換采樣率為32/44.1/48/88.2/96/192kHz，字長為16/18/20/24比特的PCM數據，具備良好的兼容性和通用性。由于非線性和不穩定性的存在，高階∑-△調制器的設計與實現存在較大的難度。本文綜合大量文獻中的經驗原則和方法，闡述了穩定的高階高精度調制器的設計流程；并據此設計了達到24bit精度和滿量程輸入范圍的的5階128倍調制器。本文創新性地提出了∑-△調制器的一種高效率流水線實現結構。分析表明，與其他常見的∑-△調制器實現結構相比，本方案具有結構簡單、運算單元少等優點；此外在同樣信號采樣率下，調制器所需的時鐘頻率大大降低。文中的過采樣濾波模塊采用三級半帶濾波器和一個可變CIC濾波器級聯組成，可以達到最高128倍的過采樣比，同時具有良好的通帶和阻帶特性。在半帶濾波器的設計中采用了CSD編碼，使結構得到了充分的簡化。本文提出的過采樣DAC方案具有可重配置結構，讓使用者能夠方便地控制過采樣比和調制器階數。通過積分梳狀濾波器的配置，能夠獲得32/64/128倍的不同過采樣比，從而實現對于32～192kHz多種采樣率輸入的處理。在不同輸入字長情況下，通過調制器的重構，則可以將調制器由高精度的5階模式改變為功耗更低的3階模式，滿足不同分辨率信號輸入時的不同精度要求。這是本文的另一創新之處。目前，該過采樣DAC已經在XilinxVirtexⅡ系列FPGA器件下得到硬件實現和驗證。測試表明，對于從32kHz到192kHz的不同輸入信號，該DAC模塊輸出1比特碼流的帶內信噪比均能滿足24比特數據轉換應用的分辨率要求。

標簽： FPGA bit DAC 24

上傳時間： 2013-07-08

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基于FPGA的PCI接口的設計

PCI（Peripheral Component Interconnect）局部總線是微型計算機中處理器、存儲器與外圍控制部件、擴展卡之間的互連接口，由于其速度快、可靠性高、成本低、兼容性好等特點，在各種計算機總線標準占有重要地位，基于PCI標準的接口設計已經成為相關項目開發中的一個重要的選擇。　　目前，現場可編程門陣列FPGA（Field Programmable Gates）得到了廣泛應用。由于其具有規模大，開發過程投資小，可反復編程，且支持軟硬件協同設計等特點，因此已逐步成為復雜數字硬件電路設計的首選。　　 PCI接口的開發有多種方法，主要有兩種：一是使用專用接口芯片，二是使用可編程邏輯器件，如FPGA。本論文基于成本和實際需要的考慮，采用第二種方法進行設計。　　本論文采用自上而下（Top-To-Down）和模塊化的設計方法，使用FPGA和硬件描述語言（VHDL和Verilog HDL）設計了一個PCI接口核，并通過自行設計的試驗板對其進行驗證。為使設計準確可靠，在具體模塊的設計中廣泛采用流水線技術和狀態機的方法。　　論文最終設計完成了一個33M32位的PCI主從接口，并把它作為以NIOSⅡ為核心的SOPC片內外設，與通用計算機成功進行了通訊。　　論文對PCI接口進行了功能仿真，仿真結果和PCI協議的要求一致，表明本論文設計正確。把設計下載進FPGA芯片EP2C8Q208C7之后，論文給出了使用SIGNALTAPⅡ觀察到的信號實際波形，波形顯示PCI接口能夠滿足本設計中系統的需要。本文最后還給出試驗板的具體設計步驟及驅動程序的安裝。

標簽： FPGA PCI 接口的設計

上傳時間： 2013-07-28

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《電磁兼容的印制電路板設計（原書第二版）》

·【內容簡介】本書涵蓋了全部PCB的設計基礎知識和每一個設計環節具體的技術，較第1版增加了許多新的設計技術、最新的研究成果、獨特的設計技術、防護和控制技術的內容。使得本書既是一本講原理的教科書又是一本完整的PCB設計技術手冊，集理論性和實用性于一身。本書可以作為高速PCB的信號完整性和電磁兼容性設計技術的高級培訓教材，也適宜作為高等院校電子、電氣、自動化等專業研究生的教材。【編輯推薦】電磁兼

標簽： 電磁兼容印制電路板設計

上傳時間： 2013-04-24

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PCB電磁兼容技術—設計實踐

資源簡介《PCB電磁兼容技術:設計實踐》集實踐和理論于一體，概括了數字電路印制電路板電磁兼容性設計的重點，適合那些涉及系統設計、邏輯設計、硬件設計、PCB布局的工程技術人員，同時適合測試工程師和技師，從事機電產品、加工、制造和兼容調試工作的人員，電磁兼容設計工程師，以及負責對硬件工程設計進行管理和質量控制的人員閱讀參考。

標簽： PCB 電磁兼容技術實踐

上傳時間： 2013-07-24

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從硬件和軟件兩方面建立了基于DSP和FPGA的軟件無線電平臺

從硬件和軟件兩方面建立了基于DSP和FPGA的軟件無線電平臺。重點研究了該實驗平臺多模式\\\\\\\\r\\\\\\\\n數字調制解調的硬件實現結構、軟件實現結構和不同模式之間的切換等，充分體現了軟件無線電系統的靈活性、\\\\\\\\r\\\\\\\\n開放性和兼容性等特點。

標簽： FPGA DSP 軟件硬件

上傳時間： 2013-08-06

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CAM350軟件的學習筆記

CAM350軟件的學習筆記目錄1. CAM3501. 一. Gerber知識2. 二.CAM3503. 三.CAM350操作4. 附錄Gerber知識l Gerber 文件的格式包括：¡ RS-274-X （常用）¡ RS-274-D （常用）¡ RS-274¡ Fire 9000¡ Mda 9000¡ Barco DPFl 標準的gerber file 格式可分為RS-274 與RS-274X 兩種，其不同在于：¡ RS-274 格式的gerber file 與aperture 是分開的不同文件。¡ RS-274X 格式的aperture 是整合在gerber file 中的，因此不需要aperture文件(即，內含D 碼)。PCB生成Gerber最好就是選用RS-274x格式，既標準，又兼容性高。l 數據格式：整數位+小數位。常用：¡ 3：3（公制，整數3 位，小數3 位）¡ 2：4（英制，整數2 位，小數4 位）¡ 2：3（英制，整數2 位，小數3 位）¡ 3：3（英制，整數3 位，小數3 位）l 前導零、后導零和不導零：¡ 例：025690 前導零后變為：25690 (Leading)¡ 025690 后導零后變為：02569 (Trailing)¡ 025690 不導零后變為：025690 (None)l 單位：¡ METRIC（mm）¡ ENGLISH（inch or mil）l 單位換算：¡ 1 inch ＝ 1000 mil ＝ 2.54 cm ＝ 25.4 mm¡ 1 mm ＝ 0.03937 inch ＝ 39.37 mill GERBER 格式的數據特點：

標簽： CAM 350 軟件

上傳時間： 2013-10-19

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EDA工程建模及其管理方法研究2

EDA工程建模及其管理方法研究2 1 隨著微電子技術與計算機技術的日益成熟，電子設計自動化(EDA)技術在電子產品與集成電路 (IC)芯片特別是單片集成(SoC)芯片的設計應用中顯得越來越重要。EDA技術采用“自上至下”的設計思想，允許設計人員能夠從系統功能級或電路功能級進行產品或芯片的設計，有利于產品在系統功能上的綜合優化，從而提高了電子設計項目的協作開發效率，降低新產品的研發成本。近十年來，EDA電路設計技術和工程管理方面的發展主要呈現出兩個趨勢： (1) 電路的集成水平已經進入了深亞微米的階段，其復雜程度以每年58％的幅度迅速增加，芯片設計的抽象層次越來越高，而產品的研發時限卻不斷縮短。 (2) IC芯片的開發過程也日趨復雜。從前期的整體設計、功能分，到具體的邏輯綜合、仿真測試，直至后期的電路封裝、排版布線，都需要反復的驗證和修改，單靠個人力量無法完成。IC芯片的開發已經實行多人分組協作。由此可見，如何提高設計的抽象層次，在較短時間內設計出較高性能的芯片，如何改進EDA工程管理，保證芯片在多組協作設計下的兼容性和穩定性，已經成為當前EDA工程中最受關注的問題。

標簽： EDA 工程建模管理方法

上傳時間： 2013-11-10

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ZLK-2A張力動態顯示控制器

一套外掛式電子模組，采用CMOS數字電路，雙顯示功能。具有高抗干擾性和良好的系統兼容性。可以帶電插拔模塊進行緊急維修。尤其適用于車載系統中，作為軍民兩用的張力動態控制器。具有高可靠性和低成本特點。

標簽： ZLK 張力動態顯示控制器

上傳時間： 2013-10-31

上傳用戶：daguda
5 Gsps高速數據采集系統的設計與實現

以某高速實時頻譜儀為應用背景，論述了5 Gsps采樣率的高速數據采集系統的構成和設計要點，著重分析了采集系統的關鍵部分高速ADC（analog to digital，模數轉換器）的設計、系統采樣時鐘設計、模數混合信號完整性設計、電磁兼容性設計和基于總線和接口標準（PCI Express）的數據傳輸和處理軟件設計。在實現了系統硬件的基礎上，采用Xilinx公司ISE軟件的在線邏輯分析儀（ChipScope Pro）測試了ADC和采樣時鐘的性能，實測表明整體指標達到設計要求。給出上位機對采集數據進行處理的結果，表明系統實現了數據的實時采集存儲功能。

標簽： Gsps 高速數據采集系統

上傳時間： 2014-11-26

上傳用戶：黃蛋的蛋黃