CharFilter_Class實(shí)例是對(duì)CharFilter實(shí)例的完善。在CharFilter實(shí)例中，我們定義了四個(gè)全局變量，這不符合WDM驅(qū)動(dòng)程序的要求，它限制了IRP的可重入性，我們應(yīng)該使用局部變量。 該實(shí)例定義了一個(gè)READ_COMPLETION_INFO結(jié)構(gòu)，當(dāng)有DeviceControl 調(diào)用時(shí)，就分配一個(gè)結(jié)構(gòu)對(duì)象，參數(shù)設(shè)置完后，就將該結(jié)構(gòu)對(duì)象地址指針?lè)旁贗.FileObject()->FsContext中。
標(biāo)簽： CharFilter CharFilter_Class
上傳時(shí)間： 2014-01-22
上傳用戶(hù)：watch100
本程序是用來(lái)將客戶(hù)選定圖書(shū)放入購(gòu)書(shū)車(chē)。使用戶(hù)對(duì)圖書(shū)的購(gòu)買(mǎi)信息有詳細(xì)的了解，暫時(shí)確定購(gòu)書(shū)者的列表。這是本項(xiàng)目的關(guān)鍵，是實(shí)現(xiàn)購(gòu)書(shū)的關(guān)鍵。是主程序的子程序。程序采用順序處理。非常駐內(nèi)存。無(wú)覆蓋要求?？芍厝?/p>
標(biāo)簽： 圖書(shū) 程序 用戶(hù)
上傳時(shí)間： 2014-09-03
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上傳時(shí)間： 2015-05-22
上傳用戶(hù)：zuozuo1215
我上傳的文件開(kāi)發(fā)環(huán)境都是ADS 1.2 ARM網(wǎng)絡(luò)開(kāi)發(fā)程序包，內(nèi)有pdf說(shuō)明文件。 ZLG/IP提供實(shí)現(xiàn) Internet 網(wǎng)絡(luò)上 IP接點(diǎn)的功能，是個(gè)高性能的嵌入式 TCP/IP 協(xié)議棧軟件。它使用μC/OS-II 實(shí)時(shí)操作系統(tǒng)的信號(hào)機(jī)制來(lái)實(shí)現(xiàn)一個(gè)多任務(wù)并行并可重入的協(xié)議棧，完全使用 ANSI C 進(jìn)行編寫(xiě)，可以象μC/OS-II 那樣支持多種 CPU。ZLG/IP還具有層次清晰，易于升級(jí)和修改等特點(diǎn)
標(biāo)簽： ADS 1.2 ARM 開(kāi)發(fā)環(huán)境
上傳時(shí)間： 2014-11-18
上傳用戶(hù)：refent
8位密碼鎖的實(shí)現(xiàn)，初始狀態(tài)默認(rèn)為密碼正確，密碼輸入正確方可設(shè)密碼，以后必須按對(duì)密碼才可重設(shè)
標(biāo)簽： 8位 密碼鎖
上傳時(shí)間： 2013-12-01
上傳用戶(hù)：CSUSheep
Lemon是一個(gè)C或者C++語(yǔ)言的LALR(1)語(yǔ)法分析器生成器。它和“bison”與“yacc”的功能是一樣的，但它不是“bison”或者“yacc”的簡(jiǎn)單復(fù)制。為了減少編寫(xiě)代碼的錯(cuò)誤，它使用了一種不同的語(yǔ)法。Lemon使用了一種更為高級(jí)的分析引擎，運(yùn)行速度比“bison”與“yacc”要更快，并且該引擎是可重入的和線程安全的。更進(jìn)一步的，Lemon實(shí)現(xiàn)了能夠消除資源泄漏的特性，適合于長(zhǎng)時(shí)間運(yùn)行的程序例如GUI或者嵌入式控制器中。
標(biāo)簽： Lemon bison LALR yacc
上傳時(shí)間： 2014-01-11
上傳用戶(hù)：lmeeworm
在了解實(shí)時(shí)嵌入式操作系統(tǒng)內(nèi)存管理機(jī)制的特點(diǎn)以及實(shí)時(shí)處理對(duì)內(nèi)存管理需求的基礎(chǔ)上，練習(xí)并掌握有效處理內(nèi)存碎片的內(nèi)存管理機(jī)制，同時(shí)理解防止內(nèi)存泄漏問(wèn)題的良好設(shè)計(jì)方法。使用預(yù)先規(guī)劃的思想，構(gòu)建自己的私有內(nèi)存管理機(jī)制，在系統(tǒng)內(nèi)存池中申請(qǐng)內(nèi)存，并將其納入私有內(nèi)存管理機(jī)制中，形成靜態(tài)預(yù)分配內(nèi)存池； 靜態(tài)預(yù)分配內(nèi)存池支持一種以上固定長(zhǎng)度內(nèi)存池，如16 字節(jié)內(nèi)存池和256 字節(jié)內(nèi)存池。固定長(zhǎng)度內(nèi)存池的單塊長(zhǎng)度應(yīng)考慮體系結(jié)構(gòu)開(kāi)銷(xiāo)，并盡量減少內(nèi)部碎片；固定長(zhǎng)度內(nèi)存池?cái)?shù)量應(yīng)可配置； 靜態(tài)預(yù)分配內(nèi)存池與系統(tǒng)內(nèi)存池的統(tǒng)一管理機(jī)制。向用戶(hù)分配內(nèi)存時(shí)應(yīng)保證長(zhǎng)度最佳匹配原則。當(dāng)申請(qǐng)內(nèi)存的長(zhǎng)度超過(guò)靜態(tài)預(yù)分配長(zhǎng)度或資源不足時(shí)，自動(dòng)向系統(tǒng)內(nèi)存池申請(qǐng)； 管理機(jī)制包括： a) 初 始化函數(shù)； b) 內(nèi) 存申請(qǐng)/釋放函數(shù)。并特別要保證釋放安全； c) 告 警機(jī)制； d) 管 理監(jiān)視機(jī)制。 5. 利用可能的互斥機(jī)制或代碼可重入設(shè)計(jì)，保證以上管理機(jī)制的操作安全性； 6. 創(chuàng)建多Task 環(huán)境測(cè)試及演示以上內(nèi)容
標(biāo)簽： 內(nèi)存管理 實(shí)時(shí)嵌入式 實(shí)時(shí)處理 操作系統(tǒng)
上傳時(shí)間： 2016-04-12
上傳用戶(hù)：lizhen9880
FPGA的作用與簡(jiǎn)介.pdf1. 什么是 FPGA ? 一個(gè) FPGA 是一種包含有一個(gè)可重配置的門(mén)陣列邏輯電路矩陣的設(shè)備。通過(guò)配置， FPGA 的內(nèi)部電路以一定方式相連接，從而創(chuàng)建了軟件應(yīng)用的一個(gè)硬件實(shí)現(xiàn)。與處 理器不同，F(xiàn)PGA 使用專(zhuān)用硬件進(jìn)行邏輯處理，而不具有操作系統(tǒng)。FPGA 在本質(zhì) 上是完全并行的，故不同的處理操作不必競(jìng)爭(zhēng)相同的資源。因此，增加額外的處理 時(shí)，應(yīng)用某一部分的性能不會(huì)受影響。而且，多個(gè)控制循環(huán)可以以不同的速率在單 個(gè) FPGA 設(shè)備上運(yùn)行?；?FPGA 的控制系統(tǒng)可以加強(qiáng)關(guān)鍵互鎖邏輯，也可以通 過(guò)設(shè)計(jì)防止操作人員強(qiáng)奪 I/O。然而，不同于擁有固定硬件資源的硬連接的印制電 路板（PCB）設(shè)計(jì)，基于 FPGA 的系統(tǒng)可以完全重新連接其內(nèi)部電路，以支持控制 系統(tǒng)在現(xiàn)場(chǎng)部署后可以重新配置。FPGA 設(shè)備提供了專(zhuān)用硬件電路所特有的性能與 可靠性。 單個(gè) FPGA 可以通過(guò)在單個(gè)集成電路（IC）芯片上集成數(shù)百萬(wàn)個(gè)邏輯門(mén)以代替數(shù) 以千計(jì)的分立元件。一個(gè) FPGA 芯片的內(nèi)部資源包括一個(gè)被 I/O 組塊環(huán)圍的可配置 邏輯組塊（CLB）矩陣。在 FPGA 矩陣內(nèi)，信號(hào)通過(guò)可編程的互連開(kāi)關(guān)和連線傳遞。 CompactRIO 入門(mén)教程 2 CompactRIO 入 門(mén) 教 程 圖 2.FPGA 芯片的內(nèi)部構(gòu)造
標(biāo)簽： fpga
上傳時(shí)間： 2022-02-18
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經(jīng)典FGPA學(xué)習(xí)書(shū)籍 Xilinx FPGA設(shè)計(jì)權(quán)威指南 Vivado集成設(shè)計(jì)環(huán)境全書(shū)共分8章，內(nèi)容包括： Vivado設(shè)計(jì)導(dǎo)論、Vivado工程模式和非工程模式設(shè)計(jì)流程、Vivado調(diào)試流程、基于IP的嵌入式系統(tǒng)設(shè)計(jì)流程、Vivado HLS設(shè)計(jì)流程、System Generator設(shè)計(jì)流程、Vivado部分可重配置設(shè)計(jì)流程和Vivado高級(jí)設(shè)計(jì)技術(shù)。本書(shū)參考了Xilinx公司提供的Vivado最新設(shè)計(jì)資料，理論與應(yīng)用并重，將Xilinx公司最新的設(shè)計(jì)方法貫穿在具體的設(shè)計(jì)實(shí)現(xiàn)中。本書(shū)可作為使用Xilinx Vivado集成開(kāi)發(fā)環(huán)境進(jìn)行FPGA設(shè)計(jì)的工程技術(shù)人員的參考用書(shū)，也可作為電子信息類(lèi)專(zhuān)業(yè)高年級(jí)本科生和研究生的教學(xué)用書(shū)，同時(shí)也可作為Xilinx公司的培訓(xùn)教材。 本書(shū)全面系統(tǒng)地介紹了Xilinx新一代集成開(kāi)發(fā)環(huán)境Vivado的設(shè)計(jì)方法、設(shè)計(jì)流程和具體實(shí)現(xiàn)。
標(biāo)簽： fpga vivado
上傳時(shí)間： 2022-06-10
LabView實(shí)用技巧系列視頻 -LabVIEW2009-2010破解工具 -LabView資料.zip 116.4MLabVIEW與機(jī)器人科技創(chuàng)新活動(dòng).zip 1.63GLabVIEW高級(jí)程序設(shè)計(jì).zip 335.1MLabVIEW高級(jí)編程與虛擬儀器工程應(yīng)用.zip 122.2MLabView寶典.zip 1.02GLabVIEW8.6中文版講解視頻（無(wú)聲音）.rar 264.9MLabVIEW2010.rar 863.7MLabVIEW 程序設(shè)計(jì)基礎(chǔ)與提高.zip 544.5M清華版labview教程12.25.rar 1MVB6_OPC_Client.rar 17KB9.VI的可重入性.avi 68.5M8.控件的輸入與輸出轉(zhuǎn)換.avi 55.2M7.VI本地化.avi 72.2M6.條件結(jié)構(gòu)的巧用.avi 133.6M5.數(shù)組和簇.avi 131.1M4.程序結(jié)構(gòu)中的分支結(jié)構(gòu)和順序結(jié)構(gòu).avi 69.8M3.程序結(jié)構(gòu)中的循環(huán)結(jié)構(gòu).avi 88.2M23.制作不規(guī)則圖形的子VI圖標(biāo).avi 52.7M22.界面設(shè)計(jì)技巧2.avi 57.6M21.界面設(shè)計(jì)技巧1.avi 86.3M20.用戶(hù)界面設(shè)計(jì)5.avi 71.4M2.多態(tài)VI的創(chuàng)建.avi 82.8M19.用戶(hù)界面設(shè)計(jì)4.avi 41.3M18.用戶(hù)界面設(shè)計(jì)3.avi 51.2M17.用戶(hù)界面設(shè)計(jì)2.avi 56.3M16.用戶(hù)界面設(shè)計(jì)1.avi 36.1M15.波形圖表、波形圖和XY圖表.avi 63.5M14.列表框控件添加圖標(biāo).avi 84.9M13.在文件夾下直接創(chuàng)建新的VI.avi 72.5M12.控件板和函數(shù)板的使用.avi 80.5M11.自定義控件.avi 44.2M10.VI屬性(下).avi 95.7M10.VI屬性(上).avi 85.3M1.VI的創(chuàng)建.avi 68.3M
標(biāo)簽： labview 視頻教程
上傳時(shí)間： 2022-06-14
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