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動態路由

  • 通過WiFi控制智能小車機器人制作過程詳解

    機器人路由篇

    標簽: WiFi 控制 智能小車 機器人

    上傳時間: 2013-11-15

    上傳用戶:123454

  • WIFI-ROBOT設計心得之刷路由篇(大亞DB120)第一篇

    機器人

    標簽: WIFI-ROBOT 120 DB 路由

    上傳時間: 2013-10-11

    上傳用戶:1966640071

  • 教你筆記本怎樣連接無線局域網

    現在的無線路由也不貴, 既可以花費少,又可以讓本本不受網線的限制,想在那里用都可以。筆記本連接無線局域網,如何設置呢下面就教大家怎么來設置無線局域網的電腦知識.

    標簽: 筆記本 無線局域網 連接

    上傳時間: 2013-10-28

    上傳用戶:菁菁聆聽

  • BGP/MPLS IPv6 VPN技術白皮書

    BGP/MPLS IPv6 VPN通過業務供應商IPv4骨干網向用戶提供基于IPv6網絡的VPN業務。在這類VPN架構中,BGP與MPLS起到非常重要的作用。BGP可發布IPv6路由信息,MPLS可轉發用戶數據包。通過深入分析IPv6 VPN原理及其業務模式,本白皮書對BGP/MPLS的IPv6 VPN特性進行了介紹。同時,本文還介紹了IPv6 VPN的各種應用場景。最后,本文通過比較BGP MPLS的IPv6 VPN架構的優勢與局限性分析其可靠性。

    標簽: MPLS IPv6 BGP VPN

    上傳時間: 2013-11-19

    上傳用戶:d815185728

  • AR46路由器配置手冊

    終端接入是指終端設備通過異步接口接到路由器,通過該路由器完成終端設備與遠端服務器或其它終端設備之間的數據交互。終端接入發起方是指首先向對端發起 TCP 連接請求的一方。終端接入的發起方作為TCP 連接的客戶端一般為路由器,接收方作為TCP 連接的服務器可以是前置機也可以是路由器。下面的敘述中提到的服務器和前置機都是指接收方安裝UNIX 或者LINUX 操作系統和服務器程序的前置機。路由器不管是作為終端接入發起方還是終端接入接收方,只要建立起TCP 連接之后,就可以將終端設備上的數據流透明傳輸到TCP 連接的對端。“透明”指的是無需用戶的干預或額外的操作。終端接入在大量采用服務器-終端工作模式的系統中,如銀行、郵政、稅務、海關和民航系統等有大量應用。不同應用中的終端接入有TTY 終端接入、RTC 終端接入和Telnet 終端接入。RTC 終端接入分別通過RTC Client 和RTC Server 實現監控中心和被監控終端的連接;而TTY 終端接入和Telnet 終端接入用于終端發起方為路由器,接收方為服務器,實現終端和服務器之間的數據通信。它們具備不同的特性和功能,下面分別進行介紹。

    標簽: AR 46 路由器 配置手冊

    上傳時間: 2013-11-02

    上傳用戶:xc216

  • 千兆位以太網組網技術_郭向勇

    主要介紹了千兆位以太網技術及其在多速率局域網的組網設計、優化方案和運用多種網絡技術的千兆位以太網組網工程實例。全書共9章,內容包括OSI參考模型與TCP/IP協議簡介,以太網基礎知識、拓撲結構,交換式以太網,虛擬局域網(VLAN),VLAN間通信與路由選擇,千兆位以太網技術的大型局域網設計原則,綜合布線系統設計,基于千兆位以太網技術的大型園區網工程及實例。  

    標簽: 千兆位以太網 組網技術

    上傳時間: 2013-10-15

    上傳用戶:lanhuaying

  • HW-RouteSim3.0

    華為路由工具HW-RouteSim3.0

    標簽: HW-RouteSim 3.0

    上傳時間: 2013-11-05

    上傳用戶:四只眼

  • HW-RouteSim3.0

    華為路由工具HW-RouteSim3.0

    標簽: HW-RouteSim 3.0

    上傳時間: 2013-10-24

    上傳用戶:fanboynet

  • Xilinx UltraScale:為您未來架構而打造的新一代架構

      Xilinx UltraScale™ 架構針對要求最嚴苛的應用,提供了前所未有的ASIC級的系統級集成和容量。    UltraScale架構是業界首次在All Programmable架構中應用最先進的ASIC架構優化。該架構能從20nm平面FET結構擴展至16nm鰭式FET晶體管技術甚至更高的技術,同 時還能從單芯片擴展到3D IC。借助Xilinx Vivado®設計套件的分析型協同優化,UltraScale架構可以提供海量數據的路由功能,同時還能智能地解決先進工藝節點上的頭號系統性能瓶頸。 這種協同設計可以在不降低性能的前提下達到實現超過90%的利用率。   UltraScale架構的突破包括:   • 幾乎可以在晶片的任何位置戰略性地布置類似于ASIC的系統時鐘,從而將時鐘歪斜降低達50%   • 系統架構中有大量并行總線,無需再使用會造成時延的流水線,從而可提高系統速度和容量   • 甚至在要求資源利用率達到90%及以上的系統中,也能消除潛在的時序收斂問題和互連瓶頸   • 可憑借3D IC集成能力構建更大型器件,并在工藝技術方面領先當前行業標準整整一代   • 能在更低的系統功耗預算范圍內顯著提高系統性能,包括多Gb串行收發器、I/O以及存儲器帶寬   • 顯著增強DSP與包處理性能   賽靈思UltraScale架構為超大容量解決方案設計人員開啟了一個全新的領域。

    標簽: UltraScale Xilinx 架構

    上傳時間: 2013-12-23

    上傳用戶:小儒尼尼奧

  • PCB LAYOUT設計規范手冊

      PCB Layout Rule Rev1.70, 規範內容如附件所示, 其中分為:   (1) ”PCB LAYOUT 基本規範”:為R&D Layout時必須遵守的事項, 否則SMT,DIP,裁板時無法生產.   (2) “錫偷LAYOUT RULE建議規範”: 加適合的錫偷可降低短路及錫球.   (3) “PCB LAYOUT 建議規範”:為製造單位為提高量產良率,建議R&D在design階段即加入PCB Layout.   (4) ”零件選用建議規範”: Connector零件在未來應用逐漸廣泛, 又是SMT生產時是偏移及置件不良的主因,故製造希望R&D及採購在購買異形零件時能顧慮製造的需求, 提高自動置件的比例.

    標簽: LAYOUT PCB 設計規范

    上傳時間: 2013-11-03

    上傳用戶:tzl1975

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