本文介紹了兩種分頻系數為整數或半整數的可控分頻器的設計方法。其中之一可以實現50％的奇數分頻。利用VHDL語言編程，并用QUARTERS||4.0進行仿真，用 FPGA 芯片實現。 關鍵詞：半整數，可控分頻器，VHDL, FPGA
標簽： VHDL 分頻 整數 系數
上傳時間： 2015-11-27
上傳用戶：tyler
本文件包是在MAX+plus II 軟件環境下實現半加器的邏輯功能
標簽： plus MAX II 軟件環境
上傳時間： 2014-01-15
上傳用戶：磊子226
全加器,有半加器和或門組成.元件例化語句.
標簽： 全加器 元件 半加器 或門
上傳時間： 2013-12-27
上傳用戶：13188549192
資料壓縮的原理與應用快速霍夫曼解碼器的C程式
標簽： 程式
上傳時間： 2013-12-23
上傳用戶：yan2267246
各種電子器件管腳圖,THD-1型數字電路實驗箱簡介,門電路及參數測試,半加器、全加器,數據選擇器,數碼比較器,譯碼器和數碼顯示器,鎖存器和觸發器,中規模計數器,雙向移位寄存器,三態門和數據總線,半導體存儲器,多諧振蕩器,單穩態觸發器,CMOS門電路及集成施密特觸發器,集成數模轉換器(DAC),逐次漸進型模數轉換器(ADC)
標簽： THD 電子器件 數字電路 實驗箱
上傳時間： 2013-12-19
上傳用戶：heart520beat
用1位半減器構成一位全減器，之后再構成8位全減器。有三個組件：h_suber，一位半減器，f_suber，一位全減器，f_suber8，8位全減器。
標簽： 半減器 減
上傳時間： 2016-06-30
上傳用戶：mpquest
用VC編的數碼相機仿真程序 包括圖像的預處理 DCT變換 壓縮等 最后可用verify.exe做比較
標簽： verify DCT exe 仿真程序
上傳時間： 2014-01-16
上傳用戶：Pzj
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標簽： cookie
上傳時間： 2016-08-02
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資料壓縮技術與應用-變動長度編碼壓縮及解壓縮(Run Length Encoding) 整數採用固定長度一個位元組表示法 對於只出現一次的位元組S亦用iS取代
標簽： Encoding Length Run 表示法
上傳時間： 2016-08-15
上傳用戶：GavinNeko
資料壓縮技術與應用-變動長度編碼壓縮(Run Length Encoding)~ 整數採用固定長度一個位元組表示法~ 對於只出現一次的位元組S亦用iS取代~
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