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雙排插針

  • 插值 1.拉格朗日插值 2.有理函數(shù)插值 3.三次樣條插值 4.有序表的檢索法 5.插值多項(xiàng)式 6.二元拉格朗日插值 7.雙三次樣條插值

    插值 1.拉格朗日插值 2.有理函數(shù)插值 3.三次樣條插值 4.有序表的檢索法 5.插值多項(xiàng)式 6.二元拉格朗日插值 7.雙三次樣條插值

    標(biāo)簽: 插值 三次樣條 函數(shù) 二元

    上傳時(shí)間: 2016-01-04

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  • Visual 開發(fā) 希望對(duì)你們有幫助 public static int Rom(int n, int m)//雙寄或雙偶 { int count = 0 //第一排Y坐標(biāo)上要幾個(gè)

    Visual 開發(fā) 希望對(duì)你們有幫助 public static int Rom(int n, int m)//雙寄或雙偶 { int count = 0 //第一排Y坐標(biāo)上要幾個(gè) if (n < m) { for (int i = 1 i <= n i = i + 2) { count++ } } else { for (int j = 1 j <= m j = j + 2) { count++ } } return count }

    標(biāo)簽: int Visual public static

    上傳時(shí)間: 2013-12-13

    上傳用戶:懶龍1988

  • 實(shí)現(xiàn)雙三次插值圖像縮放算法

    實(shí)現(xiàn)雙三次插值圖像縮放算法,修改k值,即可修改放大倍數(shù)或縮小倍數(shù)!

    標(biāo)簽: 插值 圖像 算法

    上傳時(shí)間: 2014-11-30

    上傳用戶:zaizaibang

  • 下位機(jī):基于8051內(nèi)核雙列直插式芯片實(shí)現(xiàn)

    下位機(jī):基于8051內(nèi)核雙列直插式芯片實(shí)現(xiàn),自動(dòng)控制尋跡、小車運(yùn)行狀態(tài)顯示。上位機(jī):使小車與計(jì)算機(jī)實(shí)現(xiàn)串口通信,用VC編制一個(gè)控制界面,可以通過鍵盤上的上下左右按扭或則鼠標(biāo)鍵實(shí)現(xiàn)小車實(shí)時(shí)控制和加速控制。

    標(biāo)簽: 8051 下位機(jī) 內(nèi)核 直插

    上傳時(shí)間: 2017-06-08

    上傳用戶:思琦琦

  • 四排90度排針規(guī)格書

    2.0MM四排90度排針分為針長(zhǎng)可以定做各種長(zhǎng)度類型 

    標(biāo)簽: 四拓排針 四排彎針 4排彎針 4排排針 四排90度彎針 四排90度彎針 4排90度彎針圖紙 4排90度彎針規(guī)格書

    上傳時(shí)間: 2016-01-13

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  • 2.5MM間距排針圖紙

    2.5MM間距排針有180度和90度形狀,針長(zhǎng)可以按要求做,

    標(biāo)簽: 2.5 MM間距排針 2.5間距排針 2.5MM公針 2.5MM針座 2.5排針

    上傳時(shí)間: 2016-04-30

    上傳用戶:騰菲爾科技

  • AM335X核心板PCB+封裝庫文件 AD格式 6層板 50x50mm 4x40pin排針引出

    AM335X核心板PCB+封裝庫文件,AD格式,6層板,50x50mm,4x40pin排針引出

    標(biāo)簽: am335x pcb 封裝

    上傳時(shí)間: 2022-01-27

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  • 2.54mm簡(jiǎn)牛插座 XH2.54插座 排針-排母 KF-2.54 接線端子Altium封裝

    2.54mm簡(jiǎn)牛插座 XH2.54插座 排針-排母 KF-2.54 接線端子Altium封裝 AD封裝庫 2D+3D PCB封裝庫-52MB,Altium Designer設(shè)計(jì)的PCB封裝庫文件,集成2D和3D封裝,可直接應(yīng)用的到你的產(chǎn)品設(shè)計(jì)中。PCB庫封裝列表:PCB Library : DC-2.54mm貼片簡(jiǎn)牛插座.PcbLibDate        : 2020/6/9Time        : 9:40:28DC3-12P-2.54mmDC3-14P-2.54mmDC3-16P-2.54mmDC3-18P-2.54mmDC3-20P-2.54mmDC3-22P-2.54mmDC3-24P-2.54mmDC3-26P-2.54mmDC3-28P-2.54mmDC3-30P-2.54mmDC3-32P-2.54mmDC3-34P-2.54mmDC3-36P-2.54mmDC3-38P-2.54mmDC3-40P-2.54mmDC3-42P-2.54mmDC3-44P-2.54mmDC3-46P-2.54mmDC3-48P-2.54mmDC-2.54-L-Z-24PDC-2.54-L-Z-26PDC-2.54-L-Z-28PDC-2.54-L-Z-30PDC-2.54-L-Z-32PDC-2.54-L-Z-34PDC-2.54-L-Z-36PDC-2.54-L-Z-38PDC-2.54-L-Z-40PDC-2.54-L-Z-42PKF2EDGK-2.54-LI-16PKF2EDGK-2.54-WI-2PKF2EDGK-2.54-WI-3PKF2EDGK-2.54-WI-4PKF2EDGK-2.54-WI-5PKF2EDGK-2.54-WI-6PKF2EDGK-2.54-WI-7PKF2EDGK-2.54-WI-8PKF2EDGK-2.54-WI-9PKF2EDGK-2.54-WI-10PKF2EDGK-2.54-WI-11PKF2EDGK-2.54-WI-12PKF2EDGK-2.54-WI-13PKF2EDGK-2.54-WI-14P""""""""""""""""""""""""""""""""""""""""""""""

    標(biāo)簽: 插座

    上傳時(shí)間: 2022-05-05

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  • 新型雙聲道音頻-+DAC小面積插值濾波器的設(shè)計(jì)實(shí)現(xiàn)

    摘 要:該文提出了一種新型雙聲道音頻Σ - Δ數(shù)模轉(zhuǎn)換器(DAC)小面積插值濾波器設(shè)計(jì)方法。該方法采用左右兩個(gè)聲道復(fù)用一個(gè)插值濾波器的新型結(jié)構(gòu),并利用存儲(chǔ)器實(shí)現(xiàn)第1 級(jí)半帶濾波器,從而降低芯片的實(shí)現(xiàn)面積。提出重新排序方法,保證復(fù)用后兩個(gè)聲道的同步。設(shè)計(jì)在TSMC 0.18 μm 1.8 V/3.3 V 1P5M CMOS 工藝上實(shí)現(xiàn),測(cè)試信噪比為106 dB,數(shù)字部分芯片的面積僅為0.198 mm2,功耗為0.65 mW。這種設(shè)計(jì)方法降低了Σ - Δ DAC系統(tǒng)中數(shù)字部分的面積和功耗,給模擬部分留有較大的設(shè)計(jì)裕量,這對(duì)模數(shù)混合系統(tǒng)的設(shè)計(jì)具有重要的意義。

    標(biāo)簽: 插值濾波器

    上傳時(shí)間: 2022-07-04

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  • 雙信號(hào)快速測(cè)頻技術(shù)及FPGA實(shí)現(xiàn)

    建立在數(shù)據(jù)率轉(zhuǎn)換技術(shù)之上的寬帶數(shù)字偵察接收機(jī)要求能夠?qū)崿F(xiàn)高截獲概率、高靈敏度、近乎實(shí)時(shí)的信號(hào)處理能力。雙信號(hào)數(shù)據(jù)率轉(zhuǎn)換技術(shù)是寬帶數(shù)字偵察接收機(jī)關(guān)鍵技術(shù)之一,是解決寬帶數(shù)字接收機(jī)中前端高速ADC采樣的高速數(shù)據(jù)流與后端DSP處理速度之間瓶頸問題的可行方案。測(cè)頻技術(shù)以及帶通濾波,即寬帶數(shù)字下變頻技術(shù),是實(shí)現(xiàn)數(shù)據(jù)率轉(zhuǎn)換系統(tǒng)的關(guān)鍵技術(shù)。本文首先介紹了寬帶數(shù)字偵察接收關(guān)鍵技術(shù)之一的數(shù)據(jù)率轉(zhuǎn)換技術(shù),著重研究了快速、高精度雙信號(hào)測(cè)頻算法以及實(shí)驗(yàn)系統(tǒng)硬件實(shí)現(xiàn)。論文主要工作如下: (1)分析了現(xiàn)代電子偵察環(huán)境下的信號(hào)特征,指出寬帶數(shù)字接收機(jī)必須滿足寬監(jiān)視帶寬、流水作業(yè)以及近實(shí)時(shí)的響應(yīng)時(shí)間。給出了一種頻率引導(dǎo)式的數(shù)字接收機(jī)方案,簡(jiǎn)要介紹這種接收機(jī)的關(guān)鍵技術(shù)——快速、高精度頻率估計(jì)以及高效的數(shù)據(jù)率轉(zhuǎn)換。 (2)介紹了FFT技術(shù)在測(cè)頻算法中的應(yīng)用,比較了FFT專用芯片及其優(yōu)點(diǎn)和缺點(diǎn),指出為了滿足實(shí)時(shí)處理要求,必須選用FPGA設(shè)計(jì)FFT模塊。 (3)在分析常規(guī)的插值算法基礎(chǔ)上,提出了一種單信號(hào)的快速插值頻率估計(jì)方法,只需三個(gè)FFT變換系數(shù)的實(shí)部構(gòu)造頻率修正項(xiàng),計(jì)算量低。該方法具有精度高、測(cè)頻速率快的特點(diǎn)。 (4)基于DFT理論和自相關(guān)理論,提出了結(jié)合FFT和自相關(guān)的雙信號(hào)頻率估計(jì)算法。該方法先用DFT估計(jì)其中一個(gè)信號(hào)的頻率和幅度,以此頻率對(duì)信號(hào)解調(diào)并對(duì)消該頻率成分,最后利用自相關(guān)理論估計(jì)出另一個(gè)信號(hào)的頻率。 (5)基于DFT理論和FFT技術(shù),研究了信號(hào)平方與FFT結(jié)合的雙信號(hào)頻率估計(jì)算法。根據(jù)信號(hào)中兩頻率分量的幅度比,只需一次一維平方信號(hào)譜峰搜索,就可以得到雙信號(hào)的和頻與差頻分量的估計(jì)值,并利用插值技術(shù)提高測(cè)頻精度。該算法能夠精確地估計(jì)頻率間隔小的雙信號(hào)頻率,且容易地?cái)U(kuò)展到復(fù)信號(hào),F(xiàn)PGA硬件實(shí)現(xiàn)容易。 (6)基于現(xiàn)代譜分析理論,研究了基于AR(2)模型的雙信號(hào)頻率估計(jì)算法。方法在利用AR(2)模型系數(shù)估計(jì)雙正弦信號(hào)頻率之和的同時(shí),利用FFT快速測(cè)頻算法估計(jì)其中強(qiáng)信號(hào)分量的頻率值。算法仿真驗(yàn)證和性能分析表明了提出的算法能快速高精度地估計(jì)雙信號(hào)頻率。 (7)給出了基于頻譜重心算法的雷達(dá)雙信號(hào)頻率估計(jì)的FPGA硬件實(shí)現(xiàn)架構(gòu),并進(jìn)行了時(shí)序仿真。 (8)討論了雙信號(hào)帶寬匹配接收系統(tǒng)的硬件設(shè)計(jì)方案,給出了快速測(cè)頻及帶寬估計(jì)模塊設(shè)計(jì)。

    標(biāo)簽: FPGA 信號(hào) 測(cè)頻

    上傳時(shí)間: 2013-06-02

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