高速光電隔離器6N137應用，高頻PWM輸出隔離器件
上傳時間： 2013-04-24
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無線局域網(WLAN,Wireless Local Area Network)是未來移動通信系統的重要組成部分.為了滿足用戶高速率、方便靈活的接入互聯網的需求,WLAN的研究和建設正在世界范圍內如火如荼的展開.由于擺脫了有線連接的束縛,無線局域網具有移動性好、成本低和不會出現線纜故障等特點.該文對無線局域網的主流協議IEEE 802.11a的物理層實現技術進行了系統的研究和分析,并采用可編程ASIC器件FPGA,設計實現了物理層基帶處理的關鍵模塊,為今后形成具有自主知識產權的IP核奠定了基礎.該文研究內容得到了天津市信息化辦公室"寬帶無線局域網關鍵技術研究"項目經費的支持.該文在對IEEE 802.11a協議深入研究的基礎上,提出了物理層的實現方案和功能模塊劃分.重點研究了實現基帶處理的關鍵模塊:FIR濾波器、卷積碼編碼器以及(2,1,7)Viterbi譯碼器的實現算法和硬件結構.在Viterbi譯碼器的設計中,
上傳時間： 2013-06-19
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并網逆變器并網逆變器并網逆變器并網逆變器
標簽： 并網逆變器
上傳時間： 2013-04-24
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漢字ASCII碼-Unicode碼轉化器（轉換工具）
上傳時間： 2013-07-16
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8位電流模模數轉換器設計研究 8位電流模模數轉換器設計研究
上傳時間： 2013-06-21
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逆變器在自動控制系統、電機交流調速、電力變換以及電力系統控制中都起著重要的作用；各系統對逆變器的性能需求也越來越高。PWM控制多重逆變器正是基于這些需求，實現可變頻、調壓、調相、低諧波、高穩定性的解決方案。 PWM控制逆變器通過對每個脈沖寬度進行控制，以達到控制輸出電壓和改善輸出波形的目的；多重逆變器則是把幾個矩形波逆變器的輸出組合起來起來形成階梯波，從而消除諧波；PWM控制多重逆變器綜合上述兩種技術的特點，非常適合于應用在對諧波、電壓輸出及穩定性要求比較高的場合。電力半導體技術和集成電路技術的快速發展，使得多重逆變器的控制、實現成為可能。 本文首先分析風力發電系統對逆變器的要求，從多重逆變器理論和PWM逆變器理論出發，提出同步式PWM控制電壓型串聯多重逆變器系統解決方案。本方案也可以應用在逆變電源、交流電機調速及電力變換領域中。 文中建立了一個多重逆變器的PWM控制算法模型。該算法可完成頻率、相位、幅值可調的多重逆變器的PWM控制，且能完成逆變器故障運行下的保護與告警。并在MATLAB/SIMULINK環境下對算法模型進行仿真與分析。 在比較了現有PWM發生解決方案的基礎上，本文提出了一個基于FPGA(可編程邏輯陣列)的多重逆變器PWM控制系統實現方案。并給出一個主要由FPGA、ADC/DAC、驅動與保護電路、逆變器主回路及其他外圍電路構成的多重逆變器系統解決方案。實驗結果表明，此方案系統結構簡單、可行，很好完成上述多重逆變器的PWM控制算法。
上傳時間： 2013-06-28
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較詳細的增量式和絕對式編碼器資料。開發前期很有用。
標簽： 編碼器
上傳時間： 2013-06-13
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隨著電信數據傳輸對速率和帶寬的要求變得越來越迫切,原有建成的網絡是基于話音傳輸業務的網絡,已不能適應當前的需求.而建設新的寬帶網絡需要相當大的投資且建設工期長,無法滿足特定客戶對高速數據傳輸的近期需求.反向復用技術是把一個單一的高速數據流在發送端拆散并放在兩個或者多個低速數據鏈路上進行傳輸,在接收端再還原為高速數據流.該文提出一種基于FPGA的多路E1反向復用傳輸芯片的設計方案,使用四個E1構成高速數據的透明傳輸通道,支持E1線路間最大相對延遲64ms,通過鏈路容量調整機制,可以動態添加或刪除某條E1鏈路,實現靈活、高效的利用現有網絡實現視頻、數據等高速數據的傳輸,能夠節省帶寬資源,降低成本,滿足客戶的需求.系統分為發送和接收兩部分.發送電路實現四路E1的成幀操作,數據拆分采用線路循環與幀間插相結合的方法,A路插滿一幀(30時隙)后,轉入B路E1間插數據,依此類推,循環間插所有的數據.接收電路進行HDB3解碼,幀同步定位(子幀同步和復幀同步),線路延遲判斷,FIFO和SDRAM實現多路數據的對齊,最后按照約定的高速數據流的幀格式輸出數據.整個數字電路采用Verilog硬件描述語言設計,通過前仿真和后仿真的驗證.以30萬門的FPGA器件作為硬件實現,經過綜合和布線,特別是寫約束和增量布線手動調整電路的布局,降低關鍵路徑延時,最終滿足設計要求.
上傳時間： 2013-07-16
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不錯的畢業論文 很詳細的介紹了光伏逆變器設計方法
上傳時間： 2013-04-24
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ISO和ITU-T制定的一系列視頻編碼國際標準的推出，開創了視頻通信和存儲應用的新紀元。從H.261視頻編碼建議，到H.262/3、MPEG-1/2/4等都有一個共同的不斷追求的目標，即在盡可能低的碼率(或存儲容量)下獲得盡可能好的圖像質量。 本課題的研究建立在目前主流的壓縮算法的基礎上，綜合出各種標準中實現途徑的共性和優勢，將算法的主體移植于FPGA(FieldProgrammableGateArray)平臺上。憑借該種類嵌入式系統配置靈活、資源豐富的特點，建立一個可重構的內核處理模塊。進一步的完善算法(運算速度、精度)和外圍系統后，就可作為專用視頻壓縮編碼器進行門級電路設計的原型，構建一個片上可編程的獨立系統。 編碼器設計有良好的應用前景，通過使用離散余弦變換和熵編碼，對運動圖像從空間上進行壓縮編碼，使得編碼后的數據流適合于傳輸、通信、存儲和編輯等方面的要求。同時，系統的設計將解碼的工作量大幅度降低，功能模塊在作適當的改動后可為解碼器的參考設計使用。 研究所涉及的各功能模塊都進行了系統性的仿真和綜合，滿足工程樣機的前期研發需要。
上傳時間： 2013-04-24
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