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可編程<b>器件</b>

  • 華為軟件編程規(guī)范和范例的文件

    華為軟件編程規(guī)范和范例的文件,可幫助編程時(shí)提昇成功性與可讀性

    標(biāo)簽: 華為 軟件 編程規(guī)范 范例

    上傳時(shí)間: 2014-02-05

    上傳用戶:英雄

  • 一個(gè)簡單的藥店進(jìn)

    一個(gè)簡單的藥店進(jìn),銷,存系統(tǒng)。 本程序主要面向三類權(quán)限的用戶:藥庫管理員、藥品出售員、一般患者。他們分別具有以下基本權(quán)限: 1) 一般患者 具有查詢藥品價(jià)格、類別等一般信息,不能進(jìn)行修改、添加。 2) 管理員 主要負(fù)責(zé)系統(tǒng)維護(hù)工作,包括增加用戶刪除用戶,數(shù)據(jù)備份與初始化等。 3) 出售員 出售員只能按處方出售藥品,不能修改藥品價(jià)格等信息。 以上各種用戶的基本需求,為了最大程度的方便用戶,我們還提供以下功能: a. 當(dāng)管理員登錄時(shí),對(duì)于庫存低的藥品會(huì)給出警示,藥品的最低庫存可自行設(shè)制。 b. 對(duì)每個(gè)月每種藥品的銷量做出統(tǒng)計(jì),并作出示意圖。 c. 數(shù)據(jù)備份、恢復(fù)

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    上傳時(shí)間: 2016-05-05

    上傳用戶:離殤

  • 模擬ethernet幀的發(fā)送過程

    模擬ethernet幀的發(fā)送過程,用兩個(gè)線程a和b來模擬Ethernet上的兩臺(tái)主機(jī),用一個(gè)雙字類型變量Bus來模擬總線

    標(biāo)簽: ethernet 模擬 發(fā)送過程

    上傳時(shí)間: 2013-12-17

    上傳用戶:weiwolkt

  • 這次把真正的把源程序公開了

    這次把真正的把源程序公開了,而且還有詳細(xì)的原理教程,希望大家?guī)兔Π阉龅母茫С值钠骷唷? 這個(gè)下載線電路是我做過的中最穩(wěn)定的,成功率很高。你也可以直接使用現(xiàn)有的下載線或者Atmel的原版下 載線。Easy 51Pro串行編程器也支持AT89C2051了。《Easy 51Pro的製作及使用說明》中有詳細(xì)介紹。 有何問題或者發(fā)現(xiàn)了BUG請?jiān)谶@裡給我留言: http://enkj.com/gbook/guestbook.asp?user=digiboy

    標(biāo)簽: 源程序

    上傳時(shí)間: 2013-12-12

    上傳用戶:xieguodong1234

  • 離散實(shí)驗(yàn) 一個(gè)包的傳遞 用warshall

     實(shí)驗(yàn)源代碼 //Warshall.cpp #include<stdio.h> void warshall(int k,int n) { int i , j, t; int temp[20][20]; for(int a=0;a<k;a++) { printf("請輸入矩陣第%d 行元素:",a); for(int b=0;b<n;b++) { scanf ("%d",&temp[a][b]); } } for(i=0;i<k;i++){ for( j=0;j<k;j++){ if(temp[ j][i]==1) { for(t=0;t<n;t++) { temp[ j][t]=temp[i][t]||temp[ j][t]; } } } } printf("可傳遞閉包關(guān)系矩陣是:\n"); for(i=0;i<k;i++) { for( j=0;j<n;j++) { printf("%d", temp[i][ j]); } printf("\n"); } } void main() { printf("利用 Warshall 算法求二元關(guān)系的可傳遞閉包\n"); void warshall(int,int); int k , n; printf("請輸入矩陣的行數(shù) i: "); scanf("%d",&k); 四川大學(xué)實(shí)驗(yàn)報(bào)告 printf("請輸入矩陣的列數(shù) j: "); scanf("%d",&n); warshall(k,n); } 

    標(biāo)簽: warshall 離散 實(shí)驗(yàn)

    上傳時(shí)間: 2016-06-27

    上傳用戶:梁雪文以

  • IGBT器件培訓(xùn)

    關(guān)于IGBT器件培訓(xùn)資料。可用于學(xué)習(xí)相關(guān)器件進(jìn)行培訓(xùn),參考。

    標(biāo)簽: igbt

    上傳時(shí)間: 2022-03-17

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  • 半導(dǎo)體器件 sentaurus TCAD設(shè)計(jì)與應(yīng)用[韓雁,丁扣寶][電子教案(PPT版本)]

    Sentaurus TCAD全面繼承了Tsuprem4,Medici和ISE-TCAD的特點(diǎn)和優(yōu)勢,它可以用來模擬集成器件的工藝制程,器件物理特性和互連線特性等。Sentaurus TCAD提供全面的產(chǎn)品套件,其中包括Sentaurus Workbench, Ligament, Sentaurus Process, Sentaurus Structure Editor, Mesh Noffset3D, Sentaurus Device, Tecplot SV Inspect, Advanced Calibration等等。Sentaurus Process和Sentaurus Device可以支持的仿真器件類型非常廣泛,包括CMOS,功率器件,存儲(chǔ)器,圖像傳感器,太陽能電池,和模擬/射頻器件。sentaurus TCAD還提供互連建模和參數(shù)提取工具,為優(yōu)化芯片性能提供關(guān)鍵的寄生參數(shù)信息。

    標(biāo)簽: 半導(dǎo)體器件 tcad

    上傳時(shí)間: 2022-06-30

    上傳用戶:shjgzh

  • 基于DSP和FPGA導(dǎo)航計(jì)算機(jī)硬件電路研究與設(shè)計(jì).rar

    為適應(yīng)組合導(dǎo)航計(jì)算機(jī)系統(tǒng)的微型化、高性能度的要求,拓寬導(dǎo)航計(jì)算機(jī)的應(yīng)用領(lǐng)域,本文設(shè)計(jì)出一種基于浮點(diǎn)型DSP(TMS320C6713)和可編程邏輯陣列器件(FPGA: EP1C12N240C8)協(xié)同合作的導(dǎo)航計(jì)算機(jī)系統(tǒng)。 論文在闡述了組合導(dǎo)航計(jì)算機(jī)的特點(diǎn)和應(yīng)用要求后,提出基于DSP和FPGA的組合導(dǎo)航計(jì)算機(jī)系統(tǒng)方案。該方案以DSP為導(dǎo)航解算處理器,由FPGA完成IMU信號(hào)的采集和緩存以及系統(tǒng)控制信號(hào)的整合;DSP通過EMIF接口實(shí)現(xiàn)和FPGA通信。在此基礎(chǔ)上研究了各擴(kuò)展通信接口、系統(tǒng)硬件原理圖和PCB的開發(fā),且在FPGA中使用調(diào)用IP核來實(shí)現(xiàn)FIR低通濾波數(shù)據(jù)處理機(jī)抖激光陀螺的機(jī)抖振動(dòng)的影響。其次,詳細(xì)闡述了利用TI公司的DSP集成開發(fā)環(huán)境和DSP/BIOS準(zhǔn)實(shí)時(shí)操作系統(tǒng)開發(fā)多任務(wù)系統(tǒng)軟件的具體方案。本文引入DSP/BIOS實(shí)時(shí)操作系統(tǒng)提供的多任務(wù)機(jī)制,將采集處理按照功能劃分四個(gè)相對(duì)獨(dú)立的任務(wù),這些任務(wù)在DSP/BIOS的調(diào)度下,按照用戶指定的優(yōu)先級(jí)運(yùn)行,大大提高系統(tǒng)的工作效率。最后給了DSP芯片Bootloader的制作方法。 導(dǎo)航計(jì)算機(jī)系統(tǒng)研制開發(fā)是軟、硬件研究緊密結(jié)合的過程。在微型導(dǎo)航計(jì)算機(jī)系統(tǒng)方案建立的基礎(chǔ)上,本文首先討論了系統(tǒng)硬件整體設(shè)計(jì)和軟件開發(fā)流程;其次針對(duì)導(dǎo)航計(jì)算機(jī)系統(tǒng)各個(gè)功能模塊以及多項(xiàng)關(guān)鍵技術(shù)進(jìn)行了設(shè)計(jì)與開發(fā)工作,涉及系統(tǒng)數(shù)據(jù)通信模塊、模擬信號(hào)采集模塊和數(shù)據(jù)存儲(chǔ)模塊;最后,對(duì)導(dǎo)航計(jì)算機(jī)系統(tǒng)進(jìn)行了聯(lián)合調(diào)試工作,并對(duì)各個(gè)模塊進(jìn)行了詳細(xì)的功能測試與驗(yàn)證,完成了微型導(dǎo)航計(jì)算機(jī)系統(tǒng)的制作。 以DSP/FPGA作為導(dǎo)航計(jì)算機(jī)硬件平臺(tái)的捷聯(lián)式慣性導(dǎo)航實(shí)時(shí)數(shù)據(jù)系統(tǒng)能夠滿足系統(tǒng)所要求的高精度、實(shí)時(shí)性、穩(wěn)定性要求,適應(yīng)了其高性能、低成本、低功耗的發(fā)展方向。

    標(biāo)簽: FPGA DSP 導(dǎo)航計(jì)算機(jī)

    上傳時(shí)間: 2013-04-24

    上傳用戶:lishuoshi1996

  • 基于FPGA的紅外遙控電子密碼鎖的實(shí)現(xiàn).rar

    本文介紹了一種基于現(xiàn)場可編程門陣列FPGA器件的電子密碼鎖的設(shè)計(jì)方法。重點(diǎn)闡述了紅外遙控電子密碼鎖的整體架構(gòu)設(shè)計(jì);介紹了一種由PT2248作為發(fā)送器,MIM-R1AA 38KHZ紅外一體化接收解調(diào)器作為接收器的紅外遙控系統(tǒng)的構(gòu)建方法;詳細(xì)說明了如何運(yùn)用EDA技術(shù)自頂向下的設(shè)計(jì)方法,來實(shí)現(xiàn)基于XILINX公司出品的Spartan-3E系列FPGA芯片的紅外遙控解碼、密碼鎖的解鎖、密碼修改、報(bào)警提示及液晶顯示等功能。在分析紅外遙控電子密碼鎖各功能模塊時(shí),本論文詳細(xì)闡述了各模塊的功能及外部接口信號(hào),給出了各模塊的仿真波形以及整個(gè)系統(tǒng)的測試流程和測試結(jié)果。本論文在介紹Spartan-3E系列FPGA芯片的特點(diǎn)和性能的同時(shí),利用Spartan-3E系列的XC3S500芯片中的KCPSM3和自行設(shè)計(jì)完成的狀態(tài)機(jī)控制器分別實(shí)現(xiàn)液晶顯示控制器,通過比較分析得知KCPSM3實(shí)現(xiàn)的控制器,在對(duì)FPGA的資源利用方面更加合理,實(shí)現(xiàn)更加便捷。 本論文利用紅外遙控技術(shù)解鎖,大大提高了電子密碼鎖的安全性能;采用FPGA開發(fā)設(shè)計(jì),所有算法完全由硬件電路來實(shí)現(xiàn),使得系統(tǒng)的工作可靠性大為提高,同時(shí)由于FPGA具有在系統(tǒng)可編程功能,當(dāng)設(shè)計(jì)需要更改時(shí),只需更改FPGA中的控制和接口電路,利用EDA工具將更新后的設(shè)計(jì)下載到FPGA中即可,無需更改外部電路的設(shè)計(jì),大大提高了設(shè)計(jì)的效率。因此,采用FPGA開發(fā)的數(shù)字系統(tǒng),不僅具有很高的工作可靠性,其升級(jí)與改進(jìn)也極其方便。

    標(biāo)簽: FPGA 紅外遙控 電子密碼鎖

    上傳時(shí)間: 2013-06-25

    上傳用戶:cy1109

  • FPGA芯片關(guān)鍵電路設(shè)計(jì).rar

    現(xiàn)場可編程門陣列(FPGA)器件是能通過對(duì)其進(jìn)行編程實(shí)現(xiàn)具有用戶規(guī)定功能的電路,特別適合集成電路的新品開發(fā)和小批量ASIC電路的生產(chǎn)。近幾年來,F(xiàn)PGA的發(fā)展非常迅速,但目前國內(nèi)廠商所使用的FPGA芯片主要還是從國外進(jìn)口,這種狀況除了給生產(chǎn)廠家?guī)砗艽蟮某杀緣毫σ酝猓瑫r(shí)也影響到國家信息產(chǎn)業(yè)的保密和安全問題,因此在國內(nèi)自主研發(fā)FPGA便成為一種必然的趨勢。 基于上述現(xiàn)實(shí)狀況及國內(nèi)市場的巨大需求,中國電子科技集團(tuán)公司第58研究所近年來對(duì)FPGA進(jìn)行了專項(xiàng)研究,本論文正是作為58所專項(xiàng)的一部分研究工作的總結(jié)。本文深入研究了FPGA的相關(guān)設(shè)計(jì)技術(shù),并進(jìn)行了實(shí)際的FPGA器件設(shè)計(jì),研究工作的重點(diǎn)是在華潤上華(CSMC)0.5μm標(biāo)準(zhǔn)CMOS工藝基礎(chǔ)上進(jìn)行具有6000有效門的FPGA的電路設(shè)計(jì)與仿真。 論文首先闡述了可編程邏輯器件的基本結(jié)構(gòu),就可編程邏輯器件的發(fā)展過程及其器件分類,對(duì)可編程只讀存儲(chǔ)器、現(xiàn)場可編程邏輯陣列、可編程陣列邏輯、通用邏輯陣列和復(fù)雜PLD等的基本結(jié)構(gòu)特點(diǎn)進(jìn)行了討論。接著討論了FPGA的基本結(jié)構(gòu)與分類及它的編程技術(shù),另外還闡述了FPGA的集成度和速率等相關(guān)問題。并根據(jù)實(shí)際指標(biāo)要求確定本文研究目標(biāo)FPGA的基本結(jié)構(gòu)和它的編程技術(shù),在華潤上華0.5μm標(biāo)準(zhǔn)CMOS工藝的基礎(chǔ)上,進(jìn)行一款FPGA芯片的設(shè)計(jì)研究工作。進(jìn)行了可編程邏輯單元的基本結(jié)構(gòu)的設(shè)計(jì),并用CMOS邏輯和NMOS傳輸管邏輯實(shí)現(xiàn)了函數(shù)發(fā)生器、快速進(jìn)位鏈和觸發(fā)器的電路設(shè)計(jì),并對(duì)其進(jìn)行了仿真,達(dá)到了預(yù)期的目標(biāo)。

    標(biāo)簽: FPGA 芯片 電路設(shè)計(jì)

    上傳時(shí)間: 2013-08-01

    上傳用戶:baitouyu

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