分頻器在數字中占有很重要的地位，本文詳細解析了奇偶分頻的算法！以及小數分頻的算法！是一個難得的匯總，還有舉例供參考！
標簽： 分頻器 數字
上傳時間： 2013-12-23
上傳用戶：獨孤求源
介紹了各種分頻器的設計，VHDL描述。包括偶數分頻器，奇數分頻器，辦整數分頻器
標簽： 分頻器
上傳時間： 2017-05-18
上傳用戶：haohaoxuexi
參數化分頻器，以5為例，能很方便的擴展到參數N
標簽： 參數 分頻器
上傳時間： 2017-05-25
上傳用戶：libenshu01
半整數分頻器的實現（verilog），本文以6.5分頻為例！很實用的！
標簽： verilog 整數 分頻器
上傳時間： 2014-08-20
上傳用戶：pompey
此為EDA設計的分頻器模塊。可以實現三種不同的頻率信號，可以通過使用者自由設置頻率大小
標簽： EDA 分頻器 模塊 頻率信號
上傳時間： 2013-12-22
上傳用戶：671145514
這個兩個rar文件是關于定時器0使用的例子, 也是我第一次使用定時器0做的實驗程序: 1. T0_ASM.rar, (帶中文注釋的C51語言例程), 利用定時器0中斷實現LED燈的簡單控制。 2. T0_C51.rar, (帶中文注釋的51匯編語言例程), 利用定時器0中斷實現LED燈的簡單控制。 兩個同樣功能的timer0中斷程序都在MCU51-63K仿真器下通過實驗, 小蝦們可以試試看。
標簽： 定時器 ASM C51
上傳時間： 2017-06-02
上傳用戶：D&L37
標簽： Verilog 分頻器 N倍奇數分頻器.(Verilog) N_odd_divider.v / Verilog module N_odd_divider (
標簽： Verilog N_odd_divider module 分頻器
上傳時間： 2014-01-12
上傳用戶：nanxia
分頻器的vhdl描述，在源代碼中完成對時鐘信號CLK的2分頻,4分頻,8分頻,16分頻
標簽： vhdl 分頻器
上傳時間： 2014-01-16
上傳用戶：奇奇奔奔
行動通訊上的的編程 這本書集中在三個主要的挑戰 1.更高的編程效率 2.降低計算的複雜度 2.提升容錯性
標簽： 效率
上傳時間： 2017-06-05
上傳用戶：diets
verilog實現的奇數分頻器 針對任何規模的奇數分頻
標簽： verilog 分頻器 分頻 模
上傳時間： 2017-06-19
上傳用戶：GavinNeko
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