感應電機由于具有可靠性好、結(jié)構(gòu)簡單、價格低廉和體積小等優(yōu)點，成為生產(chǎn)實踐中應用最廣泛的一種電動機。然而，感應電機是一個多變量、強耦合、非線性的時變系統(tǒng)，這使得感應電機的控制十分復雜，尤其是在對控制精度要求比較高的場合，設計出高精度的感應電機控制系統(tǒng)變得非常困難。 針對高精度感應電機控制較困難的問題，本文分析了感應電機的數(shù)學建模方法及電機控制策略問題。在對感應電機的數(shù)學模型進行了數(shù)學推導的基礎上，在Matlab/Simulink平臺上建立了感應電機的電機模型，提出了一種感應電機控制系統(tǒng)仿真建模的新方法。對常用的數(shù)字脈寬調(diào)制方法進行了數(shù)學推導及仿真研究，并將模糊控制理論應用于感應電機的變頻調(diào)速系統(tǒng)中，改善了傳統(tǒng)PI控制器超調(diào)較大、響應較慢、魯棒性差的缺點。仿真結(jié)果驗證模糊PI控制方案的優(yōu)越性。 在感應電機建模仿真的基礎上，根據(jù)高精度感應電機控制器的需求及FPGA的特點，本文提出感應電機控制器的的設計方案。按照FPGA模塊化設計思想，將整個系統(tǒng)進行了合理的劃分，對SVPWM、Park變換、模糊PI控制器、反饋速度測量等重要模塊的FPGA硬件實現(xiàn)算法進行了深入的研究。并在一些模塊算法的設計上提出了自己的思路。各模塊在Modelsim平臺上完成功能仿真后并下載到Spartan-3E開發(fā)板上完成硬件驗證。
上傳時間： 2013-04-24
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當今的船用導航雷達具有數(shù)字化、多功能、高性能、多接口、網(wǎng)絡化。同時要求具有高可靠性、高集成度、低成本，信號處理單元的小型化，產(chǎn)品更新周期短。要同時滿足上述需求，高集成度的器件應用是必須的。同時開發(fā)周期要短，需求軟件的可移植性要強，并且是模塊化設計，現(xiàn)場可編程門陣列器件(FPGA)已經(jīng)成為設計首選。 現(xiàn)場可編程門陣列是基于通過可編程互聯(lián)連接的可配置邏輯塊(CLB)矩陣的可編程半導體器件。與為特殊設計而定制的專用集成電路(ASIC)相對，F(xiàn)PGA可以針對所需的應用或功能要求進行編程。雖然具有一次性可編程(OTP)FPGA，但是主要是基于SRAM的，其可隨著設計的演化進行重編程。CLB是FPGA內(nèi)的基本邏輯單元。實際數(shù)量和特性會依器件的不同而不同，但是每個CLB都包含一個由4或6個輸入、一些選型電路(多路復用器等)和觸發(fā)器組成的可配置開關(guān)矩陣。開關(guān)矩陣是高度靈活的，可以進行配置以便處理組合邏輯、移位寄存器或RAM。當今的FPGA已經(jīng)遠遠超出了先前版本的基本性能，并且整合了常用功能(如RAM、時鐘管理和：DSP)的硬(ASIC型)塊。由于具有可編程特性，所以FPGA是眾多市場的理想之選。它高集成度，以及用于設計的強大軟件平臺、IP核、在線升級可滿足需求。 本文介紹了基于FPGA實現(xiàn)船用導航雷達數(shù)字信號處理的設計，這是一個具體的、已經(jīng)完成并進行小批量生產(chǎn)的產(chǎn)品，對指導實踐具有一定意義。
標簽： 導航雷達 數(shù)字信號處理
上傳時間： 2013-04-24
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數(shù)字通信系統(tǒng)中，信道受到多種類型噪聲的影響，信息在傳輸過程中會出現(xiàn)錯誤。為提高系統(tǒng)傳輸?shù)目煽啃裕藬U展帶寬、增加發(fā)射功率和降低系統(tǒng)噪聲等方法外，糾錯編碼也是常用技術(shù)。在編碼過程中，卷積碼充分利用了各組之間...
上傳時間： 2013-06-27
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區(qū)截裝置測速法是現(xiàn)代靶場中彈丸測速的普遍方法，測時儀作為區(qū)截裝置測速系統(tǒng)的主要組成部分，其性能直接影響彈丸測速的可靠性和精度。本文根據(jù)測時儀的發(fā)展現(xiàn)狀，按照設計要求，設計了一種基于單片機和FPGA的高精度智能測時儀，系統(tǒng)工作穩(wěn)定、操作方便、測時精度可達25ns。 本文詳細給出了系統(tǒng)的設計方案。該方案提出了一種在后端用單片機處理干擾信號的新方法，簡化了系統(tǒng)硬件電路的設計，提高了測時精度；提出了一種基于系統(tǒng)基準時間的測時方案，相對于傳統(tǒng)的測時方法，該方案為分析試驗過程提供了有效數(shù)據(jù)，進一步提高了系統(tǒng)工作的可靠性；給出了一種輸入信息處理的有效方法，保證了系統(tǒng)工作的穩(wěn)定性。 本文設計了系統(tǒng)FPGA邏輯電路，包括輸入信號的整形濾波、輸入信號的捕捉、時基模塊、異步時鐘域間數(shù)據(jù)傳遞、與單片機通信、單片機I/O總線擴展等；實現(xiàn)了系統(tǒng)單片機程序，包括單片機和。FPGA的數(shù)據(jù)交換、干擾信號排除和彈丸測速測頻算法的實現(xiàn)、LCD液晶菜單的設計和打印機的控制、FLASH的讀寫、上電后對FPGA的配置、與上位機的通信等；分析了系統(tǒng)的誤差因素，給出了系統(tǒng)的誤差和相對誤差的計算公式；通過實驗室模擬測試以及靶場現(xiàn)場測試，結(jié)果表明系統(tǒng)工作可靠、精度滿足設計要求、人機界面友好。
上傳時間： 2013-07-25
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隨著Internet的不斷發(fā)展，人們希望日常生活中所用到的嵌入式設備都能夠很方便地實現(xiàn)Intemet接入，這對嵌入式系統(tǒng)設計提出了新的挑戰(zhàn)，要求低成本、多功能、高性能。這些是目前嵌入式系統(tǒng)設計的熱點。 可編程邏輯器件FPGA在過去的幾十年中取得了飛速發(fā)展，從最初的幾千門到現(xiàn)在的幾百萬門，可靠性與集成度不斷提高，而功耗和成本卻在不斷降低，具有很高的性價比。再加上開發(fā)周期短、對開發(fā)人員的要求相對較低的優(yōu)點，因此被大量應用于嵌入式系統(tǒng)設計中。 本文是基于FPGA高性價比、可靈活配置的特點，也是當前流行的“微控制器+FPGA”的嵌入式系統(tǒng)設計方式，所以我們提出了基于FPGA的實現(xiàn)方案。本文通過在FPGA中硬件實現(xiàn)嵌入式TCP/IP協(xié)議(包括UDP、IP、ARP、TCP等網(wǎng)絡協(xié)議)以及以太網(wǎng)MAC協(xié)議，并提供標準MII接口，通過外接PHY實現(xiàn)網(wǎng)絡連接。最終成功地通過了驗證。 基于FPGA的實現(xiàn)可以有效地降低成本，同時可以在其中集成其他功能模塊，提高整個系統(tǒng)的集成度，減小PCB版圖面積和布線復雜度，有利于提高系統(tǒng)可靠性。因此，本研究課題對嵌入式系統(tǒng)設計有很大的實用價值。
上傳時間： 2013-07-08
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隨著各種通信系統(tǒng)數(shù)量的日益增多，為了充分地利用有限的頻譜資源，高頻譜利用率的調(diào)制技術(shù)不斷被應用。偏移正交相移鍵控(OQPSK: Offset QuadraturePhase Shift Keying)是一種恒包絡調(diào)制技術(shù)，具有較高的頻譜利用率和功率利用率，廣泛應用于衛(wèi)星通信系統(tǒng)和地面移動通信系統(tǒng)。因此，對于OQPSK全數(shù)字解調(diào)技術(shù)的研究具有一定的理論價值。 本文以軟件無線電和全數(shù)字解調(diào)的相關(guān)理論為指導，成功設計并實現(xiàn)了基于FPGA的OQPSK全數(shù)字解調(diào)。論文介紹了OQPSK全數(shù)字接收解調(diào)原理和基于軟件無線電設計思想的全數(shù)字接收機的基本結(jié)構(gòu)，詳細闡述了當今OQPSK數(shù)字解調(diào)中載波頻率同步、載波相位同步、時鐘同步和數(shù)據(jù)幀同步的一些常用算法，并選擇了相應算法構(gòu)建了三種系統(tǒng)級的實現(xiàn)方案。通過MATLAB對解調(diào)方案的仿真和性能分析，確定了FPGA中的系統(tǒng)實現(xiàn)方案。在此基礎上，本文采用VerilogHDL硬件描述語言在Altera公司的Quartus II開發(fā)平臺上設計了同步解調(diào)系統(tǒng)中的各個模塊，還對各模塊和整個系統(tǒng)在ModelSim中進行了時序仿真驗證，并對設計中出現(xiàn)的問題進行了修正。最后，經(jīng)過FPGA調(diào)試工具嵌入式邏輯分析儀SignalTapⅡ的硬件實際測試，本文對系統(tǒng)方案進行了最終的改進與調(diào)整。 實際測試結(jié)果表明，本文的設計最終能夠達到了預期的指標和要求。本課題設計經(jīng)過時序和資源優(yōu)化后還可以向ASIC和系統(tǒng)級SOC轉(zhuǎn)化，以進一步縮小系統(tǒng)體積、降低成本和提高電路的可靠性，因此具有良好的實際應用價值。
標簽： OQPSK FPGA 全數(shù)字 解調(diào)
上傳時間： 2013-07-14
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嵌入式系統(tǒng)組成的核心部件是各種類型的嵌入式處理器/DSP。隨著嵌入式系統(tǒng)不斷深入到人們 生活中的各個領(lǐng)域，嵌入式處理器也進而得到前所未有的飛速發(fā)展。目前據(jù)不完全統(tǒng)計，全世界嵌入 式處理器/DSP 的品種總量已經(jīng)超過1500 多種，流行體系結(jié)構(gòu)也有近百個系列，現(xiàn)在幾乎每個半導 體制造商都生產(chǎn)嵌入式處理器/DSP，越來越多的公司有自己的處理器/DSP 設計部門。 嵌入式微處理器技術(shù)的基礎是通用計算機技術(shù)。現(xiàn)在許多嵌入式處理器也是從早期的PC 機的 應用發(fā)展演化過來的，如早期PC 諸如TRS-80、Apple II 和所用的Z80 和6502 處理器，至今 仍為低端的嵌入式應用。在應用中，嵌入式微處理器具有體積小、重量輕、成本低、可靠性高的優(yōu) 點。嵌入式處理器目前主要有Am186/88、386EX、SC-400、Power PC、68000、MIPS、ARM 等系列。
上傳時間： 2013-07-15
上傳用戶：wanqunsheng
感應電機具有可靠性好、結(jié)構(gòu)簡單、耐腐蝕、效率好、結(jié)構(gòu)緊湊、價格低廉和體積小等優(yōu)點，成為工業(yè)伺服控制的主要傳動裝置然而，感應電機又是一個多變量、強耦合的非線性系統(tǒng)，磁鏈和轉(zhuǎn)矩的非線性耦合及參數(shù)時變，使得感應電機的控制十分復雜，特別是在實際電機控制系統(tǒng)中，還需要考慮硬件和周圍環(huán)境等多種因素的干擾，致使實現(xiàn)高性能的感應電機控制系統(tǒng)更加困難 本文研究感應電機的高性能控制策略，綜述了感應電機高性能控制策略的發(fā)展歷程和感應電機模糊控制的發(fā)展現(xiàn)狀，分析了實際電機控制系統(tǒng)控制器選型中各個嵌入式微處理器的基本性能和優(yōu)缺點在給出三相坐標系和二相坐標系中的感應電機數(shù)學模型之后，從理論上闡述了模糊控制和矢量控制的基本原理，針對傳統(tǒng)的PI控制器參數(shù)整定繁瑣，系統(tǒng)魯棒性差的缺點，論文將模糊控制技術(shù)應用于感應電機的變頻調(diào)速，采用CRI推理法，設計了一種參數(shù)自整定模糊PI矢量控制器，利用Matlab對基于模糊PI控制的感應電機控制系統(tǒng)進行了仿真，并對采用兩種控制器實現(xiàn)的感應電機調(diào)速控制系統(tǒng)進行了比較、分析仿真結(jié)果表明模糊控制的控制性能優(yōu)于常規(guī)的PI調(diào)節(jié)器 論文對基于ARM的感應電機數(shù)字控制技術(shù)進行了系統(tǒng)研究，闡述了采用LPC2214ARM微處理器構(gòu)成數(shù)字感應電機變頻調(diào)速系統(tǒng)的方法，給出了一種高性能感應電機的數(shù)字實現(xiàn)方案，詳細介紹了系統(tǒng)硬件結(jié)構(gòu)的組成及軟件模塊的功能，并給出了主要算法的參考代碼，為實際電機控制器的選型和開發(fā)提供了一個新的思路
標簽： ARM 感應電機 數(shù)字控制器
上傳時間： 2013-08-03
上傳用戶：sy_jiadeyi
隨著經(jīng)濟與信息通信技術(shù)的迅猛發(fā)展,作為終端產(chǎn)品的打印機,其應用已經(jīng)涉及到商品流通、交通運輸、工業(yè)控制等諸多領(lǐng)域。但是,傳統(tǒng)打印機的性能已經(jīng)無法滿足新的應用對于信息管理自動化終端產(chǎn)品提出的新要求。 熱敏打印機作為一種新產(chǎn)品,具有打印速度快、打印質(zhì)量好、噪音小、易小型化、維護方便、操作簡單、性價比高等優(yōu)點,越來越受到市場的青睞,且在美國和日本等發(fā)達國家已經(jīng)得到了廣泛的應用。同時,隨著微電子技術(shù)的發(fā)展,嵌入式芯片以其高性能和低價格逐漸成為各種智能儀器研發(fā)的首選主控芯片。本研究以新的市場需求為背景并結(jié)合熱敏打印技術(shù)以及控制技術(shù)的發(fā)展,設計了基于ARM7TDMI內(nèi)核的S3C4480X主控芯片的新型微型熱敏打印驅(qū)動方案及其應用系統(tǒng)。 本文著重分析了熱敏打印的工作特點和控制原理,比較并討論了當前常見熱敏打印系統(tǒng)設計的優(yōu)缺點,提出了本研究的設計方案,并從硬件、軟件及系統(tǒng)調(diào)試三個方面詳細闡述了熱敏打印系統(tǒng)的設計。 通過對熱敏打印頭控制特點以及主控芯片硬件資源的深入分析,基于簡化系統(tǒng)設計、提高系統(tǒng)集成度和可靠性、方便系統(tǒng)軟件開發(fā)的原則,確定了打印驅(qū)動的硬件設計方案,主要包括接口電路、狀態(tài)檢測模塊...
標簽： 熱敏打印 驅(qū)動 系統(tǒng)設計
上傳時間： 2013-07-16
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基于過采樣和∑-△噪聲整形技術(shù)的DAC能夠可靠地把數(shù)字信號轉(zhuǎn)換為高精度的模擬信號(大于等于16位)。采用這一架構(gòu)進行數(shù)模轉(zhuǎn)換具有諸多優(yōu)點，例如極低的失配噪聲和更高的可靠性，便于實現(xiàn)嵌入式集成等，最重要的是可以得到其他DAC結(jié)構(gòu)所無法達到的精度和動態(tài)范圍。在高精度測量，音頻轉(zhuǎn)換，汽車電子等領(lǐng)域有著廣泛的應用價值。 本文采用∑-△結(jié)構(gòu)以FPGA方式實現(xiàn)了一個具有高精度的數(shù)模轉(zhuǎn)換器，在24比特的輸入信號下，達到了約150dB的信噪比。作為一個靈活的音頻DAC實現(xiàn)方案。該DAC可以對CD/DVD/HDCD/SACD等多種制式下的音頻信號進行處理，接受并轉(zhuǎn)換采樣率為32/44.1/48/88.2/96/192kHz，字長為16/18/20/24比特的PCM數(shù)據(jù)，具備良好的兼容性和通用性。 由于非線性和不穩(wěn)定性的存在，高階∑-△調(diào)制器的設計與實現(xiàn)存在較大的難度。本文綜合大量文獻中的經(jīng)驗原則和方法，闡述了穩(wěn)定的高階高精度調(diào)制器的設計流程；并據(jù)此設計了達到24bit精度和滿量程輸入范圍的的5階128倍調(diào)制器。本文創(chuàng)新性地提出了∑-△調(diào)制器的一種高效率流水線實現(xiàn)結(jié)構(gòu)。分析表明，與其他常見的∑-△調(diào)制器實現(xiàn)結(jié)構(gòu)相比，本方案具有結(jié)構(gòu)簡單、運算單元少等優(yōu)點；此外在同樣信號采樣率下，調(diào)制器所需的時鐘頻率大大降低。 文中的過采樣濾波模塊采用三級半帶濾波器和一個可變CIC濾波器級聯(lián)組成，可以達到最高128倍的過采樣比，同時具有良好的通帶和阻帶特性。在半帶濾波器的設計中采用了CSD編碼，使結(jié)構(gòu)得到了充分的簡化。 本文提出的過采樣DAC方案具有可重配置結(jié)構(gòu)，讓使用者能夠方便地控制過采樣比和調(diào)制器階數(shù)。通過積分梳狀濾波器的配置，能夠獲得32/64/128倍的不同過采樣比，從而實現(xiàn)對于32～192kHz多種采樣率輸入的處理。在不同輸入字長情況下，通過調(diào)制器的重構(gòu)，則可以將調(diào)制器由高精度的5階模式改變?yōu)楣母偷?階模式，滿足不同分辨率信號輸入時的不同精度要求。這是本文的另一創(chuàng)新之處。 目前，該過采樣DAC已經(jīng)在XilinxVirtexⅡ系列FPGA器件下得到硬件實現(xiàn)和驗證。測試表明，對于從32kHz到192kHz的不同輸入信號，該DAC模塊輸出1比特碼流的帶內(nèi)信噪比均能滿足24比特數(shù)據(jù)轉(zhuǎn)換應用的分辨率要求。
上傳時間： 2013-07-08
上傳用戶：從此走出陰霾
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