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永磁同步電機(jī)FOC算法的流三相電流重構(gòu)算法

永磁同步電機(jī)FOC算法的流三相電流重構(gòu)算法。

標(biāo)簽： FOC 永磁同步電機(jī) 三相電流 算法

上傳時(shí)間： 2013-10-15

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抑制同步開(kāi)關(guān)噪聲的新穎電磁帶隙結(jié)構(gòu)

文中提出了一種應(yīng)用于印刷電路板的新穎二維電磁帶隙（MS-EBG）結(jié)構(gòu),其單位晶格由折線縫隙組合與正方形貼片橋接構(gòu)成,以抑制同步開(kāi)關(guān)噪聲。結(jié)果表明,抑制深度為-30 dB時(shí),與傳統(tǒng)L-bridged EBG結(jié)構(gòu)比較,新EBG結(jié)構(gòu)的阻帶寬度增加1.3 GHz,相對(duì)帶寬提高了約10%,能夠有效抑制0.6～5.9 GHz的同步開(kāi)關(guān)噪聲。

標(biāo)簽： 同步開(kāi)關(guān)噪聲 電磁 帶隙結(jié)構(gòu)

上傳時(shí)間： 2013-11-07

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與電網(wǎng)電壓同步的正弦波發(fā)生電路設(shè)計(jì)

目前的有源電力濾波器通常是采用基于瞬時(shí)無(wú)功功率理論的諧波電流檢測(cè)方法。其中的ip-iq算法需要用到與電網(wǎng)電壓同步的正余弦信號(hào)，即與電網(wǎng)電壓同頻同相的標(biāo)準(zhǔn)正余弦信號(hào)。該信號(hào)的獲取可以采用鎖相環(huán)加正余弦函數(shù)發(fā)生器的方法，也可采用軟件查表的方法。本設(shè)計(jì)采用全硬件電路完成，即通過(guò)鎖相環(huán)加正弦函數(shù)發(fā)生器的方法，可自動(dòng)實(shí)時(shí)跟蹤電網(wǎng)電壓的頻率和相位，不占用微處理器的軟、硬件資源，大大降低了諧波檢測(cè)算法編程的復(fù)雜度。

標(biāo)簽： 電網(wǎng)電壓 同步的 正弦波發(fā)生 電路設(shè)計(jì)

上傳時(shí)間： 2013-10-22

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同步整流技術(shù)簡(jiǎn)單介紹

同步整流技術(shù)簡(jiǎn)單介紹大家都知道，對(duì)于開(kāi)關(guān)電源，在次級(jí)必然要有一個(gè)整流輸出的過(guò)程。作為整流電路的主要元件，通常用的是整流二極管（利用它的單向?qū)щ娞匦裕梢岳斫鉃橐环N被動(dòng)式器件：只要有足夠的正向電壓它就開(kāi)通，而不需要另外的控制電路。但其導(dǎo)通壓降較高，快恢復(fù)二極管（FRD）或超快恢復(fù)二極管（SRD）可達(dá)1.0～1.2V，即使采用低壓降的肖特基二極管（SBD），也會(huì)產(chǎn)生大約0.6V的壓降。這個(gè)壓降完全是做的無(wú)用功，并且整流二極管是一種固定壓降的器件，舉個(gè)例子：如有一個(gè)管子壓降為0.7V，其整流為12V時(shí)它的前端要等效12.7V電壓，損耗占0.7/12.7≈5.5%.而當(dāng)其為3.3V整流時(shí)，損耗為0.7/4（3.3+0.7）≈17.5%。可見(jiàn)此類器件在低壓大電流的工作環(huán)境下其損耗是何等地驚人。這就導(dǎo)致電源效率降低，損耗產(chǎn)生的熱能導(dǎo)致整流管進(jìn)而開(kāi)關(guān)電源的溫度上升、機(jī)箱溫度上升--------有時(shí)系統(tǒng)運(yùn)行不穩(wěn)定、電腦硬件使用壽命急劇縮短都是拜這個(gè)高溫所賜。隨著電腦硬件技術(shù)的飛速發(fā)展，如GeForce 8800GTX顯卡，其12V峰值電流為16.2A。所以必須制造能提供更大輸出電流（如多核F1，四路12V，每路16A；3.3V和5V輸出電流各高達(dá)24A）的電源轉(zhuǎn)換器。而當(dāng)前世界的能源緊張問(wèn)題的凸現(xiàn)，為廣大用戶提供更高轉(zhuǎn)換效率（如多核R80，完全符合80PLUS標(biāo)準(zhǔn)）的電源轉(zhuǎn)換器就是我們整個(gè)開(kāi)關(guān)電源行業(yè)的不可回避的社會(huì)責(zé)任了。如何解決這些問(wèn)題？尋找更好的整流方式、整流器件。同步整流技術(shù)和通態(tài)電阻（幾毫歐到十幾毫歐）極低的專用功率MOSFET就是在這個(gè)時(shí)刻走上開(kāi)關(guān)電源技術(shù)發(fā)展的歷史舞臺(tái)了！作為取代整流二極管以降低整流損耗的一種新器件，功率MOSFET屬于電壓控制型器件，它在導(dǎo)通時(shí)的伏安特性呈線性關(guān)系。因?yàn)橛霉β蔒OSFET做整流器時(shí)，要求柵極電壓必須與被整流電壓的相位保持同步才能完成整流功能，故稱之為同步整流。它可以理解為一種主動(dòng)式器件，必須要在其控制極（柵極）有一定電壓才能允許電流通過(guò)，這種復(fù)雜的控制要求得到的回報(bào)就是極小的電流損耗。在實(shí)際應(yīng)用中，一般在通過(guò)20-30A電流時(shí)才有0.2-0.3V的壓降損耗。因?yàn)槠鋲航档扔陔娏髋c通態(tài)電阻的乘積，故小電流時(shí)，其壓降和恒定壓降的肖特基不同，電流越小壓降越低。這個(gè)特性對(duì)于改善輕載效率（20%）尤為有效。這在80PLUS產(chǎn)品上已成為一種基本的解決方案了。對(duì)于以上提到的兩種整流方案，我們可以通過(guò)灌溉農(nóng)田來(lái)理解：肖特基整流管可以看成一條建在泥土上沒(méi)有鋪水泥的灌溉用的水道，從源頭下來(lái)的水源在中途滲漏了很多，十方水可能只有七、八方到了農(nóng)田里面。而同步整流技術(shù)就如同一條鑲嵌了光滑瓷磚的引水通道，除了一點(diǎn)點(diǎn)被太陽(yáng)曬掉的損失外，十方水能有9.5方以上的水真正用于澆灌那些我們?nèi)杖召囈陨娴募Z食。我們的多核F1，多核R80，其3.3V整流電路采用了通態(tài)電阻僅為0.004歐的功率MOSFET，在通過(guò)24A峰值電流時(shí)壓降僅為20*0.004=0.08V。如一般PC正常工作時(shí)的3.3V電流為10A，則其壓降損耗僅為10*0.004=0.04V，損耗比例為0.04/4=1%，比之于傳統(tǒng)肖特基加磁放大整流技術(shù)17.5%的損耗，其技術(shù)的進(jìn)步已不僅僅是一個(gè)量的變化，而可以說(shuō)是有了一個(gè)質(zhì)的飛躍了。也可以說(shuō)，我們?yōu)橛脩粜藿艘粭l嚴(yán)絲合縫的灌溉電腦配件的供電渠道。

標(biāo)簽： 同步整流

上傳時(shí)間： 2013-10-27

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pic18fxx8單片機(jī)通用同步異步收發(fā)器的接口電路和c源代碼

pic18fxx8單片機(jī)通用同步異步收發(fā)器的接口電路和c源代碼

標(biāo)簽： fxx8 pic fxx 18

上傳時(shí)間： 2013-11-06

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HT45R37 使用SPI 進(jìn)行資料傳輸?shù)姆椒?/a>

標(biāo)簽： 45R R37 SPI HT

上傳時(shí)間： 2013-11-22

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基于OMAP1510的mp3播放器設(shè)計(jì)

　　第一章 序論……………………………………………………………6 　　1- 1 研究動(dòng)機(jī)…………………………………………………………..7 　　1- 2 專題目標(biāo)…………………………………………………………..8 　　1- 3 工作流程…………………………………………………………..9 　　1- 4 開(kāi)發(fā)環(huán)境與設(shè)備…………………………………………………10 　　第二章 德州儀器OMAP 開(kāi)發(fā)套件…………………………………10 　　2- 1 OMAP介紹………………………………………………………10 　　2-1.1 OMAP是什麼?…….………………………………….…10 　　2-1.2 DSP的優(yōu)點(diǎn)……………………………………………....11 　　2- 2 OMAP Architecture介紹………………………………………...12 　　2-2-1 OMAP1510 硬體架構(gòu)………………………………….…12 　　2-2.2 OMAP1510軟體架構(gòu)……………………………………...12 　　2-2.3 DSP / BIOS Bridge簡(jiǎn)述…………………………………...13 　　2- 3 TI Innovator套件 -- OMAP1510 ……………………………..14 　　2-2.1 General Purpose processor -- ARM925T………………...14 　　2-2.2 DSP processor -- TMS320C55x …………………………15 　　2-2.3 IDE Tool – CCS …………………………………………15 　　2-2.4 Peripheral ………………………………………………..16 　　第三章 在OMAP1510上建構(gòu)Embedded Linux System…………….17 　　3- 1 嵌入式工具………………………………………………………17 　　3-1.1 嵌入式程式開(kāi)發(fā)與一般程式開(kāi)發(fā)之不同………….….17 　　3-1.2 Cross Compiling的GNU工具程式……………………18 　　3-1.3 建立ARM-Linux Cross-Compiling 工具程式………...19 　　3-1.4 Serial Communication Program………………………...20 　　3- 2 Porting kernel………………………………………………….…21 　　3-2.1 Setup CCS ………………………………………….…..21 　　3-2.2 編譯及上傳Loader…………………………………..…23 　　3-2.3 編譯及上傳Kernel…………………………………..…24 　　3- 3 建構(gòu)Root File System………………………………………..…..26 　　3-3.1 Flash ROM……………………………………………...26 　　3-3.2 NFS mounting…………………………………………..27 　　3-3.3 支援NFS Mounting 的kernel…………………………..27 　　3-3.4 提供NFS Mounting Service……………………………29 　　3-3.5 DHCP Server……………………………………………31 　　3-3.6 Linux root 檔案系統(tǒng)……………………………….…..32 　　3- 4 啟動(dòng)及測(cè)試Innovator音效裝置…………………………..…….33 　　3- 5 建構(gòu)支援DSP processor的環(huán)境…………………………...……34 　　3-5.1 Solution -- DSP Gateway簡(jiǎn)介……………………..…34 　　3-5.2 DSP Gateway運(yùn)作架構(gòu)…………………………..…..35 　　3- 6 架設(shè)DSP Gateway………………………………………….…36 　　3-6.1 重編kernel……………………………………………...36 　　3-6.2 DEVFS driver…………………………………….……..36 　　3-6.3 編譯DSP tool和API……………………………..…….37 　　3-6.4 測(cè)試……………………………………………….…….37 　　第四章 MP3 Player……………………………………………….…..38 　　4- 1 MP3 介紹………………………………………………….…….38 　　4- 2 MP3 壓縮原理……………………………………………….….39 　　4- 3 Linux MP3 player – splay………………………………….…….41 　　4.3-1 splay介紹…………………………………………….…..41 　　4.3-2 splay 編譯………………………………………….…….41 　　4.3-3 splay 的使用說(shuō)明………………………………….……41 　　第五章 程式改寫………………………………………………...…...42 　　5-1 程式評(píng)估與改寫………………………………………………...…42 　　5-1.1 Inter-Processor Communication Scheme…………….....42 　　5-1.2 ARM part programming……………………………..…42 　　5-1.3 DSP part programming………………………………....42 　　5-2 程式碼………………………………………………………..……43 　　5-3 雙處理器程式開(kāi)發(fā)注意事項(xiàng)…………………………………...…47 　　第六章 效能評(píng)估與討論……………………………………………48 　　6-1 速度……………………………………………………………...48 　　6-2 CPU負(fù)載………………………………………………………..49 　　6-3 討論……………………………………………………………...49 　　6-3.1分工處理的經(jīng)濟(jì)效益………………………………...49 　　6-3.2音質(zhì)v.s 浮點(diǎn)與定點(diǎn)運(yùn)算………………………..…..49 　　6-3.3 DSP Gateway架構(gòu)的限制………………………….…50 　　6-3.4減少IO溝通……………….………………………….50 　　6-3.5網(wǎng)路掛載File System的Delay…………………..……51 　　第七章 結(jié)論心得…

標(biāo)簽： OMAP 1510 mp3 播放器

上傳時(shí)間： 2013-10-14

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基于單片機(jī)的輪機(jī)模擬器電站同步表實(shí)現(xiàn)

摘要：本文首先簡(jiǎn)要說(shuō)明了同步表在船舶電站中的用途，以及實(shí)船上同步表各個(gè)部分的功能和操作方法；文中介紹了在輪機(jī)模擬器上對(duì)于電站同步表的一種新的仿真模型以及該模擬器對(duì)同步表的要求，這一仿真模型和模擬器需求是文中介紹的基于單片機(jī)的同步表的基礎(chǔ)；根據(jù)這一模型，詳細(xì)介紹了用通用單片機(jī)STC89C51實(shí)現(xiàn)輪機(jī)模擬器電站系統(tǒng)上的同步表的系統(tǒng)構(gòu)成，以及模擬實(shí)現(xiàn)同步表各項(xiàng)功能的的硬件和軟件方法，并在文中給出了詳細(xì)的軟件流程圖和部分硬件原理圖以及配套的軟件代碼；在文章最后，簡(jiǎn)要介紹了本文實(shí)現(xiàn)的基于單片機(jī)的同步表的特點(diǎn)以及其在輪機(jī)模擬器上實(shí)際應(yīng)用的表現(xiàn)。關(guān)鍵詞：船舶電站；同步表；單片機(jī)；模擬

標(biāo)簽： 單片機(jī) 輪機(jī)模擬器 電站

上傳時(shí)間： 2013-11-23

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永磁同步電機(jī)控制程序(萬(wàn)山明)

永磁同步電機(jī)控制程序(萬(wàn)山明)永磁同步電機(jī)控制程序(萬(wàn)山明)

標(biāo)簽： 永磁同步 電機(jī)控制 程序

上傳時(shí)間： 2013-11-22

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基于FPGA的跳頻系統(tǒng)快速同步算法設(shè)計(jì)與實(shí)現(xiàn)

同步技術(shù)是跳頻系統(tǒng)的核心。本文針對(duì)FPGA的跳頻系統(tǒng)，設(shè)計(jì)了一種基于獨(dú)立信道法，同步字頭法和精準(zhǔn)時(shí)鐘相結(jié)合的快速同步方法，同時(shí)設(shè)計(jì)了基于雙圖案的改進(jìn)型獨(dú)立信道法，同步算法協(xié)議，協(xié)議幀格式等。該設(shè)計(jì)使用VHDL硬件語(yǔ)言實(shí)現(xiàn)，采用Altera公司的EP3C16E144C8作為核心芯片，并在此硬件平臺(tái)上進(jìn)行了功能驗(yàn)證。實(shí)際測(cè)試表明，該快速同步算法建立時(shí)間短、同步穩(wěn)定可靠。

標(biāo)簽： FPGA 跳頻系統(tǒng) 同步算法

上傳時(shí)間： 2013-10-21

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