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單片機源程序

  • F2812實現電機控制源程序.rar

    此文件包含了通過2812實現電機控制,LCD點陣實現,sci、can總線控制等源程序,便于初學者入門!-

    標簽: F2812 電機控制 源程序

    上傳時間: 2013-05-28

    上傳用戶:colinal

  • 基于單片FPGA的雷達處理機實現

    根據雷達、圖像、通信等領域對信號高速處理的要求,研究人員正尋求新的高速的數字信號處理實現方法,以滿足這種高速地處理數據的需要。 本文對單片FPGA的雷達處理機實現進行了研究。文章根據線性調頻信號脈沖壓縮理論,選擇合適的加窗函數,對線性調頻信號進行脈沖壓縮,得出仿真結果;完成了雷達信號處理部分的PCB制版;確定了與其他PCB板之間的接口關系;編寫了FPGA程序,采用DA算法并根據FIR原理實現32階濾波器,進行了脈沖壓縮處理。  

    標簽: FPGA 雷達 處理機

    上傳時間: 2013-04-24

    上傳用戶:suonidaoke

  • 18B20源程序加上位機溫度顯示應用程序包

    18B20源程序加上位機溫度顯示應用程序包

    標簽: 18B20 源程序 上位機 溫度顯示

    上傳時間: 2013-06-03

    上傳用戶:xuanjie

  • 多業務PDH單片FPGA解決方案

    隨著通信網的發展和用戶需求的提高,光纖通信中的PDH體系逐漸被SDH體系所取代.SDH光纖通信系統以其通信容量大、傳輸性能好、接口標準、組網靈活方便、管理功能強大等優點獲得越來越廣泛的應用.但是在某些對傳輸容量需求不大的場合,SDH的巨大潛力和優越性無法發揮出來,反而還會造成帶寬浪費.相反,PDH因其容量適中,配置靈活,成本低廉和功能齊全,可針對客戶不同需要設計不同的方案,在某些特定的接入場合具有一定的優勢.本課題根據現實的需要,提出并設計了一種基于PDH技術的多業務單片FPGA傳輸系統.系統可以同時提供12路E1的透明傳輸和一個線速為100M以太網通道,主要由一塊FPGA芯片實現大部分功能,該解決方案在集成度、功耗、成本以及靈活性等方面都具有明顯的優勢.本文首先介紹數字通信以及數字復接原理和以太網的相關知識,然后詳細闡述了本系統的方案設計,對所使用的芯片和控制芯片FPGA做了必要的介紹,最后具體介紹了系統硬件和FPGA編碼設計,以及后期的軟硬件調試.歸納起來,本文主要具體工作如下:1.實現4路E1信號到1路二次群信號的復分接,主要包括全數字鎖相環、HDB3-NRZ編解碼、正碼速調整、幀頭檢測和復分接等.2.將以太網MII接口來的25M的MII信號通過碼速變換到25.344M,進行映射.3.將三路二次群信號和變換過的以太網MII信號進行5b6b編解碼,以利于在光纖上傳輸.4.高速時提取時鐘采用XILINX的CDR方案.并對接收到的信號經過5b6b解碼后,分接出各路信號.

    標簽: FPGA PDH 多業務 方案

    上傳時間: 2013-07-23

    上傳用戶:lansedeyuntkn

  • 單片機C語言應用100例光盤全部C語言源程序

    單片機C語言應用100例光盤全部C語言源程序,可以提供keil軟件的編譯,如果需要實際仿真,則需要焊接實體器件電路。很具有參考價值,值得借鑒。

    標簽: 100 C語言 單片機 光盤

    上傳時間: 2013-04-24

    上傳用戶:thh29

  • 基于FPGA控制的高速數據采集系統

    數據采集系統是信號與信息處理系統中不可缺少的重要組成部分,同時也是軟件無線電系統中的核心模塊,在現代雷達系統以及無線基站系統中的應用越來越廣泛。為了能夠滿足目前對軟件無線電接收機自適應性及靈活性的要求,并充分體現在高性能FPGA平臺上設計SOC系統的思路,本文提出了由高速高精度A/D轉換芯片、高性能FPGA、PCI總線接口、DB25并行接口組成的高速數據采集系統設計方案及實現方法。其中FPGA作為本系統的控制核心和傳輸橋梁,發揮了極其重要的作用。通過FPGA不僅完成了系統中全部數字電路部分的設計,并且使系統具有了較高的可適應性、可擴展性和可調試性。 在時序數字邏輯設計上,充分利用FPGA中豐富的時序資源,如鎖相環PLL、觸發器,緩沖器FIFO、計數器等,能夠方便的完成對系統輸入輸出時鐘的精確控制以及根據系統需要對各處時序延時進行修正。 在存儲器設計上,采用FPGA片內存儲器。可根據系統需要隨時進行設置,并且能夠方便的完成數據格式的合并、拆分以及數據傳輸率的調整。 在傳輸接口設計上,采用并行接口和PCI總線接口的兩種數據傳輸模式。通過FPGA中的宏功能模塊和IP資源實現了對這兩種接口的邏輯控制,可使系統方便的在兩種傳輸模式下進行切換。 在系統工作過程控制上,通過VB程序編寫了應用于PC端的上層控制軟件。并通過并行接口實現了PC和FPGA之間的交互,從而能夠方便的在PC機上完成對系統工作過程的控制和工作模式的選擇。 在系統調試方面,充分利用QuartuslI軟件中自帶的嵌入式邏輯分析儀SignalTaplI,實時準確的驗證了在系統整個傳輸過程中數據的正確性和時序性,并極大的降低了用常規儀器觀測FPGA中眾多待測引腳的難度。 本文第四章針對FPGA中各功能模塊的邏輯設計進行了詳細分析,并對每個模塊都給出了精確的仿真結果。同時,文中還在其它章節詳細介紹了系統的硬件電路設計、并行接口設計、PCI接口設計、PC端控制軟件設計以及用于調試過程中的SignalTapⅡ嵌入式邏輯分析儀的使用方法,并且也對系統的仿真結果和測試結果給出了分析及討論。最后還附上了系統的PCB版圖、FPGA邏輯設計圖、實物圖及注釋詳細的相關源程序清單。

    標簽: FPGA 控制 高速數據 采集系統

    上傳時間: 2013-06-09

    上傳用戶:lh25584

  • 51單片機各類源程序集錦

    51單片機各類源程序集錦,代碼為Keil C51環境,涉及CAN,EEPROM,LCD,LCM,IO_Key,LIN,RS232,RS485,RTC,TCPIP,USB1.0,USB2.0等。

    標簽: 51單片機 源程序 集錦

    上傳時間: 2013-06-12

    上傳用戶:zhch602

  • 視頻圖像采集verilog HDl源程序

    :視頻圖像采集verilog HDl源程序,視頻解碼芯片部分的,可以供參考

    標簽: verilog HDl 視頻圖像 源程序

    上傳時間: 2013-04-24

    上傳用戶:koulian

  • verilog大量源程序

    verilog大量源程序,希望對大家有所幫助。。。。。。

    標簽: verilog 源程序

    上傳時間: 2013-06-03

    上傳用戶:ztj182002

  • DSP+MP3+USB+FAT12的所有源程序(C語言編寫)

    ·文件列表:   DSP+Mp3+USB+FAT12的所有源程序。   ...............................\MP3_Decoder_Project   ...............................\...................\cc_build_Debug.log   ..................

    標簽: DSP FAT USB 12

    上傳時間: 2013-04-24

    上傳用戶:1136815862

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