Median Filter 在FPGA中的實(shí)現(xiàn)
標(biāo)簽： Median Filter FPGA 中的實(shí)現(xiàn)
上傳時(shí)間： 2013-08-31
上傳用戶：bensonlly
在FPGA設(shè)計(jì)中解決如何消除毛刺現(xiàn)象的相關(guān)設(shè)計(jì)調(diào)整，對(duì)于FPGA的設(shè)計(jì)者來(lái)說(shuō)具有較好的學(xué)習(xí)作用。
標(biāo)簽： FPGA 毛刺 相關(guān)設(shè)計(jì)
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CPLD、FPGA在EL顯示模塊及接口電路中的應(yīng)用,cpld實(shí)現(xiàn)數(shù)字電路取代，fpga取代液晶顯示專用控制芯片。
標(biāo)簽： CPLD FPGA 顯示模塊 接口電路
上傳用戶：181992417
CPLD在USB20接口中的應(yīng)用，usb大家都用過(guò)吧，不用多說(shuō)了吧。
標(biāo)簽： CPLD USB 20 接口
上傳用戶：lixqiang
數(shù)字信號(hào)處理在FPGA上實(shí)現(xiàn)的經(jīng)典教材，本書詳細(xì)介紹了數(shù)字信號(hào)處理的算法，以及其在FPGA上用硬件描述語(yǔ)言實(shí)現(xiàn)
標(biāo)簽： FPGA 數(shù)字信號(hào)處理 教材
上傳時(shí)間： 2013-09-01
上傳用戶：frank1234
在無(wú)線傳送領(lǐng)域,基于FPGA 的DDS 實(shí)現(xiàn)的幾種方式
標(biāo)簽： FPGA DDS 無(wú)線傳送 方式
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詳細(xì)論述FPGA在軟件無(wú)線電技術(shù)實(shí)現(xiàn)系統(tǒng)中的應(yīng)用
標(biāo)簽： FPGA 軟件無(wú)線電 技術(shù)實(shí)現(xiàn) 中的應(yīng)用
上傳時(shí)間： 2013-09-02
上傳用戶：wsf950131
控制面板程序設(shè)計(jì)－在控制面板上加一個(gè)測(cè)試組件
標(biāo)簽： 控制 面板 程序設(shè)計(jì) 測(cè)試
上傳時(shí)間： 2013-09-03
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CPLD的VerilogHDL總線代碼,在EPM7128SLC84-10+Quartus4平臺(tái)上運(yùn)行通過(guò).
標(biāo)簽： VerilogHDL Quartus CPLD 7128
上傳用戶：gaojiao1999
第一章 在Allegro 中準(zhǔn)備好進(jìn)行SI 仿真的PCB 板圖
標(biāo)簽： Allegro PCB 仿真
上傳時(shí)間： 2013-09-04
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