H.264/AVC是ITU-T和ISO聯合推出的新標準，采用了近幾年視頻編碼方面的先進技術，以較高編碼效率和網絡友好性成為新一代國際視頻編碼標準。 本文以實現D1格式的H.264/AVC實時編碼器為目標，作者負責系統架構設計，軟硬件劃分以及部分模塊的硬件算法設計與實現。通過對H.264/AVC編碼器中主要模塊的算法復雜度的評估，算法特點的分析，同時考慮到編碼器系統的可伸縮性，可擴展性，本文采用了DSP+FPGA的系統架構。DSP充當核心處理器，而FPGA作為協處理器，針對編碼器中最復雜耗時的模塊一運動估計模塊，設計相應的硬件加速引擎，以提供編碼器所需要的實時性能。 H.264/AVC仍基于以前視頻編碼標準的運動補償混合編碼方案，其中一個主要的不同在于幀間預測采用了可變塊尺寸的運動估計，同時運動向量精度提高到1/4像素。更小和更多形狀的塊分割模式的采用，以及更加精確的亞像素位置的預測，可以改善運動補償精度，提高圖像質量和編碼效率，但同時也大大增加了編碼器的復雜度，因此需要設計專門的硬件加速引擎。 本文給出了1/4像素精度的運動估計基于FPGA的硬件算法設計與實現，包括整像素搜索，像素插值，亞像素(1/2，1/4)搜索以及多模式選擇(支持全部七種塊分割模式)。設計中，將多處理器技術和流水線技術相結合，提供高性能的并行計算能力，同時，采用合理的存儲器組織結構以提供高數據吞吐量，滿足運算的帶寬要求，并使編碼器具有較好的可伸縮性。最后，在Modelsim環境下建立測試平臺，完成了對整個設計的RTL級的仿真驗證，并針對Altera公司的FPGA芯片stratixⅡ系列的EP2S60-4器件進行優化，從而使工作頻率最終達到134MHz，分析數據表明該模塊能夠滿足編碼器的實時性要求。
上傳時間： 2013-07-24
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本文介紹了單片機在鍋爐溫度控制上的應用，主要是以87C51 單片機作為控制器核心，結合溫度傳感變送器、A/D 轉換器、LED 顯示器、D/A 轉換器，模擬多路開關等，組成一個八通道的鍋爐溫度控
上傳時間： 2013-04-24
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簡介 探討了在PC機中用Visual Basic下的Microsoft Comm control控件與使用C51編程的MCS\ 51單片機之間的串行通信的方法,以及在VB中怎樣處理二進制碼,并給出了演示程序和通信協議。
上傳時間： 2013-04-24
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在航空航天，遙感測量，安全防衛以及家用影視娛樂等領域，要求能及時保存高清晰度的視頻信號供后期分析、處理、研究和欣賞。因此，研究一套處理速度快，性能可靠，使用方便，符合行業相關規范的高清視頻編解碼系統是十分必要的。 本文首先介紹了高清視頻的發展歷史。并就當前相關領域的發展闡述了高清視頻編解碼系統的設計思路，提出了可行的系統設計方案。基于H.264的高清視頻編碼系統對處理器的要求非常高，一般的DSP和通用處理器難以達到性能要求。本系統選擇富士通公司最新的專用視頻編解碼芯片MB86H51，實時編解碼分辨率達到1080p的高清視頻。芯片具有壓縮率高，功耗低，體積小等優點。系統的控制設備由三塊FPGA芯片和ARM控制器共同完成。FPGA芯片分別負責視頻輸入輸出，碼流輸入輸出和主編解碼芯片的控制。ARM作為上層人機交互的控制器，向系統使用者提供操作界面，并與主控FPGA相連。方案實現了高清視頻的輸入，實時編碼和碼流存儲輸出等功能于一體，能夠編碼1080p的高清視頻并存儲在硬盤中。系統開發的工作難點在于FPGA的程序設計與調試工作。其次，詳細介紹了FPGA在系統中的功能實現，使用的方法和程序設計。使用VHDL語言編程實現I2C總線接口和接口控制功能，利用stratix系列FPGA內置的M4K快速存儲單元實現128K的命令存儲ROM，并對設計元件模塊化，方便今后的功能擴展。編程實現了PIO模式的硬盤讀寫和SDRAM接口控制功能，實現高速的數據存儲功能。利用時序狀態機編程實現主芯片編解碼控制功能，完成編解碼命令的發送和狀態讀取，并對設計思路，調試結果和FPGA資源使用情況進行分析。著重介紹設計中用到的最新芯片及其工作方式，分析設計過程中使用的最新技術和方法。有很強的實用價值。最后，論文對系統就不同的使用情況提出了可供改進的方案，并對與高清視頻相關的關鍵技術作了分析和展望。
上傳時間： 2013-07-26
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隨著數字技術的高速發展，越來越多的針對數字視頻壓縮、傳送、顯示等的設備涌入市場。要從這些良莠不齊的產品中挑選出令人滿意的商品，一套良好的數字視頻測試設備就必不可少。然而，現階段大多數數字視頻信號源都存在不同的缺點，如測試圖像種類太少、沒有動態測試源、缺乏專用測試信號等。為有效克服這些缺陷，作者設計并開發了一套基于FPGA的數字視頻信號發生器。整個系統包括硬件平臺和圖像格式轉換軟件兩大部分。硬件平臺本身即為獨立的信號發生器，可以生成多種測試圖像。配備了圖像格式轉換軟件，就可以實現硬件平臺從PC機接收各種靜態測試圖像、動態測試序列，不斷更新測試圖像庫。整個系統具有良好的硬件體系結構、便捷的輸入接口，穩定的信號輸出，同時操作靈活、方便，易于升級更新。 在系統的開發過程中，使用了多種硬件、軟件開發工具，如PROTEL DXP、ISE、MODEL SIM、MATLAB、C＃．NET等。由于軟硬件調試均由同一人完成，因此整個系統具備良好的統一性和兼容性。 另外，作者還研究并設計了一種針對H.264編解碼器壓縮損傷的測試信號。評估一個編碼器的性能可采用主觀評價或客觀評價兩種方法。其中主觀評價最為直接、有效。本文在依托主觀評價方法的基礎上，結合客觀參數的指導性，研究并設計一種通過人眼就可以方便的觀測到實際存在的壓縮損傷的測試信號，以達到直接對編解碼器性能進行比較的目的。
上傳時間： 2013-07-19
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目前的國內的CCD高清攝相頭能夠輸出一組視頻信號和數字圖像信號，雖然視頻信號能夠直接在監視器顯示，但是輸出的數字圖像信號占用存儲空間太大，不便于進行傳輸。本文設計了一種基于FPGA的數字圖像壓縮卡。 在過去的十幾年中，國際標準化組織制訂了一系列的國際視頻編碼標準并廣泛應用到各種領域。It.264/AVC是ITU-T和ISO聯合推出的新標準，采用了近幾年視頻編碼方面的先進技術，以較高編碼效率和網絡友好性成為新一代國際視頻編碼標準。 新發展的H．264/AVC比原有的視頻編碼標準大幅度提高了編碼效率，但其運算復雜度也大大增加，本文簡要分析了H．264/AVC的復雜度及其優化的途徑，給出了主要模塊的優化算法實驗結果。 H．264/AVC仍基于以前視頻編碼標準的運動補償混合編碼方案，主要不同有：增強的運動預測能力，準確匹配的較小塊變換，自適應環內濾波器，增強的熵編碼。測試結果表明這些新特征使H．264/AVC編碼器提高50％編碼效率的同時，增加了一個數量級的復雜度。實際中恰當地使用H．264/AVC編碼工具可以較低的實現復雜度得到與復雜配置相當的編碼效率。故實際編碼系統開發需要在運算復雜性和編碼效率之間進行折衷、兼顧考慮。H．264/AVC引入的新編碼特征既增加基本模塊的復雜度，也成倍增加算法的復雜度。針對它們的作用和實現方法的不同，可采用不同的硬件實現方法。本文基于上述思路進行優化，具體的工作包括：針對去塊濾波的復雜性，本文提出一種適合硬件實現的算法，使其在節省了資源的同時，很好的達到了標準所定義的性能。針對變換量化的復雜性，本文提出一種既滿足整體的硬件流水結構，又極大的降低了硬件資源的實現方法。針對碼率控制的實現，本文提出了一種有別于傳統實現方式的算法，在保證實時性的同時，極大的提高了編碼器的性能。本文基于上述算法還進行Baseline Profile編碼器的研究，給出了一種實時編碼器結構，實現了對高清圖像格式(720P)的實時編碼，并將其和當前業界先進水平進行了對比，表明本文所實現得結構能夠達到當前業界的先進水平。
上傳時間： 2013-07-23
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隨著我國信息化發展進程加快，信息化覆蓋面擴大，信息安全問題也就隨之增多，其影響和后果也更加廣泛和嚴重。同時，信息安全及其對經濟發展、國家安全和社會穩定的重大影響，正日益突出地顯現出來，受到越來越多的關注。在和平年代，通過對信息載體進行大規模的物理破壞，從而達到危害信息安全的目的，在一定程度上是行不通的。然而，在信息安全的角力上，破壞者從來都沒有放棄過，他們把目標對準了信息載體中的數據，由于數據的易失性，計算機數據成為信息安全中的最大隱患，同時也是破壞信息安全的一個突破口。 本文提出研制硬盤加密卡的主要目的是為了防止對計算機數據的竊取，保護硬盤中的數據。破壞者在得到硬盤后，也不能夠得到硬盤中的數據，從而達到保護信息安全的目的。加密卡提供兩個符合ATA-6標準的接口，串接在主板IDE接口和硬盤之間。存儲在硬盤上的數據，是經過加密以后的加密數據；從硬盤上讀出的數據，必須經過該卡的解密才可被正常使用，否則只是一堆亂碼。加密卡采用FPGA技術實現IDE接口和加密算法，以減小加解密帶來的速度上的影響。 論文的工作重點主要有以下幾個方面的內容：FPGA及VHDL語言的研究，ATA協議標準研究及IDE接口的FPGA實現。論文對ATA協議做了細致的研究，分析了硬盤接口的工作機制以及主機與硬盤之間的通信協議，并在此基礎上，重點研究了用FPGA的編程功能來實現一個計算機硬件底層接口協議的方法，詳細介紹了芯片的內部框圖及FPGA的軟件流程圖，提出了在實現過程中應注意的要點，最終用FPGA構建了一個雙向IDE硬盤通道，實現了兩套符合ATA-6規范的IDE接口。
上傳時間： 2013-08-02
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隨著多媒體編碼技術的發展，視頻壓縮標準在很多領域都得到了成功應用，如視頻會議(H.263)、DVD(MPEG-2)、機頂盒(MPEG-2)等等，而網絡帶寬的不斷提升和高效視頻壓縮技術的發展使人們逐漸把關注的焦點轉移到了寬帶網絡數字電視(IPTV)、流媒體等基于傳輸的業務上來。帶寬的增加為流式媒體的發展鋪平了道路，而高效的視頻壓縮標準的出臺則是流媒體技術發展的關鍵。H.264/AVC是由國際電信聯合會和國際標準化組織共同發展的下一代視頻壓縮標準之一。新標準中采用了新的視頻壓縮技術，如多模式幀間預測、1/4像素精度預測、整數DCT變換、變塊尺寸運動補償、基于上下文的二元算術編碼(CABAC)、基于上下文的變長編碼(CAVLC)等等，這些技術的采用大大提高了視頻壓縮的效率，更有利于寬帶網絡數字電視(IPTV)、流媒體等基于傳輸的業務的實現。 本文主要根據視頻會議應用的需要對JM8.6代碼進行優化，目標是實現基于Baseline的低復雜度的CIF編碼器，并對部分功能模塊進行電路設計。在設計方法上采用自頂向下的設計方法，首先對H.264編碼器的C代碼和算法進行優化，并對優化后的結果進行測試比較，結果顯示在圖像質量沒有明顯降低的情況下，H.264編碼器編碼CIF格式視頻每秒達到15幀以上，滿足了視頻會議應用的實時性要求。然后，以C模型為參考對H.264編碼器的部分功能模塊電路進行設計。采用Verilog HDL實現了這些模塊，并在Quartus Ⅱ中進行了綜合、仿真、驗證。主要完成了Zig-zag掃描和CAVLC模塊的設計，詳細說明模塊的工作原理和過程，然后進行多組的仿真測試，結果與C模型相應部分的結果一致，證明了設計的正確性。
上傳時間： 2013-06-11
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超寬帶沖激雷達是一種新體制雷達，其發射信號是無高頻載頻，寬度僅為納秒級的沖激脈沖。得益于這種特殊的發射信號，超寬帶沖激雷達具有優異的探測性能和廣泛的應用前景。自然地，對于發射機的研究，在超寬帶沖激雷達研究領域有著極其重要的地位。本文在超寬帶沖激雷達實驗系統的基礎上，對其發射機進行了深入研究，主要內容如下： 1、介紹了超寬帶沖激雷達發射機，尤其是脈沖源的原理及設計。 2、分析了決定超寬帶沖激雷達探測距離的因素。在此基礎上尋求通過提高發射信號脈沖重復頻率來增大發射機的能量輸出；提出了一種提高脈沖重復頻率的方法。設計了基于現場可編程門陣列的延時控制電路，對提高脈沖重復頻率予以工程實現。 3、提出了超寬帶沖激雷達波束掃描的實現方法：通過精密控制各發射機脈沖源觸發時間，在各路發射信號之間產生一定的延時。設計了運用現場可編程門陣列實現這種控制的精密延時電路。
上傳時間： 2013-08-05
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H-JTAG USB仿真器是一款高速USB接口仿真器。仿真器采用USB接口供電，無需外接電源。支持10K~15MHZ的JTAG時鐘,，可提供最高可達750 KB/S的下載速度與最高可達550 KB/S讀取速度。與H-JTAG/H-FLASHER配合使用，可以實現高速調試與下載。該仿真器靈活，高效，穩定性好，能夠全面滿足用戶的需求
標簽： H-JTAG
上傳時間： 2013-04-24
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