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在線維護(hù)

  • JTAG邊界掃描在FPGA中的應(yīng)用及電路設(shè)計

    邊界掃描技術(shù)是一種應(yīng)用于數(shù)字集成電路器件的標(biāo)準(zhǔn)化可測試性設(shè)計方法,它提供了對電路板上元件的功能、互連及相互間影響進(jìn)行測試的一種新方案,極大地方便了系統(tǒng)電路的測試。本文基于IEEE 1149.1標(biāo)準(zhǔn)剖析了JTAG邊界掃描測試的精髓,分析了其組成,功能與時序控制等關(guān)鍵技術(shù)。 應(yīng)用在FPGA芯片中的邊界掃描電路側(cè)重于電路板級測試,兼顧芯片功能測試,同時提供JTAG下載方式。針對在FPGA芯片中的應(yīng)用特點,設(shè)計了一種邊界掃描電路,應(yīng)用于自行設(shè)計的FPGA結(jié)構(gòu)之中。除了基本的測試功能外,加入了對FPGA芯片進(jìn)行配置、回讀以及用戶自定義測試等功能。 通過仿真驗證,所設(shè)計的邊界掃描電路可實現(xiàn)FPGA芯片的測試、配置和回讀等功能,并符合IEEE 11491.1邊界掃描標(biāo)準(zhǔn)的規(guī)定,達(dá)到設(shè)計要求。

    標(biāo)簽: JTAG FPGA 邊界掃描 中的應(yīng)用

    上傳時間: 2013-04-24

    上傳用戶:372825274

  • 高速FIR數(shù)字濾波器在FPGA上的實現(xiàn)

    常用的實時數(shù)字信號處理的器件有可編程的數(shù)字信號處理(DSP)芯片(如AD系列、TI系列)、專用集成電路(ASIC)、現(xiàn)場可編程門陣列(FPGA)等。在工程實踐中,往往要求對信號處理要有高速性、實時性和靈活性,而已有的一些軟件和硬件實現(xiàn)方式則難以同時達(dá)到這幾方面的要求。隨著可編程邏輯器件和EDA技術(shù)的發(fā)展,使用FPGA來實現(xiàn)數(shù)字信號處理,既具有實時性,又兼顧了一定的靈活性。FPGA具有的靈活的可編程邏輯可以方便的實現(xiàn)高速數(shù)字信號處理,突破了并行處理、流水級數(shù)的限制,有效地利用了片上資源,加上反復(fù)的可編程能力,越來越受到國內(nèi)外從事數(shù)字信號處理的研究者所青睞。 FIR數(shù)字濾波器以其良好的線性特性被廣泛使用,屬于數(shù)字信號處理的基本模塊之一。本論文對基于FPGA的FIR數(shù)字濾波器實現(xiàn)進(jìn)行了研究,所做的主要工作如下: 1.介紹了FIR數(shù)字濾波器的基本理論和FPGA的基本概況,以及FPGA設(shè)計流程、設(shè)計指導(dǎo)原則和常用的設(shè)計指導(dǎo)思想與技巧。 2.以FIR數(shù)字濾波器的基本理論為依據(jù),使用分布式算法為濾波器的硬件實現(xiàn)算法,并對其進(jìn)行了詳細(xì)的討論。針對分布式算法中查找表規(guī)模過大的缺點,采用優(yōu)化分布式算法的多塊查找表方式使得硬件規(guī)模極大的減小。 3.設(shè)計出一個192階的FIR濾波器實例。其系統(tǒng)要求為:定點16位輸入、定點12位系數(shù)、定點16位輸出,采樣率為75MHz。設(shè)計用Quartus II軟件進(jìn)行仿真,并將其仿真結(jié)果與Matlab仿真結(jié)果進(jìn)行對比分析。 仿真結(jié)果表明,本論文設(shè)計的濾波器硬件規(guī)模較小,采樣率達(dá)到了75MHz。同時只要將查找表進(jìn)行相應(yīng)的改動,就能分別實現(xiàn)低通、高通、帶通FIR濾波器,體現(xiàn)了設(shè)計的靈活性。

    標(biāo)簽: FPGA FIR 數(shù)字濾波器

    上傳時間: 2013-06-06

    上傳用戶:June

  • 單片機(jī)在鍋爐溫度控制系統(tǒng)中的應(yīng)用

    本文介紹了單片機(jī)在鍋爐溫度控制上的應(yīng)用,主要是以87C51 單片機(jī)作為控制器核心,結(jié)合溫度傳感變送器、A/D 轉(zhuǎn)換器、LED 顯示器、D/A 轉(zhuǎn)換器,模擬多路開關(guān)等,組成一個八通道的鍋爐溫度控

    標(biāo)簽: 單片機(jī) 中的應(yīng)用 鍋爐 溫度控制系統(tǒng)

    上傳時間: 2013-04-24

    上傳用戶:x4587

  • 在VB下PC機(jī)與MCS.doc

    簡介 探討了在PC機(jī)中用Visual Basic下的Microsoft Comm control控件與使用C51編程的MCS\ 51單片機(jī)之間的串行通信的方法,以及在VB中怎樣處理二進(jìn)制碼,并給出了演示程序和通信協(xié)議。

    標(biāo)簽: MCS PC機(jī)

    上傳時間: 2013-04-24

    上傳用戶:18752787361

  • FPGA在硬盤加密卡中的應(yīng)用與研究

    隨著我國信息化發(fā)展進(jìn)程加快,信息化覆蓋面擴(kuò)大,信息安全問題也就隨之增多,其影響和后果也更加廣泛和嚴(yán)重。同時,信息安全及其對經(jīng)濟(jì)發(fā)展、國家安全和社會穩(wěn)定的重大影響,正日益突出地顯現(xiàn)出來,受到越來越多的關(guān)注。在和平年代,通過對信息載體進(jìn)行大規(guī)模的物理破壞,從而達(dá)到危害信息安全的目的,在一定程度上是行不通的。然而,在信息安全的角力上,破壞者從來都沒有放棄過,他們把目標(biāo)對準(zhǔn)了信息載體中的數(shù)據(jù),由于數(shù)據(jù)的易失性,計算機(jī)數(shù)據(jù)成為信息安全中的最大隱患,同時也是破壞信息安全的一個突破口。 本文提出研制硬盤加密卡的主要目的是為了防止對計算機(jī)數(shù)據(jù)的竊取,保護(hù)硬盤中的數(shù)據(jù)。破壞者在得到硬盤后,也不能夠得到硬盤中的數(shù)據(jù),從而達(dá)到保護(hù)信息安全的目的。加密卡提供兩個符合ATA-6標(biāo)準(zhǔn)的接口,串接在主板IDE接口和硬盤之間。存儲在硬盤上的數(shù)據(jù),是經(jīng)過加密以后的加密數(shù)據(jù);從硬盤上讀出的數(shù)據(jù),必須經(jīng)過該卡的解密才可被正常使用,否則只是一堆亂碼。加密卡采用FPGA技術(shù)實現(xiàn)IDE接口和加密算法,以減小加解密帶來的速度上的影響。 論文的工作重點主要有以下幾個方面的內(nèi)容:FPGA及VHDL語言的研究,ATA協(xié)議標(biāo)準(zhǔn)研究及IDE接口的FPGA實現(xiàn)。論文對ATA協(xié)議做了細(xì)致的研究,分析了硬盤接口的工作機(jī)制以及主機(jī)與硬盤之間的通信協(xié)議,并在此基礎(chǔ)上,重點研究了用FPGA的編程功能來實現(xiàn)一個計算機(jī)硬件底層接口協(xié)議的方法,詳細(xì)介紹了芯片的內(nèi)部框圖及FPGA的軟件流程圖,提出了在實現(xiàn)過程中應(yīng)注意的要點,最終用FPGA構(gòu)建了一個雙向IDE硬盤通道,實現(xiàn)了兩套符合ATA-6規(guī)范的IDE接口。

    標(biāo)簽: FPGA 硬盤 加密卡 中的應(yīng)用

    上傳時間: 2013-08-02

    上傳用戶:Ants

  • 精密延時電路在UWB雷達(dá)發(fā)射機(jī)

    超寬帶沖激雷達(dá)是一種新體制雷達(dá),其發(fā)射信號是無高頻載頻,寬度僅為納秒級的沖激脈沖。得益于這種特殊的發(fā)射信號,超寬帶沖激雷達(dá)具有優(yōu)異的探測性能和廣泛的應(yīng)用前景。自然地,對于發(fā)射機(jī)的研究,在超寬帶沖激雷達(dá)研究領(lǐng)域有著極其重要的地位。本文在超寬帶沖激雷達(dá)實驗系統(tǒng)的基礎(chǔ)上,對其發(fā)射機(jī)進(jìn)行了深入研究,主要內(nèi)容如下: 1、介紹了超寬帶沖激雷達(dá)發(fā)射機(jī),尤其是脈沖源的原理及設(shè)計。 2、分析了決定超寬帶沖激雷達(dá)探測距離的因素。在此基礎(chǔ)上尋求通過提高發(fā)射信號脈沖重復(fù)頻率來增大發(fā)射機(jī)的能量輸出;提出了一種提高脈沖重復(fù)頻率的方法。設(shè)計了基于現(xiàn)場可編程門陣列的延時控制電路,對提高脈沖重復(fù)頻率予以工程實現(xiàn)。 3、提出了超寬帶沖激雷達(dá)波束掃描的實現(xiàn)方法:通過精密控制各發(fā)射機(jī)脈沖源觸發(fā)時間,在各路發(fā)射信號之間產(chǎn)生一定的延時。設(shè)計了運用現(xiàn)場可編程門陣列實現(xiàn)這種控制的精密延時電路。

    標(biāo)簽: UWB 精密 延時電路 雷達(dá)發(fā)射機(jī)

    上傳時間: 2013-08-05

    上傳用戶:564708051@qq.com

  • STM32在RVMDK中入門講解之安裝目錄說明

    cortex在rvmdk中設(shè)置方式,及STM32在RVMDK中入門講解之開發(fā)環(huán)境的建立

    標(biāo)簽: RVMDK STM 32 目錄

    上傳時間: 2013-06-10

    上傳用戶:sh19831212

  • 教你如何在orcad設(shè)計原理圖怎樣在powerpcb中生成PCB的步驟及方法

    教你如何在orcad設(shè)計原理圖怎樣在powerpcb中生成PCB的步驟及方法

    標(biāo)簽: powerpcb orcad PCB 設(shè)計原理

    上傳時間: 2013-07-05

    上傳用戶:huyanju

  • 在PC上用并行口模擬I2C總線的C源代碼

    在微機(jī)上模擬I2C總線的設(shè)計,用并行口的D0(PIN2)模擬SCL信號,用D1(PIN3)模擬SDA信號。

    標(biāo)簽: I2C 并行口 模擬 總線

    上傳時間: 2013-07-14

    上傳用戶:xuanchangri

  • FPGA在數(shù)字信號處理中的應(yīng)用與研究

    數(shù)字信號處理是信息科學(xué)中近幾十年來發(fā)展最為迅速的學(xué)科之一.目前,數(shù)字信號處理廣泛應(yīng)用于通信、雷達(dá)、聲納、語音與圖像處理等領(lǐng)域.而數(shù)字信號處理算法的硬件實現(xiàn)一般來講有三種方式:用于通用目的的可編程DSP芯片;用于特定目的的固定功能DSP芯片組和ASIC;可以由用戶編程的FPGA芯片.隨著微電子技術(shù)的發(fā)展,采用現(xiàn)場可編程門陣列FPGA進(jìn)行數(shù)字信號處理得到了飛速發(fā)展,FPGA正在越來越多地代替ASIC和PDSP用作前端數(shù)字信號處理的運算.該文主要探討了基于FPGA數(shù)字信號處理的實現(xiàn).首先詳細(xì)闡述了數(shù)字信號處理的理論基礎(chǔ),重點討論了離散傅立葉變換算法原理,由于快速傅立葉變換算法在實際中得到了廣泛的應(yīng)用,該文給出了基-2FFT算法原理、討論了按時間抽取FFT算法的特點.該論文對硬件描述語言的描述方法和風(fēng)格做了一定的探討,介紹了硬件描述語言的開發(fā)環(huán)境MAXPLUSII.在此基礎(chǔ)上,該論文詳細(xì)闡述了數(shù)字集成系統(tǒng)的高層次設(shè)計方法,討論了數(shù)字系統(tǒng)設(shè)計層次的劃分和數(shù)字系統(tǒng)的自頂向下的設(shè)計方法,探討了數(shù)字集成系統(tǒng)的系統(tǒng)級設(shè)計和寄存器傳輸級設(shè)計,描述了數(shù)字集成系統(tǒng)的高層次綜合方法.最后該文描述了數(shù)字信號處理系統(tǒng)結(jié)構(gòu)的實現(xiàn)方法,指出常見的高速、實時信號處理系統(tǒng)的四種結(jié)構(gòu);由于FFT算法在數(shù)字信號處理中占有重要的地位,所以該文提出了用FPGA實現(xiàn)FFT的一種設(shè)計思想,給出了總體實現(xiàn)框圖;重點設(shè)計實現(xiàn)了FFT算法中的蝶形處理單元,采用了一種高效乘法器算法設(shè)計實現(xiàn)了蝶形處理單元中的旋轉(zhuǎn)因子乘法器,從而提高了蝶形處理器的運算速度,降低了運算復(fù)雜度.

    標(biāo)簽: FPGA 數(shù)字信號處理 中的應(yīng)用

    上傳時間: 2013-05-23

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