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本文從AES的算法原理和基于ARM核嵌入式系統的開發著手，研究了AES算法的設計原則、數學知識、整體結構、算法描述以及AES存住的優點利局限性。 針對ARM核的體系結構及特點，對AES算法進行了優化設計，提出了從AES算法本身和其結構兩個方面進行優化的方法，在算法本身優化方面是把加密模塊中的字節替換運算、列混合運算和解密模塊中的逆列混合運算中原來的復雜的運算分別轉換為簡單的循環移位、乘和異或運算。在算法結構優化方面是在輸入輸山接口上采用了4個32位的寄存器對128bits數據進行了并行輸入并行輸出的優化設計；在密鑰擴展上的優化設計是采用內部擴展，即在進行每一輪的運算過程的同時算出下一輪的密鑰，并把下一輪的密鑰暫存在SRAM里，使得密鑰擴展與加/解密運算并行執行；加密和解密優化設計是將輪函數查表操作中的四個操作表查詢工作合并成一個操作表查詢工作，同時為了使加密代碼在解密代碼中可重用，節省硬件資源，在解密過程中采用了與加密相一致的過程順序。 根據上述的優化設計，基于ARM核嵌入式系統的ADS開發環境，提出了AES實現的軟硬件方案、AES加密模塊和解密模塊的實現方案以及測試方案，總結了基于ARM下的高效編程技巧及混合接口規則，在集成開發環境下對算法進行了實現，分別得出了初始密鑰為128bits、192bits和256bits下的加密與解密的結果，并得劍了正確驗證。在性能測試的過程中應用編譯器的優化選項和其它優化技巧優化了算法，使算法具有較高的加密速度。
標簽： ARM AES 嵌入式系統 算法優化
上傳時間： 2013-04-24
上傳用戶：liansi
隨著現場可編程門陣列(FPGA)在工業中的廣泛應用，使得基于FPGA數字信號處理的實現在雷達信號處理中有著重要地位。模型化設計是一種自頂向下的面向FPGA的快速原型驗證法，它不僅降低了FPGA設計門檻，而且縮短了開發周期，提高了設計效率。這使得FPGA模型化設計成為了FPGA系統設計的發展趨勢。本文針對常見雷達信號處理模塊的FPGA模型化實現，在以下幾個方面展開研究：首先對基于FPGA的模型化設計方法進行了研究，給出了模型化設計方法的發展現狀和趨勢，并對本文中使用的模型化設計方法的軟件工具System Generator和AccelDSP進行了介紹。其次使用這兩種軟件工具對FIR濾波器進行了模型化設計并同RTL(寄存器傳輸級)設計方法進行對比，全面分析了模型化設計方法和RTL設計方法的優缺點。然后在簡明闡述雷達信號處理原理的基礎上，使用System Generator對數字下變頻(DDC)、脈沖壓縮、動目標顯示(MTI)及恒虛警(CFAR)處理等雷達信號處理模塊進行了自頂向下的模型化設計。在Simulink中進行了功能仿真驗證，生成了HDL代碼，并在Xilinx FPGA中進行了RTL的時序仿真分析。關鍵詞：雷達信號處理 FPGA 模型化設計 System Generator AccelDSP
標簽： FPGA 模型 雷達信號
上傳時間： 2013-07-25
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·基于TMS320C5402芯片DSK平臺的諧波測量與分析
標簽： C5402 320C 5402 TMS
上傳時間： 2013-06-17
上傳用戶：gundamwzc
·詳細說明：使用凌陽單片機的多命令語音識別范例- The use insults the positive monolithic integrated circuit the multi- orders speech recognition model 文件列表: Recognise_SD ............\bsrSD.h ............\
標簽： 凌陽單片機 命令 語音識別 范例
上傳用戶：moshushi0009
·基于Opencv與VC環境的視頻采集圖像濾波與角點檢測運動跟蹤
標簽： Opencv VC環境 視頻采集 圖像濾波
上傳用戶：gengxiaochao
基于FPGA數字頻率計的實現，文中有所有的源代碼，僅供參考。
標簽： FPGA 數字頻率計
上傳時間： 2013-08-05
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基于FPGA流水線CPU控制器的設計與實現：在FPGA上設計并實現了一種具有MIPS風格的CPU硬布線控制器。
標簽： FPGA CPU MIPS 控制器
上傳時間： 2013-08-06
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基于Altium Designer 6.0的FPGA開發
標簽： Designer Altium FPGA 6.0
上傳時間： 2013-08-08
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VHDL 基于FPGA 和VGA 接口的應用設計
標簽： VHDL FPGA VGA 接口
上傳時間： 2013-08-09
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大型設計中FPGA的多時鐘設計策略,希望有需要的人喜歡
標簽： FPGA 大型 多時鐘 策略
上傳時間： 2013-08-14
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