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多任務(wù)處理

  • 基于FPGA的視頻圖像畫面分割器的設(shè)計(jì)

      系統(tǒng)結(jié)構(gòu)如 圖 1所示 , 從 系統(tǒng) 結(jié) 構(gòu)圖可 以看 出 , 系統(tǒng)主要包括視頻信 號輸入模塊 , 視頻信號處 理模 塊和視頻信號輸出模塊等 3個(gè)部分組成。各個(gè)模塊主要功能為: 視頻輸入模塊 將 采 集 的 多路 視 頻 信 號 轉(zhuǎn) 換成 數(shù) 字 信 號 送 到F P GA; 視頻處理模塊主要有F P GA 完成 ,根據(jù) 需要 對輸入 的數(shù)字視頻信號進(jìn)行處理 ; 視頻輸 出模塊將 F P GA處理后的信號轉(zhuǎn)換成模擬信號輸出到顯示器。

    標(biāo)簽: FPGA 視頻圖像 畫面分割器

    上傳時(shí)間: 2013-11-09

    上傳用戶:xiaoyunyun

  • 怎樣使用Nios II處理器來構(gòu)建多處理器系統(tǒng)

    怎樣使用Nios II處理器來構(gòu)建多處理器系統(tǒng) Chapter 1. Creating Multiprocessor Nios II Systems Introduction to Nios II Multiprocessor Systems . . . . . . . . . . . . . . 1–1 Benefits of Hierarchical Multiprocessor Systems  . . . . . . . . . . . . . . . 1–2 Nios II Multiprocessor Systems . . . . . . . . . . . . . . . . . . . .  . . . . . . . . . . . . . 1–2 Multiprocessor Tutorial Prerequisites   . . . . . . . . . . .  . . . . . . . . . . . . 1–3 Hardware Designs for Peripheral Sharing   . . . . . . . . . . . .. . . . . . . . 1–3 Autonomous Multiprocessors   . . . . . . . . . . . . . . . . . . . . . .  . . . . . . . 1–3 Multiprocessors that Share Peripherals . . . . . . . . . . . . . . . . . . . . . . 1–4 Sharing Peripherals in a Multiprocessor System   . . . . . . . . . . . . . . . . . 1–4 Sharing Memory  . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1–6 The Hardware Mutex Core  . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .  . . . . 1–7 Sharing Peripherals   . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .. . . . . . 1–8 Overlapping Address Space  . . . . . . . . . . . . . . . . . . . . . . . . . . . .  . . . . 1–8 Software Design Considerations for Multiple Processors . . .. . . . . 1–9 Program Memory  . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1–9 Boot Addresses  . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .. 1–13 Debugging Nios II Multiprocessor Designs  . . . . . . . . . . . . . . . .  1–15 Design Example: The Dining Philosophers’ Problem   . . . . .. . . 1–15 Hardware and Software Requirements . . . . . . . . . . . . . . . .. . . 1–16 Installation Notes  . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1–17 Creating the Hardware System   . . . . . . . . . . . . . . .. . . . . . 1–17 Getting Started with the multiprocessor_tutorial_start Design Example   1–17 Viewing a Philosopher System   . . . . . . . . . . . . . . . . . . . . . . . . . . . .  . . 1–18 Philosopher System Pipeline Bridges  . . . . . . . . . . . . . . . . . . . . . 1–19 Adding Philosopher Subsystems   . . . . . . . . . . . . . . . . . . . . . .  . . . . 1–21 Connecting the Philosopher Subsystems  . . . . . . . . . . . . .. . . . . 1–22 Viewing the Complete System . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1–27 Generating and Compiling the System   . . . . . . . . . . . . . . . . . .. 1–28

    標(biāo)簽: Nios 處理器 多處理器

    上傳時(shí)間: 2013-11-21

    上傳用戶:lo25643

  • 基于FPGA的多功能多路舵機(jī)控制器的實(shí)現(xiàn)

    伺服舵機(jī)作為基本的輸出執(zhí)行機(jī)構(gòu)廣泛應(yīng)用于 遙控航模以及人形機(jī)器人的控制中。舵機(jī)是一種位 置伺服的驅(qū)動(dòng)器,其控制信號是PWM信號.,利 用占空比的變化改變舵機(jī)的位置,也可使用FPGA、 模擬電路、單片機(jī)來產(chǎn)生舵機(jī)的控制信號舊。應(yīng) 用模擬電路產(chǎn)生PWM信號,應(yīng)用的元器件較多, 會(huì)增加電路的復(fù)雜程度;若用單片機(jī)產(chǎn)生PWM信 號,當(dāng)信號路數(shù)較少時(shí)單片機(jī)能滿足要求,但當(dāng) PWM信號多于4路時(shí),由于單片機(jī)指令是順序執(zhí) 行的,會(huì)產(chǎn)生較大的延遲,從而使PWM信號波形 不穩(wěn),導(dǎo)致舵機(jī)發(fā)生顫振。

    標(biāo)簽: FPGA 多功能 多路 舵機(jī)

    上傳時(shí)間: 2013-11-20

    上傳用戶:cjh1129

  • 基于FPGA的多路視頻合成系統(tǒng)的設(shè)計(jì)

      摘 要:研究一種基于FPGA的多路視頻合成系統(tǒng)。系統(tǒng)接收16路ITU656格式的視頻數(shù)據(jù),按照畫面分割的要求對視頻數(shù)據(jù)流進(jìn)行有效抽取和幀合成處理,經(jīng)過視頻編碼芯片轉(zhuǎn)換成模擬信號輸出到顯示器,以全屏或多窗口模式顯示多路視頻畫面。系統(tǒng)利用FPGA的高速并行處理能力的優(yōu)勢,應(yīng)用靈活的的多路視頻信號的合成技術(shù)和數(shù)字圖像處理算法,實(shí)現(xiàn)實(shí)時(shí)處理多路視頻數(shù)據(jù)。

    標(biāo)簽: FPGA 多路 視頻合成

    上傳時(shí)間: 2013-11-21

    上傳用戶:pei5

  • 多層線路板設(shè)計(jì)

    多層線路板設(shè)計(jì)

    標(biāo)簽: 多層 線路板設(shè)計(jì)

    上傳時(shí)間: 2013-11-20

    上傳用戶:love1314

  • 用FPGA設(shè)計(jì)多功能數(shù)字鐘

    用FPGA設(shè)計(jì)多功能數(shù)字鐘

    標(biāo)簽: FPGA 多功能 數(shù)字

    上傳時(shí)間: 2013-10-27

    上傳用戶:ommshaggar

  • 基于DDS的多波形信號發(fā)生器設(shè)計(jì)

    基于DDS的多波形信號發(fā)生器設(shè)計(jì)

    標(biāo)簽: DDS 多波形 信號發(fā)生器

    上傳時(shí)間: 2013-10-15

    上傳用戶:zhishenglu

  • 大規(guī)模FPGA設(shè)計(jì)中的多點(diǎn)綜合技術(shù)

      本文介紹了在大規(guī)模FPGA設(shè)計(jì)中可以提高綜合效率和效果的多點(diǎn)綜合技術(shù),本文適合大規(guī)模FPGA的設(shè)計(jì)者和Synplify pro的用戶閱讀。  

    標(biāo)簽: FPGA 大規(guī)模 多點(diǎn)

    上傳時(shí)間: 2013-11-04

    上傳用戶:變形金剛

  • 基于Actel FPGA的多串口擴(kuò)展設(shè)計(jì)

    基于Actel FPGA 的多串口擴(kuò)展設(shè)計(jì)采用了Actel 公司高集成度,小體積,低功耗,低系統(tǒng)成本,高安全性和可靠性的小容量FPGA—A3P030 進(jìn)行設(shè)計(jì),把若干接口電路的功能集成到A3P030 中,實(shí)現(xiàn)了三路以上的串口擴(kuò)展。該設(shè)計(jì)靈活性高,可根據(jù)需求靈活實(shí)現(xiàn)并行總線擴(kuò)展三路UART 或者SPI 擴(kuò)展三路UART,波特率可以靈活設(shè)置。

    標(biāo)簽: Actel FPGA 多串口 擴(kuò)展設(shè)計(jì)

    上傳時(shí)間: 2013-11-03

    上傳用戶:924484786

  • AutoCAD 2008單機(jī)版安裝手冊

    本節(jié)提供了有關(guān)如何在系統(tǒng)中安裝 AutoCAD 的逐步說明。如果本章內(nèi)容包括用戶沒有從本節(jié)“快速入門”找到問題的答案,請閱讀整個(gè)《單機(jī)版安裝手冊》。■ 如何準(zhǔn)備安裝■ 如何安裝和運(yùn)行AutoCAD■ 如何安裝和啟動(dòng) CAD 管理員控制實(shí)用程序有關(guān)安裝本程序的網(wǎng)絡(luò)許可版或多套單機(jī)版的信息,請參見《網(wǎng)絡(luò)管理員手冊》。

    標(biāo)簽: AutoCAD 2008 單機(jī) 安裝手冊

    上傳時(shí)間: 2013-12-22

    上傳用戶:honyeal

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