SAR-GMTI_Range_Compression_Implementation_in_FPGAs\\r\\n\\r\\n在多FPGA陣列上實(shí)現(xiàn)SAR距離脈壓，超長(zhǎng)點(diǎn)數(shù)脈壓的FPGA實(shí)現(xiàn)
標(biāo)簽： FPGA SAR 陣列 脈壓
上傳時(shí)間： 2013-08-09
上傳用戶：13160677563
在測(cè)控系統(tǒng)中用IP核實(shí)現(xiàn)DA轉(zhuǎn)換.doc
標(biāo)簽： 測(cè)控系統(tǒng) IP核 DA轉(zhuǎn)換
上傳時(shí)間： 2013-08-13
上傳用戶：13736136189
大型設(shè)計(jì)中FPGA的多時(shí)鐘設(shè)計(jì)策略,希望有需要的人喜歡
標(biāo)簽： FPGA 大型 多時(shí)鐘 策略
上傳時(shí)間： 2013-08-14
上傳用戶：zhichenglu
采用Altera公司的FPGA芯片，在MAX+plus II軟件平臺(tái)上實(shí)現(xiàn)多路HDLC電路
標(biāo)簽： Altera FPGA HDLC plus
上傳時(shí)間： 2013-08-16
上傳用戶：ommshaggar
多款FPGA CPLD開(kāi)發(fā)板的原理圖，很好的線路設(shè)計(jì)參考
標(biāo)簽： FPGA CPLD 開(kāi)發(fā)板 原理圖
上傳時(shí)間： 2013-08-18
上傳用戶：shanml
基于FPGA的多功能數(shù)字鐘的設(shè)計(jì)與實(shí)現(xiàn) 內(nèi)附有詳盡的Verilog HDL源碼，其功能主要有：時(shí)間設(shè)置，時(shí)間顯示，跑表，分頻，日期設(shè)置，日期顯示等
標(biāo)簽： Verilog FPGA HDL 多功能
上傳用戶：問(wèn)題問(wèn)題
PROTUES中簡(jiǎn)單圖片顯示,請(qǐng)多提意見(jiàn).謝謝!
標(biāo)簽： PROTUES
上傳時(shí)間： 2013-08-20
上傳用戶：wawjj
多路18b20測(cè)溫顯示系統(tǒng),可同時(shí)測(cè)量n個(gè)第三18b20
標(biāo)簽： 18b20 多路 測(cè)溫 顯示系統(tǒng)
上傳時(shí)間： 2013-08-21
上傳用戶：zhangchu0807
用NiosII軟核配置FPGA的C語(yǔ)言源程序，比較經(jīng)典，我用一年了，時(shí)序不需更改
標(biāo)簽： NiosII FPGA C語(yǔ)言 軟核
上傳用戶：qq521
關(guān)于FPGA的設(shè)計(jì)方面的諸多經(jīng)驗(yàn)總結(jié)，討論了設(shè)計(jì)方面應(yīng)該注意的問(wèn)題。
標(biāo)簽： FPGA 方面 經(jīng)驗(yàn)
上傳用戶：onewq
蟲(chóng)蟲(chóng)下載站版權(quán)所有 京ICP備2021023401號(hào)-1
