此電路是我個人設計的！是一個辦公設備多紙張檢測電路！遇到一次多紙張進機就自動檢出！
上傳時間： 2013-10-22
上傳用戶：michael20
PCB設計經驗，多層PCB設計經驗。
上傳時間： 2013-10-26
上傳用戶：xinhaoshan2016
為了能實時監控無人機的狀態和提高無人機的安全可靠性，本設計利用FPGA高速率、豐富的片上資源和靈活的設計接口，設計了一套無人機多路監控系統。該監控系統具備了將處于無人機不同位置的攝像機所采集的視頻信息，傳送給地面站控制設備，并在同一臺顯示器上實現同步顯示的功能。仿真結果表明，該系統可以很好的保證監控視頻的實時性、和高清度，確保無人機完成偵查任務。
上傳時間： 2013-10-24
上傳用戶：baiom
通過對LCD1602/LCD12864顯示模塊控制時序和指令集的對比分析，利用Verilog HDL描述語言完成了多功能LCD顯示控制模塊的IP核設計．所設計的LCD顯示控制器具有很好的可移植性，只需通過端口的使能參數配置便可以驅動LCD1602/LCD12864模塊實現字符或圖形的實時顯示，并且該多功能LCD控制器的可行性也在Cyclone II系列的EP2C5T144C8 FPGA芯片上得到了很好的驗證．
上傳時間： 2015-01-01
上傳用戶：wwwwwen5
附件為天正建筑8.0單機版安裝程序，內含天正建筑8.0單機版破解文件和天正注冊機。 天正建筑8.0免費下載TArch 8采用了全新的開發技術，對軟件技術核心進行了全面的提升，特別在自定義對象核心技術方面取得了革命性突破！傳統的以自定義對象為基礎的建筑軟件每次大版本的升級都會造成文件格式不兼容，TArch8引入了動態數據擴展的技術解決方案，突破了這一限制。以這一開放性技術創新為基礎，用戶再也不需要為之后大版本升級的文件格式兼容問題而煩惱，同時，這也必將極大地促進設計行業圖紙交流問題的解決。 天正建筑8.0是為 cad 2008 而準備的 計算機輔助設計而量身定制軟件工具。是CAD更加強大。 軟件功能設計的目標定位 天正建筑8.0應用專業對象技術，在三維模型與平面圖同步完成的技術基礎上，進一步滿足建筑施工圖需要反復修改的要求。 利用天正專業對象建模的優勢，為規劃設計的日照分析提供日照分析模型(如下圖)和遮擋模型；為強制實施的建筑節能設計提供節能建筑分析模型。實現高效化、智能化、可視化始終是天正建筑CAD軟件的開發目標。 自定義對象構造專業構件 天正建筑8.0開發了一系列自定義對象表示建筑專業構件，具有使用方便、通用性強的特點。例如各種墻體構件具有完整的幾何和材質特征?？梢韵馎utoCAD的普通圖形對象一樣進行操作， 可以用夾點隨意拉伸改變幾何形狀，與門窗按相互關系智能聯動（如下圖），顯著提高編輯效率。具有舊圖轉換的文件接口，可將TArch 3以下版本天正軟件繪制的圖形文件轉換為新的對象格式，方便原有用戶的快速升級。同時提供了圖形導出命令的文件接口，可將TArch 8.0 新版本繪制的圖形導出，作為下行專業條件圖使用。
上傳時間： 2013-10-23
上傳用戶：獨孤求源
怎樣使用Nios II處理器來構建多處理器系統 Chapter 1. Creating Multiprocessor Nios II Systems Introduction to Nios II Multiprocessor Systems . . . . . . . . . . . . . . 1–1 Benefits of Hierarchical Multiprocessor Systems . . . . . . . . . . . . . . . 1–2 Nios II Multiprocessor Systems . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1–2 Multiprocessor Tutorial Prerequisites . . . . . . . . . . . . . . . . . . . . . . . 1–3 Hardware Designs for Peripheral Sharing . . . . . . . . . . . .. . . . . . . . 1–3 Autonomous Multiprocessors . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1–3 Multiprocessors that Share Peripherals . . . . . . . . . . . . . . . . . . . . . . 1–4 Sharing Peripherals in a Multiprocessor System . . . . . . . . . . . . . . . . . 1–4 Sharing Memory . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1–6 The Hardware Mutex Core . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1–7 Sharing Peripherals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .. . . . . . 1–8 Overlapping Address Space . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1–8 Software Design Considerations for Multiple Processors . . .. . . . . 1–9 Program Memory . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1–9 Boot Addresses . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .. 1–13 Debugging Nios II Multiprocessor Designs . . . . . . . . . . . . . . . . 1–15 Design Example: The Dining Philosophers’ Problem . . . . .. . . 1–15 Hardware and Software Requirements . . . . . . . . . . . . . . . .. . . 1–16 Installation Notes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1–17 Creating the Hardware System . . . . . . . . . . . . . . .. . . . . . 1–17 Getting Started with the multiprocessor_tutorial_start Design Example 1–17 Viewing a Philosopher System . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1–18 Philosopher System Pipeline Bridges . . . . . . . . . . . . . . . . . . . . . 1–19 Adding Philosopher Subsystems . . . . . . . . . . . . . . . . . . . . . . . . . . 1–21 Connecting the Philosopher Subsystems . . . . . . . . . . . . .. . . . . 1–22 Viewing the Complete System . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1–27 Generating and Compiling the System . . . . . . . . . . . . . . . . . .. 1–28
上傳時間： 2013-11-21
上傳用戶：lo25643
伺服舵機作為基本的輸出執行機構廣泛應用于 遙控航模以及人形機器人的控制中。舵機是一種位 置伺服的驅動器，其控制信號是PWM信號.，利 用占空比的變化改變舵機的位置，也可使用FPGA、 模擬電路、單片機來產生舵機的控制信號舊。應 用模擬電路產生PWM信號，應用的元器件較多， 會增加電路的復雜程度；若用單片機產生PWM信 號，當信號路數較少時單片機能滿足要求，但當 PWM信號多于4路時，由于單片機指令是順序執 行的，會產生較大的延遲，從而使PWM信號波形 不穩，導致舵機發生顫振。
上傳時間： 2013-11-20
上傳用戶：cjh1129
摘 要：研究一種基于FPGA的多路視頻合成系統。系統接收16路ITU656格式的視頻數據，按照畫面分割的要求對視頻數據流進行有效抽取和幀合成處理，經過視頻編碼芯片轉換成模擬信號輸出到顯示器，以全屏或多窗口模式顯示多路視頻畫面。系統利用FPGA的高速并行處理能力的優勢，應用靈活的的多路視頻信號的合成技術和數字圖像處理算法，實現實時處理多路視頻數據。
上傳時間： 2013-11-21
上傳用戶：pei5
七天玩轉Altera：學習FPGA必經之路包括基礎篇、時序篇和驗證篇三個部分。
上傳時間： 2013-11-13
上傳用戶：yyyyyyyyyy
多層線路板設計
上傳時間： 2013-11-20
上傳用戶：love1314
