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多媒體教學(xué)(xué)

  • 基于FPGA實(shí)現(xiàn)數(shù)控步進(jìn)電機(jī)多軸連動(dòng)

    數(shù)控系統(tǒng)在工礦領(lǐng)域已得到廣泛應(yīng)用,計(jì)算機(jī)數(shù)控系統(tǒng)通過對(duì)數(shù)字化信息的處理和運(yùn)算,并轉(zhuǎn)化成脈沖信號(hào),實(shí)現(xiàn)對(duì)步進(jìn)電機(jī)的控制,進(jìn)而控制數(shù)控機(jī)床動(dòng)作和零件加工。隨著嵌入式技術(shù)的發(fā)展,我們可以設(shè)計(jì)規(guī)模更小,成本更低,功能更特定的嵌入式系統(tǒng)來(lái)完成傳統(tǒng)計(jì)算機(jī)數(shù)控系統(tǒng)所完成的工作。 步進(jìn)電機(jī)以其精度高、控制靈活、定位準(zhǔn)確、起停迅速、工作可靠、能直接接受數(shù)字信號(hào)的特點(diǎn),成為數(shù)控系統(tǒng)中的重要執(zhí)行部件。然而根據(jù)步進(jìn)電機(jī)的特性,必須要采取適當(dāng)而有效的升降速控制策略,特別是在多電機(jī)連動(dòng)的系統(tǒng)中,對(duì)多個(gè)電機(jī)連動(dòng)的速度控制和脈沖分配也很值得研究。在本文中作者將介紹一種三軸連動(dòng)的速度控制和脈沖分配的優(yōu)化算法,以及其在基于FPGA和ARM配合的高速數(shù)控雕刻機(jī)控制系統(tǒng)中的實(shí)現(xiàn)。 在本文中還可以看見,為了減小本系統(tǒng)中主控MCU的壓力,作者還將利用FPGA來(lái)設(shè)計(jì)一個(gè)針對(duì)多電機(jī)連動(dòng)的速度控制和脈沖分配優(yōu)化算法的外圍定制控制器。 最終實(shí)驗(yàn)結(jié)果表明,作者所提出的優(yōu)化算法及其在本系統(tǒng)的實(shí)現(xiàn)方案,完全達(dá)到客戶所提出的高速數(shù)控雕刻機(jī)控制系統(tǒng)的各項(xiàng)設(shè)計(jì)性能指標(biāo)。

    標(biāo)簽: FPGA 數(shù)控 步進(jìn)電機(jī)

    上傳時(shí)間: 2013-07-02

    上傳用戶:dreamboy36

  • 基于DSP/FPGA的多波形數(shù)字脈沖壓縮系統(tǒng)硬件的研究與實(shí)現(xiàn)

    現(xiàn)代雷達(dá)系統(tǒng)廣泛采用脈沖壓縮技術(shù),用以解決作用距離與分辨能力之間的矛盾。脈沖壓縮是指雷達(dá)通過發(fā)射寬脈沖,保證足夠的最大作用距離,而接收時(shí),采用相應(yīng)的脈沖壓縮法獲得窄脈沖以提高距離分辨率的過程。同時(shí),數(shù)字信號(hào)處理技術(shù)的迅猛發(fā)展和廣泛應(yīng)用,為雷達(dá)脈沖壓縮處理的數(shù)字化實(shí)現(xiàn)提供了可能。 本文主要研究雷達(dá)多波形頻域數(shù)字脈沖壓縮系統(tǒng)的硬件系統(tǒng)實(shí)現(xiàn)。在匹配濾波理論的指導(dǎo)下,成功研制了基于FPGAEP1K100QC208-1和4片高性能ADSP21160M的多波形頻域數(shù)字脈沖壓縮系統(tǒng)。該系統(tǒng)可處理時(shí)寬在42μs以內(nèi)、帶寬在5MHz以下的線性調(diào)頻信號(hào)(LFM),非線性調(diào)頻信號(hào)(NLFM)和Taylor四相碼信號(hào),且技術(shù)指標(biāo)完全滿足實(shí)用系統(tǒng)的設(shè)計(jì)要求。 本文完成的主要工作和創(chuàng)新之處有:(1)基于雙通道模數(shù)轉(zhuǎn)換器AD10242設(shè)計(jì)高精度數(shù)據(jù)采集電路,為整個(gè)脈壓系統(tǒng)的工作提供必要的條件。完成了前端模擬信號(hào)輸入電路的優(yōu)化和差分輸入時(shí)鐘的產(chǎn)生,以實(shí)現(xiàn)高精度采樣。 (2)根據(jù)協(xié)議和脈壓系統(tǒng)的工作要求,以基于FPGAEP1K100QC208完成系統(tǒng)控制,使整個(gè)脈壓系統(tǒng)正確穩(wěn)定地工作。同時(shí)以該FPGA生成雙口RAM,實(shí)現(xiàn)數(shù)據(jù)暫存,以匹配采樣速率和脈壓系統(tǒng)頻率。 (3)設(shè)計(jì)基于4片高性能ADSP21160M的緊耦合并行處理系統(tǒng),以完成多波形頻域數(shù)字脈沖壓縮的全部運(yùn)算工作。4片DSP共享外部總線,且各DSP以鏈路口互連,進(jìn)行數(shù)據(jù)通信。各DSP還使用一個(gè)鏈路口連接到接口板DSP,將脈壓結(jié)果送出。 (4)以一片ADSP21160M和一片EP1K100QC208為核心,設(shè)計(jì)輸出板電路,完成數(shù)據(jù)對(duì)齊、求模和數(shù)據(jù)向下一級(jí)的輸出,并產(chǎn)生模擬輸出。 (5)調(diào)試并改進(jìn)處理板和輸出板。

    標(biāo)簽: FPGA DSP 多波形 壓縮系統(tǒng)

    上傳時(shí)間: 2013-06-11

    上傳用戶:qq277541717

  • 基于WEB實(shí)現(xiàn)FPGA的遠(yuǎn)程多路數(shù)據(jù)采集系統(tǒng)

      本文首先研究了常規(guī)的數(shù)據(jù)采集的方法,針對(duì)由單片機(jī)構(gòu)成的數(shù)據(jù)采集系統(tǒng)數(shù)據(jù)處理能力弱的問題提出了基于現(xiàn)場(chǎng)可編程門陣列(FieldProgrammableGateArray,FPGA)為邏輯控制芯片對(duì)三片A/D芯片進(jìn)行控制的遠(yuǎn)程多路數(shù)據(jù)采集的解決方案。 本文利用VisualBasic編寫串口通信程序,通過串行端口向FPGA數(shù)據(jù)采集板發(fā)送數(shù)據(jù)采集的參數(shù)指令,FPGA數(shù)據(jù)采集板接受指令后進(jìn)行現(xiàn)場(chǎng)數(shù)據(jù)采集,并通過串行通信將數(shù)據(jù)發(fā)送到PC機(jī),在通信過程中完全遵守RS-232協(xié)議,具有較強(qiáng)的通用性和推廣價(jià)值。然后本文重點(diǎn)介紹了該采集系統(tǒng)的硬件設(shè)計(jì)原理和軟件設(shè)計(jì)框架,實(shí)現(xiàn)實(shí)時(shí)嵌入式微機(jī)數(shù)據(jù)采集系統(tǒng)的軟件和硬件設(shè)計(jì)方法,將部分軟件的功能改由硬件實(shí)現(xiàn),從邏輯上大大簡(jiǎn)化了嵌入式軟件的設(shè)計(jì)。

    標(biāo)簽: FPGA WEB 遠(yuǎn)程 多路數(shù)據(jù)采集

    上傳時(shí)間: 2013-04-24

    上傳用戶:yaohe123

  • 基于WEB實(shí)現(xiàn)FPGA的遠(yuǎn)程多路數(shù)據(jù)采集系統(tǒng)

      本文首先研究了常規(guī)的數(shù)據(jù)采集的方法,針對(duì)由單片機(jī)構(gòu)成的數(shù)據(jù)采集系統(tǒng)數(shù)據(jù)處理能力弱的問題提出了基于現(xiàn)場(chǎng)可編程門陣列(FieldProgrammableGateArray,FPGA)為邏輯控制芯片對(duì)三片A/D芯片進(jìn)行控制的遠(yuǎn)程多路數(shù)據(jù)采集的解決方案。 本文利用VisualBasic編寫串口通信程序,通過串行端口向FPGA數(shù)據(jù)采集板發(fā)送數(shù)據(jù)采集的參數(shù)指令,FPGA數(shù)據(jù)采集板接受指令后進(jìn)行現(xiàn)場(chǎng)數(shù)據(jù)采集,并通過串行通信將數(shù)據(jù)發(fā)送到PC機(jī),在通信過程中完全遵守RS-232協(xié)議,具有較強(qiáng)的通用性和推廣價(jià)值。然后本文重點(diǎn)介紹了該采集系統(tǒng)的硬件設(shè)計(jì)原理和軟件設(shè)計(jì)框架,實(shí)現(xiàn)實(shí)時(shí)嵌入式微機(jī)數(shù)據(jù)采集系統(tǒng)的軟件和硬件設(shè)計(jì)方法,將部分軟件的功能改由硬件實(shí)現(xiàn),從邏輯上大大簡(jiǎn)化了嵌入式軟件的設(shè)計(jì)。

    標(biāo)簽: FPGA WEB 遠(yuǎn)程 多路數(shù)據(jù)采集

    上傳時(shí)間: 2013-05-30

    上傳用戶:1193169035

  • 基于DSP和FPGA的四關(guān)節(jié)實(shí)驗(yàn)室機(jī)器人控制器的研制

    在機(jī)器人學(xué)的研究領(lǐng)域中,如何有效地提高機(jī)器人控制系統(tǒng)的控制性能始終是研究學(xué)者十分關(guān)注的一個(gè)重要內(nèi)容。在分析了工業(yè)機(jī)器人的發(fā)展歷程和機(jī)器人控制系統(tǒng)的研究現(xiàn)狀后,本論文的主要目標(biāo)是針對(duì)四關(guān)節(jié)實(shí)驗(yàn)室機(jī)器人特有的機(jī)械結(jié)構(gòu)和數(shù)學(xué)模型,建立一個(gè)新型全數(shù)字的基于DSP和FPGA的機(jī)器人位置伺服控制系統(tǒng)的軟、硬件平臺(tái),實(shí)現(xiàn)對(duì)四關(guān)節(jié)實(shí)驗(yàn)室機(jī)器人的精確控制。 本論文從實(shí)際情況出發(fā),首先分析了所研究的四關(guān)節(jié)實(shí)驗(yàn)室機(jī)器人的本體結(jié)構(gòu),并對(duì)其抽象簡(jiǎn)化得到了它的運(yùn)動(dòng)學(xué)數(shù)學(xué)模型。在明確了實(shí)現(xiàn)機(jī)器人精確位置伺服控制的控制原理后,我們對(duì)機(jī)器人控制系統(tǒng)的諸多可行性方案進(jìn)行了充分論證,并最終決定采用了三級(jí)CPU控制的控制體系結(jié)構(gòu):第一級(jí)CPU為上位計(jì)算機(jī),它實(shí)現(xiàn)對(duì)機(jī)器人的系統(tǒng)管理、協(xié)調(diào)控制以及完成機(jī)器人實(shí)時(shí)軌跡規(guī)劃等控制算法的運(yùn)算;第二級(jí)CPU為高性能的DSP處理器,它輔之以具有高速并行處理能力的FPGA芯片,實(shí)現(xiàn)了對(duì)機(jī)器人多個(gè)關(guān)節(jié)的高速并行驅(qū)動(dòng);第三級(jí)CPU為交流伺服驅(qū)動(dòng)處理器,它實(shí)現(xiàn)了機(jī)器人關(guān)節(jié)伺服電機(jī)的精確三閉環(huán)誤差驅(qū)動(dòng)控制,以及電機(jī)的故障診斷和自動(dòng)保護(hù)等功能。此外,我們采用比普通UART速度快得多的USB來(lái)實(shí)現(xiàn)上位計(jì)算機(jī).與下位控制器之間的數(shù)據(jù)通信,這樣既保證了兩者之間連接方便,又有效的提高了控制系統(tǒng)的通信速度和可靠性。 機(jī)器人系統(tǒng)的軟件設(shè)計(jì)包括兩個(gè)部分:一是采用VC++實(shí)現(xiàn)的上位監(jiān)控軟件系統(tǒng),它主要負(fù)責(zé)機(jī)器人實(shí)時(shí)軌跡規(guī)劃等控制算法的運(yùn)算,同時(shí)完成用戶與機(jī)器人系統(tǒng)之間的信息交互;二是采用C語(yǔ)言實(shí)現(xiàn)的下位DSP控制程序,它主要負(fù)責(zé)接收上位監(jiān)控系統(tǒng)或者下位控制箱發(fā)送的控制信號(hào),實(shí)現(xiàn)對(duì)機(jī)器人的實(shí)時(shí)驅(qū)動(dòng),同時(shí)還能夠?qū)崟r(shí)的向上位監(jiān)控系統(tǒng)或者下位控制箱反饋機(jī)器人的當(dāng)前狀態(tài)信息。 研究開發(fā)出來(lái)的四關(guān)節(jié)實(shí)驗(yàn)室機(jī)器人控制器具有控制實(shí)時(shí)性好、定位精度高、運(yùn)行穩(wěn)定可靠的特點(diǎn),它允許用戶通過上位控制計(jì)算機(jī)實(shí)現(xiàn)對(duì)機(jī)器人的各種設(shè)定作業(yè)的控制,也可以讓用戶通過機(jī)器人控制箱現(xiàn)場(chǎng)對(duì)機(jī)器人進(jìn)行回零、示教等各項(xiàng)操作。

    標(biāo)簽: FPGA DSP 實(shí)驗(yàn)室 機(jī)器人控制器

    上傳時(shí)間: 2013-06-11

    上傳用戶:edisonfather

  • 基于多相濾波的寬帶DDC及其FPGA實(shí)現(xiàn)

    隨著現(xiàn)代雷達(dá)技術(shù)的不斷發(fā)展,電子偵察設(shè)備面臨電磁環(huán)境日益復(fù)雜多變,發(fā)展寬帶化、數(shù)字化、多功能、軟件化的電子偵察設(shè)備已是一項(xiàng)重要的任務(wù).然而,目前的寬帶A/D與后續(xù)DSP之間的工作速率總有一到兩個(gè)數(shù)量級(jí)的差別,二者之間的瓶頸成為電子偵察系統(tǒng)數(shù)字化的最大障礙.通信領(lǐng)域軟件無(wú)線電的成功應(yīng)用為電子偵察系統(tǒng)的發(fā)展提供了一種理想模式.另一方面,微電子技術(shù)的快速發(fā)展,以及FPGA的廣泛應(yīng)用,在很大程度上影響了數(shù)字電路的設(shè)計(jì)與開發(fā).這也為解決高速A/D與DSP處理能力之間的矛盾提供了一種有效的解決方法.為了解決寬帶A/D與后續(xù)DSP之間的瓶頸問題,本文給出了一種基于多相濾波的寬帶數(shù)字下變頻結(jié)構(gòu),并從軟件無(wú)線電原理出發(fā),從理論推導(dǎo)和計(jì)算機(jī)仿真兩方面對(duì)該結(jié)構(gòu)進(jìn)行了驗(yàn)證,并進(jìn)一步給出該結(jié)構(gòu)改進(jìn)方案以及改進(jìn)的多相濾波數(shù)字下變頻結(jié)構(gòu)的硬件實(shí)現(xiàn)方法.本文將多相濾波下變頻的并行結(jié)構(gòu)應(yīng)用到數(shù)字下變頻電路中,并在后繼的混頻模塊中也采用并行混頻的方式來(lái)實(shí)現(xiàn),不僅在一定程度上解決了二者之間的瓶頸問題,同時(shí)也大大提高了實(shí)時(shí)處理速度.經(jīng)過多相濾波下變頻處理后的數(shù)據(jù),在速率和數(shù)據(jù)量上都有大幅減少,達(dá)到了現(xiàn)有通用DSP器件處理能力的要求.另外,本人還用FPGA設(shè)計(jì)了實(shí)驗(yàn)電路,利用微機(jī)串口,與實(shí)驗(yàn)?zāi)繕?biāo)板進(jìn)行控制和數(shù)據(jù)交換.利用FPGA的在線編程特性,可以方便靈活的對(duì)各種實(shí)現(xiàn)方法加以驗(yàn)證和比較.

    標(biāo)簽: FPGA DDC 多相濾波 寬帶

    上傳時(shí)間: 2013-07-13

    上傳用戶:華華123

  • 24l01 7對(duì)1 多機(jī)通信

    無(wú)線模塊24l01 7對(duì)1多機(jī)通信

    標(biāo)簽: 24l01 多機(jī)通信

    上傳時(shí)間: 2013-07-12

    上傳用戶:yaohe123

  • DSP實(shí)時(shí)多任務(wù)操作系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)

    DSP實(shí)時(shí)多任務(wù)操作系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)pdf版

    標(biāo)簽: DSP 實(shí)時(shí)多任務(wù) 操作 系統(tǒng)設(shè)計(jì)

    上傳時(shí)間: 2013-06-21

    上傳用戶:不挑食的老鼠

  • 基于ARMDSP多功能車內(nèi)語(yǔ)音終端的設(shè)計(jì)與實(shí)現(xiàn)

    隨著通信、網(wǎng)絡(luò)等技術(shù)的不斷發(fā)展,對(duì)車內(nèi)(機(jī)內(nèi))通話系統(tǒng)提出了更高的要求。本文以軍用車內(nèi)通話系統(tǒng)為主要應(yīng)用背景,實(shí)現(xiàn)對(duì)現(xiàn)有車內(nèi)通話系統(tǒng)的升級(jí)和改造,主要涉及系統(tǒng)結(jié)構(gòu)、軟件流程、相關(guān)接口及通信協(xié)議等內(nèi)容。 早期模擬車內(nèi)通話系統(tǒng)已經(jīng)不能滿足數(shù)字化建設(shè)的需要?,F(xiàn)役的數(shù)字式車內(nèi)通話系統(tǒng)普遍功能單一,不具備數(shù)據(jù)傳輸?shù)裙δ堋6蚁到y(tǒng)組成單體設(shè)備種類多、接口不統(tǒng)一、兼容性差,較難實(shí)現(xiàn)通用化設(shè)計(jì)。 本文提出一種基于ARM+DSP架構(gòu)的多功能車內(nèi)通話系統(tǒng)。主要由多個(gè)語(yǔ)音終端、一個(gè)主控盒以及頭戴通信帽等硬件組成,最大可支持車內(nèi)16個(gè)乘員之間通話,具有群呼、組呼、選呼、強(qiáng)呼、數(shù)據(jù)傳輸?shù)裙δ?,系統(tǒng)內(nèi)乘員還可以通過主控盒與車外網(wǎng)絡(luò)的用戶進(jìn)行通話或通信。 論文共分七章,主要內(nèi)容包括:(1)車內(nèi)通話系統(tǒng)的國(guó)內(nèi)外發(fā)展現(xiàn)狀和趨勢(shì);(2)語(yǔ)音終端系統(tǒng)設(shè)計(jì),包括軟硬件實(shí)現(xiàn)、通信協(xié)議等;(3)語(yǔ)音終端設(shè)計(jì)中幾個(gè)關(guān)鍵技術(shù)的分析和研究。 本文設(shè)計(jì)的語(yǔ)音終端話音質(zhì)量高,擴(kuò)展功能強(qiáng)大,成本相對(duì)低廉,除適合在軍用通信領(lǐng)域外,在商用領(lǐng)域也具有良好的市場(chǎng)前景。

    標(biāo)簽: ARMDSP 多功能 語(yǔ)音終端

    上傳時(shí)間: 2013-05-17

    上傳用戶:TF2015

  • 基于ARMLinux的多道脈沖幅度分析器數(shù)字系統(tǒng)設(shè)計(jì)

    隨著電子技術(shù)的不斷發(fā)展,各種智能核儀器逐步走向自動(dòng)化、智能化、數(shù)字化和便攜式的方向發(fā)展。針對(duì)傳統(tǒng)的多道脈沖幅度分析器體積大,人機(jī)交互不友好,不方便現(xiàn)場(chǎng)分析等的缺陷[5]。新型的高速、集成度高、界面友好的多道脈沖幅度分析器的陸續(xù)出現(xiàn)填補(bǔ)了這一缺點(diǎn)。 隨著電子技術(shù)的發(fā)展,以ARM為核的處理器技術(shù)的應(yīng)用領(lǐng)域不斷擴(kuò)大,相比較單片機(jī)而言,它的主頻高、運(yùn)算速度快,可以滿足多道脈沖幅度分析器的苛刻的時(shí)間上的要求。而且ARM處理器功耗小,適合于功耗要求比較苛刻的地方,這些方面的特點(diǎn)正好滿足了便攜式多道脈沖幅度分析器野外勘察的要求。同時(shí),由于以ARM為核的處理器具有豐富的外設(shè)資源,這樣就簡(jiǎn)化了外設(shè)電路及芯片的使用,降低了功耗并增強(qiáng)了產(chǎn)品的信賴性。另外,ARM芯片可以方便的移植操作系統(tǒng),為多道脈沖幅度分析器多任務(wù)的管理和并行的處理,甚至硬實(shí)時(shí)功能的實(shí)現(xiàn)提供了前提。而且在ARM平臺(tái)使用嵌入式linux操作系統(tǒng)使多道脈沖幅度分析器的軟件易于升級(jí)。 智能化和小型化是多道脈沖幅度分析器的發(fā)展趨勢(shì)。智能化要求系統(tǒng)的自動(dòng)化程度高、操作簡(jiǎn)便、容錯(cuò)性好。智能化除了需要控制軟件外,還需要軟件命令的執(zhí)行者即硬件控制電路來(lái)實(shí)現(xiàn)相應(yīng)的控制邏輯,兩者的結(jié)合才能真正的實(shí)現(xiàn)智能化。小型化要求系統(tǒng)的體積小、功耗小、便于攜帶;小型化除了要求采用微功耗的器件,還要求電路板的尺寸盡量的小且所用元件盡量的少,但小型化的同時(shí)必須保持系統(tǒng)的智能化,即不能減少智能化所要求的復(fù)雜的邏輯和時(shí)序的控制功能。為此采用高集成度的ARM芯片實(shí)現(xiàn)控制電路能滿意地同時(shí)滿足智能化和小型化的要求。在研制的多道脈沖幅度分析器中,幾乎所有的控制都可以用控制芯片來(lái)實(shí)現(xiàn),如閾值設(shè)定、自動(dòng)穩(wěn)譜以及多道數(shù)據(jù)采集,在節(jié)省了元件的數(shù)目和電路板的尺寸的同時(shí)仍能保持系統(tǒng)的智能化程度。 Linux內(nèi)核精簡(jiǎn)而高效,可修改性強(qiáng),支持多種體系結(jié)構(gòu)的處理器等,使得它是一個(gè)非常適合于嵌入式開發(fā)和應(yīng)用的操作系統(tǒng)。嵌入式Linux可以運(yùn)行的硬件平臺(tái)十分廣泛,從x86、MIPS、POWERPC到ARM,以及其他許多硬件體系結(jié)構(gòu)。目前在世界范圍內(nèi),ARM體系結(jié)構(gòu)的SOC逐漸占領(lǐng)32位嵌入式微處理器市場(chǎng),ARM處理器及技術(shù)的應(yīng)用幾乎已經(jīng)深入到各個(gè)領(lǐng)域,例如:工業(yè)控制,無(wú)線通訊,網(wǎng)絡(luò),消費(fèi)類電子,成像等。 本課題采用三星公司生產(chǎn)的ARM(Advanced RISC Machines,先進(jìn)精簡(jiǎn)指令集機(jī)器)芯片S3C2410A設(shè)計(jì)并研制了一種便攜式的核數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)方案。利用ARM芯片豐富的外設(shè)資源對(duì)傳統(tǒng)的多道脈沖幅度分析器進(jìn)行改進(jìn)和簡(jiǎn)化。系統(tǒng)由前端探測(cè)器系統(tǒng),以及由線性脈沖放大器、甄別電路、控制電路、采樣保持電路組成的前置電路,中央處理器模塊,顯示模塊,用戶交互模塊,存儲(chǔ)模塊,網(wǎng)絡(luò)傳輸模塊等多個(gè)模塊組成。本設(shè)計(jì)基于ARM9芯片S3C2410,并在此平臺(tái)上移植了嵌入式linux操作系統(tǒng)來(lái)進(jìn)行任務(wù)的調(diào)度和處理等。 電路板核心板部分設(shè)計(jì)采用6層PCB板結(jié)構(gòu),這樣增加了系統(tǒng)可靠性,提高了電磁兼容的穩(wěn)定性。數(shù)據(jù)采集系統(tǒng)是多道脈沖幅度分析器的核心,A/D轉(zhuǎn)換直接使用了S3C2410內(nèi)置的ADC(Analog to Digital Converter,模數(shù)轉(zhuǎn)換器),在2.5 MHz的轉(zhuǎn)換時(shí)鐘下最大轉(zhuǎn)換速度500 KSPS(Kilo-Samples per second,千采樣點(diǎn)每秒),滿足了系統(tǒng)最低轉(zhuǎn)換時(shí)間≤5 μs的要求,并且控制簡(jiǎn)單,簡(jiǎn)化了外部接口電路。由于SD(Secure Digital Card,安全數(shù)碼卡)卡存儲(chǔ)容量大、攜帶方便、成本低等優(yōu)點(diǎn),所以設(shè)計(jì)中采用其作為外部的數(shù)據(jù)存儲(chǔ)設(shè)備,其驅(qū)動(dòng)部分采用SD卡軟件包,為開發(fā)帶來(lái)了方便。本設(shè)計(jì)采用640*480的6.4寸LCD(Liquid Crystal Display,液晶顯示)屏作為人機(jī)交互的顯示部分,并且通過Qt/Embedded為系統(tǒng)提供圖形用戶界面的應(yīng)用框架和窗口系統(tǒng)。其中包括了波形顯示部分和用戶菜單設(shè)置部分,這樣方便了用戶操作。系統(tǒng)的數(shù)據(jù)存取方面是基于SQLite嵌入式小型數(shù)據(jù)庫(kù)而進(jìn)行的。為了方便數(shù)據(jù)向上位機(jī)的傳輸,系統(tǒng)設(shè)計(jì)中采用XML(Extensible Markup Language,可擴(kuò)展標(biāo)記語(yǔ)言)格式來(lái)組織傳輸?shù)臄?shù)據(jù),通過基于TCP/IP(Transmission Control Protocol/Internet Protocol)協(xié)議的Linux下Socket套接字編程,來(lái)進(jìn)行與上位機(jī)或PC(Personal Computer,個(gè)人計(jì)算機(jī)或桌面機(jī))等的連接和數(shù)據(jù)傳輸。

    標(biāo)簽: ARMLinux 多道 分析器 脈沖幅度

    上傳時(shí)間: 2013-04-24

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