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多目標(biāo)

  • TCN多功能車輛通信總線的FPGA設計.rar

    隨著列車自動化控制和現場總線技術的發展,基于分布式控制系統的列車通信網絡技術TCN(IEC-61375)在現代高速列車上得到廣泛應用。TCN協議將列車通信網絡分為絞線式列車總線WTB和多功能車輛總線MVB,其中WTB實現對開式列車中的互聯車輛間的數據傳輸和通信,MVB實現車載設備的協同工作和互相交換信息。 本文介紹了國內外列車通信網絡的發展情況和各自優勢,分析了MVB一類設備底層協議。研究利用FPGA實現MVB控制芯片MVBC,用ARM作為微處理器實現MVB一類設備的嵌入式解決方案。其中,在FPGA芯片中主要采用自頂向下的設計方法,RLT硬件描述語言實現MVB控制芯片MVBC一類設備的主要功能,包括幀編碼器、幀解碼器和邏輯接口單元。ARM主要完成了軟件程序的編寫和實時操作系統的移植。在eCos實時操作系統上,完成了驅動和上層應用程序,包括端口初始化、端口配置、幀收發指令和報文分析。 為了驗證設計的正確性,在設計的硬件平臺基礎上,搭建了MVB通信網絡的最小系統,對網絡進行系統功能測試。測試結果表明:設計方案正確,達到了設計的預期要求。

    標簽: FPGA TCN 多功能

    上傳時間: 2013-08-03

    上傳用戶:bruce5996

  • 基于FPGA的多平臺虛擬儀器研究設計.rar

    虛擬儀器技術是以傳感器、信號測量與處理、微型計算機等技術為基礎而形成的一門綜合應用技術。目前虛擬儀器大部分是基于PC機,利用PCI等總線技術傳輸數據,數據卡插拔不便,便攜性差。隨著嵌入式技術的飛速發展,嵌入式系統平臺已經應用到各個領域,而市場上的嵌入式虛擬儀器系統還相當少,各種研究工作才剛剛起步,各種高性能的虛擬儀器和處理系統在現代工業控制和科學研究中已成為必不可少的部分。因此在我國開發具有較高性能、接口靈活、功能多樣化、低成本的虛擬儀器裝置勢在必行。 針對目前虛擬儀器系統發展趨勢和特點,采用FPGA技術,進行一種支持多種平臺的高速虛擬儀器系統的設計與研究,并針對高速虛擬儀器系統中的一些技術難點提出解決方案。首先進行了系統的總體設計,確定了采用FPGA作為系統的控制核心,并選取了Labview作為PC平臺應用程序開發工具,利用USB2.0接口來進行數據傳輸;同時選取嵌入式處理器S3C2410以及WinCE作為嵌入式系統硬軟件平臺。隨后進行了各個具體模塊的設計,在硬件方面,分別設計了前端處理電路,ADC電路以及USB接口電路。在軟件方面,進行了FPGA控制程序的設計工作,實現了對各個模塊和接口電路的控制功能。在上層應用程序的設計方面,設計了Labview應用程序,實現了波形顯示和頻譜分析等儀器功能,人機界面良好。在嵌入式平臺上面,進行了WinCE下GPIO驅動程序設計,并在上層應用程序中調用驅動來進行數據的讀取。為了解決高速ADC與數據緩存器的速度不匹配的問題,提出利用多體交叉式存儲器結構的設計方案,并在FPGA內對控制程序進行了設計,對其時序進行了仿真。 最后對系統進行了聯合調試工作,利用上層軟件對輸入波形進行采集。根據調試結果看,該系統對輸入信號進行了較好的采樣和存儲,還原了波形,達到了預期效果。課題研究并且對設計出一種支持多平臺的新型虛擬儀器系統,具有性能好、使用靈活,節省成本等特點,具有較高的研究價值和現實意義。

    標簽: FPGA 虛擬儀器

    上傳時間: 2013-04-24

    上傳用戶:shwjl

  • 多載波擴頻通信的Rake接收機理論研究及FPGA實現.rar

    由于移動環境的復雜性,無線信號在發送傳輸和接收過程中有很明顯的衰落現象,特別是在高頻無線通信中,多徑衰落或頻率選擇性衰落對無線信號的干擾最為嚴重。通過分集接收技術,Rake接收機在CDMA移動通信系統中抗多徑衰落效果尤為明顯。作為一種新穎的多址接入方式,多載波CDMA充分利用了OFDM最優頻率利用率以及CDMA的多址和頻率分集,且系統容量和抗符號間干擾性能明顯優于傳統的單載波CDMA。這些特性使得多載波CDMA成為未來的寬帶無線通信系統最有希望的候選。 @@ 本文研究了一種多載波擴頻通信系統,介紹了其Rake接收機工作原理和設計思想,進行了理論仿真并用FPGA予以實現。 @@ 本文首先介紹了移動通信系統的發展歷史以及OFDM和CDMA技術原理,并描述了OFDM和CDMA結合的三種系統(MC-DS-CDMA、MT-CDMA、MC-CDMA)的原理和系統模型;接著,介紹了目前影響移動通信的主要衰落以及Rake接收機基本原理及其作用。多徑信號的每路信號都可能含有可以利用的信息,Rake接收機就是通過多個相關接收器接收多徑信號中各路信號,通過信道估計和信道補償消去信道因子的附加相位,并把他們合并在一起,以此來改善信號的信噪比和系統的可靠性;在此基礎上,論文提出了一種多載波擴頻通信系統的實現方案,并詳細介紹了其Rake接收機實現原理,給出了最大比合并時各種分徑數目下系統誤碼率的仿真圖;最后介紹了此方案中Rake接收機的FPGA硬件實現設計方案及其系統 測試結果。@@ 仿真結果顯示出隨著分集徑數的增加,系統的誤碼率顯著降低。表明Rake接收機抗多徑衰落效果顯著,且在多載波CDMA系統中其分集效果更好,實現相對簡單。最終Rake接收機的FPGA實現結果同理論仿真一致,時序通過,資源耗費不大,具有較大的實用價值。 @@關鍵詞:多載波擴頻通信,CDMA,Rake接收機,FPGA

    標簽: Rake FPGA 多載波

    上傳時間: 2013-07-25

    上傳用戶:axxsa

  • 基于FPGA的多速率調制解調器的實現.rar

    隨著人們對于高速無線數據業務的急切需求以及新的無線通信技術的發展,頻譜資源匱乏問題日益嚴重。無線頻譜的緊缺已經成為限制無線通信與服務應用持續發展的瓶頸。認知無線電技術(Cognitive Radio)改變了傳統的固定頻譜分配方式,它以頻譜利用的高效性為目標,允許非授權用戶擇機利用授權用戶的頻譜空洞傳輸數據,以此來解決無線頻譜資源短缺的問題。它是具有自主尋找和使用空閑頻譜資源能力的智能無線電技術。本文的目標是在基于FPGA+DSP的系統硬件平臺上,以軟件編程的方式實現認知無線電數據傳輸的功能。 軟件無線電是實現認知無線電的理想平臺。本文首先闡述了軟件無線電的基本工作原理及關鍵技術途徑,對多速率信號處理中的內插和抽取、帶通采樣、數字下變頻、濾波等技術進行了分析與探討,為設計多速率調制解調系統提供了理論基礎。然后針對軟件無線電的要求給出了基于FPFA+DSP的系統設計硬件框圖,并對其中的部分硬件(FPGA、AD9857、AD9235)做了簡要的描述并給出其初始化過程。在理解基本概念和原理的基礎上,詳細論述了在系統硬件設計平臺上實現的π/4-DQPSK、8PSK、16QAM調制解調技術。本文給出了調制解調系統實現方案中的各個功能模塊(差分編、解碼,加同步頭、內插和成形濾波,下變頻,系統同步等)具體的設計方案和通過硬件編程實現了板級的仿真和最后的硬件實現,并對其中得到的數據進行分析,進一步驗證方案的可行性。最后介紹了通信板同頻譜感知板協同工作原理,依據頻譜感知板獲取的各個信道狀況自適應的選擇π/4-DQPSK、8PSK、16QAM調制解調方式并在FPGA上實現了其中部分功能。

    標簽: FPGA 多速率 調制解調器

    上傳時間: 2013-05-30

    上傳用戶:fywz

  • MSP430系列多單片機間的SPI主從通信.rar

    這篇文章介紹了MSP430系列多單片機間的SPI主從通信原理和相關例程

    標簽: MSP 430 SPI

    上傳時間: 2013-04-24

    上傳用戶:啦啦啦啦啦啦啦

  • 基于FPGA的人臉檢測系統設計.rar

    人臉識別技術繼指紋識別、虹膜識別以及聲音識別等生物識別技術之后,以其獨特的方便、經濟及準確性而越來越受到世人的矚目。作為人臉識別系統的重要環節—人臉檢測,隨著研究的深入和應用的擴大,在視頻會議、圖像檢索、出入口控制以及智能人機交互等領域有著重要的應用前景,發展速度異常迅猛。 FPGA的制造技術不斷發展,它的功能、應用和可靠性逐漸增加,在各個行業也顯現出自身的優勢。FPGA允許用戶根據自己的需要來建立自己的模塊,為用戶的升級和改進留下廣闊的空間。并且速度更高,密度也更大,其設計方法的靈活性降低了整個系統的開發成本,FPGA 設計成為電子自動化設計行業不可缺少的方法。 本文從人臉檢測算法入手,總結基于FPGA上的嵌入式系統設計方法,使用IBM的Coreconnect掛接自定義模塊技術。經過訓練分類器、定點化、以及硬件加速等方法后,能夠使人臉檢測系統在基于Xilinx的Virtex II Pro開發板上平臺上,達到實時的檢測效果。本文工作和成果可以具體描述如下: 1. 算法分析:對于人臉檢測算法,首先確保的是檢測率的準確性程度。本文所采用的是基于Paul Viola和Michael J.Jones提出的一種基于Adaboost算法的人臉檢測方法。算法中較多的是積分圖的特征值計算,這便于進一步的硬件設計。同時對檢測算法進行耗時分析確定運行速度的瓶頸。 2. 軟硬件功能劃分:這一步考慮市場可以提供的資源狀況,又要考慮系統成本、開發時間等諸多因素。Xilinx公司提供的Virtex II Pro開發板,在上面有可以供利用的Power PC處理器、可擴展的存儲器、I/O接口、總線及數據通道等,通過分析可以對算法進行細致的劃分,實現需要加速的模塊。 3. 定點化:在Adaboost算法中,需要進行大量的浮點計算。這里采用的方法是直接對數據位進行操作它提取指數和尾數,然后對尾數執行移位操作。 4. 改進檢測用的級聯分類器的訓練,提出可以迅速提高分類能力、特征數量大大減小的一種訓練方法。 5. 最后對系統的整體進行了驗證。實驗表明,在視頻輸入輸出接入的同時,人臉檢測能夠達到17fps的檢測速度,并且獲得了很好的檢測率以及較低的誤檢率。

    標簽: FPGA 人臉檢測 系統設計

    上傳時間: 2013-07-01

    上傳用戶:84425894

  • 基于FPGA的多通道DMA控制器的IP核設計.rar

    當前,隨著電子技術的飛速發展,智能化系統中需要傳輸的數據量日益增大,要求數據傳送的速度也越來越快,傳統的數據傳輸方式已無法滿足目前的要求。在此前提下,采用高速數據傳輸技術成為必然,DMA(直接存儲器訪問)技術就是較理想的解決方案之一,能夠滿足信息處理實時性和準確性的要求。 本文以EDA工具、硬件描述語言和可編程邏輯器件(FPGA)為技術支撐,設計DMA控制器的總體結構。在通道檢測模塊中,解決了信號抗干擾和請求信號撤銷問題,并提出并行通道檢測算法;在優先級管理模塊中提出了動態優先級端口響應機制;在傳輸模塊中采用狀態機的設計思想設計多個通道的數據傳輸。通過各模塊問題的解決及新方法的采用,最終設計出基于FPGA的多通道DMA控制器的IP軟核。實驗仿真結果表明,本控制器傳輸速度較快,主頻達100MHz以上,且工作穩定。

    標簽: FPGA DMA 多通道

    上傳時間: 2013-05-16

    上傳用戶:希醬大魔王

  • 基于RS-485的多點數據采集與顯示系統.rar

    基于RS-485的多點數據采集與顯示系統。

    標簽: 485 RS 多點

    上傳時間: 2013-05-24

    上傳用戶:huql11633

  • 基于FPGA的磁盤陣列控制器的硬件設計與實現.rar

    隨著存儲技術的迅速發展,存儲業務需求的不斷增長,獨立的磁盤冗余陣列可利用多個磁盤并行存取提高存儲系統的性能。磁盤陣列技術采用硬件和軟件兩種方式實現,軟件RAID(Redundant Array of Independent Disks)主要利用操作系統提供的軟件實現磁盤冗余陣列功能,對系統資源利用率高,節省成本。硬件RAID將大部分RAID功能集成到一塊硬件控制器中,系統資源占用率低,可移植性好。 分析了軟件RAID的性能瓶頸,使用硬件直接完成部分計算提高軟件RAID性能。針對RAID5采用FPGA(Field Programmable Gate Array)技術實現RAID控制器硬件設計,完成磁盤陣列啟動、數據緩存(Cache)以及數據XOR校驗等功能。基于硬件RAID的理論,提出一種基于Virtex-4的硬件RAID控制器的系統設計方案:獨立微處理器和較大容量的內存;實現RAID級別遷移,在線容量擴展,在線數據熱備份等高效、用戶可定制的高級RAID功能;利用Virtex-4內置硬PowerPC完成RAID服務器部分配置和管理工作,運行Linux操作系統、RAID管理軟件等。控制器既可以作為RAID控制卡在服務器上使用,也可作為一個獨立的系統,成為磁盤陣列的調試平臺。 隨著集成電路的發展,芯片的體積越來越小,電路的布局布線密度越來越大,信號的工作頻率也越來越高,高速電路的傳輸線效應和信號完整性問題越來越明顯。RAID控制器屬于高速電路的范疇,在印刷電路板(Printed Circuit Block, PCB)實現時分別從疊層設計、布局、電源完整性、阻抗匹配和串擾等方面考慮了信號完整性問題,并基于IBIS(I/O Buffer Information Specification)模型進行了信號完整性分析及仿真。

    標簽: FPGA 磁盤陣列 控制器

    上傳時間: 2013-04-24

    上傳用戶:jeffery

  • 基于FPGA的多路脈沖時序控制電路設計與實現.rar

    在團簇與激光相互作用的研究中和在團簇與加速器離子束的碰撞研究中,需要對加速器束流或者激光束進行脈沖化與時序同步,同時用于測量作用產物的探測系統如飛行時間譜儀(TOF)等要求各加速電場的控制具有一定的時序匹配。在整個實驗中,需要用到符合要求的多路脈沖時序信號控制器,而且要求各脈沖序列的周期、占空比、重復頻率等方便可調。為此,本論文基于FPGA設計完成了一款多路脈沖時序控制電路。 本文基于Altera公司的Cyclone系列FPGA芯片EPlC3T100C8,設計出了一款可以同時輸出8路脈沖序列、各脈沖序列之間具有可調高精度延遲、可調脈沖寬度及占空比等。論文討論了FPGA芯片結構及開發流程,著重討論了較高頻率脈沖電路的可編程實現方法,以及如何利用VHDL語言實現硬件電路軟件化設計的技巧與方法,給出了整個系統設計的原理與實現。討論了高精密電源的PWM技術原理及實現,并由此設計了FPGA所需電源系統。給出了配置電路設計、數據通信及接口電路的實現。開發了上層控制軟件來控制各路脈沖時序及屬性。 該電路工作頻率200MHz,輸出脈沖最小寬度可達到10ns,最大寬度可達到us甚至ms量級。可以同時提供l路同步脈沖和7路脈沖,并且7路脈沖相對于同步脈沖的延遲時間可調,調節步長為5ns。

    標簽: FPGA 多路 脈沖

    上傳時間: 2013-06-15

    上傳用戶:ZJX5201314

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