異步FIFO是用來適配不同時鐘域之間的相位差和頻率飄移的重要模塊。本文設計的異步FIFO采用了格雷（GRAY）變換技術和雙端口RAM實現了不同時鐘域之間的數據無損傳輸。該結構利用了GRAY變換的特點，使得整個系統可靠性高和抗干擾能力強，系統可以工作在讀寫時鐘頻率漂移達到正負300PPM的惡劣環境。并且由于采用了模塊化結構，使得系統具有良好的可擴充性。
標簽： FIFO GRAY RAM 適配
上傳時間： 2013-08-08
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FPGA中雙向端口IO的研究FPGA中雙向端口IO的研究.
標簽： FPGA 雙向端口
上傳時間： 2013-08-09
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cpld與單片機8051的通信的設計方法 以及cpld和單片機的端口對應
標簽： cpld 8051 單片機 通信
上傳時間： 2013-09-01
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隨著面向應用的增加,單片機系統I/O端口數量有限的問題日益突出。根據74HC164串行輸入、并行輸出的工作原理,對單片機系統的I/O端口進行擴展。設計具有16個按鍵的中斷串行鍵盤和具有8個數碼管的串行數碼管顯示,用4個I/O端口完成了傳統并行技術中需要24個I/O端口才能實現的功能。給出了硬件電路、程序和需要注意的問題。實踐表明,基于74HC164擴展單片機系統I/O端口的效果良好。
標簽： 164 I_O 74 HC
上傳時間： 2013-10-14
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端口驅動 用于向單片機燒制程序
標簽： 端口驅動
上傳時間： 2013-11-01
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51端口的結構及工作原理
標簽： 51端口 工作原理
上傳時間： 2013-10-19
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51 端口的結構及工作原理
上傳時間： 2013-10-23
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并行端口大全_10332210.pdf
標簽： 10332210 并行端口
上傳時間： 2014-01-17
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P0端口由鎖存器、輸入緩沖器、切換開關、一個與非門、一個與門及場效應管驅動電路構成。再看圖的右邊，標號 為P0.X引腳的圖標，也就是說P0.X引腳可以是P0.0到P0.7的任何一位，即在P0口有8個與上圖相同的電路組成。
上傳時間： 2014-01-13
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NXP半導體設計的LPC3000系列ARM芯片，適用于要求高性能和低功耗結合的嵌入式應用中。 NXP通過使用90納米的處理技術，將一個帶有矢量浮點協處理器的ARM926EJ-S CPU內核與一系列包括USB On-The-Go在內的標準外設結合起來，從而實現LPC3000的性能目標。LPC3000系列ARM可工作在高于266MHz的CPU頻率下。ARM926EJ-S CPU內核加入5級流水處理并采用哈佛結構。該內核還具有一個完整的存儲器管理單元（MMU），以提供支持現代操作系統多程序設計所需的虛擬存儲器功能。ARM926EJ-S CPU內核還包含了帶有單周期MAC操作的一系列DSP指令擴展，以及Jazelle Java字節代碼執行。NXP實現的器件具有一個32kB指令高速緩存和32kB數據高速緩存。
標簽： ARM 176 PL 多端口
上傳時間： 2013-11-20
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