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在利益的驅使下，超限運輸在世界各地已成為了普遍現象。這給國家帶來了諸多經濟和社會問題。實踐證明動態稱重系統（WIM）能有效地抑制超限運輸，但同時也存在部分問題，這些問題的解決有賴于國家相關法規的出臺，也有賴于關鍵測量設備（WIM系統）性能的提高。 由于應變式稱重傳感器容易受到各種環境干擾，對環境適應性差，課題采用光纖Bragg光柵傳感器(FBG)作為稱重傳感器，它具有很強的抗干擾性，利于提高系統測量精度。使用光纖傳感器的關鍵是波長解調技術，本文在比較了幾種常見解調技術的前提下，結合課題的實際情況選用了基于F-P腔可調諧濾波解調方法，文章在分析該解調方法原理的基礎上，設計了解調器中的各個硬件電路模塊；此外，為了提高數據采集、傳輸的效率，文章還對數據緩沖電路進行了設計，在電路中引入了換體存儲及DMA傳輸技術。 鑒于動態稱重信號為短歷程信號并且包含各種各樣的噪聲，稱重算法的研究也是本課題要解決的重要內容。本文在分析了稱臺振動及已有先驗知識的基礎上，將小波分析、LM非線性擬合算法及殘差分析相結合應用在動態稱重系統中，為了驗證算法的有效性，利用MATLAB對實測數據進行了仿真分析，結果表明該算法能夠提高測量精度。 提高動態稱重系統性能指標的另一方面是提高系統運行的軟硬件平臺。課題采用的核心硬件為Xscale ARM平臺，處理器時鐘可高達400MHz；軟件上采用了多用戶、多任務的Linux操作系統平臺。文章對操作系統linux2.6進行了合適的配置，成功地將它移植到了課題的ARM平臺上，并且在此操作系統上設計了基于MiniGUI的人機交互界面及波長解調和數據緩沖電路的驅動程序。
上傳時間： 2013-07-26
上傳用戶：neibuzhuzu
隨著微電子技術和電力電子技術的飛速發展，運動控制系統正朝著通用化、智能化、微型化的方向發展。目前，以數字信號處理器（DSP）和現場可編程門陣列（FPGA）為核心的運動控制卡已成為運動控制器的發展主流。它可方便地以插卡形式嵌入PC機，將PC機強大的信息處理能力和開放式特點與運動控制卡的運動控制能力相結合，具有信息處理能力強、開放程度高、運動控制方便、通用性好的特點。因此，本文通過對運動控制技術的深入研究，開發了一款以DSP和FPGA為主控單元、基于PCI總線的運動控制卡。 首先，設計了運動控制卡硬件電路，對控制卡的DSP和FPGA外圍電路、PCI總線接口電路、模擬量輸出電路、編碼器信號采集電路、通用I/O接口電路等實現方法進行了詳細討論。 為提高控制卡的硬件集成度和可靠性，通過對FPGA的編程設計，在FPGA中實現了PCI總線目標設備接口控制器、雙端口RAM、DDA精插補電路、DAC接口電路、編碼器信號處理電路和數字I/O信號處理電路。 基于改進的數字PID控制器和前饋控制，設計開發了運動控制卡的位置閉環伺服控制器，并整定了控制器參數，獲得良好的伺服控制特性。 最后，采用WinDriver開發了控制卡的驅動程序，并詳細介紹了驅動程序的開發流程。
上傳時間： 2013-08-01
上傳用戶：00.00
以混合信號單片機C8051F020 及DDS 芯片AD9834 為核心，采用直接數字合成（DDS）技術完成多功能高頻正弦信號發生器的設計。該正弦信號發生器可輸出可調頻穩定正弦信號，頻率最高可達
上傳時間： 2013-04-24
上傳用戶：pinksun9
隨著科技的發展，電子電路的設計正逐漸擺脫傳統的設計模式?？删幊踢壿嬈骷坝布枋稣Z言的出現與發展從根本上改變了數字系統設計與實現的技術與方法，越來越多的數字信號處理系統采用可編程邏輯器件來實現。 數字濾波技術作為數字信號處理的基本分支之一，在各種數字信號處理中起著重要作用，被廣泛應用于很多領域。其中有限長沖激響應（FIR）濾波器，只有零點、系統穩定、運算速度快、具有線性相位的特性，設計靈活，在工程實際中獲得廣泛應用。 本文以數字濾波器的基本理論為依據，通過對現場可編程門陣列（FPGA）內部結構的研究，結合軟件工程學中結構化設計思想和硬件描述語言的特點，以9階FIR低通數字濾波器為例，采用Altera公司的EPIK30TC144-3器件完成了FIR數字濾波器的軟硬件設計。我們在設計中采用了層次化、模塊化的設計思想，將整個濾波器劃分為多個功能模塊，利用VHDL語言進行了各個功能模塊的設計。 為了使設計的過程和結果更為直觀，文中詳細介紹了核心及外圍硬件電路的設計過程，最終達到了基于FPGA硬件實現參數化FIR數字濾波器的目的。實驗測試表明，本論文所設計的基于FPGA的9階FIR低通數字濾波器基本達到了設計指標。依照此方法，只要修改參數，升級相關硬件，便可以更改濾波器性能，實現高通、帶通FIR數字濾波器，說明本設計具有普遍指導意義。
上傳時間： 2013-05-24
上傳用戶：1101055045
本文分析了當代高精度地震勘探數據采集系統的發展現狀，研究了數據采集的A/D方法及理論、現場可編程門陣列(Field Programmable GateArray，FPGA)技術的發展及原理，串口通信的原理及實現。在此基礎上，探討了采用FPGA控制24位△∑模數轉換器來實現高精度地震勘探數據采集系統的實現思路，對探測傳感器或檢波器后端數據采集系統的信號A/D轉換、FPGA與外部接口設計、串口數據通信做了詳細的研究，尤其是在用FPGA來完成與外部ADC的接口控制上做了深入的開發和設計，整個接口控制模塊采用VHDL語言編寫，并同時將ROM、FIFO等數字邏輯模塊一起集成到一片FPGA芯片當中，并在Quartus Ⅱ6.0的開發平臺上通過了軟件仿真，時序仿真結果達到了系統要求。
上傳時間： 2013-05-21
上傳用戶：yuele0123
正交頻分復用（OFDM）是一種無線環境下的高速傳輸技術，它使用一系列低速子載波并行傳輸數據，具有抗多徑干擾的能力、能以很高的頻譜利用率實現高速數據傳輸等優點。數字音頻廣播（DAB）系統中采用OFDM調制技術。 本文首先概述了OF'DM的基本原理和實現方法，分析了DAB中不同模式下OFDM調制的參數和特點。實現OFDM的核心技術是快速傅立葉變換（FFT）。本文在分析研究了多種FFT算法的基礎上選擇了最適合FPGA實現的，滿足DAB系統中OFDM調制要求的FFT算法，即將2048點FFT分解為基-4和基-2混合基算法。 本文研究重點是使用FPGA實現2048點復數FFT處理器。2048點FFT由五級基-4運算和一級基-2運算組成。針對這一算法以及FPGA特點，進行系統結構設計、各個模塊設計、FPGA實現和測試。一個基-4和基-2復用的蝶形運算模塊是整個FFT處理器的核心部分。此外系統還包括：系統控制模塊，地址產生模塊，RAM和ROM。本文特別針對2048點按頻率抽取基-4/2順序處理的FFT處理器提出了一種巧妙的數據地址和旋轉因子地址生成的方法。 仿真和驗證表明，運算的結果可以達到一定的精度要求，運算速度滿足系統要求，說明該OFDM調制器的設計是可行的，可以應用于DAB系統中
上傳時間： 2013-06-05
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"Quartus II設計軟件是Altera提供的完整的多平臺設計環境，能夠直接滿足特定設計需要， 為可編程芯片系統（SOPC）提供全面的設計環境。"
標簽： QuartusII Edtition 10.1 Web
上傳時間： 2013-06-07
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【經典設計】VHDL源代碼下載～～ 其中經典的設計有：【自動售貨機】、【電子鐘】、【紅綠燈交通信號系統】、【步進電機定位控制系統】、【直流電機速度控制系統】、【計算器】、【點陣列LED顯示控制系統】 基本數字邏輯設計有：【鎖存器】、【多路選擇器】、【三態門】、【雙向輸入|輸出端口】、【內部（緩沖）信號】、【編碼轉換】、【加法器】、【編碼器/譯碼器】、【4位乘法器】、【只讀存儲器】、【RSFF觸發器】、【DFF觸發器】、【JKFF觸發器】、【計數器】、【分頻器】、【寄存器】、【狀態機】
上傳時間： 2013-05-27
上傳用戶：shijiang
生物醫學信號是源于一個生物系統的一類信號，像心音、腦電、生物序列和基因以及神經活動等，這些信號通常含有與生物系統生理和結構狀態相關的信息，它們對這些系統狀態的研究和診斷具有很大的價值。信號拾取、采集和處理的正確與否直接影響到生物醫學研究的準確性，如何有效地從強噪聲背景中提取有用的生物醫學信號是信號處理技術的重要問題。 設計自適應濾波器對帶有工頻干擾的生物醫學信號進行濾波，從而消除工頻干擾，獲得最佳的濾波效果是本研究要解決的問題。生物醫學信號具有信號弱、噪聲強、頻率范圍較低、隨機性強等特點。由于心電(electrocardiogram，ECG)信號的確定性、穩定性、規則性都比其他生物信號高，便于準確評估和檢測濾波效果，本研究采用ECG信號作為原始的模板信號。 本研究將新的電子芯片技術與現代信號處理技術相結合，從過去單一的軟件算法研究，轉向軟件與硬件結合，從而提高自適應速度和精度，而且可以使系統的開發周期縮短、成本降低、容易升級和變更。 采用現場可編程邏輯器件(Field Programmable Gate Array，FPGA)作為新的ECG快速提取算法的硬件載體，加快信號處理的速度。為了將ECG快速提取算法轉換為常用的適合于FPGA芯片的定點數算法，研究中詳細分析了定點數的量化效應對自適應噪聲消除器的影響，以及對浮點數算法和定點數算法的復合自適應濾波器的各種參數的選擇，如步長因子和字長選擇。研究中以定點數算法中的步長因子和字長選擇，作為FPGA設計的基礎，利用串并結合的硬件結構實現自適應濾波器，并得到了預期的效果，準確提取改善后的ECG信號。 研究中，在MATLAB(Matrix Laboratry)軟件的環境下模擬，選取帶有50Hz工頻干擾的不同信噪比的ECG原始信號，在浮點數情況下，原始信號通過采用最小均方LMS(LeastMean Squares)算法的浮點數自適應濾波器后，根據信噪比的改善和收斂速度，確定不同的最佳μ值，并在定點數情況下，在最佳μ值的情況下，原始信號通過采用LMs算法的定點數自適應濾波器后，根據信噪比的改善效果和采用硬件的經濟性，確定最佳的定點數。并了解LMS算法中步長因子、定點數字長值對信號信噪比、收斂速度和硬件經濟性的影響。從而得出針對含有工頻干擾的不同信噪比的原始ECG，應該采用什么樣的μ值和什么樣的定點數才能對原始ECG的改善和以后的硬件實現取得最佳的效果，并根據所得到的數據和結果，在FPGA上實現自適應濾波器，使自適應濾波器能對帶有工頻干擾的ECG原始信號有最佳的濾波效果。
上傳時間： 2013-04-24
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標簽： 人工智能
上傳時間： 2013-04-24
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