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完整電路

耦合、隔直和旁路電容的選擇

耦合、隔直和旁路電容的選擇。。對電源方面會有一定的幫助。。

標簽： 耦合旁路電容

上傳時間： 2013-06-03

上傳用戶：cc111
基于GPRS與ARM的集中抄表系統(tǒng)

集中抄表系統(tǒng)是一個集現(xiàn)代化管理、計算機應用、現(xiàn)代通訊技術、自動控制、信息等多學科技術于一體，實現(xiàn)電力營銷監(jiān)控、電力營銷管理、營業(yè)抄收、數(shù)據(jù)采集和網絡連接等多種功能的一個完整的系統(tǒng)。本文設計了基于GPRS與ARM技術的集抄系統(tǒng)，充分利用GPRS通信實時在線、按流量計費、高速傳輸?shù)膬?yōu)點。本系統(tǒng)采用的是華為的GTM900-B模塊，適用于小數(shù)據(jù)量傳送的場合，用戶無需實現(xiàn)PPP協(xié)議也可實現(xiàn)數(shù)據(jù)傳輸功能。基于GPRS與ARM的集中抄表系統(tǒng)包含三個主要的組成部分：基于.NET平臺的系統(tǒng)管理中心（主站），基于GPRS的通信網絡和基于ARM平臺的終端系統(tǒng)。系統(tǒng)管理中心負責系統(tǒng)數(shù)據(jù)的采集、存儲和分析等功能；終端系統(tǒng)實現(xiàn)遠程用電設備的信息采集和控制；通信網絡則在管理中心和終端系統(tǒng)間建立數(shù)據(jù)傳輸鏈路。基于GPRS與ARM的集中抄表系統(tǒng)豐富了以往系統(tǒng)原有的應用功能，提升了集中抄表系統(tǒng)的綜合性能。經過測試，本系統(tǒng)能夠順利的進行撥號，與主站進行正常的數(shù)據(jù)發(fā)送和接收，能正常的對電表數(shù)據(jù)進行采集和上位機管理命令下發(fā)，達到了預期的效果和設計要求。本系統(tǒng)已經在湖北石首，黃岡，黃石，十堰和湖南部分縣、市有一定規(guī)模的應用。在石首地區(qū)復雜的供電環(huán)境下，20個臺區(qū)所有電表的數(shù)據(jù)都能按時正確的收集到主站，終端也能正常響應主站下發(fā)的命令，實現(xiàn)設計的功能，證明了本系統(tǒng)運行穩(wěn)定可靠，有利于配電網絡運行的安全性和經濟性管理，對加強用電管理和提高電網供電質量起到了積極的作用。

標簽： GPRS ARM 抄表系統(tǒng)

上傳時間： 2013-06-29

上傳用戶：jing911003
一個串口的完整FPGA工程

實現(xiàn)完整的串口設置，含校驗位設置，撥特率設置，MCU接口，簡單易用

標簽： FPGA 串口工程

上傳時間： 2013-06-26

上傳用戶：luke5347
(臺達)開關電源基本原理與設計介紹

(臺達)開關電源基本原理與設計介紹，比較實用

標簽： 開關電源

上傳時間： 2013-06-15

上傳用戶：ybysp008
基于ARM的高級數(shù)據(jù)鏈路控制規(guī)程研究

高級數(shù)據(jù)鏈路控制規(guī)程，是由ISO開發(fā)，面向比特的數(shù)據(jù)鏈路層協(xié)議，具有差錯檢測功能強大、高效和同步傳輸?shù)牡忍攸c，是通信領域中應用最廣泛的協(xié)議之一。隨著大規(guī)模電路的集成度和工藝水平不斷提高，ARM處理器上的高級數(shù)據(jù)鏈路控制器外設，幾乎涵蓋了HDLC規(guī)程常用的大部分子集。利用ARM芯片對HDLC通信過程進行控制，將具有成本低廉、靈活性好、便于擴展為操作系統(tǒng)下的應用程序等優(yōu)點。本文在這一背景下，提出了在ARM下實現(xiàn)鏈路層傳輸?shù)姆桨福诜桨钢袑崿F(xiàn)了基于HDLC協(xié)議子集的簡單協(xié)議。本文以嵌入式的高速發(fā)展為背景，對基于ARM核微處理器的鏈路層通信規(guī)程進行研究，闡述了HDLC幀的結構、特點和工作原理，提出了在ARM芯片上實現(xiàn)HDLC規(guī)程的兩種方法，同時給出其設計方案、關鍵代碼和調試方法。其中，重點對無操作系統(tǒng)時中斷模式下，以及基于操作系統(tǒng)時ARM芯片上實現(xiàn)HDLC規(guī)程的方法進行了探討設計。

標簽： ARM 高級數(shù)據(jù)鏈路控制規(guī)程

上傳時間： 2013-08-04

上傳用戶：時代將軍
飛思卡爾平板電腦完整電路圖

飛思卡爾平板電腦開發(fā)板完整電路圖，是A8核的ARM作為cpu

標簽： 飛思卡爾平板電腦電路圖

上傳時間： 2013-07-18

上傳用戶：ykykpb
基于ARM的多路串行和以太網通信技術的研究與應用

近年來，隨著控制系統(tǒng)規(guī)模的擴大和總線技術的發(fā)展，對數(shù)據(jù)采集和傳輸技術提出了更高的要求。目前，很多設備需要實現(xiàn)從單串口通信到多路串口通信的技術改進。同時，隨著以太網技術的發(fā)展和普及，這些設備的串行數(shù)據(jù)需要通過網絡進行傳輸，因而有必要尋求一種解決方案，以實現(xiàn)技術上的革新。本文分別對串行通信和基于TCP/IP協(xié)議的以太網通信進行研究和分析，在此基礎上，設計一個嵌入式系統(tǒng)一基于APM處理器的多路串行通信與以太網通信系統(tǒng)，來實現(xiàn)F8-DCS系統(tǒng)中多路串口數(shù)據(jù)采集和以太網之間的數(shù)據(jù)傳輸。主要作了如下工作：首先，分析了當前串行通信的應用現(xiàn)狀和以太網技術的發(fā)展動態(tài)，通過比較傳統(tǒng)的多路串口通信系統(tǒng)的優(yōu)缺點，設計出了一種采用CPID技術和CAN總線技術相結合的新型技術，并結合F8-DCS系統(tǒng)數(shù)據(jù)量大和實時性高的特點，對串行通訊幀同步的方法進行了詳細的研究。然后，根據(jù)課題的實際需求，對系統(tǒng)進行總體設計和功能模塊劃分，并詳細介紹了基于ARM7處理器的多路串口通信接口、以太網通信接口以及二者之間的數(shù)據(jù)傳輸接口的電路設計。在軟件設計上，對系統(tǒng)的啟動代碼、串行通信協(xié)議、串口驅動以及多串口與網口間雙向數(shù)據(jù)傳輸?shù)冗M行了詳細的論述。最后，將上述技術應用于某大型火電廠主機F8-DCS系統(tǒng)I/O通訊網絡的測試與分析，達到了設計要求。

標簽： ARM 多路串行以太網

上傳時間： 2013-07-31

上傳用戶：aeiouetla
WiMAX網絡終端基帶算法與FPGA實現(xiàn)

隨著全球經濟不斷增長和信息技術持續(xù)發(fā)展，越來越多用戶提出了對數(shù)據(jù)、語音和視訊等寬帶接入業(yè)務的需求。傳統(tǒng)的接入網技術己成為新一代寬帶通信網絡建設的瓶頸，通信網絡的寬帶化成為一個必然的趨勢。在眾多新興的接入技術中，寬帶無線接入技術以其特有的優(yōu)勢成為近年來通信技術市場的最大亮點。基于IEEE802．16e的WiMAX技術作為一種面向無線城域網(WMAN)的寬帶接入方案，正以其優(yōu)異的性能和廣闊的市場前景而倍受關注。本文是基于WiMAX技術的網絡終端的設計，根據(jù)IEEE802.16e協(xié)議，物理層需要對收發(fā)信息進行編解碼、調制解調等的處理，其中包含很多運算密集的算法；這些處理有些適合硬件邏輯實現(xiàn)，有些適合數(shù)字信號處理器實現(xiàn)，所以設計采用了FPGAs+DSPs的實現(xiàn)方式。考慮對接收和發(fā)送數(shù)據(jù)的不同處理，在詳細分析上行和下行鏈路的工作過程的基礎上，對模塊的進行了詳細劃分，并對系統(tǒng)的FPGA部分進行了詳細設計。設計中本文充分考慮了FPGA和DSP之間處理的優(yōu)缺點，并注意避免器件之間通信的復雜化，在滿足器件之間數(shù)據(jù)流量的同時，盡量使數(shù)據(jù)流向簡單化，避免了延時增加和接口帶寬調度的復雜化。最終整個設計完成完整的802.16e網絡終端的物理層基帶處理功能。

標簽： WiMAX FPGA 網絡終端基帶

上傳時間： 2013-06-01

上傳用戶：123456wh
WCDMA多用戶檢測算法的研究和下行鏈路解復用技術的FPGA實現(xiàn)

本文首先在介紹多用戶檢測技術的原理以及系統(tǒng)模型的基礎上，對比分析了幾種多用戶檢測算法的性能，給出了算法選擇的依據(jù)。為了同時克服多址干擾和多徑干擾，給出了融合多用戶檢測與分集合并技術的接收機結構。接著，針對WCDMA反向鏈路信道結構，介紹了擴頻使用的OVSF碼和擾碼，分析了擾碼的延時自相關特性和互相關特性，指出了存在多址干擾和多徑干擾的根源。在此基礎上，給出了解相關檢測器的數(shù)學公式推導和結構框圖，并仿真研究了用戶數(shù)、擴頻比、信道估計精度等參數(shù)對系統(tǒng)性能的影響。常規(guī)的干擾抵消是基于chip級上的抵消，需要對用戶信號重構，因此具有較高的復雜度。在解相關檢測器的基礎上，衍生出符號級上的干擾抵消。通過仿真，給出了算法中涉及的干擾抑制控制權值、干擾抵消級數(shù)等參數(shù)的最佳取值，并進行了算法性能比較。仿真結果驗證了該算法的有效性。最后，介紹了WCDMA系統(tǒng)移動臺解復用技術的硬件實現(xiàn)，在FPGA平臺上分別實現(xiàn)了與基站和安捷倫8960儀表的互聯(lián)互通。

標簽： WCDMA FPGA 多用戶檢測下行鏈路

上傳時間： 2013-07-29

上傳用戶：jiangxin1234
基于FPGA的多路E1反向復用傳輸芯片的設計與實現(xiàn)

隨著電信數(shù)據(jù)傳輸對速率和帶寬的要求變得越來越迫切,原有建成的網絡是基于話音傳輸業(yè)務的網絡,已不能適應當前的需求.而建設新的寬帶網絡需要相當大的投資且建設工期長,無法滿足特定客戶對高速數(shù)據(jù)傳輸?shù)慕谛枨?反向復用技術是把一個單一的高速數(shù)據(jù)流在發(fā)送端拆散并放在兩個或者多個低速數(shù)據(jù)鏈路上進行傳輸,在接收端再還原為高速數(shù)據(jù)流.該文提出一種基于FPGA的多路E1反向復用傳輸芯片的設計方案,使用四個E1構成高速數(shù)據(jù)的透明傳輸通道,支持E1線路間最大相對延遲64ms,通過鏈路容量調整機制,可以動態(tài)添加或刪除某條E1鏈路,實現(xiàn)靈活、高效的利用現(xiàn)有網絡實現(xiàn)視頻、數(shù)據(jù)等高速數(shù)據(jù)的傳輸,能夠節(jié)省帶寬資源,降低成本,滿足客戶的需求.系統(tǒng)分為發(fā)送和接收兩部分.發(fā)送電路實現(xiàn)四路E1的成幀操作,數(shù)據(jù)拆分采用線路循環(huán)與幀間插相結合的方法,A路插滿一幀(30時隙)后,轉入B路E1間插數(shù)據(jù),依此類推,循環(huán)間插所有的數(shù)據(jù).接收電路進行HDB3解碼,幀同步定位(子幀同步和復幀同步),線路延遲判斷,FIFO和SDRAM實現(xiàn)多路數(shù)據(jù)的對齊,最后按照約定的高速數(shù)據(jù)流的幀格式輸出數(shù)據(jù).整個數(shù)字電路采用Verilog硬件描述語言設計,通過前仿真和后仿真的驗證.以30萬門的FPGA器件作為硬件實現(xiàn),經過綜合和布線,特別是寫約束和增量布線手動調整電路的布局,降低關鍵路徑延時,最終滿足設計要求.

標簽： FPGA 多路傳輸片的設計

上傳時間： 2013-07-16

上傳用戶：asdkin