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  • Jlink.rar

    這是一個超級鏈接檢查工具,它可以對那些擁有巨大數量的鏈接進行檢查以便發現問題,它的特性包括:提供無限通道同時驗證許多鏈接;可定制性強、提供過濾功能等等。

    標簽: Jlink

    上傳時間: 2013-07-06

    上傳用戶:唐僧他不信佛

  • 三維圖形幾何管線的算法

    近年來,計算機圖形學應用越來越廣泛,尤其是三維(3D)繪圖。3D繪圖使用3D模型和各種影像處理產生具有三維空間真實感的影像,應用于虛擬真實情況以及多媒體的產品上,且多半是使用低成本的實時3D計算機繪圖技術為基礎。在初期3D圖形學剛起步時,由于圖形簡單,因此可以利用CPU來運算,但隨著圖形學技術的發展,所要繪制的圖形越來越復雜,這時如果單純依賴CPU來處理,不能達到實時的要求,因此需要專門的硬件來加速圖形處理,GPU(圖形處理單元)因此出現了。不過由于3D圖形加速硬件的復雜性和短壽命,這極大地提高了對硬件開發環境的需要。為了更好的對設計進行更改和測試,不能僅僅用專門定制的方法來設計,需要其他的方:硬件描述語言(HDL)和FPGA。 隨著計算機繪圖規模的需要,借助輔助硬件資源,來提高圖形處理單元(GPU)處理速度的需求越來越普遍。自從15年前現場可編程門陣列(FPGA)開始出現以來,其在可編程硬件領域所起的作用越來越大。它們在速度、體積和速度方面都有了很大的提高。這意味著FPGA在以前只能使用專用硬件的場合越來越重要。其中一個應用領域就是3D圖形渲染,在這個研究領域里人們正在利用具有可編程性能的FPGA來幫助改進圖形處理單元(GPU)的性能。 能夠在廉價、可動態重新配置的FPGA上實現復雜算法來輔助硬件設計。本文的設計就是通過在FPGA上實現3維圖形幾何處理管線部分功能來提高圖形處理速度。具體實現中使用硬件描述語言(Verilog HDL)進行邏輯設計,并發現問題解決問題。 本文主要特色如下: 1.針對幾何變換換子系統,提出一種硬件實現方案,該方案能對基本的幾何變換如:平移、縮放、旋轉和投影進行操作。首先構造出總體變換矩陣,隨后進行矩陣乘法運算,再進行投影變換,最后輸出變換座標。提出一種脈動陣列結構,用于兩個矩陣的乘法運算。找到一種快捷的方法來實現矩陣相乘,將能大大提高系統的效率。 2.對于3D圖形裁剪,文中描述了一種裁剪引擎,它能夠處理3D圖形中的裁剪、透視除法以及視口映射的功能。硬件實現的難度取決于裁剪算法的復雜程度。我們在Sutherland-Hodgman裁剪算法的基礎上提出一種新的裁剪算法,該算法通過去除冗余頂點以提高處理速度,同時利用編碼來判斷線段可見性的方法使得硬件實現變得很容易。 3.最后,我們在FPGA上實現了幾何變換以及三維裁剪,并與C語言的模擬結果對比發現結果正確,且三維裁剪能夠以3M個三角形/s的速度運行,滿足了圖形流水中的實時性要求。

    標簽: 三維圖形 幾何 算法

    上傳時間: 2013-04-24

    上傳用戶:yerik

  • 基于以太網和FPGA的智能小區管理系統

    智能化住宅小區,是指在一定范圍內通過有效的傳輸網絡,將多元住處服務、物業管理、安防以及住宅智能化等系統結合在一起,為該小區的服務與管理提供高技術的智能化手段。從而實現快捷高效的超值服務管理和安全舒適的家居環境,使業主生活得更安全、更方便。 隨著國民經濟和科學技術水平的提高,特別是計算機技術、通信技術、網絡技術和控制技術的迅速發展,促進了智能小區在我國的推廣和應用。目前這些小區的智能化建設大多數是采用Lonworks、FF等現場總線技術。但是現場總線協議標準化程度還不成熟,且成本較高。隨著寬帶Internet進入家庭,利用Internet來構建智能小區已成為大勢所趨。 本文介紹了一種基于以太網和FPGA的嵌入式智能小區管理系統的組建方法。首先,以Altera的FPGA為核心,通過在外圍添加適當的存儲設備和通信接口設備,構成一個嵌入式系統的硬件平臺。其次,在此平臺的基礎上,通過在FPGA中定制Nios Ⅱ軟核處理器以及在外圍的Flash存儲器中下載uClinux操作系統,從而構建出一套資源豐富的嵌入式操作系統。該系統帶有一個網絡功能齊全的Web服務器。最后,將此操作系統作為智能小區的樓宇集中器,再根據需要配置適當的采集器和顯示器,就可以組建成一套功能強大的智能小區管理系統。它可以完成圖像抄表、定時圖像采集、實時溫度監控、樓宇廣播、智能語音報警等功能。 這種利用當前流行的嵌入式系統來組建的智能小區管理系統,不但實現簡單、功能強大;而且節約布線、成本低廉。因此具有很高的性價比,相信在未來有較大的市場潛力。 本文主要包括如下幾個部分:系統硬件結構設計,包括系統的原理圖構建和PCB板的繪制:系統核心處理器設計,包括Nios Ⅱ軟核CPU的設計方法、外圍存儲和通信器件的添加及設計方法;嵌入式操作系統uClinux的相關知識及移植方法:系統的軟件結構設計,包括圖像采集、溫度采集、LCD顯示等CGI程序設計,以及單片機語音報警程序設計等;最后給出了調試情況以及一些試驗結果。

    標簽: FPGA 以太網 智能小區 管理系統

    上傳時間: 2013-06-11

    上傳用戶:ccsp11

  • 船用導航雷達數字信號處理設計

    當今的船用導航雷達具有數字化、多功能、高性能、多接口、網絡化。同時要求具有高可靠性、高集成度、低成本,信號處理單元的小型化,產品更新周期短。要同時滿足上述需求,高集成度的器件應用是必須的。同時開發周期要短,需求軟件的可移植性要強,并且是模塊化設計,現場可編程門陣列器件(FPGA)已經成為設計首選。 現場可編程門陣列是基于通過可編程互聯連接的可配置邏輯塊(CLB)矩陣的可編程半導體器件。與為特殊設計而定制的專用集成電路(ASIC)相對,FPGA可以針對所需的應用或功能要求進行編程。雖然具有一次性可編程(OTP)FPGA,但是主要是基于SRAM的,其可隨著設計的演化進行重編程。CLB是FPGA內的基本邏輯單元。實際數量和特性會依器件的不同而不同,但是每個CLB都包含一個由4或6個輸入、一些選型電路(多路復用器等)和觸發器組成的可配置開關矩陣。開關矩陣是高度靈活的,可以進行配置以便處理組合邏輯、移位寄存器或RAM。當今的FPGA已經遠遠超出了先前版本的基本性能,并且整合了常用功能(如RAM、時鐘管理和:DSP)的硬(ASIC型)塊。由于具有可編程特性,所以FPGA是眾多市場的理想之選。它高集成度,以及用于設計的強大軟件平臺、IP核、在線升級可滿足需求。 本文介紹了基于FPGA實現船用導航雷達數字信號處理的設計,這是一個具體的、已經完成并進行小批量生產的產品,對指導實踐具有一定意義。

    標簽: 導航雷達 數字信號處理

    上傳時間: 2013-04-24

    上傳用戶:稀世之寶039

  • VC編程經驗總結

    VC編程經驗總結.rar一本不錯的介紹VC編程的書 CSDN介紹屏保的好像不多,我來補個空缺,呵呵 :) 對于屏幕保護程序,大家應該不會陌生。屏幕保護程序的后綴名是.scr,其實它就是一個可執行的.exe文件。 VC提供了一個支持屏幕保護的開發庫scrnsave.lib,這個庫已經定制了一個屏幕保護程序的框架結構,開發者只需要在完成相應的函數和提供相應的資源就可以寫出自己的屏幕保護程序。

    標簽: 編程 經驗

    上傳時間: 2013-07-10

    上傳用戶:candice613

  • Viewdraw 30

    一個有趣的、易用的、直觀的、可自由定制的白板軟件是什么樣的?深圳市艾博德科技有限公司強勢推出的DrawView V3.0將帶給你全新的體驗。

    標簽: Viewdraw 30

    上傳時間: 2013-06-16

    上傳用戶:CHENKAI

  • Virtuso 6.1.50

    Virtuoso定制設計平臺是一個全面的系統,能夠加速差異化定制芯片的精確設計

    標簽: Virtuso 50

    上傳時間: 2013-06-15

    上傳用戶:天涯

  • wince5.0升級包0

    "目前WinCE5.0的開發工具主要有以下幾種:Platform Builder5.0、EVC4.0+SP4、Visual Studio2005。其中Platform Builder主要用于定制WinCE操作系統,它也可以用來編寫驅動程序和應用程序。EVC顧名思義就是嵌入式版的VC,它主要用來開發應用程序,當然也可用來編寫驅動程序。Visual Studio2005是微軟的集大成開發工具。它能用來定制WinCE6.0的操作系統,也可以用來開發應用和驅動程序。"

    標簽: wince 5.0

    上傳時間: 2013-07-28

    上傳用戶:gengxiaochao

  • FPGA布線算法的研究

    現場可編程門陣列(FPGA)是一種可實現多層次邏輯器件?;赟RAM的FPGA結構由邏輯單元陣列來實現所需要的邏輯函數。FPGA中,互連線資源是預先定制的,這些資源是由各種長度的可分割金屬線,緩沖器和.MOS管實現的,所以相對于ASIC中互連線所占用的面積更大。為了節省芯片面積,一般都采用單個MOS晶體管來連接邏輯資源。MOS晶體管的導通電阻可以達到千歐量級,可分割金屬線段的電阻相對于MOS管來說是可以忽略的,然而它和地之間的電容達到了0.1pf[1]。為了評估FPGA的性能,用HSPICE仿真模型雖可以獲得非常精確的結果,但是基于此模型需要花費太多的時間。這在基于時序驅動的工藝映射和布局布線以及靜態時序分析中都是不可行的。于是,非常迫切地需要一種快速而精確的模型。 FPGA中連接盒、開關盒都是由MOS管組成的。FPGA中的時延很大部分取決于互連,而MOS傳輸晶體管在互連中又占了很大的比重。所以對于MOS管的建模對FPGA時延估算有很大的影響意義。對于MOS管,Muhammad[15]采用導通電阻來代替MOS管,然后用。Elmore[3]時延和Rubinstein[4]時延模型估算互連時延。Elmore時延用電路的一階矩來近似信號到達最大值50%時的時延,而Rubinstein也是通過計算電路的一階矩估算時延的上下邊界來估算電路的時延,然而他們都是用來計算RC互連時延。傳輸管是非線性器件,所以沒有一個固定的電阻,這就造成了Elmore時延和Rubinstein時延模型的過于近似的估算,對整體評估FPGA的性能帶來負面因素。 本論文提出快速而精確的現場可編程門陣列FPGA中的互連資源MOS傳輸管時延模型。首先從階躍信號推導出適合50%時延的等效電阻模型,然后在斜坡輸入的時候,給出斜坡輸入時的時延模型,并且給出等效電容的計算方法。結果驗證了我們精確的時延模型在時間上的開銷少的性能。 在島型FPGA中,單個傳輸管能夠被用來作為互連線和互連線之間的連接,或者互連線和管腳之間的連接,如VPR把互連線和管腳作為布線資源,管腳只能單獨作為輸入或者輸出管腳,以致于它們不是一個線網的起點就是線網的終點。而這恰恰忽略了管腳實際在物理上可以作為互連線來使用的情況(VPR認為dogleg現象本身對性能提高不多)。本論文通過對dogleg現象進行了探索,并驗證了在使用SUBSET開關盒的情況下,dogleg能提高FPGA的布通率。

    標簽: FPGA 布線 法的研究

    上傳時間: 2013-07-24

    上傳用戶:yezhihao

  • 全國高校物聯網專業師資培訓班

    全國高校物聯網專業師資培訓班。培訓目標: 本次物聯網師資培訓課程內容針對高校物聯網專業師資缺乏的現狀量身定制,涵蓋了物聯網核心技術知識體系、短距離無線通信技術與簡單無線網絡、zigbee無線傳感網絡、嵌入式藍牙和WIFI技術、射頻識別RFID、遠程網絡和多網絡融合技術,涵蓋物聯網教學40個典型實驗。

    標簽: 物聯網

    上傳時間: 2013-06-25

    上傳用戶:cngeek

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