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定相

  • 徹底搞定C指針_姚云飛

    《徹底搞定C指針》是互聯網上下載次數最多的針對C指針問題的中文資源之一?,F在,經由修訂者的重新修訂、編輯與排版,本書的《完全版·修訂增補版》全新登場。新版本中的技術用語更加清楚嚴謹,行文的結構層次更加分明,例子中的程序代碼均通過編譯以測試其精準性。

    標簽: 指針

    上傳時間: 2013-11-15

    上傳用戶:許小華

  • 單相逆變器光伏仿真程序--原文資料

    單相逆變器光伏仿真程序

    標簽: 單相逆變器 光伏 仿真程序

    上傳時間: 2013-11-20

    上傳用戶:362279997

  • NE555電路智能設計軟件下載

    附件為NE555電路智能設計軟件,是以NE555芯片為核心,設計出不同的智能控制電路的軟件。 NE555為8腳時基集成電路, 各腳主要功能(集成塊圖在下面) 1地GND 2觸發 3輸出 4復位 5控制電壓 6門限(閾值) 7放電 8電源電壓Vcc 應用十分廣泛,可裝如下幾種電路: 1。單穩類電路作用: 定延時,消抖動,分(倍)頻,脈沖輸出,速率檢測等。 2。雙穩類電路作用: 比較器,鎖存器,反相器,方波輸出及整形等。 3。無穩類電路作用: 方波輸出,電源變換,音響報警,玩具,電控測量,定時等。 我們知道,555電路在應用和工作方式上一般可歸納為3類。每類工作方式又有很多個不同的電路。在實際應用中,除了單一品種的電路外,還可組合出很多不同電路,如:多個單穩、多個雙穩、單穩和無穩,雙穩和無穩的組合等。這樣一來,電路變的更加復雜。為了便于我們分析和識別電路,更好的理解555電路,這里我們這里按555電路的結構特點進行分類和歸納,把555電路分為3大類、8種、共18個單元電路。每個電路除畫出它的標準圖型,指出他們的結構特點或識別方法外,還給出了計算公式和他們的用途。方便大家識別、分析555電路。下面將分別介紹這3類電路  

    標簽: 555 NE 電路

    上傳時間: 2013-10-23

    上傳用戶:qimingxing130

  • TimeQuest就一定要搞定完整版

    TimeQuest就一定要搞定完整版,學習TimeQuest很好的資料

    標簽: TimeQuest

    上傳時間: 2013-12-17

    上傳用戶:fujiura

  • 編碼器倍頻、鑒相電路在FPGA中的實現

    編碼器倍頻、鑒相電路在FPGA中的實現

    標簽: FPGA 編碼器 倍頻 中的實現

    上傳時間: 2013-10-27

    上傳用戶:royzhangsz

  • PCB設計要求簡介

    PCB設計要點 一.PCB工藝限制 1)線  一般情況下,線與線之間和線與焊盤之間的距離大于等于13mil,實際應用中,條件允許時應考慮加大距離;布線密度較高時,可考慮但不建議采用IC腳間走兩根線,線的寬度為10mil,線間距不小于10mil。特殊情況下,當器件管腳較密,寬度較窄時,可按適當減小線寬和線間距。  2)焊盤 焊盤與過渡孔的基本要求是:盤的直徑比孔的直徑要大于0.6mm;例如,通用插腳式電阻、電容和集成電路等,采用盤/孔尺寸 1.6mm/0.8mm(63mil/32mil),插座、插針和二極管1N4007等,采用1.8mm/1.0mm(71mil/39mil)。實際應用中,應根據實際元件的尺寸來定,有條件時,可適當加大焊盤尺寸;PCB板上設計的元件安裝孔徑應比元件管腳的實際尺寸大0.2~0.4mm左右。  3)過孔 一般為1.27mm/0.7mm(50mil/28mil);當布線密度較高時,過孔尺寸可適當減小,但不宜過小,可考慮采用1.0mm/0.6mm(40mil/24mil)。  二.網表的作用     網表是連接電氣原理圖和PCB板的橋梁。是對電氣原理圖中各元件之間電氣連接的定義,是從圖形化的原理圖中提煉出來的元件連接網絡的文字表達形式。在PCB制作中加載網絡表,可以自動得到與原理圖中完全相

    標簽: PCB

    上傳時間: 2013-10-11

    上傳用戶:13817753084

  • CPLD器件在兩相混合式步進電動機驅動器中的應用

    文章詳細介紹了一種以Xilinx 公司生產的CPLD 器件XC9536 為核心來產生電機繞組參考電流, 進而實現具有繞組電流補償功能的兩相混合式步進電動機10 細分和50 細分運行方式的方法。實踐證明, 該方法可以有效地提高兩相混合式步進電動機系統的運行效果。

    標簽: CPLD 器件 中的應用 步進電動

    上傳時間: 2013-11-16

    上傳用戶:trepb001

  • 基于FPGA的數字三相鎖相環的優化設計

    數字三相鎖相環中含有大量乘法運算和三角函數運算,占用大量的硬件邏輯資源。為此,提出一種數字三相鎖相環的優化實現方案,利用乘法模塊復用和CORDIC算法實現三角函數運算,并用Verilog HDL硬件描述語言對優化前后的算法進行了編碼實現。仿真和實驗結果表明,優化后的數字三相鎖相環大大節省了FPGA的資源,并能快速、準確地鎖定相位,具有良好的性能。

    標簽: FPGA 數字 三相 優化設計

    上傳時間: 2013-10-22

    上傳用戶:emhx1990

  • 基于FPGA的全數字鎖相環路的設計

    介紹了應用VHDL技術設計嵌入式全數字鎖相環路的方法。詳細描述了其工作原理和設計思想,并用可編程邏輯器件FPGA加以實面。

    標簽: FPGA 全數字 鎖相環路

    上傳時間: 2013-10-20

    上傳用戶:yl8908

  • PCB設計經典資料

    本文將接續介紹電源與功率電路基板,以及數字電路基板導線設計。寬帶與高頻電路基板導線設計a.輸入阻抗1MHz,平滑性(flatness)50MHz 的OP增幅器電路基板圖26 是由FET 輸入的高速OP 增幅器OPA656 構成的高輸入阻抗OP 增幅電路,它的gain取決于R1、R2,本電路圖的電路定數為2 倍。此外為改善平滑性特別追加設置可以加大噪訊gain,抑制gain-頻率特性高頻領域時峰值的R3。圖26 高輸入阻抗的寬帶OP增幅電路圖27 是高輸入阻抗OP 增幅器的電路基板圖案。降低高速OP 增幅器反相輸入端子與接地之間的浮游容量非常重要,所以本電路的浮游容量設計目標低于0.5pF。如果上述部位附著大浮游容量的話,會成為高頻領域的頻率特性產生峰值的原因,嚴重時頻率甚至會因為feedback 阻抗與浮游容量,造成feedback 信號的位相延遲,最后導致頻率特性產生波動現象。此外高輸入阻抗OP 增幅器輸入部位的浮游容量也逐漸成為問題,圖27 的電路基板圖案的非反相輸入端子部位無full ground設計,如果有外部噪訊干擾之虞時,接地可設計成網格狀(mesh)。圖28 是根據圖26 制成的OP 增幅器Gain-頻率特性測試結果,由圖可知即使接近50MHz頻率特性非常平滑,-3dB cutoff頻率大約是133MHz。

    標簽: PCB

    上傳時間: 2013-11-09

    上傳用戶:z754970244

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