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實時處理

實時處理即即時運算（Real-timecomputing），是計算機科學中對受到“即時約束”的電腦硬件和電腦軟件系統的研究，即時約束像是從事件發生到系統回應之間的最長時間限制。即時程序必須保證在嚴格的時間限制內響應。

基于FPGA的實時圖像融合處理系統

隨著多媒體技術發展，數字圖像處理已經成為眾多應用系統的核心和基礎。圖像處理作為一種重要的現代技術，已經廣泛應用于軍事指揮、大視場展覽、跟蹤雷達、電視會議、導航等眾多領域。因而，實現高分辨率高幀率圖像實時處理的技術不僅具有廣泛的應用前景，而且對相關領域的發展也具有深遠意義。大視場可視化系統由于屏幕尺寸很大，只有在特制的曲面屏幕上才能使細節得到充分地展現。為了在曲面屏幕上正確的顯示圖像，需要在投影前實時地對圖像進行幾何校正和邊緣融合。而現場可編程門陣列(FPGA)則是用硬件處理實時圖像數據的理想選擇，基于FPGA的圖像處理技術是世界范圍內廣泛關注的研究領域。本課題的主要工作就是設計一個以FPGA為核心的硬件系統，該系統可對高分辨率高刷新率(1024*768@60Hz)的視頻圖像實時地進行幾何校正和邊緣融合。論文首先介紹了圖像處理的幾何原理，然后提出了基于FPGA的大視場實時圖像融合處理系統的設計方案和模塊功能劃分。系統分為算法與軟件設計，硬件電路設計和FPGA邏輯設計三個大的部分。本論文主要負責FPGA的邏輯設計。圍繞FPGA的邏輯設計，論文先介紹了系統涉及的關鍵技術，以及使用Verilog語言進行邏輯設計的基本原則。論文重點對FPGA內部模塊設計進行了詳細的闡述。仲裁與控制模塊是頂模塊的主體部分，主要實現系統狀態機和時序控制；參數表模塊主要實現SDRAM存儲器的控制器接口，用于圖像處理時讀取參數信息。圖像處理模塊是整個系統的核心，通過調用FPGA內嵌的XtremeDSP模塊，高速地完成對圖像數據的乘累加運算。最后論文提出并實現了一種基于PicoBlaze核的12C總線接口用于配置FPGA外圍芯片。經過對寄存器傳輸級VerilogHDL代碼的綜合和仿真，結果表明，本文所設計的系統可以應用在大視場可視化系統中完成對高分辨率高幀率圖像的實時處理。

標簽： FPGA 實時圖像處理系統

上傳時間： 2013-05-19

上傳用戶：戀天使569
高分辨率實時圖像處理系統的fpga設計及實現

本課題給出了一種基于高速PCI總線、以FPGA為核心處理器和控制器的高分辨率實時圖像處理系統，該系統可實現對高分辨率高幀率圖像（1024*768@60HZ）的實時采集、處理以及輸出。本文首先給出了高分辨率實時圖像處理系統的系統方案，然后介紹了高分辨率實時圖像處理卡的詳細設計方案。本文的重點在于介紹高分辨率實時圖像處理系統的FPGA控制邏輯設計，主要研究了該數字圖像處理系統中影響系統實時處理速度的數據流控制技術，如PCI接口控制、FPGA與外部RAM的高速讀寫控制、圖像的采集預處理，圖像的輸出控制等，本文還介紹了高分辨率實時圖像處理卡的上位機應用程序設計與實現，本文的最后介紹了系統的調試及應用。驗證結果表明，本文所設計的接口模塊可以很好地應用在高分辨率實時圖像處理系統中，采用這些接口模塊，系統能有效完成上述的圖像數據流控制功能。

標簽： 圖像處理 fpga

上傳時間： 2022-07-27

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基于DSPFPGA的圖像處理電路板硬件設計.rar

波前處理機是自適應光學系統中實時信號處理和運算的核心，隨著自適應光學系統得發展，波前傳感器的采樣頻率越來越高，這就要求波前處理機必須有更強的數據處理能力以保證系統的實時性。在整個波前處理機的工作流程中，對CCD傳來的實時圖像數據進行實時處理是第一步，也是十分重要的一步。如果不能保證圖像處理的實時性，那么后續的處理過程都無從談起。因此，研制高性能的圖像處理平臺，對波前處理機性能的提高具有十分重要的意義。論文介紹了本研究課題的背景以及國內外圖像處理技術的應用和發展狀況，接著介紹了傳統的專用和通用圖像處理系統的結構、特點和模型，并通過分析DSP芯片以及DSP系統的特點，提出了基于DSP和FPGA芯片的實時圖像處理系統。該系統不同于傳統基于PC機模式的圖像處理系統，發揮了DSP和FPGA兩者的優勢，能更好地提高圖像處理系統實時性能，同時也最大可能地降低成本。論文根據圖像處理系統的設計目的、應用需求確定了器件的選型。介紹了主要的器件，接著從系統架構、邏輯結構、硬件各功能模塊組成等方面詳細介紹了DSP+FPGA圖像處理系統硬件設計，并分析了包括各種參數指標選擇、連接方式在內的具體設計方法以及應該注意的問題。論文在闡述傳輸線理論的基礎上，在制作PCB電路板的過程中，針對高速電路設計中易出現的問題，詳細分析了高速PCB設計中的信號完整性問題，包括反射、串擾等，說明了高速PCB的信號完整性、電源完整性和電磁兼容性問題及其解決方法，進行了一定的理論和技術探討和研究。論文還介紹了基于FPGA的邏輯設計，包括了圖像采集模塊的工作原理、設計方案和SDRAM控制器的設計，介紹了SDRAM的基本操作和工作時序，重點闡述系統中可編程器件內部模塊化SDRAM控制器的設計及仿真結果。論文最后描述了硬件系統的測試及調試流程，并給出了部分的調試結果。該系統主要優點有：實時性、高速性。硬件設計的執行速度，在高速DSP和FPGA中實現信號處理算法程序，保證了系統實時性的實現；性價比高。自行研究設計的電路及硬件系統比較好的解決了高速實時圖像處理的需求。

標簽： DSPFPGA 圖像處理電路板

上傳時間： 2013-05-30

上傳用戶：fxf126@126.com
基于FPGA技術的微弱GPS信號實時處理的實現.rar

普通GPS接收機在特殊環境下，如在高樓林立的城市中心，林木遮擋的森林公路，特別是在隧道和室內環境的情況下，由于衛星信號非常微弱，載噪比（Carrier Noise Ratio，C/No）通常都在34dB-Hz以下，很難有效捕獲到衛星信號，導致無法正常定位。惡劣條件下的定位有廣闊的發展和應用前景，特別是在交通事故、火災和地震等極端環境下，快速準確定位當事者所處位置對于降低事態損失和營救受傷者是極為重要的。歐美和日本等發達國家也都制定了相應的提高惡劣條件下高靈敏度定位能力的發展政策。而高靈敏度GPS接收機定位的關鍵在于GPS微弱信號的處理。本課題的主要研究內容是針對GPS微弱信號改進處理方法。針對傳統GPS接收機信號捕獲中的串行搜索方法提出了基于批處理的微弱信號捕獲方法,來提高低信噪比情況下微弱信號的捕獲能力，實現快速高靈敏度的準確捕獲；針對捕獲微弱信號處理大量數據導致的運算量激增，運用雙塊零拓展(Double Block Zero Padding，DBZP)處理方法減少運算量同時縮短捕獲時間。針對傳統GPS接收機延遲鎖相環跟蹤算法提出了基于卡爾曼濾波的新型捕獲算法，減小延遲鎖相環失鎖造成的信號跟蹤丟失概率，來提高惡劣環境下低信噪比信號的跟蹤能力，實現微弱信號的連續可靠跟蹤。通過提高GPS微弱信號的捕獲與跟蹤能力，進而使GPS接收機在惡劣環境下衛星信號微弱時能夠實現較好的定位與導航。通過擬合GPS接收機實際接收到的原始數據，構造出不同載噪比的數字信號，分別對提出的針對微弱信號的捕獲與跟蹤算法進行仿真比較驗證，結果表明，對接收機后端信號處理部分作出的算法改進使得GPS接收機可以更好的處理微弱信號，并且具有較高的靈敏度和精度。文章同時針對提出的數據處理特征使用FPGA技術對算法主要的數據處理部分進行了初步的構架實現并進行了板級驗證，結果表明，利用FPGA技術可以較好的實現算法的數據處理功能。文章最后給出了結論，通過提出的基于批處理和基于DBZP方法的捕獲算法以及基于卡爾曼濾波的信號跟蹤算法，可以有效地解決微弱GPS信號處理的難題，進而實現微弱信號環境下的定位與導航。

標簽： FPGA GPS 信號實時處理

上傳時間： 2013-05-31

上傳用戶：cccole0605
二維DCT/IDCT處理核的FPGA設計與實現

離散余弦變換(DCT)及其反變換(IDCT)在圖像編解碼方面應用十分廣泛，至今已被JPEG、MPEG-1、MPEG-2、MPEG-4和H.26x等國際標準所采用。由于其計算量較大，軟件實現往往難以滿足實時處理的要求，因而在很多實際應用中需要采用硬件設計的DCT/IDCT處理電路來滿足我們對處理速度的要求。本文所研究的內容就是針對圖像處理應用的8×8二維DCT/IDCT處理核的硬件實現。本文首先介紹了DCT和IDCT在圖像處理中的作用和原理，詳細說明了DCT變換實現圖像壓縮的過程，并與其它變換比較說明了用DCT變換實現圖像壓縮的優勢。接著，分析研究了DCT的各種快速算法，總結了前人對DCT快速算法及其實現所做的研究。本文給出了兩種性能、資源上有一定差異的二維DCT/IDCT的FPGA設計方案。兩種方案均利用DCT的行列分離特性，采用流水線設計技術，將二維DCT/IDCT實現轉化為兩個一維DCT/IDCT實現。在一維DCT/IDCT設計中，根據圖像處理的特點對Loeffler算法的數據流進行了優化，通過合理安排時鐘周期數和簡化各周期內的操作，大大縮短了關鍵路徑的執行時間，從而提高了流水線的執行速度。最后，對所設計的DCT/IDCT處理核進行了綜合和時序仿真。結果表明，當使用Altera公司的MERCURY系列FPGA器件時，本文設計的方案一能夠在116M時鐘頻率下正確完成8×8的二維DCT或IDCT的邏輯運算，消耗2827個邏輯單元；方案二能夠在74M時鐘頻率下正常工作，消耗1629個邏輯單元。

標簽： IDCT FPGA DCT 二維

上傳時間： 2013-07-14

上傳用戶：3291976780
面向特種LCD圖像處理方法與FPGA實現研究

本文研究特種LCD的圖像處理方法和FPGA實現方案，并研制出基于FPGA的若干實際應用系統，有效地解決目前存在的問題。本文主要研究內容為：　　(1)給出一種基于彩色空間變換的色彩調整方法，在YCrCb空間內實現亮度和色度分離，避免了RGB空間兩者同時變化造成偏色和失真的現象，并在FPGA內采用流水線結構改進3階矩陣運算的邏輯結構，節省出2/3的邏輯資源，提高了模塊的最高運行速度。　　(2)研究利用FPGA實現圖像實時縮放處理的方法，選擇能夠滿足特種LCD要求的雙線性插值法作為研究對象，實時計算插值系數dx和dy，并采用流水線結構進行插值計算，僅使用FPGA中的3個雙端口RAM來緩沖圖像數據，沒有外擴大容量幀存儲器，降低了成本，提高特種LCD的系統兼容性。　　(3)設計一種針對特種LCD更為簡捷、有效的隔行轉逐行掃描的實現方案，即利用圖像實時縮放的方法，把一場圖像縮放到LCD的分辨率，實現復合視頻圖像在LCD的“滿屏”顯示，改善現有特種LCD在顯示隔行掃描的復合視頻信號時，遇到圖像信息丟失或顯示效果不佳的問題。　　(4)設計出一種基于字符和位圖的數字OSD控制核，合理使用分布式RAM和塊RAM兩種邏輯資源來存儲字符和位圖信息，OSD圖像由數字邏輯自動合成，編程簡單靈活，使特種LCD的參數調整更加方便。　　(5)研制成功基于FPGA的特種LCD顯示控制板，能顯示三種分辨率640×480，800×600，1024×768的圖像信號；支持寬范圍的亮度、對比度、顯示位置等參數的實時調整，并提供全功能的透明OSD菜單進行指示。　　(6)研制成功基于FPGA的特種LCD圖像調節板，用于對某型號機載特種LCD進行改造，增加寬范圍的亮度、對比度、圖像顯示位置的實時調整功能，提供無信號輸入檢測與OSD指示功能，提高圖像顯示的性能，通過了環境溫度試驗與性能測試，并已裝機。　　(7)研制成功基于DSP和FPGA的圖像采集顯示板，實現了對全分辨率復合視頻信號進行25幀/秒的實時采集和顯示，在DSP內使用“三幀”輪換的圖像數據緩沖方法提高了系統的實時處理能力，使之能夠完成一定復雜度的實時圖像處理。

標簽： FPGA LCD 圖像處理方法

上傳時間： 2013-06-12

上傳用戶：ivan-mtk
基于ARM的鋼廠實時能耗監測系統設計

近年來，隨著社會經濟的發展，社會對能源的需求量越來越大，對能源的依賴性也越來越強，而同時全球的能源儲備越來越少。尤其是中國，幾乎所有能源人均都不及世界的一半。2007年“兩會”，政府工作報告中明確提出把節能減耗作為工作切入點，并成立國務院節能減排工作領導小組。鋼廠作為工業耗能大戶，其節能減耗顯得尤為重要，舊的分散式能耗測量方法已不能滿足需要，提出新的能耗檢測方法迫在眉睫。本文的工作就是以此為大背景，針對鋼廠的能源消耗提出一種新型實時測量方法。系統以嵌入式為開發思路、WINCE操作系統丌發監測終端，包括數據采集、數據傳輸以及數據集中處理顯示三部分。數據采集主要依賴傳感器和單片機，將采集到的模擬數據轉換為數字量并按照協議要求進行格式打包，包括電參數采集、水參數采集和天然氣參數采集三部分；數據傳輸則采用傳統的RS485工業控制網絡；終端部分則以ARM為載體，WINCE為平臺，開發應用程序實時處理數據。文中詳細闡述了整個監測系統的硬件設計思路和軟件設計流程。介紹了數據檢測原理及過程，給出了底層和終端的系統通信協議及通信流程，同時通過對監測終端的描述詳細介紹了WINCE嵌入式操作系統的定制和在ARM9目標板上的移植，并詳細闡述了基于WINCE的EVC應用程序開發，給出了部分代碼。本次設計提出了一種新的鋼廠能耗數據集中實時采集技術，并完成了系統整體設計。經過測試運行，各項技術性能指標已經達到了設計的要求。

標簽： ARM 能耗監測系統設計

上傳時間： 2013-04-24

上傳用戶：ve3344
采用FPGA實現信號處理算法的研究及實驗平臺的建立

該文針對復雜信號實時處理的困難,提出了采用FPGA來實現信號處理的方法,并根據系統需要設計了一個嵌入式實驗平臺.根據FPGA實現信號處理的關鍵點:設計合理的FPGA結構,體現算法的并行性和流水性,論文著重分析了用FPGA實現陣列結構處理的具體方法和實現過程.論文從分析算法的并行度入手,提出用相關圖方法直觀反映算法的相關性,在此基礎上設計了算法的信號流圖結構和脈動陣列結構.并針對典型信號處理算法(矩陣運算、卷積運算)進行了并行度分析,相關圖設計和從相關圖導出脈動陣列結構的研究.同時針對FPGA特點,提出了采用CORDIC結構來設計通用運算單元,給出其流水實現的結構,結合脈動陣列結構提高了矩陣運算性能.最后設計一個以32位CPU為核心的實驗平臺,編寫了啟動程序和診斷程序.

標簽： FPGA 信號處理法的研究實驗

上傳時間： 2013-04-24

上傳用戶：1427796291
高速并行信號處理板數據接口與控制的FPGA設計

隨著信息社會的發展，人們要處理的各種信息總量變得越來越大，尤其在處理大數據量與實時處理數據方面，對處理設備的要求是非常高的。為滿足這些要求，實時快速的各種CPU、處理板應運而生。這類CPU與板卡處理數據速度快，效率高，并且不斷的完善與發展。此類板卡要求與外部設備通訊，同時也要進行內部的數據交換，于是板卡的接口設備調試與內部數據交換也成為必須要完成的工作。本文所作的工作正是基于一種高速通用信號處理板的外部接口和內部數據通道的設計。本文首先介紹了通用信號處理板的應用開發背景，包括此類板卡使用的處理芯片、板上設備、發展概況以及和外部相連的各種總線概況，同時說明了本人所作的主要工作。其次，介紹了PCI接口的有關規范，給出了通用信號處理板與CPCI的J1口的設計時序；介紹了DDR存儲器的概況、電平標準以及功能寄存器，并給出了與DDR．存儲器接口的設計時序；介紹了片上主要數據處理器件TS-202的有關概況，設計了板卡與DSP的接口時序。再次，介紹了Altera公司FPGA的程序設計流程，并使用VHDL語言編程完成各個模塊之間的數據傳遞，并重點介紹了DDR控制核的編寫。再次，介紹了WDM驅動程序的結構，程序設計方法等。最后，通過從工控機向通用信號處理板寫連續遞增的數據驗證了整個系統已經正常工作。實現了信號處理板內部數據通道設計以及與外部接口的通訊；并且還提到了對此設計以后地完善與發展。本文所作的工作如下： 1、設計完成了處理板各接口時序，使處理板可以從接口接受/發送數據。 2、完成了FPGA內部的數據通道的設計，使數據可以從CPCI準確的傳送到DSP進行處理，并編寫了DSP的測試程序。 3、完成了DDR SDRAM控制核的VHDL程序編寫。 4、完成了PCI驅動程序的編寫。

標簽： FPGA 高速并行信號處理板數據接口

上傳時間： 2013-06-30

上傳用戶：唐僧他不信佛
星載SAR高速FPGA預處理板的研制

合成孔徑雷達的實時信號處理系統,可以分成相對獨立的幾個階段,即A/D變換和緩存、距離向預處理器、方位向預處理器、距離向壓縮處理、轉置存儲器、方位向壓縮處理、逆轉置存儲器.合成孔徑雷達預處理的目的,就是緩解高處理數據率和低傳輸數據率的矛盾,使得在不太影響成像質量的前提下,盡量減少傳輸的數據率,有利于后續處理的硬件實現,做到實時處理.論文結合電子所合成孔徑雷達實時成像處理系統,設計開發了基于Xilinx Virtex-E FPGA的星載SAR高速預處理板,該信號處理板處理能力強,結構緊湊,運行效率高;其硬件電路的設計思路和結構形式有很強的通用性和使用價值.論文重點研究了預處理的核心部分—固定系數FIR濾波器的設計問題.而固定系數FIR濾波器的實現問題的重點又是FPGA內部的固定系數FIP濾波器實現問題,針對FPGA內部的查找表資源,我們選擇目前流行的分布式算法來實現FIR濾波器的設計.對比于預處理器中其他濾波器設計方案,基于FPGA分布式算法的FIR濾波器的設計,避免了乘累加運算,提高了系統運行的速度并且節省了大量的FPGA資源.并且由于FPGA可編程的特性,所以可以靈活的改變濾波器的系數和階數.所設計的電路簡單高速,工作正常、可靠,完全滿足了預處理器設計的技術要求.隨著超大規模集成電路技術,高密度存儲器技術,計算機技術的發展,一個全數字化的機載實時成像處理系統的研制,已經不是非常困難的事情了.而在現有條件下,全數字化的高分辨率星載實時成像處理系統的研制,將是一個非常具有挑戰意義的課題,論文以星載SAR的預處理器設計為例,拋磚引玉,希望對未來全數字化星載實時成像處理系統的研制起到一定參考價值.

標簽： FPGA SAR 星載預處理

上傳時間： 2013-07-03

上傳用戶：lanhuaying

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實時處理

基于FPGA的實時圖像融合處理系統

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