電子產(chǎn)品功能越來越強(qiáng)大的同時(shí)，對便攜的要求也越來越高，小型化設(shè)計(jì)成為很多電子設(shè)計(jì)公司的研究課題。本文以小型化設(shè)計(jì)的方法、挑戰(zhàn)和趨勢為主線，結(jié)合Cadence SPB16.5在小型化設(shè)計(jì)方面的強(qiáng)大功能，全面剖析小型化設(shè)計(jì)的工程實(shí)現(xiàn)。主要包括以下內(nèi)容：小型化設(shè)計(jì)的現(xiàn)狀和趨勢，以及現(xiàn)在主流的HDI加工工藝，介紹最新的ANYLAYER（任意階）技術(shù)的設(shè)計(jì)方法以及工藝實(shí)現(xiàn)，介紹埋阻、埋容的應(yīng)用，埋入式元器件的設(shè)計(jì)方法以及工藝實(shí)現(xiàn)。同時(shí)介紹Cadence SPB16.5軟件對小型化設(shè)計(jì)的支持。最后介紹HDI設(shè)計(jì)在高速中的應(yīng)用以及仿真方法，HDI在通信系統(tǒng)類產(chǎn)品中的應(yīng)用，HDI和背鉆的比較等。
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上傳時(shí)間： 2013-10-08
上傳用戶：nanshan
Arduino 是一塊基于開放原始代碼的Simple i/o 平臺，并且具有使用類似java,C 語言的開發(fā)環(huán)境。讓您可以快速 使用Arduino 語言與Flash 或Processing…等軟件，作出互動作品。Arduino 可以使用開發(fā)完成的電子元件例如Switch 或Sensors 或其他控制器、ＬＥＤ、步進(jìn)電機(jī)或其他輸出裝置。Arduino 也可以獨(dú)立運(yùn)作成為一個(gè)可以跟軟件溝通的平臺，例如說：flash processing Max/MSP VVVV 或其他互動軟件… Arduino 開發(fā)ＩＤＥ界面基于開放原始碼原則，可以讓您免費(fèi)下載使用開發(fā)出更多令人驚奇的互動作品。 什么是Roboduino? DFRduino 與Arduino 完全兼容，只是在原來的基礎(chǔ)上作了些改進(jìn)。Arduino 的IO 使用的孔座，做互動作品需要面包板和針線搭配才能進(jìn)行，而DFRduino 的IO 使用針座，使用我們的杜邦線就可以直接把各種傳感器連接到DFRduino 上。 特色描述 1． 開放原始碼的電路圖設(shè)計(jì)，程式開發(fā)界面免費(fèi)下載，也可依需求自己修改!! 2． DFRduino 可使用ISP 下載線，自我將新的IC 程序燒入「bootloader」； 3． 可依據(jù)官方電路圖，簡化DFRduino 模組，完成獨(dú)立云作的微處理控制器； 4． 可簡單地與傳感器、各式各樣的電子元件連接(如：紅外線,超聲波,熱敏電阻,光敏電阻,伺服電機(jī)等)； 5． 支援多樣的互動程式 如: Flash,Max/Msp,VVVV,PD,C,Processing 等； 6． 使用低價(jià)格的微處理控制器(ATMEGA168V-10PI)； 7． USB 接口，不需外接電源，另外有提供9VDC 輸入接口； 8． 應(yīng)用方面，利用DFRduino，突破以往只能使用滑鼠，鍵盤，CCD 等輸入的裝置的互動內(nèi)容，可以更簡單地達(dá)成單人或多人游戲互動。 性能描述 1． Digital I/O 數(shù)字輸入/輸出端共 0~13。 2． Analog I/O 模擬輸入/輸出端共 0~5。 3． 支持USB 接口協(xié)議及供電(不需外接電源)。 4． 支持ISP 下載功能。 5． 支持單片機(jī)TX/RX 端子。 6． 支持USB TX/RX 端子。 7． 支持AREF 端子。 8． 支持六組PWM 端子(Pin11,Pin10,Pin9，Pin6,Pin5,Pin3)。 9． 輸入電壓：接上USB 時(shí)無須外部供電或外部5V~9V DC 輸入。 10．輸出電壓：5V DC 輸出和3.3V DC 輸出 和外部電源輸入。 11．采用Atmel Atmega168V-10PI 單片機(jī)。 12．DFRduino 大小尺寸：寬70mm X 高54mm。 Arduino開發(fā)板圖片
上傳時(shí)間： 2013-10-30
上傳用戶：wangzhen1990
為解決目前高速信號處理中的數(shù)據(jù)傳輸速度瓶頸以及傳輸距離的問題，設(shè)計(jì)并實(shí)現(xiàn)了一種基于FPGA 的高速數(shù)據(jù)傳輸系統(tǒng)，本系統(tǒng)借助Altera Cyclone III FPGA 的LVDS I/O 通道產(chǎn)生LVDS 信號，穩(wěn)定地完成了數(shù)據(jù)的高速、遠(yuǎn)距離傳輸。系統(tǒng)所需的8B/10B 編解碼、數(shù)據(jù)時(shí)鐘恢復(fù)(CDR)、串/并行轉(zhuǎn)換電路、誤碼率計(jì)算模塊均在FPGA 內(nèi)利用VHDL 語言設(shè)計(jì)實(shí)現(xiàn)，大大降低了系統(tǒng)互聯(lián)的復(fù)雜度和成本，提高了系統(tǒng)集成度和穩(wěn)定性。
上傳時(shí)間： 2013-11-25
上傳用戶：爺?shù)臍赓|(zhì)
摘 要:介紹了FPGA最新一代器件Virtex25上的高速串行收發(fā)器RocketIO?；贛L505開發(fā)平臺構(gòu)建了一個(gè)高速串行數(shù)據(jù)傳輸系統(tǒng),重點(diǎn)說明了該系統(tǒng)采用RocketIO實(shí)現(xiàn)1. 25Gbp s高速串行傳輸?shù)脑O(shè)計(jì)方案。實(shí)現(xiàn)并驗(yàn)證了采用FPGA完成千兆串行傳輸?shù)墓δ苣繕?biāo),為后續(xù)采用FPGA實(shí)現(xiàn)各種高速協(xié)議奠定了良好的基礎(chǔ)。關(guān)鍵詞: FPGA;高速串行傳輸; RocketIO; GTP 在數(shù)字系統(tǒng)互連設(shè)計(jì)中,高速串行I/O技術(shù)取代傳統(tǒng)的并行I/O技術(shù)成為當(dāng)前發(fā)展的趨勢。與傳統(tǒng)并行I/O技術(shù)相比,串行方案提供了更大的帶寬、更遠(yuǎn)的距離、更低的成本和更高的擴(kuò)展能力,克服了并行I/O設(shè)計(jì)存在的缺陷。在實(shí)際設(shè)計(jì)應(yīng)用中,采用現(xiàn)場可編程門陣列( FPGA)實(shí)現(xiàn)高速串行接口是一種性價(jià)比較高的技術(shù)途徑。
上傳時(shí)間： 2013-10-22
上傳用戶：semi1981
本次程序的題目為：進(jìn)程管理——支持多個(gè)進(jìn)程并發(fā)運(yùn)行的簡單的進(jìn)程管理模擬系統(tǒng)，對本實(shí)驗(yàn)的分析要求是：⑴系統(tǒng)中的同步機(jī)構(gòu)采用信號量上的P、V操作的機(jī)制；⑵控制機(jī)構(gòu)包括阻塞和喚醒操作；⑶時(shí)間片中斷處理程序處理模擬的時(shí)間片中斷；⑷進(jìn)程調(diào)度程序負(fù)責(zé)為各進(jìn)程分配處理機(jī)；⑸根據(jù)用戶的需求來創(chuàng)建n個(gè)進(jìn)程(n為即滿足用戶需求,又不超出系統(tǒng)可容的最大進(jìn)程數(shù)),各進(jìn)程互斥地訪問使用臨界資源 S1、S2；⑹使用動態(tài)優(yōu)先數(shù)(如：隨阻塞次數(shù)的增加而減小優(yōu)先數(shù)，以提高其優(yōu)先權(quán))；⑺進(jìn)程結(jié)束后應(yīng)能夠撤消；⑻進(jìn)程間能實(shí)現(xiàn)“發(fā)送”和“接收”兩個(gè)消息緩沖通信操作；⑼系統(tǒng)在運(yùn)行過程中隨機(jī)打印出各進(jìn)程的狀態(tài)變換過程、系統(tǒng)的調(diào)度過程及公共變量的變化情況，在一個(gè)進(jìn)程運(yùn)行完畢，進(jìn)入完成狀態(tài)后，可以將該進(jìn)程撤消，也可以動態(tài)的創(chuàng)建另一個(gè)新的進(jìn)程。
標(biāo)簽： 進(jìn)程 程序 模擬系統(tǒng) 運(yùn)行
上傳時(shí)間： 2014-01-01
上傳用戶：ggwz258
本次程序的題目為：進(jìn)程管理——支持多個(gè)進(jìn)程并發(fā)運(yùn)行的簡單的進(jìn)程管理模擬系統(tǒng)，對本實(shí)驗(yàn)的分析要求是：⑴系統(tǒng)中的同步機(jī)構(gòu)采用信號量上的P、V操作的機(jī)制；⑵控制機(jī)構(gòu)包括阻塞和喚醒操作；⑶時(shí)間片中斷處理程序處理模擬的時(shí)間片中斷；⑷進(jìn)程調(diào)度程序負(fù)責(zé)為各進(jìn)程分配處理機(jī)；⑸根據(jù)用戶的需求來創(chuàng)建n個(gè)進(jìn)程(n為即滿足用戶需求,又不超出系統(tǒng)可容的最大進(jìn)程數(shù)),各進(jìn)程互斥地訪問使用臨界資源 S1、S2；⑹使用動態(tài)優(yōu)先數(shù)(如：隨阻塞次數(shù)的增加而減小優(yōu)先數(shù)，以提高其優(yōu)先權(quán))；⑺進(jìn)程結(jié)束后應(yīng)能夠撤消；⑻進(jìn)程間能實(shí)現(xiàn)“發(fā)送”和“接收”兩個(gè)消息緩沖通信操作；⑼系統(tǒng)在運(yùn)行過程中隨機(jī)打印出各進(jìn)程的狀態(tài)變換過程、系統(tǒng)的調(diào)度過程及公共變量的變化情況，在一個(gè)進(jìn)程運(yùn)行完畢，進(jìn)入完成狀態(tài)后，可以將該進(jìn)程撤消，也可以動態(tài)的創(chuàng)建另一個(gè)新的進(jìn)程。
標(biāo)簽： 進(jìn)程 程序 模擬系統(tǒng) 運(yùn)行
上傳時(shí)間： 2013-12-03
上傳用戶：kikye
MATLAB程序的仿真比較。隨后，針對QPsK，詳細(xì)討論了其基本原理和具體的實(shí)現(xiàn)算法，并進(jìn)行了仿真驗(yàn)證，然后選用HSP502巧數(shù)字上變頻芯片和HSP50214B數(shù)字下變頻芯片，設(shè)計(jì)了數(shù)字調(diào)制、解調(diào)器的實(shí)現(xiàn)方案。最后，作為對整個(gè)數(shù)字視頻圖像傳輸系統(tǒng)的宏觀認(rèn)識，利用M戶JLAB中的實(shí)時(shí)建模仿真Simullnk庫對典型的視頻圖像傳輸系統(tǒng)一數(shù)字視頻廣播系統(tǒng)(D vB)，進(jìn)行了建模、仿真和初步的分析，結(jié)果表明:在高斯白噪聲的傳輸環(huán)境下，系統(tǒng)采取的一系列抗干擾措施，包括內(nèi)、外碼級聯(lián)的信道糾錯(cuò)編碼和先進(jìn)的調(diào)制技術(shù)(o FDM)等，保證了信源信息傳輸?shù)挠行нM(jìn)行。
上傳時(shí)間： 2013-12-26
上傳用戶：songrui
LZW壓縮和解壓縮程序 lzw.c 主要的功能模塊 bitio.c/bitio.h 一些支撐函數(shù)，支持以比特(bit)為單位的文件I/O 用法： 壓縮 lzw E <in-file> <out-file> 解壓縮 lzw D <in-file> <out-file> 壓縮時(shí)，讀入<in-file>中內(nèi)容，壓縮后存入<out-file>中，得到壓縮文件。 解壓縮時(shí)，讀入<in-file>中內(nèi)容，將結(jié)果存入<out-file>中，得到原文件。 本代碼在linux+gcc/windows+vc下經(jīng)過測試，為了使讀者容易理解算法本身， 算法實(shí)現(xiàn)中僅采用了簡單的錯(cuò)誤處理機(jī)制和優(yōu)化。
上傳時(shí)間： 2015-06-08
上傳用戶：chenbhdt
一本講授如何構(gòu)建嵌入式系統(tǒng)的初級教材。可以作為入門者廓清概念的參考書，pdf文檔。其中也有可以立刻借鑒的東西。比如單片機(jī)鍵盤的省I/O口的接法等！
標(biāo)簽： 嵌入式系統(tǒng) 教材
上傳時(shí)間： 2015-08-25
上傳用戶：yuanyuan123
計(jì)數(shù)排序是一個(gè)非基于比較的線性時(shí)間排序算法。它對輸入的數(shù)據(jù)有附加的限制條件： 1、輸入的線性表的元素屬于有限偏序集S； 2、設(shè)輸入的線性表的長度為n，|S|=k（表示集合S中元素的總數(shù)目為k），則k=O(n)。 在這兩個(gè)條件下，計(jì)數(shù)排序的復(fù)雜性為O(n)。 計(jì)數(shù)排序算法的基本思想是對于給定的輸入序列中的每一個(gè)元素x，確定該序列中值小于x的元素的個(gè)數(shù)。一旦有了這個(gè)信息，就可以將x直接存放到最終的輸出序列的正確位置上。例如，如果輸入序列中只有17個(gè)元素的值小于x的值，則x可以直接存放在輸出序列的第18個(gè)位置上。 計(jì)數(shù)排序算法沒有用到元素間的比較，它利用元素的實(shí)際值來確定它們在輸出數(shù)組中的位置。因此，計(jì)數(shù)排序算法不是一個(gè)基于比較的排序算法，從而它的計(jì)算時(shí)間下界不再是Ω(nlogn)。另一方面，計(jì)數(shù)排序算法之所以能取得線性計(jì)算時(shí)間的上界是因?yàn)閷υ氐娜≈捣秶髁艘欢ㄏ拗?，即k=O(n)。如果k=n2,n3,..，就得不到線性時(shí)間的上界。
上傳時(shí)間： 2015-10-30
上傳用戶：chenxichenyue
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