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  • PCI架構資料_適合入門者學習,先看這份資料再去研讀PCI SPEC 會更快上手,本資料只要是讓初學者對PCI架構有更近一步的認識

    PCI架構資料_適合入門者學習,先看這份資料再去研讀PCI SPEC 會更快上手,本資料只要是讓初學者對PCI架構有更近一步的認識

    標簽: PCI SPEC

    上傳時間: 2014-01-25

    上傳用戶:13215175592

  • USB是PC體系中的一套全新的工業標準

    USB是PC體系中的一套全新的工業標準,它支持單個主機與多個外接設備同時進行數據交換。 首先會介紹USB的結構和特點,包括總線特徵、協議定義、傳輸方式和電源管理等等。這部分內容會使USB開發者和用戶對USB有一整體的認識。

    標簽: USB

    上傳時間: 2015-10-18

    上傳用戶:lixinxiang

  • 這個是去年寫的東東。 以前公司一直使用易飛ERP

    這個是去年寫的東東。 以前公司一直使用易飛ERP,也因此自學了Delphi(本人以前一直使用VFP), 這是第一個模擬易飛界面的東東。 以前有進過易飛俱樂部論壇(http://www.dcmsclub.com)的朋友可能有下載過。 裏面使用到的都是D7裏自帶的標準組件. 認識一些共同研究易飛及Delphi編程方面的朋友. 由于本人也在處于入門階段,非常感謝盒子及各位朋友的幫助。3Q! 先把MainMenu.exe文件改名下(可不要覆蓋掉原來易飛的文件啊), 解壓復制到易飛安裝目錄下的c_dsbin文件夾裏 如 易飛安裝在D盤的Conductor 文件夾,則解壓至D:\Conductor\c_dsbin 注:本源碼只供新手參考,有錯的請指出。

    標簽: ERP

    上傳時間: 2016-11-07

    上傳用戶:lanhuaying

  • 小型化設計的實現與應用

    電子產品功能越來越強大的同時,對便攜的要求也越來越高,小型化設計成為很多電子設計公司的研究課題。本文以小型化設計的方法、挑戰和趨勢為主線,結合Cadence SPB16.5在小型化設計方面的強大功能,全面剖析小型化設計的工程實現。主要包括以下內容:小型化設計的現狀和趨勢,以及現在主流的HDI加工工藝,介紹最新的ANYLAYER(任意階)技術的設計方法以及工藝實現,介紹埋阻、埋容的應用,埋入式元器件的設計方法以及工藝實現。同時介紹Cadence SPB16.5軟件對小型化設計的支持。最后介紹HDI設計在高速中的應用以及仿真方法,HDI在通信系統類產品中的應用,HDI和背鉆的比較等。

    標簽:

    上傳時間: 2014-01-18

    上傳用戶:yph853211

  • 折衷選擇輸入電容鏈波電流的線壓范圍

    透過增加輸入電容,可以在獲得更多鏈波電流的同時,還能藉由降低輸入電容的壓降來縮小電源的工作輸入電壓範圍。這會影響電源的變壓器圈數比以及各種電壓與電流應力(current stresscurrent stress current stresscurrent stress current stress current stress )。電容鏈波電流額定值越大,應力越小,電源效率也就越高。

    標簽: 輸入電容 電流

    上傳時間: 2013-11-11

    上傳用戶:jelenecheung

  • 小型化設計的實現與應用

    電子產品功能越來越強大的同時,對便攜的要求也越來越高,小型化設計成為很多電子設計公司的研究課題。本文以小型化設計的方法、挑戰和趨勢為主線,結合Cadence SPB16.5在小型化設計方面的強大功能,全面剖析小型化設計的工程實現。主要包括以下內容:小型化設計的現狀和趨勢,以及現在主流的HDI加工工藝,介紹最新的ANYLAYER(任意階)技術的設計方法以及工藝實現,介紹埋阻、埋容的應用,埋入式元器件的設計方法以及工藝實現。同時介紹Cadence SPB16.5軟件對小型化設計的支持。最后介紹HDI設計在高速中的應用以及仿真方法,HDI在通信系統類產品中的應用,HDI和背鉆的比較等。

    標簽:

    上傳時間: 2013-10-08

    上傳用戶:nanshan

  • 本次程序的題目為:進程管理——支持多個進程并發運行的簡單的進程管理模擬系統

    本次程序的題目為:進程管理——支持多個進程并發運行的簡單的進程管理模擬系統,對本實驗的分析要求是:⑴系統中的同步機構采用信號量上的P、V操作的機制;⑵控制機構包括阻塞和喚醒操作;⑶時間片中斷處理程序處理模擬的時間片中斷;⑷進程調度程序負責為各進程分配處理機;⑸根據用戶的需求來創建n個進程(n為即滿足用戶需求,又不超出系統可容的最大進程數),各進程互斥地訪問使用臨界資源 S1、S2;⑹使用動態優先數(如:隨阻塞次數的增加而減小優先數,以提高其優先權);⑺進程結束后應能夠撤消;⑻進程間能實現“發送”和“接收”兩個消息緩沖通信操作;⑼系統在運行過程中隨機打印出各進程的狀態變換過程、系統的調度過程及公共變量的變化情況,在一個進程運行完畢,進入完成狀態后,可以將該進程撤消,也可以動態的創建另一個新的進程。

    標簽: 進程 程序 模擬系統 運行

    上傳時間: 2014-01-01

    上傳用戶:ggwz258

  • 本次程序的題目為:進程管理——支持多個進程并發運行的簡單的進程管理模擬系統

    本次程序的題目為:進程管理——支持多個進程并發運行的簡單的進程管理模擬系統,對本實驗的分析要求是:⑴系統中的同步機構采用信號量上的P、V操作的機制;⑵控制機構包括阻塞和喚醒操作;⑶時間片中斷處理程序處理模擬的時間片中斷;⑷進程調度程序負責為各進程分配處理機;⑸根據用戶的需求來創建n個進程(n為即滿足用戶需求,又不超出系統可容的最大進程數),各進程互斥地訪問使用臨界資源 S1、S2;⑹使用動態優先數(如:隨阻塞次數的增加而減小優先數,以提高其優先權);⑺進程結束后應能夠撤消;⑻進程間能實現“發送”和“接收”兩個消息緩沖通信操作;⑼系統在運行過程中隨機打印出各進程的狀態變換過程、系統的調度過程及公共變量的變化情況,在一個進程運行完畢,進入完成狀態后,可以將該進程撤消,也可以動態的創建另一個新的進程。

    標簽: 進程 程序 模擬系統 運行

    上傳時間: 2013-12-03

    上傳用戶:kikye

  • Boost C++ Libraries 1.35.0

    Boost C++ Libraries Free peer-reviewed portable C++ source libraries Boost C++ Libraries 基本上是一個免費的 C++ 的跨平臺函式庫集合,基本上應該可以把它視為 C++ STL 的功能再延伸;他最大的特色在於他是一個經過「同行評審」(peer review,可參考維基百科)、開放原始碼的函式庫,而且有許多 Boost 的函式庫是由 C++ 標準委員會的人開發的,同時部分函式庫的功能也已經成為 C++ TR1 (Technical Report 1,參考維基百科)、TR2、或是 C++ 0x 的標準了。 它的官方網站是:http://www.boost.org/,包含了 104 個不同的 library;由於他提供的函式庫非常地多,的內容也非常地多元,根據官方的分類,大致上可以分為下面這二十類: 字串和文字處理(String and text processing) 容器(Containers) Iterators 演算法(Algorithms) Function objects and higher-order programming 泛型(Generic Programming) Template Metaprogramming Preprocessor Metaprogramming Concurrent Programming 數學與數字(Math and numerics) 正確性與測試(Correctness and testing) 資料結構(Data structures) 影像處理(Image processing) 輸入、輸出(Input/Output) Inter-language support 記憶體(Memory) 語法分析(Parsing) 程式介面(Programming Interfaces) 其他雜項 Broken compiler workarounds 其中每一個分類,又都包含了一個或多個函式庫,可以說是功能相當豐富。

    標簽: Boost C++ Libraries

    上傳時間: 2015-05-15

    上傳用戶:fangfeng

  • OPEN-JTAG ARM JTAG 測試原理 1 前言 本篇報告主要介紹ARM JTAG測試的基本原理。基本的內容包括了TAP (TEST ACCESS PORT) 和BOUNDARY-SCAN

    OPEN-JTAG ARM JTAG 測試原理 1 前言 本篇報告主要介紹ARM JTAG測試的基本原理。基本的內容包括了TAP (TEST ACCESS PORT) 和BOUNDARY-SCAN ARCHITECTURE的介紹,在此基礎上,結合ARM7TDMI詳細介紹了的JTAG測試原理。 2 IEEE Standard 1149.1 - Test Access Port and Boundary-Scan Architecture 從IEEE的JTAG測試標準開始,JTAG是JOINT TEST ACTION GROUP的簡稱。IEEE 1149.1標準最初是由JTAG這個組織提出,最終由IEEE批準並且標準化,所以,IEEE 1149.1這個標準一般也俗稱JTAG測試標準。 接下來介紹TAP (TEST ACCESS PORT) 和BOUNDARY-SCAN ARCHITECTURE的基本架構。

    標簽: JTAG BOUNDARY-SCAN OPEN-JTAG ARM

    上傳時間: 2016-08-16

    上傳用戶:sssl

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