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51單片機(jī)實(shí)驗(yàn)例程

51單片機(jī)開發(fā)例程，有圖片和文字說明，配合hc6800開發(fā)板使用更佳

標(biāo)簽： 51單片機(jī)實(shí)驗(yàn)

上傳時(shí)間： 2013-04-24

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用于FPGA的N+0.5分頻代碼

用于FPGA的N+0.5分頻代碼，可以用來進(jìn)行非整數(shù)分頻！

標(biāo)簽： FPGA 0.5 分頻 代碼

上傳時(shí)間： 2013-08-06

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FPGA和嵌入式處理器實(shí)現(xiàn)低成本智能顯示模塊,并帶有部分源程序

FPGA和嵌入式處理器實(shí)現(xiàn)低成本智能顯示模塊,并帶有部分源程序

標(biāo)簽： FPGA 嵌入式處理器 分 顯示模塊

上傳時(shí)間： 2013-08-06

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《CPLDFPGA嵌入式應(yīng)用開發(fā)技術(shù)白金手冊(cè)》源代碼

《CPLDFPGA嵌入式應(yīng)用開發(fā)技術(shù)白金手冊(cè)》源代碼，涉及FPGA/CPLD的各個(gè)方面，鍵盤掃描，LED掃描等簡(jiǎn)單程序及濾波器等的設(shè)計(jì)

標(biāo)簽： CPLDFPGA 嵌入式應(yīng)用 開發(fā)技術(shù)

上傳時(shí)間： 2013-08-08

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基于FPGA 的出租車計(jì)價(jià)器系統(tǒng)設(shè)計(jì)

摘要: 本文介紹了基于FPGA 的出租車計(jì)價(jià)器系統(tǒng)的功能、設(shè)計(jì)思想和實(shí)現(xiàn), 該設(shè)計(jì)采用模塊化自上而下的層次化設(shè)計(jì),頂\r\n層設(shè)計(jì)有5 個(gè)模塊,各模塊中子模塊采用VHDL 或圖形法設(shè)計(jì)。在Max+plusⅡ下實(shí)現(xiàn)編譯、仿真等,最后成功下載到FPGA 芯\r\n片中。完成了可預(yù)置自動(dòng)計(jì)費(fèi)、自動(dòng)計(jì)程、計(jì)時(shí)、空車顯示等多功能計(jì)價(jià)器。由于FPGA 具有高密度、可編程及有強(qiáng)大的軟件\r\n支持等特點(diǎn),所以該設(shè)計(jì)具有功能強(qiáng)、靈活和可靠性高等特點(diǎn),具有一定的實(shí)用價(jià)值。

標(biāo)簽： FPGA 出租車計(jì)價(jià)器 系統(tǒng)設(shè)計(jì)

上傳時(shí)間： 2013-08-09

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《FPGA嵌入式應(yīng)用系統(tǒng)開發(fā)典型實(shí)例》-書的光盤資料

《FPGA嵌入式應(yīng)用系統(tǒng)開發(fā)典型實(shí)例》-書的光盤資料，該資料是用VHDL語(yǔ)言編寫，作者：葉淦華

標(biāo)簽： FPGA 嵌入式應(yīng)用 典型 光盤

上傳時(shí)間： 2013-08-09

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應(yīng)用VHDL技術(shù)設(shè)計(jì)嵌入式全數(shù)字鎖相環(huán)路的方法

介紹了應(yīng)用VHDL技術(shù)設(shè)計(jì)嵌入式全數(shù)字鎖相環(huán)路的方法，詳細(xì)敘述了其工作原理和設(shè)計(jì)思想，并用可編程邏輯器件FPGA實(shí)現(xiàn)。

標(biāo)簽： VHDL 嵌入式 全數(shù)字 鎖相環(huán)路

上傳時(shí)間： 2013-08-11

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CPLD_FPGA的嵌入式系統(tǒng)設(shè)計(jì)過程

本書詳細(xì)介紹了基于CPLD_FPGA的嵌入式系統(tǒng)設(shè)計(jì)過程。使用超星瀏覽器閱讀

標(biāo)簽： CPLD_FPGA 嵌入式系統(tǒng)設(shè)計(jì) 過程

上傳時(shí)間： 2013-08-11

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FPGA，初學(xué)嵌入式資料集

嵌入式簡(jiǎn)介，是初學(xué)嵌入式的好東西，F(xiàn)PGA

標(biāo)簽： FPGA 嵌入式

上傳時(shí)間： 2013-08-12

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FPGA開發(fā)板上自帶的LED測(cè)試?yán)?/a>

標(biāo)簽： FPGA LED 開發(fā)板 測(cè)試

上傳時(shí)間： 2013-08-13

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