ISE新建工程及使用IP核步驟詳解
上傳時間： 2015-01-01
上傳用戶：liuxinyu2016
講解到位，工程例子很全，適合下載學(xué)習(xí)。
標簽： Altera FPGA CPLD 電子系統(tǒng)設(shè)計
上傳時間： 2013-10-21
上傳用戶：lhll918
一、PCB設(shè)計團隊的組建建議 二、高性能PCB設(shè)計的硬件必備基礎(chǔ)三、高性能PCB設(shè)計面臨的挑戰(zhàn)和工程實現(xiàn) 1.研發(fā)周期的挑戰(zhàn) 2.成本的挑戰(zhàn) 3.高速的挑戰(zhàn) 4.高密的挑戰(zhàn) 5.電源、地噪聲的挑戰(zhàn) 6.EMC的挑戰(zhàn) 7.DFM的挑戰(zhàn)四、工欲善其事，必先利其器摘要：本文以IT行業(yè)的高性能的PCB設(shè)計為主線，結(jié)合Cadence在高速PCB設(shè)計方面的強大功能，全面剖析高性能PCB設(shè)計的工程實現(xiàn)。正文：電子產(chǎn)業(yè)在摩爾定律的驅(qū)動下，產(chǎn)品的功能越來越強，集成度越來越高、信號的速率越來越快，產(chǎn)品的研發(fā)周期也越來越短，PCB的設(shè)計也隨之進入了高速PCB設(shè)計時代。PCB不再僅僅是完成互連功能的載體，而是作為所有電子產(chǎn)品中一個極為重要的部件。本文從高性能PCB設(shè)計的工程實現(xiàn)的角度，全面剖析IT行業(yè)高性能PCB設(shè)計的方方面面。實現(xiàn)高性能的PCB設(shè)計首先要有一支高素質(zhì)的PCB設(shè)計團隊。一、PCB設(shè)計團隊的組建建議自從PCB設(shè)計進入高速時代，原理圖、PCB設(shè)計由硬件工程師全權(quán)負責(zé)的做法就一去不復(fù)返了,專職的PCB工程師也就應(yīng)運而生。
標簽： PCB 性能 工程實現(xiàn)
上傳時間： 2013-10-24
上傳用戶：leehom61
EDA工程建模及其管理方法研究2 1 隨著微電子技術(shù)與計算機技術(shù)的日益成熟，電子設(shè)計自動化(EDA)技術(shù)在電子產(chǎn)品與集成電路 (IC)芯片特別是單片集成(SoC)芯片的設(shè)計應(yīng)用中顯得越來越重要。EDA技術(shù)采用“自上至下”的設(shè)計思想，允許設(shè)計人員能夠從系統(tǒng)功能級或電路功能級進行產(chǎn)品或芯片的設(shè)計，有利于產(chǎn)品在系統(tǒng)功能上的綜合優(yōu)化，從而提高了電子設(shè)計項目的協(xié)作開發(fā)效率，降低新產(chǎn)品的研發(fā)成本。 近十年來，EDA電路設(shè)計技術(shù)和工程管理方面的發(fā)展主要呈現(xiàn)出兩個趨勢： (1) 電路的集成水平已經(jīng)進入了深亞微米的階段，其復(fù)雜程度以每年58％的幅度迅速增加，芯片設(shè)計的抽象層次越來越高，而產(chǎn)品的研發(fā)時限卻不斷縮短。 (2) IC芯片的開發(fā)過程也日趨復(fù)雜。從前期的整體設(shè)計、功能分，到具體的邏輯綜合、仿真測試，直至后期的電路封裝、排版布線，都需要反復(fù)的驗證和修改，單靠個人力量無法完成。IC芯片的開發(fā)已經(jīng)實行多人分組協(xié)作。由此可見，如何提高設(shè)計的抽象層次，在較短時間內(nèi)設(shè)計出較高性能的芯片，如何改進EDA工程管理，保證芯片在多組協(xié)作設(shè)計下的兼容性和穩(wěn)定性，已經(jīng)成為當(dāng)前EDA工程中最受關(guān)注的問題。
上傳時間： 2013-10-15
上傳用戶：shen007yue
LAYOUT REPORT .............. 1 目錄.................. 1 1. PCB LAYOUT 術(shù)語解釋(TERMS)......... 2 2. Test Point : ATE 測試點供工廠ICT 測試治具使用............ 2 3. 基準點 (光學(xué)點) -for SMD:........... 4 4. 標記 (LABEL ING)......... 5 5. VIA HOLE PAD................. 5 6. PCB Layer 排列方式...... 5 7.零件佈置注意事項 (PLACEMENT NOTES)............... 5 8. PCB LAYOUT 設(shè)計............ 6 9. Transmission Line ( 傳輸線 )..... 8 10.General Guidelines – 跨Plane.. 8 11. General Guidelines – 繞線....... 9 12. General Guidelines – Damping Resistor. 10 13. General Guidelines - RJ45 to Transformer................. 10 14. Clock Routing Guideline........... 12 15. OSC & CRYSTAL Guideline........... 12 16. CPU
上傳時間： 2013-10-29
上傳用戶：1234xhb
電氣工程基礎(chǔ)
標簽： 電氣工程
上傳時間： 2013-11-30
上傳用戶：lxm
熱工儀表工程選用安裝調(diào)試與維護技術(shù)
標簽： 熱工儀表 工程 安裝調(diào)試 維護技術(shù)
上傳時間： 2013-10-20
上傳用戶：四只眼
文中針對某電氣化鐵路站點的電氣電力工程中,用電工程結(jié)合計量測試技術(shù)進行了探討,并結(jié)合電子信息技術(shù),對計量測試技術(shù)在電氣工程中的應(yīng)用前景進行了剖析和展望。
標簽： 計量測試 電氣工程 中的應(yīng)用
上傳時間： 2013-11-17
上傳用戶：行旅的喵
Visual C 串口通信技術(shù)與工程實踐
上傳時間： 2013-10-28
上傳用戶：Vici
經(jīng)過擴展的CGraph類及示例工程源代碼
上傳時間： 2013-12-18
上傳用戶：a3318966
蟲蟲下載站版權(quán)所有 京ICP備2021023401號-1
