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并行口擴(kuò)(kuò)展

  • STM32F的232口簡(jiǎn)易MODBUS-RTU通訊程序.pdf

    STM32F的232口簡(jiǎn)易MODBUS-RTU通訊程序.pdf

    標(biāo)簽: MODBUS-RTU STM 232 32F

    上傳時(shí)間: 2013-06-01

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  • Vista,Win7串口調(diào)試

    Vista ,Win7環(huán)境下串口調(diào)試工具-超級(jí)終端 被微軟刪除了。附件是個(gè)人版串口調(diào)試工具for Vista ,WIN7

    標(biāo)簽: Vista Win 串口調(diào)試

    上傳時(shí)間: 2013-04-24

    上傳用戶:lht618

  • 8255中文資料, 數(shù)據(jù)手冊(cè)

    8255內(nèi)部包括三個(gè)并行數(shù)據(jù)輸入/輸出端口,兩個(gè)工作方式控制電路,一個(gè)讀/寫控制邏輯電路和8位總線緩沖器。各部分功能概括如下: (1)端口A、B、CA口:是一個(gè)8位數(shù)據(jù)輸

    標(biāo)簽: 8255 數(shù)據(jù)手冊(cè)

    上傳時(shí)間: 2013-05-21

    上傳用戶:隱界最新

  • FPGA串口學(xué)習(xí)例程

    自己寫的一個(gè)FPGA串口通信的例程,已通過(guò)了軟件驗(yàn)證,發(fā)給現(xiàn)在在學(xué)習(xí)FPGA通信的朋友。

    標(biāo)簽: FPGA 串口

    上傳時(shí)間: 2013-07-25

    上傳用戶:wsm555

  • 12位4通道并行串行模數(shù)轉(zhuǎn)換芯片ADS7824的原理及應(yīng)用

    ADS7824是美國(guó)BB公司生產(chǎn)的12位開關(guān)電容式逐次逼近型模/數(shù)轉(zhuǎn)換芯片.它具有與CPU的并行/串行接口,功耗低,片上資源豐富,接口靈活等特點(diǎn).文中詳細(xì)介紹了ADS7824的工作原理、引腳定義、工作

    標(biāo)簽: 7824 ADS 4通道 并行

    上傳時(shí)間: 2013-07-08

    上傳用戶:yy307115118

  • stm8串口下載教程

    stm8串口下載教程 stm8串口下載教程

    標(biāo)簽: stm8 串口下載 教程

    上傳時(shí)間: 2013-08-03

    上傳用戶:jichenxi0730

  • sscom33串口通訊工具

    這個(gè)是串口通訊工具,無(wú)論windows編程,還是嵌入式的上位機(jī)和下位機(jī)通訊,調(diào)試時(shí)使用它都很方便-This is a serial communications tools

    標(biāo)簽: sscom 33 串口通訊

    上傳時(shí)間: 2013-04-24

    上傳用戶:eddy77

  • 基于FPGA的數(shù)字相位計(jì)的研究與實(shí)現(xiàn)

    本文結(jié)合工程需要詳細(xì)論述了一種數(shù)字相位計(jì)的實(shí)現(xiàn)方法,該方法是基于FPGA(現(xiàn)場(chǎng)可編程門陣列)芯片運(yùn)用FFT(快速傅立葉變換)算法完成的。首先,從相位測(cè)量的原理出發(fā),分析了傳統(tǒng)相位計(jì)的缺點(diǎn),給出了一種高可靠性的相位檢測(cè)實(shí)用算法,其算法核心是對(duì)采集信號(hào)進(jìn)行FFT變換,通過(guò)頻譜分析,實(shí)現(xiàn)對(duì)參考信號(hào)和測(cè)量信號(hào)初相位的檢測(cè),并同時(shí)闡述了FPGA在實(shí)現(xiàn)數(shù)字相位計(jì)核心FFT算法中的優(yōu)勢(shì)。在優(yōu)化的硬件結(jié)構(gòu)中,利用多個(gè)乘法器并行運(yùn)算的方式加快了蝶形運(yùn)算單元的運(yùn)算速度;內(nèi)置雙端口RAM、旋轉(zhuǎn)因子ROM使數(shù)據(jù)存儲(chǔ)的速度得到提高;采用了流水線的工作方式使數(shù)據(jù)的存儲(chǔ)、運(yùn)算在時(shí)間上達(dá)到匹配。整個(gè)設(shè)計(jì)采用VHDL(超高速硬件描述語(yǔ)言)語(yǔ)言作為系統(tǒng)內(nèi)部硬件結(jié)構(gòu)的描述手段,在Altera的QuartusⅡ軟件支持下完成。仿真結(jié)果表明,基于FPGA實(shí)現(xiàn)的FFT算法無(wú)論在速度和精度上都滿足了相位測(cè)量的需要,其運(yùn)算64點(diǎn)數(shù)據(jù)僅需27.5us,最大誤差在1%之內(nèi)。

    標(biāo)簽: FPGA 數(shù)字 相位計(jì)

    上傳時(shí)間: 2013-05-16

    上傳用戶:lgs12321

  • 高速并行信號(hào)處理板數(shù)據(jù)接口與控制的FPGA設(shè)計(jì)

    隨著信息社會(huì)的發(fā)展,人們要處理的各種信息總量變得越來(lái)越大,尤其在處理大數(shù)據(jù)量與實(shí)時(shí)處理數(shù)據(jù)方面,對(duì)處理設(shè)備的要求是非常高的。為滿足這些要求,實(shí)時(shí)快速的各種CPU、處理板應(yīng)運(yùn)而生。這類CPU與板卡處理數(shù)據(jù)速度快,效率高,并且不斷的完善與發(fā)展。此類板卡要求與外部設(shè)備通訊,同時(shí)也要進(jìn)行內(nèi)部的數(shù)據(jù)交換,于是板卡的接口設(shè)備調(diào)試與內(nèi)部數(shù)據(jù)交換也成為必須要完成的工作。本文所作的工作正是基于一種高速通用信號(hào)處理板的外部接口和內(nèi)部數(shù)據(jù)通道的設(shè)計(jì)。 本文首先介紹了通用信號(hào)處理板的應(yīng)用開發(fā)背景,包括此類板卡使用的處理芯片、板上設(shè)備、發(fā)展概況以及和外部相連的各種總線概況,同時(shí)說(shuō)明了本人所作的主要工作。 其次,介紹了PCI接口的有關(guān)規(guī)范,給出了通用信號(hào)處理板與CPCI的J1口的設(shè)計(jì)時(shí)序;介紹了DDR存儲(chǔ)器的概況、電平標(biāo)準(zhǔn)以及功能寄存器,并給出了與DDR.存儲(chǔ)器接口的設(shè)計(jì)時(shí)序;介紹了片上主要數(shù)據(jù)處理器件TS-202的有關(guān)概況,設(shè)計(jì)了板卡與DSP的接口時(shí)序。 再次,介紹了Altera公司FPGA的程序設(shè)計(jì)流程,并使用VHDL語(yǔ)言編程完成各個(gè)模塊之間的數(shù)據(jù)傳遞,并重點(diǎn)介紹了DDR控制核的編寫。 再次,介紹了WDM驅(qū)動(dòng)程序的結(jié)構(gòu),程序設(shè)計(jì)方法等。 最后,通過(guò)從工控機(jī)向通用信號(hào)處理板寫連續(xù)遞增的數(shù)據(jù)驗(yàn)證了整個(gè)系統(tǒng)已經(jīng)正常工作。實(shí)現(xiàn)了信號(hào)處理板內(nèi)部數(shù)據(jù)通道設(shè)計(jì)以及與外部接口的通訊;并且還提到了對(duì)此設(shè)計(jì)以后地完善與發(fā)展。 本文所作的工作如下: 1、設(shè)計(jì)完成了處理板各接口時(shí)序,使處理板可以從接口接受/發(fā)送數(shù)據(jù)。 2、完成了FPGA內(nèi)部的數(shù)據(jù)通道的設(shè)計(jì),使數(shù)據(jù)可以從CPCI準(zhǔn)確的傳送到DSP進(jìn)行處理,并編寫了DSP的測(cè)試程序。 3、完成了DDR SDRAM控制核的VHDL程序編寫。 4、完成了PCI驅(qū)動(dòng)程序的編寫。

    標(biāo)簽: FPGA 高速并行 信號(hào)處理板 數(shù)據(jù)接口

    上傳時(shí)間: 2013-06-30

    上傳用戶:唐僧他不信佛

  • 基于多相濾波的寬帶DDC及其FPGA實(shí)現(xiàn)

    隨著現(xiàn)代雷達(dá)技術(shù)的不斷發(fā)展,電子偵察設(shè)備面臨電磁環(huán)境日益復(fù)雜多變,發(fā)展寬帶化、數(shù)字化、多功能、軟件化的電子偵察設(shè)備已是一項(xiàng)重要的任務(wù).然而,目前的寬帶A/D與后續(xù)DSP之間的工作速率總有一到兩個(gè)數(shù)量級(jí)的差別,二者之間的瓶頸成為電子偵察系統(tǒng)數(shù)字化的最大障礙.通信領(lǐng)域軟件無(wú)線電的成功應(yīng)用為電子偵察系統(tǒng)的發(fā)展提供了一種理想模式.另一方面,微電子技術(shù)的快速發(fā)展,以及FPGA的廣泛應(yīng)用,在很大程度上影響了數(shù)字電路的設(shè)計(jì)與開發(fā).這也為解決高速A/D與DSP處理能力之間的矛盾提供了一種有效的解決方法.為了解決寬帶A/D與后續(xù)DSP之間的瓶頸問(wèn)題,本文給出了一種基于多相濾波的寬帶數(shù)字下變頻結(jié)構(gòu),并從軟件無(wú)線電原理出發(fā),從理論推導(dǎo)和計(jì)算機(jī)仿真兩方面對(duì)該結(jié)構(gòu)進(jìn)行了驗(yàn)證,并進(jìn)一步給出該結(jié)構(gòu)改進(jìn)方案以及改進(jìn)的多相濾波數(shù)字下變頻結(jié)構(gòu)的硬件實(shí)現(xiàn)方法.本文將多相濾波下變頻的并行結(jié)構(gòu)應(yīng)用到數(shù)字下變頻電路中,并在后繼的混頻模塊中也采用并行混頻的方式來(lái)實(shí)現(xiàn),不僅在一定程度上解決了二者之間的瓶頸問(wèn)題,同時(shí)也大大提高了實(shí)時(shí)處理速度.經(jīng)過(guò)多相濾波下變頻處理后的數(shù)據(jù),在速率和數(shù)據(jù)量上都有大幅減少,達(dá)到了現(xiàn)有通用DSP器件處理能力的要求.另外,本人還用FPGA設(shè)計(jì)了實(shí)驗(yàn)電路,利用微機(jī)串口,與實(shí)驗(yàn)?zāi)繕?biāo)板進(jìn)行控制和數(shù)據(jù)交換.利用FPGA的在線編程特性,可以方便靈活的對(duì)各種實(shí)現(xiàn)方法加以驗(yàn)證和比較.

    標(biāo)簽: FPGA DDC 多相濾波 寬帶

    上傳時(shí)間: 2013-04-24

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