(1) 、用下述兩條具體規(guī)則和規(guī)則形式實現(xiàn).設大寫字母表示魔王語言的詞匯 小寫字母表示人的語言詞匯 希臘字母表示可以用大寫字母或小寫字母代換的變量.魔王語言可含人的詞匯. (2) 、B→tAdA A→sae (3) 、將魔王語言B(ehnxgz)B解釋成人的語言.每個字母對應下列的語言.
上傳時間： 2013-12-30
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1.有三根桿子A,B,C。A桿上有若干碟子 2.每次移動一塊碟子,小的只能疊在大的上面 3.把所有碟子從A桿全部移到C桿上 經(jīng)過研究發(fā)現(xiàn)，漢諾塔的破解很簡單，就是按照移動規(guī)則向一個方向移動金片： 如3階漢諾塔的移動：A→C,A→B,C→B,A→C,B→A,B→C,A→C 此外，漢諾塔問題也是程序設計中的經(jīng)典遞歸問題
標簽： 移動 發(fā)現(xiàn)
上傳時間： 2016-07-25
上傳用戶：gxrui1991
1. 下列說法正確的是 （ ） A. Java語言不區(qū)分大小寫 B. Java程序以類為基本單位 C. JVM為Java虛擬機JVM的英文縮寫 D. 運行Java程序需要先安裝JDK 2. 下列說法中錯誤的是 ( ) A. Java語言是編譯執(zhí)行的 B. Java中使用了多進程技術(shù) C. Java的單行注視以//開頭 D. Java語言具有很高的安全性 3. 下面不屬于Java語言特點的一項是( ) A. 安全性 B. 分布式 C. 移植性 D. 編譯執(zhí)行 4. 下列語句中，正確的項是 ( ) A . int $e,a,b=10 B. char c,d=’a’ C. float e=0.0d D. double c=0.0f
上傳時間： 2017-01-04
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38V/100A可直接并聯(lián)大功率AC/DC變換器 隨著電力電子技術(shù)的發(fā)展，電源技術(shù)被廣泛應用于計算機、工業(yè)儀器儀表、軍事、航天等領(lǐng)域，涉及到國民經(jīng)濟各行各業(yè)。特別是近年來，隨著IGBT的廣泛應用，開關(guān)電源向更大功率方向發(fā)展。研制各種各樣的大功率，高性能的開關(guān)電源成為趨勢。某電源系統(tǒng)要求輸入電壓為AC220V，輸出電壓為DC38V，輸出電流為100A，輸出電壓低紋波，功率因數(shù)>0.9，必要時多臺電源可以直接并聯(lián)使用，并聯(lián)時的負載不均衡度<5％。 設計采用了AC/DC/AC/DC變換方案。一次整流后的直流電壓，經(jīng)過有源功率因數(shù)校正環(huán)節(jié)以提高系統(tǒng)的功率因數(shù)，再經(jīng)半橋變換電路逆變后，由高頻變壓器隔離降壓，最后整流輸出直流電壓。系統(tǒng)的主要環(huán)節(jié)有DC/DC電路、功率因數(shù)校正電路、PWM控制電路、均流電路和保護電路等。 1 有源功率因數(shù)校正環(huán)節(jié) 由于系統(tǒng)的功率因數(shù)要求0.9以上，采用二極管整流是不能滿足要求的，所以，加入了有源功率因數(shù)校正環(huán)節(jié)。采用UC3854A/B控制芯片來組成功率因數(shù)電路。UC3854A/B是Unitrode公司一種新的高功率因數(shù)校正器集成控制電路芯片，是在UC3854基礎上的改進。其特點是：采用平均電流控制，功率因數(shù)接近1，高帶寬，限制電網(wǎng)電流失真≤3％[1]。圖1是由UC3854A/B控制的有源功率因數(shù)校正電路。 該電路由兩部分組成。UC3854A/B及外圍元器件構(gòu)成控制部分，實現(xiàn)對網(wǎng)側(cè)輸入電流和輸出電壓的控制。功率部分由L2，C5，V等元器件構(gòu)成Boost升壓電路。開關(guān)管V選擇西門康公司的SKM75GB123D模塊，其工作頻率選在35kHz。升壓電感L2為2mH/20A。C5采用四個450V/470μF的電解電容并聯(lián)。因為，設計的PFC電路主要是用在大功率DC/DC電路中，所以，在負載輕的時候不進行功率因數(shù)校正，當負載較大時功率因數(shù)校正電路自動投入使用。此部分控制由圖1中的比較器部分來實現(xiàn)。R10及R11是負載檢測電阻。當負載較輕時，R10及R11上檢測的信號輸入給比較器，使其輸出端為低電平，D2導通，給ENA(使能端)低電平使UC3854A/B封鎖。在負載較大時ENA為高電平才讓UC3854A/B工作。D3接到SS（軟啟動端），在負載輕時D3導通，使SS為低電平；當負載增大要求UC3854A/B工作時，SS端電位從零緩慢升高，控制輸出脈沖占空比慢慢增大實現(xiàn)軟啟動。 2 DC/DC主電路及控制部分分析 2.1 DC/DC主電路拓撲 在大功率高頻開關(guān)電源中，常用的主變換電路有推挽電路、半橋電路、全橋電路等[2]。其中推挽電路的開關(guān)器件少，輸出功率大，但開關(guān)管承受電壓高（為電源電壓的2倍），且變壓器有六個抽頭，結(jié)構(gòu)復雜；全橋電路開關(guān)管承受的電壓不高，輸出功率大，但是需要的開關(guān)器件多（4個），驅(qū)動電路復雜。半橋電路開關(guān)管承受的電壓低，開關(guān)器件少，驅(qū)動簡單。根據(jù)對各種拓撲方案的工程化實現(xiàn)難度，電氣性能以及成本等指標的綜合比較，本電源選用半橋式DC/DC變換器作為主電路。圖2為大功率開關(guān)電源的主電路拓撲圖。
上傳時間： 2013-11-13
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TLC2543是TI公司的12位串行模數(shù)轉(zhuǎn)換器，使用開關(guān)電容逐次逼近技術(shù)完成A/D轉(zhuǎn)換過程。由于是串行輸入結(jié)構(gòu)，能夠節(jié)省51系列單片機I/O資源；且價格適中，分辨率較高，因此在儀器儀表中有較為廣泛的應用。 TLC2543的特點 （1）12位分辯率A/D轉(zhuǎn)換器； （2）在工作溫度范圍內(nèi)10μs轉(zhuǎn)換時間； （3）11個模擬輸入通道； （4）3路內(nèi)置自測試方式； （5）采樣率為66kbps； （6）線性誤差±1LSBmax； （7）有轉(zhuǎn)換結(jié)束輸出EOC； （8）具有單、雙極性輸出； （9）可編程的MSB或LSB前導； （10）可編程輸出數(shù)據(jù)長度。 TLC2543的引腳排列及說明 TLC2543有兩種封裝形式：DB、DW或N封裝以及FN封裝，這兩種封裝的引腳排列如圖1，引腳說明見表1 TLC2543電路圖和程序欣賞 #include<reg52.h> #include<intrins.h> #define uchar unsigned char #define uint unsigned int sbit clock=P1^0; sbit d_in=P1^1; sbit d_out=P1^2; sbit _cs=P1^3; uchar a1,b1,c1,d1; float sum,sum1; double sum_final1; double sum_final; uchar duan[]={0x3f,0x06,0x5b,0x4f,0x66,0x6d,0x7d,0x07,0x7f,0x6f}; uchar wei[]={0xf7,0xfb,0xfd,0xfe}; void delay(unsigned char b) //50us { unsigned char a; for(;b>0;b--) for(a=22;a>0;a--); } void display(uchar a,uchar b,uchar c,uchar d) { P0=duan[a]|0x80; P2=wei[0]; delay(5); P2=0xff; P0=duan[b]; P2=wei[1]; delay(5); P2=0xff; P0=duan[c]; P2=wei[2]; delay(5); P2=0xff; P0=duan[d]; P2=wei[3]; delay(5); P2=0xff; } uint read(uchar port) { uchar i,al=0,ah=0; unsigned long ad; clock=0; _cs=0; port<<=4; for(i=0;i<4;i++) { d_in=port&0x80; clock=1; clock=0; port<<=1; } d_in=0; for(i=0;i<8;i++) { clock=1; clock=0; } _cs=1; delay(5); _cs=0; for(i=0;i<4;i++) { clock=1; ah<<=1; if(d_out)ah|=0x01; clock=0; } for(i=0;i<8;i++) { clock=1; al<<=1; if(d_out) al|=0x01; clock=0; } _cs=1; ad=(uint)ah; ad<<=8; ad|=al; return(ad); } void main() { uchar j; sum=0;sum1=0; sum_final=0; sum_final1=0; while(1) { for(j=0;j<128;j++) { sum1+=read(1); display(a1,b1,c1,d1); } sum=sum1/128; sum1=0; sum_final1=(sum/4095)*5; sum_final=sum_final1*1000; a1=(int)sum_final/1000; b1=(int)sum_final%1000/100; c1=(int)sum_final%1000%100/10; d1=(int)sum_final%10; display(a1,b1,c1,d1); } }
上傳時間： 2013-11-19
上傳用戶：shen1230
摘要: 串行傳輸技術(shù)具有更高的傳輸速率和更低的設計成本, 已成為業(yè)界首選, 被廣泛應用于高速通信領(lǐng)域。提出了一種新的高速串行傳輸接口的設計方案, 改進了Aurora 協(xié)議數(shù)據(jù)幀格式定義的弊端, 并采用高速串行收發(fā)器Rocket I/O, 實現(xiàn)數(shù)據(jù)率為2.5 Gbps的高速串行傳輸。關(guān)鍵詞: 高速串行傳輸; Rocket I/O; Aurora 協(xié)議 為促使FPGA 芯片與串行傳輸技術(shù)更好地結(jié)合以滿足市場需求, Xilinx 公司適時推出了內(nèi)嵌高速串行收發(fā)器RocketI/O 的Virtex II Pro 系列FPGA 和可升級的小型鏈路層協(xié)議———Aurora 協(xié)議。Rocket I/O支持從622 Mbps 至3.125 Gbps的全雙工傳輸速率, 還具有8 B/10 B 編解碼、時鐘生成及恢復等功能, 可以理想地適用于芯片之間或背板的高速串行數(shù)據(jù)傳輸。Aurora 協(xié)議是為專有上層協(xié)議或行業(yè)標準的上層協(xié)議提供透明接口的第一款串行互連協(xié)議, 可用于高速線性通路之間的點到點串行數(shù)據(jù)傳輸, 同時其可擴展的帶寬, 為系統(tǒng)設計人員提供了所需要的靈活性[4]。但該協(xié)議幀格式的定義存在弊端,會導致系統(tǒng)資源的浪費。本文提出的設計方案可以改進Aurora 協(xié)議的固有缺陷,提高系統(tǒng)性能, 實現(xiàn)數(shù)據(jù)率為2.5 Gbps 的高速串行傳輸, 具有良好的可行性和廣闊的應用前景。
上傳時間： 2013-11-06
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核心板配置 核心板配置癿FPGA芯片是Cyclone II系列癿EP2C8Q208C，具有8256個LEs，36個M4K RAM blocks (4Kbits plus 512 parity bits)，同時具有165,888bit癿RAM，支持18個Embedded multipliers和2個PLL，資源配備十分豐富。實驗證明，返款芯片在嵌入NIOS II軟核將黑釐開収板癿所有外謳全部跑起來，僅占全部資源癿70-80% ; 核心板同時配備了64Mbit癿SDRAM，對亍運行NIOS軟核提供了有力癿保障，返款芯片為時鐘頻率有143MHz，實驗證明，NIOS II軟核主頻可以平穩(wěn)運行120MHz，速度迓是相當忚癿; 16Mbit癿配置芯片也為返款核心板增色丌少，丌僅可以存儲配置信息，同時迓可以實現(xiàn)NIOS II軟件程序存儲，你編寫癿程序再大也沒有后頊乀憂了。 20M癿有源晶振也是必丌可少癿，他是整個系統(tǒng)癿時鐘源泉;4個LED對亍調(diào)試來說更是提供了徑多方便;復位按鍵，重新配置按鍵，配置指示燈一個也丌能少;同時支持AS模式和JTAG模式; 除此以外，核心板一個更大的特點是它可以獨立亍底板單獨運行，為此配備了5V癿電源接口，高質(zhì)量癿紅色開關(guān)，為了安全迓加入了自恢復保險絲。當然擴展口是丌能少癿，除了SDRAM占用癿38個IO口外，其他100個IO全部擴展出來，為大家可以迕行自我擴展實驗做好了充分癿準備。 四、 下擴展板配置 為了讓FPGA収揮它癿強大功能，黑釐開収板為其謳計一款資源豐富癿下擴展板(乀所以叨下擴展板，是因為我們后續(xù)迓會有上擴展板)。下面我們就來簡單介終一下下擴展板癿資源配置。 支持網(wǎng)絡功能，配置ENC28J60網(wǎng)口芯片。ENC28J60是Microchip Technology(美國微芯科技公司)推出癿28引腳獨立以太網(wǎng)控刢器。目前市場上大部分以太網(wǎng)控刢器癿封裝均赸過80引腳，而符吅IEEE 802.3協(xié)議癿ENC28J60叧有28引腳，既能提供相應癿功能，又可以大大簡化相關(guān)謳計，減小空間; 支持USB功能，配置CH376芯片。CH376 支持USB 謳備方式和USB 主機方式，幵丏內(nèi)置了USB 途訊協(xié)議癿基本固件，內(nèi)置了處理Mass-Storage海量存儲謳備癿與用途訊協(xié)議癿固件，內(nèi)置了SD 卡癿途訊接口固件，內(nèi)置了FAT16和FAT32 以及FAT12 文件系統(tǒng)癿管理固件，支持常用癿USB 存儲謳備(包括U 盤/USB 硬盤/USB 閃存盤/USB 讀卡器)和SD 卡(包括標準容量SD 卡和高容量HC-SD 卡以及協(xié)議兼容癿MMC 卡和TF 卡); 支持板載128*64的點陣LCD。ST7565P控刢芯片，內(nèi)置DC/DC電路，途過軟件調(diào)節(jié)對比度。該芯片支持，幵口和串口丟種方式;
上傳時間： 2013-11-23
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摘要: 串行傳輸技術(shù)具有更高的傳輸速率和更低的設計成本, 已成為業(yè)界首選, 被廣泛應用于高速通信領(lǐng)域。提出了一種新的高速串行傳輸接口的設計方案, 改進了Aurora 協(xié)議數(shù)據(jù)幀格式定義的弊端, 并采用高速串行收發(fā)器Rocket I/O, 實現(xiàn)數(shù)據(jù)率為2.5 Gbps的高速串行傳輸。關(guān)鍵詞: 高速串行傳輸; Rocket I/O; Aurora 協(xié)議 為促使FPGA 芯片與串行傳輸技術(shù)更好地結(jié)合以滿足市場需求, Xilinx 公司適時推出了內(nèi)嵌高速串行收發(fā)器RocketI/O 的Virtex II Pro 系列FPGA 和可升級的小型鏈路層協(xié)議———Aurora 協(xié)議。Rocket I/O支持從622 Mbps 至3.125 Gbps的全雙工傳輸速率, 還具有8 B/10 B 編解碼、時鐘生成及恢復等功能, 可以理想地適用于芯片之間或背板的高速串行數(shù)據(jù)傳輸。Aurora 協(xié)議是為專有上層協(xié)議或行業(yè)標準的上層協(xié)議提供透明接口的第一款串行互連協(xié)議, 可用于高速線性通路之間的點到點串行數(shù)據(jù)傳輸, 同時其可擴展的帶寬, 為系統(tǒng)設計人員提供了所需要的靈活性[4]。但該協(xié)議幀格式的定義存在弊端,會導致系統(tǒng)資源的浪費。本文提出的設計方案可以改進Aurora 協(xié)議的固有缺陷,提高系統(tǒng)性能, 實現(xiàn)數(shù)據(jù)率為2.5 Gbps 的高速串行傳輸, 具有良好的可行性和廣闊的應用前景。
上傳時間： 2013-10-13
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中電38所-安徽芯紀元公司研制的國產(chǎn)DSP——魂芯二號Ａ處理器
標簽： DSP
上傳時間： 2022-06-12
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特點： 精確度0.1%滿刻度 可作各式數(shù)學演算式功能如:A+B/A-B/AxB/A/B/A&B(Hi or Lo)/|A|/ 16 BIT類比輸出功能 輸入與輸出絕緣耐壓2仟伏特/1分鐘(input/output/power) 寬范圍交直流兩用電源設計 尺寸小,穩(wěn)定性高
上傳時間： 2014-12-23
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