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性能檢驗(yàn)(yàn)

  • 基于C8051的光纜性能試驗(yàn)機(jī)的設(shè)計(jì)

    設(shè)計(jì)了一種基于C8051F340微處理器的新型光纜性能試驗(yàn)機(jī)的控制系統(tǒng)。針對(duì)傳統(tǒng)試驗(yàn)機(jī)的不足,簡(jiǎn)化了設(shè)計(jì)方案、提高了采集數(shù)據(jù)的精度、改進(jìn)了控制臺(tái)的設(shè)計(jì)和數(shù)據(jù)轉(zhuǎn)遞的方式、增加了語(yǔ)音告警和提示功能。該方案能廣泛應(yīng)用于數(shù)據(jù)采集、工業(yè)監(jiān)控和網(wǎng)絡(luò)傳輸?shù)阮I(lǐng)域。對(duì)硬件和軟件設(shè)計(jì)中的關(guān)鍵技術(shù)進(jìn)行了說(shuō)明。

    標(biāo)簽: C8051 光纜 性能 試驗(yàn)機(jī)

    上傳時(shí)間: 2013-11-16

    上傳用戶(hù):change0329

  • C8051F040在曳引及制動(dòng)性能檢測(cè)系統(tǒng)中的應(yīng)用

    基于改善電梯檢測(cè)現(xiàn)狀和電梯檢測(cè)的高可靠性的考慮,設(shè)計(jì)了一套基于CAN總線的電梯曳引及制動(dòng)性能檢測(cè)系統(tǒng)。本文著重闡述了檢測(cè)系統(tǒng)的CAN節(jié)點(diǎn)里比較有代表性的、利用C8051F040單片機(jī)設(shè)計(jì)的一個(gè)多功能混合信號(hào)節(jié)點(diǎn)的硬件和軟件設(shè)計(jì)方法以及基于此節(jié)點(diǎn)的CAN總線系統(tǒng)調(diào)試方式。實(shí)際應(yīng)用結(jié)果證明本檢測(cè)系統(tǒng)的設(shè)計(jì)方法正確,具備很好的可靠性和應(yīng)用前景。

    標(biāo)簽: C8051F040 制動(dòng)性能 中的應(yīng)用 檢測(cè)系統(tǒng)

    上傳時(shí)間: 2013-10-18

    上傳用戶(hù):waizhang

  • DM647,DM648應(yīng)用及性能

    達(dá)芬奇技術(shù)使視頻安全與監(jiān)控應(yīng)用獲得系統(tǒng)性能雙倍提升,系統(tǒng)成本大幅降低

    標(biāo)簽: DM 647 648 性能

    上傳時(shí)間: 2013-10-11

    上傳用戶(hù):菁菁聆聽(tīng)

  • 改善基于微控制器的應(yīng)用的瞬態(tài)免疫性能

    家電制造業(yè)的競(jìng)爭(zhēng)日益激烈,市場(chǎng)調(diào)整壓力越來(lái)越大,原始設(shè)備制造商們(OEM)為了面對(duì)這一挑戰(zhàn),必須在滿(mǎn)足電磁兼容性的條件下,不斷降低產(chǎn)品的成本。由于強(qiáng)調(diào)成本控制,為防止由電源和信號(hào)線的瞬變所產(chǎn)生的電器故障而實(shí)施必要的瞬態(tài)免疫保護(hù),對(duì)于家電設(shè)計(jì)者來(lái)說(shuō)變得更具挑戰(zhàn)性。由于傳統(tǒng)的電源設(shè)計(jì)和電磁干擾(EMI)控制措施為節(jié)約成本讓路,家電設(shè)計(jì)者必須開(kāi)發(fā)出新的技術(shù)來(lái)滿(mǎn)足不斷調(diào)整的電磁兼容(EMC)需求。本應(yīng)用筆記探討了瞬態(tài)電氣干擾對(duì)嵌入式微控制器(MCU)的影響,并提供了切實(shí)可行的硬件和軟件設(shè)計(jì)技術(shù),這些技術(shù)可以為電快速瞬變(EFT)、靜電放電(ESD)以及其它電源線或信號(hào)線的短時(shí)瞬變提供低成本的保護(hù)措施。雖然這種探討是主要針對(duì)家電制造商,但是也適用于消費(fèi)電子、工業(yè)以及汽車(chē)電子方面的應(yīng)用。 低成本的基于MCU 的嵌入式應(yīng)用特別容易受到ESD 和EFT 影響降低性能。即使是運(yùn)行在較低時(shí)鐘頻率下的微控制器,通常對(duì)快速上升時(shí)間瞬變也很敏感。這種敏感性歸咎于所使用的工藝技術(shù)。如今針對(duì)低成本8/16位的MCU的半導(dǎo)體工藝技術(shù)所實(shí)現(xiàn)的晶體管柵極長(zhǎng)度在0.65 μm~0.25 μm范圍內(nèi)。此范圍內(nèi)的柵極長(zhǎng)度能產(chǎn)生和響應(yīng)上升時(shí)間在次納秒范圍內(nèi)(或超過(guò)300 MHz 的等同帶寬)的信號(hào)。因此, MCU 能夠響應(yīng)進(jìn)入其引腳的ESD 或EFT 信號(hào)。除上述工藝技術(shù)之外, MCU 在ESD 或EFT 事件中的性能還會(huì)受到IC 設(shè)計(jì)及其封裝、印刷電路板(PCB)的設(shè)計(jì)、MCU 上運(yùn)行的軟件、系統(tǒng)設(shè)計(jì)以及ESD 或EFT 波形特征的影響。各因素的相對(duì)影響(強(qiáng)調(diào)對(duì)最大影響的貢獻(xiàn))如圖1 所示。

    標(biāo)簽: 微控制器 瞬態(tài)免疫 性能

    上傳時(shí)間: 2013-11-09

    上傳用戶(hù):Jerry_Chow

  • TMS320F28335DSP在電力電子變流器中、性能優(yōu)勢(shì)分析

    TMS320F28335DSP在電力電子變流器中、性能優(yōu)勢(shì)分析

    標(biāo)簽: F28335 28335 320F TMS

    上傳時(shí)間: 2013-11-20

    上傳用戶(hù):arnold

  • 基于FPGA的隨機(jī)數(shù)性能檢測(cè)設(shè)計(jì)

    為了滿(mǎn)足對(duì)隨機(jī)數(shù)性能有一定要求的系統(tǒng)能夠?qū)崟r(shí)檢測(cè)隨機(jī)數(shù)性能的需求,提出了一種基于FPGA的隨機(jī)數(shù)性能檢測(cè)設(shè)計(jì)方案。根據(jù)NIST的測(cè)試標(biāo)準(zhǔn),采用基于統(tǒng)計(jì)的方法,在FPGA內(nèi)部實(shí)現(xiàn)了對(duì)隨機(jī)序列的頻率測(cè)試、游程測(cè)試、最大游程測(cè)試、離散傅里葉變換測(cè)試和二元矩陣秩測(cè)試。與現(xiàn)在常用的隨機(jī)數(shù)性能測(cè)試軟件相比,該設(shè)計(jì)方案,能靈活嵌入到需要使用隨機(jī)數(shù)的系統(tǒng)中,實(shí)現(xiàn)對(duì)隨機(jī)性能的實(shí)時(shí)檢測(cè)。實(shí)際應(yīng)用表明,該設(shè)計(jì)具有使用靈活、測(cè)試準(zhǔn)確、實(shí)時(shí)輸出結(jié)果的特點(diǎn),達(dá)到了設(shè)計(jì)要求。

    標(biāo)簽: FPGA 隨機(jī)數(shù) 性能檢測(cè)

    上傳時(shí)間: 2013-11-13

    上傳用戶(hù):lliuhhui

  • 對(duì)Altera 28nm FPGA浮點(diǎn)DSP設(shè)計(jì)流程和性能的獨(dú)立分析

      電子發(fā)燒友網(wǎng)核心提示:Altera公司昨日宣布,在業(yè)界率先在28 nm FPGA器件上成功測(cè)試了復(fù)數(shù)高性能浮點(diǎn)數(shù)字信號(hào)處理(DSP)設(shè)計(jì)。獨(dú)立技術(shù)分析公司Berkeley設(shè)計(jì)技術(shù)有限公司(BDTI)驗(yàn)證了能夠在 Altera Stratix V和Arria V 28 nm FPGA開(kāi)發(fā)套件上簡(jiǎn)單方便的高效實(shí)現(xiàn)Altera浮點(diǎn)DSP設(shè)計(jì)流程,同時(shí)驗(yàn)證了要求較高的浮點(diǎn)DSP應(yīng)用的性能。本文是BDTI完整的FPGA浮點(diǎn)DSP分析報(bào)告。    Altera的浮點(diǎn)DSP設(shè)計(jì)流程經(jīng)過(guò)規(guī)劃,能夠快速適應(yīng)可參數(shù)賦值接口的設(shè)計(jì)更改,其工作環(huán)境包括來(lái)自MathWorks的MATLAB和 Simulink,以及Altera的DSP Builder高級(jí)模塊庫(kù),支持FPGA設(shè)計(jì)人員比傳統(tǒng)HDL設(shè)計(jì)更迅速的實(shí)現(xiàn)并驗(yàn)證復(fù)數(shù)浮點(diǎn)算法。這一設(shè)計(jì)流程非常適合設(shè)計(jì)人員在應(yīng)用中采用高性能 DSP,這些應(yīng)用包括,雷達(dá)、無(wú)線基站、工業(yè)自動(dòng)化、儀表和醫(yī)療圖像等。

    標(biāo)簽: Altera FPGA DSP 28

    上傳時(shí)間: 2014-12-28

    上傳用戶(hù):18888888888

  • WP245 - 使用Virtex-5系列FPGA獲得更高系統(tǒng)性能

    Virtex™-5 器件包括基于第二代高級(jí)硅片組合模塊 (ASMBL™) 列架構(gòu)的多平臺(tái) FPGA 系列。集成了為獲得最佳性能、更高集成度和更低功耗設(shè)計(jì)的若干新型架構(gòu)元件,Virtex-5 器件達(dá)到了比以往更高的系統(tǒng)性能水平。

    標(biāo)簽: Virtex FPGA 245 WP

    上傳時(shí)間: 2013-10-29

    上傳用戶(hù):long14578

  • GPS_北斗-2組合定位性能的研究

    今年年底北斗衛(wèi)星導(dǎo)航系統(tǒng)已基本完成地球靜止軌道衛(wèi)星和傾斜地球同步軌道衛(wèi)星的建設(shè)工作。目前,在中國(guó)及周邊地區(qū)北斗導(dǎo)航系統(tǒng)已經(jīng)可以單獨(dú)提供定位服務(wù)。本文對(duì)GPS/北斗組合系統(tǒng)以及GPS北斗單獨(dú)系統(tǒng)在上海的定位性能進(jìn)行了評(píng)估,分析了在不同模式下的可視衛(wèi)星數(shù)量、幾何精度因子、定位的穩(wěn)定性和準(zhǔn)確性。結(jié)果表明組合定位進(jìn)一步提高了單獨(dú)系統(tǒng)模式下的定位性能,北斗系統(tǒng)目前在水平方向上的定位精度已經(jīng)達(dá)到10米級(jí)。

    標(biāo)簽: GPS 北斗 組合 定位

    上傳時(shí)間: 2013-10-20

    上傳用戶(hù):rishian

  • 基于PWLAN GPF的QoS性能分析與仿真

    基于IEEE802.11協(xié)議中PCF/DCF技術(shù),在無(wú)線局域網(wǎng)(WLAN)中,介紹了GPF的系統(tǒng)結(jié)構(gòu)和數(shù)據(jù)幀格式等。分別對(duì)基于IEEE802.11b媒體接入控制(MAC)協(xié)議、基于IEEE802.11e媒體接入控制(MAC)協(xié)議以及基于業(yè)務(wù)劃分Qos的GPF仿真的時(shí)間參數(shù)和接入原則等進(jìn)行了說(shuō)明。在PWLAN的3種測(cè)試環(huán)境下,對(duì)802.11b、802.11e、GPF協(xié)議的整體性能進(jìn)行了仿真,并對(duì)其結(jié)果進(jìn)行了分析。

    標(biāo)簽: PWLAN GPF QoS 性能分析

    上傳時(shí)間: 2013-11-15

    上傳用戶(hù):chaisz

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