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技術(shù)特點(diǎn)

  • 網(wǎng)絡(luò)奇技贏巧大搜捕

    網(wǎng)絡(luò)奇技贏巧大搜捕

    標(biāo)簽: 網(wǎng)絡(luò)

    上傳時(shí)間: 2013-04-15

    上傳用戶:eeworm

  • 武漢新特光電-激光配件-產(chǎn)品目錄-13.3M.rar

    專輯類----元器件樣本專輯 武漢新特光電-激光配件-產(chǎn)品目錄-13.3M.rar

    標(biāo)簽: 13.3 光電

    上傳時(shí)間: 2013-08-02

    上傳用戶:cngeek

  • 網(wǎng)絡(luò)奇技贏巧大搜捕.pdf

    專輯類-網(wǎng)絡(luò)及電腦相關(guān)專輯-114冊(cè)-4.31G 網(wǎng)絡(luò)奇技贏巧大搜捕.pdf

    標(biāo)簽: 網(wǎng)絡(luò)

    上傳時(shí)間: 2013-07-25

    上傳用戶:小寶愛考拉

  • 基于FPGA的卷積編碼和維特比譯碼的研究與實(shí)現(xiàn).rar

    在數(shù)字通信中,采用差錯(cuò)控制技術(shù)(糾錯(cuò)碼)是提高信號(hào)傳輸可靠性的有效手段,并發(fā)揮著越來(lái)越重要的作用。糾錯(cuò)碼主要有分組碼和卷積碼兩種。在碼率和編碼器復(fù)雜程度相同的情況下,卷積碼的性能優(yōu)于分組碼。 卷積碼的譯碼方法主要有代數(shù)譯碼和概率譯碼。代數(shù)譯碼是基于碼的代數(shù)結(jié)構(gòu);而概率譯碼不僅基于碼的代數(shù)結(jié)構(gòu),還利用了信道的統(tǒng)計(jì)特性,能充分發(fā)揮卷積碼的特點(diǎn),使譯碼錯(cuò)誤概率達(dá)到很小。 卷積碼譯碼器的設(shè)計(jì)是由高性能的復(fù)雜譯碼器開始的,對(duì)于概率譯碼最初的序列譯碼,隨著譯碼約束長(zhǎng)度的增加,其譯碼錯(cuò)誤概率可達(dá)到非常小。后來(lái)慢慢地向低性能的簡(jiǎn)單譯碼器演化,對(duì)不太長(zhǎng)的約束長(zhǎng)度,維特比(Viterbi)算法是非常實(shí)用的。維特比算法是一種最大似然的譯碼方法。當(dāng)編碼約束度不太大(小于等于10)或者誤碼率要求不太高(約10-5)時(shí),Viterbi譯碼算法效率很高,速度很快,譯碼器也較簡(jiǎn)單。 目前,卷積碼在數(shù)傳系統(tǒng),尤其是在衛(wèi)星通信、移動(dòng)通信等領(lǐng)域已被廣泛應(yīng)用。 本論文對(duì)卷積碼編碼和Viterbi譯碼的設(shè)計(jì)原理及其FPGA實(shí)現(xiàn)方案進(jìn)行了研究。同時(shí),將交織和解交織技術(shù)應(yīng)用于編碼和解碼的過(guò)程中。 首先,簡(jiǎn)要介紹了卷積碼的基礎(chǔ)知識(shí)和維特比譯碼算法的基本原理,并對(duì)硬判決譯碼和軟判決譯碼方法進(jìn)行了比較。其次,討論了交織和解交織技術(shù)及其在糾錯(cuò)碼中的應(yīng)用。然后,介紹了FPGA硬件資源和軟件開發(fā)環(huán)境Quartus Ⅱ,包括數(shù)字系統(tǒng)的設(shè)計(jì)方法和設(shè)計(jì)規(guī)則。再有,對(duì)基于FPGA的維特比譯碼器各個(gè)模塊和相應(yīng)算法實(shí)現(xiàn)、優(yōu)化進(jìn)行了研究。最后,在Quartus Ⅱ平臺(tái)上對(duì)硬判決譯碼和軟判決譯碼以及有無(wú)交織等不同情況進(jìn)行了仿真,并根據(jù)仿真結(jié)果分析了維特比譯碼器的性能。 分析結(jié)果表明,系統(tǒng)的誤碼率達(dá)到了設(shè)計(jì)要求,從而驗(yàn)證了譯碼器設(shè)計(jì)的可靠性,所設(shè)計(jì)基于FPGA的并行Viterbi譯碼器適用于高速數(shù)據(jù)傳輸?shù)膱?chǎng)合。

    標(biāo)簽: FPGA 卷積 編碼

    上傳時(shí)間: 2013-04-24

    上傳用戶:tedo811

  • 基于FPGA的卷積編碼和維特比譯碼

    在數(shù)字通信中,采用差錯(cuò)控制技術(shù)(糾錯(cuò)碼)是提高信號(hào)傳輸可靠性的有效手段,并發(fā)揮著越來(lái)越重要的作用。糾錯(cuò)碼主要有分組碼和卷積碼兩種。在碼率和編碼器復(fù)雜程度相同的情況下,卷積碼的性能優(yōu)于分組碼。 卷積碼的譯碼方法主要有代數(shù)譯碼和概率譯碼。代數(shù)譯碼是基于碼的代數(shù)結(jié)構(gòu);而概率譯碼不僅基于碼的代數(shù)結(jié)構(gòu),還利用了信道的統(tǒng)計(jì)特性,能充分發(fā)揮卷積碼的特點(diǎn),使譯碼錯(cuò)誤概率達(dá)到很小。 卷積碼譯碼器的設(shè)計(jì)是由高性能的復(fù)雜譯碼器開始的,對(duì)于概率譯碼最初的序列譯碼,隨著譯碼約束長(zhǎng)度的增加,其譯碼錯(cuò)誤概率可達(dá)到非常小。后來(lái)慢慢地向低性能的簡(jiǎn)單譯碼器演化,對(duì)不太長(zhǎng)的約束長(zhǎng)度,維特比(Viterbi)算法是非常實(shí)用的。維特比算法是一種最大似然的譯碼方法。當(dāng)編碼約束度不太大(小于等于10)或者誤碼率要求不太高(約10-5)時(shí),Viterbi譯碼算法效率很高,速度很快,譯碼器也較簡(jiǎn)單。 目前,卷積碼在數(shù)傳系統(tǒng),尤其是在衛(wèi)星通信、移動(dòng)通信等領(lǐng)域已被廣泛應(yīng)用。 本論文對(duì)卷積碼編碼和Viterbi譯碼的設(shè)計(jì)原理及其FPGA實(shí)現(xiàn)方案進(jìn)行了研究。同時(shí),將交織和解交織技術(shù)應(yīng)用于編碼和解碼的過(guò)程中。 首先,簡(jiǎn)要介紹了卷積碼的基礎(chǔ)知識(shí)和維特比譯碼算法的基本原理,并對(duì)硬判決譯碼和軟判決譯碼方法進(jìn)行了比較。其次,討論了交織和解交織技術(shù)及其在糾錯(cuò)碼中的應(yīng)用。然后,介紹了FPGA硬件資源和軟件開發(fā)環(huán)境Quartus Ⅱ,包括數(shù)字系統(tǒng)的設(shè)計(jì)方法和設(shè)計(jì)規(guī)則。再有,對(duì)基于FPGA的維特比譯碼器各個(gè)模塊和相應(yīng)算法實(shí)現(xiàn)、優(yōu)化進(jìn)行了研究。最后,在Quartus Ⅱ平臺(tái)上對(duì)硬判決譯碼和軟判決譯碼以及有無(wú)交織等不同情況進(jìn)行了仿真,并根據(jù)仿真結(jié)果分析了維特比譯碼器的性能。 分析結(jié)果表明,系統(tǒng)的誤碼率達(dá)到了設(shè)計(jì)要求,從而驗(yàn)證了譯碼器設(shè)計(jì)的可靠性,所設(shè)計(jì)基于FPGA的并行Viterbi譯碼器適用于高速數(shù)據(jù)傳輸?shù)膱?chǎng)合。

    標(biāo)簽: FPGA 卷積 編碼 譯碼

    上傳時(shí)間: 2013-04-24

    上傳用戶:zhenyushaw

  • 卷積編碼和維特比譯碼的FPGA實(shí)現(xiàn)

    由于其很強(qiáng)的糾錯(cuò)性能和適合硬件實(shí)現(xiàn)的編譯碼算法,卷積編碼和軟判決維特比譯碼目前已經(jīng)廣泛應(yīng)用于衛(wèi)星通信系統(tǒng)。然而隨著航天事業(yè)的發(fā)展,衛(wèi)星有效載荷種類的增多和分辨率的不斷提高,信息量越來(lái)越大。如何在低信噪比的功率受限信道條件下提高傳輸速率成為目前亟待解決的問(wèn)題。本論文結(jié)合在研項(xiàng)目,在編譯碼算法、編譯碼器的設(shè)計(jì)與實(shí)現(xiàn)、編譯碼器性能提高三個(gè)方面對(duì)卷積編碼和維特比譯碼進(jìn)行了深入研究,并進(jìn)一步介紹了使用VHDL語(yǔ)言和原理圖混合輸入的方式,實(shí)現(xiàn)一種(7,3/4)增信刪余方式的高速卷積編碼器和維特比譯碼器的詳細(xì)過(guò)程;然后將設(shè)計(jì)下載到XILINX的Virtex2 FPGA內(nèi)部進(jìn)行功能和時(shí)序確認(rèn),最終在整個(gè)數(shù)據(jù)傳輸系統(tǒng)中測(cè)試其性能。本文所實(shí)現(xiàn)的維特比譯碼器速率達(dá)160Mbps,遠(yuǎn)遠(yuǎn)高于目前國(guó)內(nèi)此領(lǐng)域內(nèi)的相關(guān)產(chǎn)品速率。 首先,論文具體介紹了卷積編碼和維特比譯碼的算法,研究卷積碼的各種參數(shù)(約束長(zhǎng)度、生成多項(xiàng)式、碼率以及增信刪余等)對(duì)其譯碼性能的影響;針對(duì)項(xiàng)目需求,確定卷積編碼器的約束長(zhǎng)度、生成多項(xiàng)式格式、碼率和相應(yīng)的維特比譯碼器的回歸長(zhǎng)度。 其次,論文介紹了編解碼器的軟、硬件設(shè)計(jì)和調(diào)試一根據(jù)已知條件,使用VHDL語(yǔ)言和原理圖混合輸入的方式設(shè)計(jì)卷積編碼和維特比譯碼的源代碼和原理圖,分別采用功能和電路級(jí)仿真,確定卷積編碼和維特比譯碼分別需要占用的資源,考慮卷積編碼器和維特比譯碼器的具體設(shè)計(jì)問(wèn)題,包括編譯碼的基本結(jié)構(gòu),各個(gè)模塊的功能及實(shí)現(xiàn)策略,編譯碼器的時(shí)序、邏輯綜合等;根據(jù)軟件仿真結(jié)果,分別確定卷積編碼器和維特比譯碼器的接口、所需的FPGA器件選型和進(jìn)行各自的印制板設(shè)計(jì)。利用卷積碼本身的特點(diǎn),結(jié)合FPGA內(nèi)部結(jié)構(gòu),采用并行卷積編碼和譯碼運(yùn)算,設(shè)計(jì)出高速編譯碼器;對(duì)軟、硬件分別進(jìn)行驗(yàn)證和調(diào)試,并將驗(yàn)證后的軟件下載到FPGA進(jìn)行電路級(jí)調(diào)試。 最后,論文討論了卷積編碼和維特比譯碼的性能:利用已有的測(cè)試設(shè)備在整個(gè)數(shù)據(jù)傳輸系統(tǒng)中測(cè)試其性能(與沒(méi)有采用糾錯(cuò)編碼的數(shù)傳系統(tǒng)進(jìn)行比對(duì));在信道中加入高斯白噪聲,模擬高斯信道,進(jìn)行誤碼率和信噪比測(cè)試。

    標(biāo)簽: FPGA 卷積 編碼 譯碼

    上傳時(shí)間: 2013-04-24

    上傳用戶:mingaili888

  • 羅斯蒙特1700/2700操作說(shuō)明書

    適用于羅斯蒙特質(zhì)量流量計(jì)1700或2700表頭的組態(tài)操作

    標(biāo)簽: 1700 2700 羅斯蒙特 操作

    上傳時(shí)間: 2013-04-24

    上傳用戶:glitter

  • 山特UPS-500不間斷電源電路圖

    山特UPS-500不間斷電源電路圖,多款電路圖

    標(biāo)簽: UPS 500 山特 不間斷電源

    上傳時(shí)間: 2013-04-24

    上傳用戶:sardinescn

  • 你一生的故事 特德·蔣

    《你一生的故事》是特德·蔣最富盛名的科幻小說(shuō)。

    標(biāo)簽:

    上傳時(shí)間: 2013-06-04

    上傳用戶:hmr0452

  • 希爾伯特變換Hilbert算法

    此文件是數(shù)字處理算法的一種,希爾伯特變換-Hilbert。曾在上課時(shí)編寫該算法,反復(fù)調(diào)試成功。該算法在工程應(yīng)用中很有用。算法用C語(yǔ)言編寫,可直接用于C的開發(fā)環(huán)境中。省去了自己編寫的調(diào)試過(guò)程。

    標(biāo)簽: Hilbert 希爾伯特 變換 算法

    上傳時(shí)間: 2013-06-22

    上傳用戶:三人用菜

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