P1.0-P1.7為八路搶答輸入 數(shù)碼管段選P0口，位選P2口，蜂鳴器輸出為P3.6口。 P3.0為開始搶答，P3.7為停止。
標(biāo)簽： 1.0 1.7 搶答 P0口
上傳時間： 2017-04-15
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基于ATmega16L 單片機(jī)的六路搶答器設(shè)計，可完成搶答器的基本功能
標(biāo)簽： ATmega 16L 16 單片機(jī)
上傳時間： 2014-01-10
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一款搶答器 界面友好 功能完善 支持?jǐn)嚅_重連 可在娛樂競賽中使用此為 源代碼
標(biāo)簽： 搶答器 娛樂 斷開 競賽
上傳時間： 2013-12-25
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VHDL基礎(chǔ) 數(shù)據(jù)對象 搶答器 適合新手
標(biāo)簽： VHDL 數(shù)據(jù) 對象 搶答器
上傳時間： 2014-01-02
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51單片機(jī)實(shí)現(xiàn)搶答器，已經(jīng)在89ST52為微處理器的開發(fā)板上運(yùn)行通過了
標(biāo)簽： 51單片機(jī) 搶答器
上傳時間： 2017-04-29
上傳用戶：源弋弋
用verilog編寫的搶答器，當(dāng)主持人宣布“開始比賽”，系統(tǒng)初始化，選手進(jìn)入“搶答狀態(tài)”。當(dāng)某一選手首先按下搶答開關(guān)時，相應(yīng)的指示燈亮，此時搶答器不再接受其他輸入信號。電路具有累計分控制（分別用４個４位選手的積分——十六進(jìn)制數(shù)），由主持人控制“加分”。“加分”加分完畢，開始下一輪搶答。電路還可以設(shè)有回答問題時間控制。
標(biāo)簽： verilog 編寫 搶答器
上傳時間： 2014-01-16
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基于VHDL的數(shù)字競賽搶答器的設(shè)計及其仿真
標(biāo)簽： VHDL 數(shù)字 搶答器 仿真
上傳時間： 2017-05-10
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51單片機(jī)寫的搶答器,注釋很詳細(xì),適全初學(xué)單片機(jī)的人.
標(biāo)簽： 51單片機(jī) 搶答器 單片機(jī)
上傳時間： 2017-06-15
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直接燒寫進(jìn)單片機(jī)即可按四個獨(dú)立按鍵 分別代表4路搶答器按鍵
標(biāo)簽： 按鍵 燒寫 單片機(jī) 分
上傳時間： 2013-12-12
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四路搶答器perteus電路仿真,由四個搶答按鈕和一個主持人清除按鈕組成
標(biāo)簽： perteus 按鈕 四路搶答器 電路仿真
上傳時間： 2014-01-24
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