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振動(dòng)(dòng)

  • 磁通反向電機(jī)的數(shù)學(xué)模型及性能分析

    磁通反向電機(jī)(FRM)是一種新型的雙凸極永磁(DSPM)電機(jī),它把高磁能的永磁體放在定子極的表面,永磁體易于安裝.隨著轉(zhuǎn)子旋轉(zhuǎn),FRM定子繞組所交鏈的永磁磁通改變極性,這意味著比磁通脈振產(chǎn)生更大的磁通變化.由于FRM的繞組利用率高、結(jié)構(gòu)簡(jiǎn)單、轉(zhuǎn)動(dòng)慣量小及適于高速運(yùn)轉(zhuǎn)等優(yōu)點(diǎn),可廣泛應(yīng)用于汽車(chē)制造業(yè)、航空航天等工業(yè)領(lǐng)域.本文將從模型建立、分析方法、性能分析等方面對(duì)該電機(jī)進(jìn)行深入研究.首先,為了解FRM基本理論和掌握其基本規(guī)律,寫(xiě)出FRM的基本方程式;由于電機(jī)的雙凸極結(jié)構(gòu)以及飽和和非線性的影響,整個(gè)系統(tǒng)為一強(qiáng)非線性系統(tǒng).對(duì)該電機(jī)作適當(dāng)簡(jiǎn)化,建立其線性數(shù)學(xué)模型,這樣有利于對(duì)FRM的定性分析,弄清其內(nèi)部的基本電磁關(guān)系和基本特性.討論了繞組電感、繞組磁鏈、感應(yīng)電動(dòng)勢(shì)及繞組電流、電磁轉(zhuǎn)矩等靜態(tài)特性,推導(dǎo)出FRM的功率密度計(jì)算公式.其次,為準(zhǔn)確計(jì)算FRM性能,要考慮磁路飽和、鐵磁材料的非線性以及永磁磁場(chǎng)與電樞反應(yīng)磁場(chǎng)之間的相互影響等因素,要建立FRM的非線性模型,提出用變網(wǎng)絡(luò)等效磁路法進(jìn)行分析.具體方法是建立FRM的非線性變網(wǎng)絡(luò)等效磁路模型,推導(dǎo)等效磁路中各部分磁導(dǎo)的計(jì)算公式,用節(jié)點(diǎn)磁位法建立相應(yīng)的方程,通過(guò)求解該非線性等效磁路方程,得到磁路各部分的磁通分布,進(jìn)一步求得靜態(tài)特性,計(jì)算出電磁參數(shù).然后用FRM樣機(jī)的實(shí)驗(yàn)結(jié)果驗(yàn)證理論分析的正確性.樣機(jī)的理論分析結(jié)果同實(shí)驗(yàn)結(jié)果進(jìn)行比較表明,本文所介紹的FRM變網(wǎng)絡(luò)等效磁路模型具有較好的精度及通用性,基于等效磁網(wǎng)絡(luò)模型的FRM電磁計(jì)算是可行的,計(jì)算結(jié)果是正確的.最后對(duì)磁通反向汽車(chē)發(fā)電機(jī)的功率密度進(jìn)行分析.導(dǎo)出了磁通反向汽車(chē)發(fā)電機(jī)功率密度的計(jì)算公式,分析了影響電機(jī)功率密度的因素,并與電勵(lì)磁汽車(chē)發(fā)電機(jī)進(jìn)行了比較.

    標(biāo)簽: 磁通 反向電機(jī) 數(shù)學(xué)模型 性能分析

    上傳時(shí)間: 2013-07-30

    上傳用戶(hù):ljthhhhhh123

  • 基于ARM和嵌入式Linux的網(wǎng)絡(luò)視頻監(jiān)控系統(tǒng)的設(shè)計(jì)與研究

    隨著社會(huì)的發(fā)展,網(wǎng)絡(luò)視頻監(jiān)控系統(tǒng)已經(jīng)成為日常生產(chǎn)生活中的重要輔助設(shè)備,應(yīng)用十分廣泛。當(dāng)前視頻監(jiān)控系統(tǒng)正逐步由模擬化走向數(shù)字化,隨著視頻壓縮技術(shù)和網(wǎng)絡(luò)技術(shù)的發(fā)展,開(kāi)發(fā)新一代的基于計(jì)算機(jī)網(wǎng)絡(luò)和多媒體MPEG-4壓縮算法的視頻監(jiān)控系統(tǒng)已成為整個(gè)行業(yè)技術(shù)發(fā)展的主要方向之一。人們有時(shí)會(huì)采用DSP與MPEG-4算法結(jié)合的方案來(lái)實(shí)現(xiàn),也有的部門(mén)采用了片上系統(tǒng)(SOC),但這些不但編程極度復(fù)雜,而且成本也過(guò)高。本文提出并研究設(shè)計(jì)了一種基于ARM微處理器S3C2410、MPEG-4專(zhuān)用壓縮芯片MPG440、以嵌入式Linux為操作系統(tǒng)的視頻監(jiān)控系統(tǒng)方案,不僅開(kāi)發(fā)便捷、成本低廉,而且實(shí)時(shí)性較好,適應(yīng)范圍廣。 首先,采用軟硬件協(xié)同設(shè)計(jì)的思想提出了系統(tǒng)的總體設(shè)計(jì)方案,系統(tǒng)的整體架構(gòu)分為攝像頭、云臺(tái)控制器、網(wǎng)絡(luò)視頻服務(wù)器以及客戶(hù)端PC機(jī)等四大部分。 第二,以三星公司的S3C2410芯片和DAVICOM公司的DM9000以太網(wǎng)接口芯片為硬件核心,對(duì)整個(gè)系統(tǒng)進(jìn)行了模塊化的硬件電路的設(shè)計(jì)。根據(jù)S3C2410的特點(diǎn)及系統(tǒng)整體需求,完成了電源復(fù)位模塊、晶振模塊、存儲(chǔ)器接口模塊、視頻數(shù)據(jù)處理模塊、以太網(wǎng)接口模塊、云臺(tái)控制模塊等的硬件選型與電路連接。其中,在云臺(tái)控制模塊等的電路設(shè)計(jì)中充分體現(xiàn)了優(yōu)化設(shè)計(jì)的技巧,并重點(diǎn)對(duì)網(wǎng)絡(luò)接口部分和視頻數(shù)據(jù)處理部分進(jìn)行了詳細(xì)的硬件設(shè)計(jì)與說(shuō)明。闡述了整個(gè)系統(tǒng)的工作流程。 第三,從應(yīng)用需求出發(fā),選擇嵌入式Linux操作系統(tǒng)作為本系統(tǒng)的軟件平臺(tái),搭建了交叉式的開(kāi)發(fā)環(huán)境,對(duì)bootloader進(jìn)行了選擇,并給出了加載步驟。完成了對(duì)嵌入式Linux內(nèi)核的選擇及移植。 第四,采用基于任務(wù)的設(shè)計(jì)方法對(duì)服務(wù)器端的軟件進(jìn)行了總體設(shè)計(jì),主要包括共用程序庫(kù)、config配置文件、日志文件以及多個(gè)任務(wù)等。并對(duì)運(yùn)行于客戶(hù)端的軟件設(shè)計(jì)進(jìn)行了簡(jiǎn)要說(shuō)明。 第五,由于數(shù)字視頻傳輸?shù)膶?shí)時(shí)性能和通過(guò)網(wǎng)絡(luò)傳輸以后客戶(hù)端接收的視頻圖像質(zhì)量在本系統(tǒng)中至關(guān)重要,所以本文對(duì)傳輸信道和網(wǎng)絡(luò)協(xié)議進(jìn)行了優(yōu)化選擇,并詳細(xì)闡述了IP組播技術(shù)、流媒體傳輸協(xié)議等在圖像傳輸過(guò)程中的具體應(yīng)用。

    標(biāo)簽: Linux ARM 嵌入式 網(wǎng)絡(luò)視頻

    上傳時(shí)間: 2013-04-24

    上傳用戶(hù):sc965382896

  • PSLIB21

    pb開(kāi)發(fā)soket所需要的一個(gè)關(guān)鍵動(dòng)態(tài)庫(kù),我找了很久的,現(xiàn)在份享一下-pb socket dll

    標(biāo)簽: PSLIB 21

    上傳時(shí)間: 2013-04-24

    上傳用戶(hù):refent

  • FPGA用于160Gbs高速光纖通信系統(tǒng)中PMD補(bǔ)償?shù)难芯?/a>

    偏振模色散(PMD)是限制光通信系統(tǒng)向高速率和大容量擴(kuò)展的主要障礙,尤其是160Gb/s光傳輸系統(tǒng)中,由PMD引起的脈沖畸變現(xiàn)象更加嚴(yán)重。為了克服PMD帶來(lái)的危害,國(guó)內(nèi)外已經(jīng)開(kāi)始了對(duì)PMD補(bǔ)償?shù)难芯俊5悄壳暗难a(bǔ)償系統(tǒng)復(fù)雜、成本高且補(bǔ)償效果不理想,因此采用前向糾錯(cuò)(FEC)和偏振擾偏器配合抑制PMD的方法,可以實(shí)現(xiàn)低成本的PMD補(bǔ)償。 在實(shí)驗(yàn)中將擾偏器連入光時(shí)分復(fù)用系統(tǒng),通過(guò)觀察其工作前后的脈沖波形,發(fā)現(xiàn)擾偏器的應(yīng)用改善了系統(tǒng)的性能。隨著系統(tǒng)速率的提高,對(duì)擾偏器速率的要求也隨之提高,目前市場(chǎng)上擾偏器的速率無(wú)法滿(mǎn)足160Gb/s光傳輸系統(tǒng)要求。通過(guò)對(duì)偏振擾偏器原理的分析,決定采用高速控制電路驅(qū)動(dòng)偏振控制器的方法來(lái)實(shí)現(xiàn)高速擾偏器的設(shè)計(jì)。擾偏器采用鈮酸鋰偏振控制器,其響應(yīng)時(shí)間小于100ns,是目前偏振控制器能夠達(dá)到的最高速率,但是將其用于160Gb/s高速光通信系統(tǒng)擾偏時(shí),這個(gè)速率仍然偏低,因此,提出采用多段鈮酸鋰晶體并行擾偏的方法,彌補(bǔ)鈮酸鋰偏振控制器速率低的問(wèn)題。通過(guò)對(duì)幾種處理器的分析和比較,選擇DSP+FPGA作為控制端,DSP芯片用于產(chǎn)生隨機(jī)數(shù)據(jù),F(xiàn)PGA芯片具有豐富的I/O引腳,工作頻率高,可以實(shí)現(xiàn)大量數(shù)據(jù)的快速并行輸出。這樣的方案可以充分發(fā)揮DSP和FPGA各自的優(yōu)勢(shì)。另外對(duì)數(shù)模轉(zhuǎn)換芯片也要求響應(yīng)速度快,本論文以FPGA為核心,完成了FPGA與其它芯片的接口電路設(shè)計(jì)。在QuartusⅡ集成環(huán)境中進(jìn)行FPGA的開(kāi)發(fā),使用VHDL語(yǔ)言和原理圖輸入法進(jìn)行電路設(shè)計(jì)。 本文設(shè)計(jì)的偏振擾偏器在高速控制電路的驅(qū)動(dòng)下,可以實(shí)現(xiàn)大量的數(shù)據(jù)處理,采用多段鈮酸鋰晶體并行工作的方法,可以提高偏振擾偏器的速率。利用本方案制作的擾偏器具有高擾偏速率,適合應(yīng)用于160Gb/s光通信系統(tǒng)中進(jìn)行PMD補(bǔ)償。

    標(biāo)簽: FPGA 160 Gbs PMD

    上傳時(shí)間: 2013-04-24

    上傳用戶(hù):suxuan110425

  • 基于ARM的液晶顯示控制設(shè)計(jì)

    隨著液晶顯示技術(shù)的發(fā)展,我們的日常生活中出現(xiàn)了各種各樣功能強(qiáng)大的顯示系統(tǒng)。本文主要以液晶顯示技術(shù)的基本原理為理論基礎(chǔ),探討并比較了單片機(jī)和ARM微處理器作為液晶顯示控制系統(tǒng)各自的優(yōu)缺點(diǎn),并設(shè)計(jì)和完成了~套基于ARM微處理器的液晶顯示控制系統(tǒng)。 該系統(tǒng)以Samsung公司的ARM微處理器芯片S3C4510B為CPU,根據(jù)ARM微處理器的特點(diǎn),本文系統(tǒng)地分析了電源及復(fù)位電路、晶振電路、Flash 存儲(chǔ)器接口電路、SDRAM存儲(chǔ)器接口電路、串行接口電路、JTAG接口電路以及10M/100M以太網(wǎng)接口電路的設(shè)計(jì)方法。同時(shí),重點(diǎn)描述了液晶顯示模塊電路和鍵盤(pán)控制電路的設(shè)計(jì)與實(shí)現(xiàn)。在各個(gè)部分硬件電路的調(diào)試成功過(guò)后,介紹了Bootloader的下載以及uClinux操作系統(tǒng)的下載和編譯。在液晶顯示控制系統(tǒng)的軟件設(shè)計(jì)部分,本文重點(diǎn)分析了在uClinux操作系統(tǒng)下進(jìn)行的用戶(hù)程序的開(kāi)發(fā)。根據(jù)液晶顯示模塊的特點(diǎn)和對(duì)鍵盤(pán)控制電路的I/O口配置,對(duì)整個(gè)顯示控制系統(tǒng)的程序設(shè)計(jì)作出了一定的分析。最終通過(guò)對(duì)系統(tǒng)的調(diào)試,實(shí)現(xiàn)了ARM微處理器系統(tǒng)對(duì)LCD液晶顯示器的顯示控制。

    標(biāo)簽: ARM 液晶顯示 控制設(shè)計(jì)

    上傳時(shí)間: 2013-04-24

    上傳用戶(hù):change0329

  • 基于FPGA的高頻數(shù)字DCDC變換器研究

    在傳統(tǒng)的電力電子電路中,DC/DC變換器通常采用模擬電路實(shí)現(xiàn)電壓或電流的控制。數(shù)字控制與模擬控制相比,有著顯著的優(yōu)點(diǎn),數(shù)字控制可以實(shí)現(xiàn)復(fù)雜的控制策略,同時(shí)大大提高系統(tǒng)的可靠性和靈活性,并易于實(shí)現(xiàn)系統(tǒng)的智能化。但目前數(shù)字控制基本上限于電力傳動(dòng)領(lǐng)域,DC/DC變換器由于其開(kāi)關(guān)頻率較高,一般其外圍功能由DSP或微處理器完成,而控制的核心,如PWM發(fā)生等大多采用專(zhuān)用控制芯片實(shí)現(xiàn)。FPGA由于其快速性、靈活性及保密性等優(yōu)點(diǎn),近年來(lái)在數(shù)字控制領(lǐng)域受到越來(lái)越多的關(guān)注?;贔PGA的DC/DC變換器是電力電子領(lǐng)域重要的研究方向之一。本文研究了同步Buck變換器的建模、設(shè)計(jì)及仿真,采用Xinlix的VIRTEX-Ⅱ PRO FPGA開(kāi)發(fā)板實(shí)現(xiàn)了Buck變換器的全數(shù)字控制。 論文首先從Buck變換器的理論分析入手,根據(jù)它的物理特性,研究了該變換器的狀態(tài)空間平均模型和小信號(hào)分析。為了獲得高性能的開(kāi)關(guān)電源,提出并分析了混雜模型設(shè)計(jì)方案,然后進(jìn)行了控制器設(shè)計(jì)。并采用MATLAB/SIMULINK建立了同步Buck電路的仿真模型,并進(jìn)行仿真研究。浮點(diǎn)仿真的運(yùn)算精度與溢出問(wèn)題,影響了仿真的精度。為了克服這些不足,作者采用了定點(diǎn)仿真方法,得到了滿(mǎn)意的仿真結(jié)果。論文還著重論述了開(kāi)關(guān)電源的數(shù)字控制器部分,數(shù)字控制器一般由三個(gè)主要功能模塊組成:模數(shù)轉(zhuǎn)換器、數(shù)字脈寬調(diào)制器(Digital PulseWidth Modulation:DPWM)和數(shù)字補(bǔ)償器。文中重點(diǎn)研究了DPWM和數(shù)字補(bǔ)償器,闡述了目前高頻數(shù)字控制變換器中存在的主要問(wèn)題,特別是高頻狀態(tài)下DPWM分辨率較低,影響控制精度,甚至引起極限環(huán)(Limit Cycling)現(xiàn)象,對(duì)DPWM分辨率的提高與系統(tǒng)硬件工作頻率之間的矛盾、DPWM分辨率與A/D分辨率之間的關(guān)系等問(wèn)題作了全面深入的分析。論文提出了一種新的提高DPWM分辨率的方法,該方法在不提高系統(tǒng)硬件頻率的前提下,采用軟件使DPWM的分辨率大大提高。作者還設(shè)計(jì)了兩種數(shù)字補(bǔ)償器,并進(jìn)行了分析比較,選擇了合適的補(bǔ)償算法,達(dá)到了改善系統(tǒng)性能的目的。 設(shè)計(jì)完成后,作者使用ISE 9.1i軟件進(jìn)行了FPGA實(shí)現(xiàn)的前、后仿真,驗(yàn)證了所提出理論及控制算法的正確性。作者完成了Buck電路的硬件制作及基于FPGA的軟件設(shè)計(jì),采用32MHz的硬件晶振實(shí)現(xiàn)了11-bit的DPWM分辨率,開(kāi)關(guān)頻率達(dá)到1MHz,得到了滿(mǎn)意的系統(tǒng)性能,論文最后給出了仿真和實(shí)驗(yàn)結(jié)果。

    標(biāo)簽: FPGA DCDC 高頻 數(shù)字

    上傳時(shí)間: 2013-07-23

    上傳用戶(hù):kristycreasy

  • 基于FPGA的體視攝像顯示技術(shù)的研究

    體視攝像顯示技術(shù)的研究以應(yīng)用于微創(chuàng)傷外科的光電醫(yī)療儀器——三維電視內(nèi)窺鏡的開(kāi)發(fā)與研制為背景,設(shè)計(jì)研究一種基于FPGA技術(shù)的立體顯示系統(tǒng),以滿(mǎn)足三維立體內(nèi)窺鏡、戰(zhàn)場(chǎng)立體觀察系統(tǒng)和立體電影等設(shè)備的技術(shù)要求。 主要研究?jī)?nèi)容是對(duì)體視攝像顯示系統(tǒng)的進(jìn)行硬件電路設(shè)計(jì)、VerilogHDL 語(yǔ)言的軟件編程、并采用MCU(Micro Control IJnit)的I

    標(biāo)簽: FPGA 顯示技術(shù)

    上傳時(shí)間: 2013-05-30

    上傳用戶(hù):壞天使kk

  • USBasp

    USBasp制作成功,全部資料包括原理圖和PCB及驅(qū)動(dòng)安裝說(shuō)明。首次制作過(guò)程中發(fā)現(xiàn)芯片燒寫(xiě)熔絲位后不工作,以為芯片被鎖死,用8M有源晶振不能解鎖,因手邊沒(méi)有示波器,所以郁悶了好幾個(gè)小時(shí),結(jié)果是因?yàn)榫д竦碾娙萑葜挡粚?duì),換成20PF的電容后問(wèn)題就解決了,制作過(guò)程還算順利的,

    標(biāo)簽: USBasp

    上傳時(shí)間: 2013-06-24

    上傳用戶(hù):dialouch

  • 基于FPGA的精確時(shí)鐘同步方法研究

    在工業(yè)控制領(lǐng)域,多種現(xiàn)場(chǎng)總線標(biāo)準(zhǔn)共存的局面從客觀上促進(jìn)了工業(yè)以太網(wǎng)技術(shù)的迅速發(fā)展,國(guó)際上已經(jīng)出現(xiàn)了HSE、Profinet、Modbus TCP/IP、Ethernet/IP、Ethernet Powerlink、EtherCAT等多種工業(yè)以太網(wǎng)協(xié)議。將傳統(tǒng)的商用以太網(wǎng)應(yīng)用于工業(yè)控制系統(tǒng)的現(xiàn)場(chǎng)設(shè)備層的最大障礙是以太網(wǎng)的非實(shí)時(shí)性,而實(shí)現(xiàn)現(xiàn)場(chǎng)設(shè)備間的高精度時(shí)鐘同步是保證以太網(wǎng)高實(shí)時(shí)性的前提和基礎(chǔ)。 IEEE 1588定義了一個(gè)能夠在測(cè)量和控制系統(tǒng)中實(shí)現(xiàn)高精度時(shí)鐘同步的協(xié)議——精確時(shí)間協(xié)議(Precision Time Protocol)。PTP協(xié)議集成了網(wǎng)絡(luò)通訊、局部計(jì)算和分布式對(duì)象等多項(xiàng)技術(shù),適用于所有通過(guò)支持多播的局域網(wǎng)進(jìn)行通訊的分布式系統(tǒng),特別適合于以太網(wǎng),但不局限于以太網(wǎng)。PTP協(xié)議能夠使異質(zhì)系統(tǒng)中各類(lèi)不同精確度、分辨率和穩(wěn)定性的時(shí)鐘同步起來(lái),占用最少的網(wǎng)絡(luò)和局部計(jì)算資源,在最好情況下能達(dá)到系統(tǒng)級(jí)的亞微級(jí)的同步精度。 基于PC機(jī)軟件的時(shí)鐘同步方法,如NTP協(xié)議,由于其實(shí)現(xiàn)機(jī)理的限制,其同步精度最好只能達(dá)到毫秒級(jí);基于嵌入式軟件的時(shí)鐘同步方法,將時(shí)鐘同步模塊放在操作系統(tǒng)的驅(qū)動(dòng)層,其同步精度能夠達(dá)到微秒級(jí)?,F(xiàn)場(chǎng)設(shè)備間微秒級(jí)的同步精度雖然已經(jīng)能滿(mǎn)足大多數(shù)工業(yè)控制系統(tǒng)對(duì)設(shè)備時(shí)鐘同步的要求,但是對(duì)于運(yùn)動(dòng)控制等需求高精度定時(shí)的系統(tǒng)來(lái)說(shuō),這仍然不夠?;谇度胧杰浖臅r(shí)鐘同步方法受限于操作系統(tǒng)中斷響應(yīng)延遲時(shí)間不一致、晶振頻率漂移等因素,很難達(dá)到亞微秒級(jí)的同步精度。 本文設(shè)計(jì)并實(shí)現(xiàn)了一種基于FPGA的時(shí)鐘同步方法,以IEEE 1588作為時(shí)鐘同步協(xié)議,以Ethernet作為底層通訊網(wǎng)絡(luò),以嵌入式軟件形式實(shí)現(xiàn)TCP/IP通訊,以數(shù)字電路形式實(shí)現(xiàn)時(shí)鐘同步模塊。這種方法充分利用了FPGA的特點(diǎn),通過(guò)準(zhǔn)確捕獲報(bào)文時(shí)間戳和動(dòng)態(tài)補(bǔ)償晶振頻率漂移等手段,相對(duì)于嵌入式軟件時(shí)鐘同步方法實(shí)現(xiàn)了更高精度的時(shí)鐘同步,并通過(guò)實(shí)驗(yàn)驗(yàn)證了在以集線器互連的10Mbps以太網(wǎng)上能夠達(dá)到亞微秒級(jí)的同步精度。

    標(biāo)簽: FPGA 時(shí)鐘同步 方法研究

    上傳時(shí)間: 2013-07-28

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  • 軟件無(wú)線電中數(shù)字下變頻技術(shù)研究

    軟件無(wú)線電(SDR,Software Defined Radio)由于具備傳統(tǒng)無(wú)線電技術(shù)無(wú)可比擬的優(yōu)越性,已成為業(yè)界公認(rèn)的現(xiàn)代無(wú)線電通信技術(shù)的發(fā)展方向。理想的軟件無(wú)線電系統(tǒng)強(qiáng)調(diào)體系結(jié)構(gòu)的開(kāi)放性和可編程性,減少靈活性著的硬件電路,把數(shù)字化處理(ADC和DAC)盡可能靠近天線,通過(guò)軟件的更新改變硬件的配置、結(jié)構(gòu)和功能。目前,直接對(duì)射頻(RF)進(jìn)行采樣的技術(shù)尚未實(shí)現(xiàn)普及的產(chǎn)品化,而用數(shù)字變頻器在中頻進(jìn)行數(shù)字化是普遍采用的方法,其主要思想是,數(shù)字混頻器用離散化的單頻本振信號(hào)與輸入采樣信號(hào)在乘法器中相乘,再經(jīng)插值或抽取濾波,其結(jié)果是,輸入信號(hào)頻譜搬移到所需頻帶,數(shù)據(jù)速率也相應(yīng)改變,以供后續(xù)模塊做進(jìn)一步處理。數(shù)字變頻器在發(fā)射設(shè)備和接收設(shè)備中分別稱(chēng)為數(shù)字上變頻器(DUC,Digital Upper Converter)和數(shù)字下變頻器(DDC,Digital Down Converter),它們是軟件無(wú)線電通信設(shè)備的關(guān)鍵部什。大規(guī)??删幊踢壿嬈骷膽?yīng)用為現(xiàn)代通信系統(tǒng)的設(shè)計(jì)帶來(lái)極大的靈活性?;贔PGA的數(shù)字變頻器設(shè)計(jì)是深受廣大設(shè)計(jì)人員歡迎的設(shè)計(jì)手段。本文的重點(diǎn)研究是數(shù)字下變頻器(DDC),然而將它與數(shù)字上變頻器(DUC)完全割裂后進(jìn)行研究顯然是不妥的,因此,本文對(duì)數(shù)字上變頻器也作適當(dāng)介紹。 第一章簡(jiǎn)要闡述了軟件無(wú)線電及數(shù)字下變頻的基本概念,介紹了研究背景及所完成的主要研究工作。 第二章介紹了數(shù)控振蕩器(NCO),介紹了兩種實(shí)現(xiàn)方法,即基于查找表和基于CORDIC算法的實(shí)現(xiàn)。對(duì)CORDIc算法作了重點(diǎn)介紹,給出了傳統(tǒng)算法和改進(jìn)算法,并對(duì)基于傳統(tǒng)CORDIC算法的NCO的FPGA實(shí)現(xiàn)進(jìn)行了EDA仿真。 第三章介紹了變速率采樣技術(shù),重點(diǎn)介紹了軟件無(wú)線電中廣泛采用的級(jí)聯(lián)積分梳狀濾波器 (cascaded integratot comb, CIC)和ISOP(Interpolated Second Order Polynomial)補(bǔ)償法,對(duì)前者進(jìn)行了基于Matlab的理論仿真和FPGA實(shí)現(xiàn)的EDA仿真,后者只進(jìn)行了基于Matlab的理論仿真。 第四章介紹了分布式算法和軟件無(wú)線電中廣泛采用的半帶(half-band,HB)濾波器,對(duì)基于分布式算法的半帶濾波器的FPGA實(shí)現(xiàn)進(jìn)行了EDA仿真,最后簡(jiǎn)要介紹了FIR的多相結(jié)構(gòu)。 第五章對(duì)數(shù)字下變頻器系統(tǒng)進(jìn)行了噪聲綜合分析,給出了一個(gè)噪聲模型。 第六章介紹了數(shù)字下變頻器在短波電臺(tái)中頻數(shù)字化應(yīng)用中的一個(gè)實(shí)例,給出了測(cè)試結(jié)果,重點(diǎn)介紹了下變頻器的:FPGA實(shí)現(xiàn),其對(duì)應(yīng)的VHDL程序收錄在本文最后的附錄中,希望對(duì)從事該領(lǐng)域設(shè)計(jì)的技術(shù)人員具有一定參考價(jià)值。

    標(biāo)簽: 軟件無(wú)線電 數(shù)字下變頻 技術(shù)研究

    上傳時(shí)間: 2013-06-09

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