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控制<b>芯片</b>

80C51特殊功能寄存器地址表

/*--------- 8051內(nèi)核特殊功能寄存器 -------------*/ sfr ACC = 0xE0; //累加器 sfr B = 0xF0; //B 寄存器 sfr PSW = 0xD0; //程序狀態(tài)字寄存器 sbit CY = PSW^7; //進位標志位 sbit AC = PSW^6; //輔助進位標志位 sbit F0 = PSW^5; //用戶標志位0 sbit RS1 = PSW^4; //工作寄存器組選擇控制位 sbit RS0 = PSW^3; //工作寄存器組選擇控制位 sbit OV = PSW^2; //溢出標志位 sbit F1 = PSW^1; //用戶標志位1 sbit P = PSW^0; //奇偶標志位 sfr SP = 0x81; //堆棧指針寄存器 sfr DPL = 0x82; //數(shù)據(jù)指針0低字節(jié) sfr DPH = 0x83; //數(shù)據(jù)指針0高字節(jié) /*------------ 系統(tǒng)管理特殊功能寄存器 -------------*/ sfr PCON = 0x87; //電源控制寄存器 sfr AUXR = 0x8E; //輔助寄存器 sfr AUXR1 = 0xA2; //輔助寄存器1 sfr WAKE_CLKO = 0x8F; //時鐘輸出和喚醒控制寄存器 sfr CLK_DIV = 0x97; //時鐘分頻控制寄存器 sfr BUS_SPEED = 0xA1; //總線速度控制寄存器 /*----------- 中斷控制特殊功能寄存器 --------------*/ sfr IE = 0xA8; //中斷允許寄存器 sbit EA = IE^7; //總中斷允許位 sbit ELVD = IE^6; //低電壓檢測中斷控制位 8051

標簽： 80C51 特殊功能寄存器地址

上傳時間： 2013-10-30

上傳用戶：yxgi5
基于PIC單片機的以太網(wǎng)數(shù)據(jù)采集與控制電路設計

本文介紹了由單片機控制的基于以太網(wǎng)的數(shù)據(jù)采集電路。該電路采用了美國Microchip公司的8位單片機PIC16F877和臺灣Realtek公司的10M以太網(wǎng)控制芯片RTL8019AS，實現(xiàn)了數(shù)據(jù)采集以及以太網(wǎng)數(shù)據(jù)傳輸?shù)墓δ堋Ｕ麄€電路主要包括網(wǎng)絡接口電路，單片機電路，A/D轉換電路，D/A轉換電路，RAM存儲電路，EEPROM存儲電路，DIO電路等。文中簡單闡述了以太網(wǎng)數(shù)據(jù)采集電路的設計原理,并給出了其實現(xiàn)的方法。隨著互聯(lián)網(wǎng)絡軟硬件的迅猛發(fā)展，網(wǎng)絡用戶快速增長。在計算機網(wǎng)絡互聯(lián)的同時，各種儀器儀表、家電設備以及工業(yè)生產(chǎn)中的數(shù)據(jù)采集與控制設備慢慢的走向網(wǎng)絡化，便于共享網(wǎng)絡中豐富的信息資源。另一方面，由于以太網(wǎng)技術越來越成熟，并且擁有高速、大容量、降低成本、簡化結構等特性，使得其在各種領域內(nèi)迅速發(fā)展。在電子設備日趨網(wǎng)絡化的背景下，通過單片機控制以太網(wǎng)芯片進行數(shù)據(jù)傳輸，是當前令人感興趣的一個研究方向。通過單片機控制芯片編程就可以完全拋開網(wǎng)絡操作系統(tǒng)而實現(xiàn)局域網(wǎng)內(nèi)任意終端之間或單片機與終端之間的通信，即在脫離PC環(huán)境下實現(xiàn)以太網(wǎng)芯片與其它微處理器之間的接口，從而建立基于非PC平臺的局域網(wǎng)絡。本系統(tǒng)設計了PIC單片機驅動臺灣Realtek公司生產(chǎn)的NE2000兼容以太網(wǎng)控制芯片RTL8019AS，從而構建了一個微型網(wǎng)絡數(shù)據(jù)采集系統(tǒng)，性能優(yōu)良，成本低廉。

標簽： PIC 單片機以太網(wǎng)數(shù)據(jù)采集控制

上傳時間： 2013-10-16

上傳用戶：CSUSheep
同地彈現(xiàn)象的分析和講解

地彈的形成：芯片內(nèi)部的地和芯片外的PCB地平面之間不可避免的會有一個小電感。這個小電感正是地彈產(chǎn)生的根源，同時，地彈又是與芯片的負載情況密切相關的。下面結合圖介紹一下地彈現(xiàn)象的形成。簡單的構造如上圖的一個小“場景”，芯片A為輸出芯片，芯片B為接收芯片，輸出端和輸入端很近。輸出芯片內(nèi)部的CMOS等輸入單元簡單的等效為一個單刀雙擲開關，RH和RL分別為高電平輸出阻抗和低電平輸出阻抗，均設為20歐。GNDA為芯片A內(nèi)部的地。GNDPCB為芯片外PCB地平面。由于芯片內(nèi)部的地要通過芯片內(nèi)的引線和管腳才能接到GNDPCB，所以就會引入一個小電感LG，假設這個值為1nH。CR為接收端管腳電容，這個值取6pF。這個信號的頻率取200MHz。雖然這個LG和CR都是很小的值，不過，通過后面的計算我們可以看到它們對信號的影響。先假設A芯片只有一個輸出腳，現(xiàn)在Q輸出高電平，接收端的CR上積累電荷。當Q輸出變?yōu)榈碗娖降臅r候。CR、RL、LG形成一個放電回路。自諧振周期約為490ps，頻率為2GHz，Q值約為0.0065。使用EWB建一個仿真電路。（很老的一個軟件，很多人已經(jīng)不懈于使用了。不過我個人比較依賴它，關鍵是建模，模型參數(shù)建立正確的話仿真結果還是很可靠的，這個小軟件幫我發(fā)現(xiàn)和解決過很多實際模擬電路中遇到的問題。這個軟件比較小，有比較長的歷史，也比較成熟，很容易上手。建議電子初入門的同學還是熟悉一下。）因為只關注下降沿，所以簡單的構建下面一個電路。起初輸出高電平，10納秒后輸出低電平。為方便起見，高電平輸出設為3.3V，低電平是0V。（實際200M以上芯片IO電壓會比較低，多采用1.5－2.5V。）

標簽： 分

上傳時間： 2013-10-17

上傳用戶：zhishenglu
高性能可編程DMA控制接口82C37A-5

高性能可編程DMA控制接口82C37A-54.1 概述對象實體：直接存儲器訪問（DMA）控制接口芯片82C37A-5芯片的特點：1、管腳引線與NMOS 8237A-5兼容。2、允許/禁止單獨DMA請求控制。3、頻率從0~5MHz區(qū)間全靜態(tài)設計。4、低電平操作。 5、4個各自獨立的DMA通道并獨立的進行初始化。6、存儲器到存儲器之間傳送。7、存儲器模塊初始化處理。8、地址的增量和減量。9、傳送速率可達1.6MB/s.10、可直接擴展成任意數(shù)量的通道。11 、終止傳送的過程即輸入結束。12、軟件請求。13、獨立信號DREQ和信號DACK的極性控制。4.2 82C37A-5的體系結構4.2.1 基本結構描述1. 82C37A-5內(nèi)部配備了規(guī)模為344位的內(nèi)部存儲器，它是以寄存器的形式出現(xiàn)的。2. 配有3個基本的控制模塊：（1）定時及控制模塊；（2）優(yōu)先級編碼及循環(huán)優(yōu)先級控制模塊；（3）命令控制模塊； 3. 12個不同類型的寄存器。圖 4-1 82C37A-5結構圖EOP# A0~A3RESETCS#. IOW# DREQ0~DREQ3HLDAHRQ DB0~DB7DACK0~DACK3

標簽： DMA 82 37 性能

上傳時間： 2013-10-21

上傳用戶：ming52900
采用高速串行收發(fā)器Rocket I/O實現(xiàn)數(shù)據(jù)率為2.5 G

摘要: 串行傳輸技術具有更高的傳輸速率和更低的設計成本, 已成為業(yè)界首選, 被廣泛應用于高速通信領域。提出了一種新的高速串行傳輸接口的設計方案, 改進了Aurora 協(xié)議數(shù)據(jù)幀格式定義的弊端, 并采用高速串行收發(fā)器Rocket I/O, 實現(xiàn)數(shù)據(jù)率為2.5 Gbps的高速串行傳輸。關鍵詞: 高速串行傳輸; Rocket I/O; Aurora 協(xié)議為促使FPGA 芯片與串行傳輸技術更好地結合以滿足市場需求, Xilinx 公司適時推出了內(nèi)嵌高速串行收發(fā)器RocketI/O 的Virtex II Pro 系列FPGA 和可升級的小型鏈路層協(xié)議———Aurora 協(xié)議。Rocket I/O支持從622 Mbps 至3.125 Gbps的全雙工傳輸速率, 還具有8 B/10 B 編解碼、時鐘生成及恢復等功能, 可以理想地適用于芯片之間或背板的高速串行數(shù)據(jù)傳輸。Aurora 協(xié)議是為專有上層協(xié)議或行業(yè)標準的上層協(xié)議提供透明接口的第一款串行互連協(xié)議, 可用于高速線性通路之間的點到點串行數(shù)據(jù)傳輸, 同時其可擴展的帶寬, 為系統(tǒng)設計人員提供了所需要的靈活性[4]。但該協(xié)議幀格式的定義存在弊端,會導致系統(tǒng)資源的浪費。本文提出的設計方案可以改進Aurora 協(xié)議的固有缺陷,提高系統(tǒng)性能, 實現(xiàn)數(shù)據(jù)率為2.5 Gbps 的高速串行傳輸, 具有良好的可行性和廣闊的應用前景。

標簽： Rocket 2.5 高速串行收發(fā)器

上傳時間： 2013-11-06

上傳用戶：smallfish
B-基于自由擺的平板控制系統(tǒng)（B題）

注意啦！

標簽： 自由擺平板控制系統(tǒng)

上傳時間： 2013-10-28

上傳用戶：qiaoyue
采用高速串行收發(fā)器Rocket I/O實現(xiàn)數(shù)據(jù)率為2.5 G

摘要: 串行傳輸技術具有更高的傳輸速率和更低的設計成本, 已成為業(yè)界首選, 被廣泛應用于高速通信領域。提出了一種新的高速串行傳輸接口的設計方案, 改進了Aurora 協(xié)議數(shù)據(jù)幀格式定義的弊端, 并采用高速串行收發(fā)器Rocket I/O, 實現(xiàn)數(shù)據(jù)率為2.5 Gbps的高速串行傳輸。關鍵詞: 高速串行傳輸; Rocket I/O; Aurora 協(xié)議為促使FPGA 芯片與串行傳輸技術更好地結合以滿足市場需求, Xilinx 公司適時推出了內(nèi)嵌高速串行收發(fā)器RocketI/O 的Virtex II Pro 系列FPGA 和可升級的小型鏈路層協(xié)議———Aurora 協(xié)議。Rocket I/O支持從622 Mbps 至3.125 Gbps的全雙工傳輸速率, 還具有8 B/10 B 編解碼、時鐘生成及恢復等功能, 可以理想地適用于芯片之間或背板的高速串行數(shù)據(jù)傳輸。Aurora 協(xié)議是為專有上層協(xié)議或行業(yè)標準的上層協(xié)議提供透明接口的第一款串行互連協(xié)議, 可用于高速線性通路之間的點到點串行數(shù)據(jù)傳輸, 同時其可擴展的帶寬, 為系統(tǒng)設計人員提供了所需要的靈活性[4]。但該協(xié)議幀格式的定義存在弊端,會導致系統(tǒng)資源的浪費。本文提出的設計方案可以改進Aurora 協(xié)議的固有缺陷,提高系統(tǒng)性能, 實現(xiàn)數(shù)據(jù)率為2.5 Gbps 的高速串行傳輸, 具有良好的可行性和廣闊的應用前景。

標簽： Rocket 2.5 高速串行收發(fā)器

上傳時間： 2013-10-13

上傳用戶：lml1234lml
ti公司的多串口芯片的初始化程序

ti公司的多串口芯片的初始化程序，控制該芯片的單片機使用的是富士通的mb90f549

標簽： 多串口初始化程序芯片

上傳時間： 2014-01-11

上傳用戶：冇尾飛鉈
SH401.C 單片機驅動直流電機的例程 SH402.C 單片機數(shù)模輸出控制LED亮度的例程 SH403.C 單片機PWM輸出控制電機的轉角 404 介紹光耦的作用 SH405.C 單片機驅動

SH401.C 單片機驅動直流電機的例程 SH402.C 單片機數(shù)模輸出控制LED亮度的例程 SH403.C 單片機PWM輸出控制電機的轉角 404 介紹光耦的作用 SH405.C 單片機驅動壓電應變片的例程 SH406.C 單片機控制語音芯片的例程 SH407.C 單片機控制充電芯片的例程 SH408.C 單片機控制時鐘芯片的例程

標簽： SH 401 402 LED

上傳時間： 2013-11-25

上傳用戶：dave520l
tvp5150視頻編解碼芯片驅動程序

tvp5150視頻編解碼芯片驅動程序，cpu通過i2c控制該芯片，將驅動程序放入driver/i2c/chips目錄下，并且在makefile文件中加入該驅動編譯即可。

標簽： 5150 tvp 視頻編解碼芯片驅動

上傳時間： 2014-01-08

上傳用戶：windwolf2000