ALTERA PWM電路 這是一個ALTERA的PWM電路，可以整合到NIOSII IDE中，來完成一個PWM的系統(tǒng)。
標(biāo)簽： ALTERA PWM
上傳時間： 2013-12-08
上傳用戶：zxc23456789
用遞推法產(chǎn)生正交多項式系，即求alpha[j+1]、beta[j] 入口參數(shù)：m是數(shù)據(jù)點數(shù)，n是擬合的最高階數(shù)， float x[],float y[]是對應(yīng)縱橫坐標(biāo)，出口參數(shù)：a[] 是最小二乘擬合參數(shù)，alpha[]、beta[]是遞推系數(shù)
標(biāo)簽： 正 多項式
上傳時間： 2014-01-19
上傳用戶：gyq
使用FPGA設(shè)計WiMax接收機之OFDM同步硬體電路(內(nèi)附VHDL code)
標(biāo)簽： WiMax FPGA OFDM VHDL
上傳時間： 2016-01-22
上傳用戶：zhuyibin
B樹及其B+樹的實現(xiàn)代碼，支持模版（數(shù)據(jù)類型，M值）
標(biāo)簽： 樹 代碼
上傳時間： 2016-02-22
上傳用戶：jhksyghr
ADS操作影片,教我們怎麼tuning電路.中文發(fā)音,步驟清楚,非常適合初學(xué)入門者.希望對大家有幫助.
標(biāo)簽： tuning ADS 操作 家
上傳時間： 2016-02-25
上傳用戶：trepb001
推箱子游戲 為研究A*尋路算法的實現(xiàn)，編寫了一個老游戲，希望對新手有所幫助。
標(biāo)簽： 算法
上傳時間： 2014-12-06
上傳用戶：從此走出陰霾
一個可以計算分壓電路的源碼。 可透過輸出與輸入電壓，計算電阻的大小；或透過輸入電壓與電阻，計算最後輸出之電壓
標(biāo)簽： 分
上傳時間： 2014-12-09
上傳用戶：hoperingcong
是一個用verilog寫成的加法器電路,可把七個元件加起來
標(biāo)簽： verilog 加法器 元件
上傳時間： 2014-01-07
上傳用戶：zhangzhenyu
使用硬體描述語言HDL 設(shè)計硬體電路，臺灣人寫的PPT講義，非常不錯。VHDL硬件設(shè)計入門學(xué)習(xí)。VHDL基本語法架構(gòu)，VHDL的零件庫(Library)及包裝(Package)等內(nèi)容。
標(biāo)簽： HDL
上傳時間： 2014-01-22
上傳用戶：cxl274287265
5 bits 的加法器與減法器合併電路之原始程式製作
標(biāo)簽： bits 加法器 法器 程式
上傳時間： 2016-05-18
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