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收發原理

手機基本原理: ETACS、GSM蜂窩手機是一個工作在雙工狀態下的收發信機。一部移動電話包括無線接收機(Receiver)、發射機(Transmitter)、控制模塊(Controller)及人機界面

手機基本原理: ETACS、GSM蜂窩手機是一個工作在雙工狀態下的收發信機。一部移動電話包括無線接收機(Receiver)、發射機(Transmitter)、控制模塊(Controller)及人機界面部分(Interface)和電源(Power Supply)。

標簽： Transmitter Controller Receiver ETACS

上傳時間： 2014-01-04

上傳用戶：wang5829
可以自行開發ATMEL系列燒錄器,內容原理圖線路圖以及gerberfile提供自己做過可行

可以自行開發ATMEL系列燒錄器,內容原理圖線路圖以及gerberfile提供自己做過可行

標簽： gerberfile ATMEL

上傳時間： 2017-01-17

上傳用戶：小碼農lz
SP200S_SCH_V126.pdf為編程器的原理圖。里面含收PL2303HX芯片的電路圖

SP200S_SCH_V126.pdf為編程器的原理圖。里面含收PL2303HX芯片的電路圖，此圖支持51和AVR的編程

標簽： S_SCH_V 2303 200 126

上傳時間： 2017-05-27

上傳用戶：lifangyuan12
應用于 POS 機、收銀機等80mm 高速微型打印機（原理圖、上位機、程序源碼）

應用于 POS 機、收銀機等80mm 高速微型打印機（原理圖、上位機、程序源碼）

標簽： 微型打印機

上傳時間： 2022-06-22

上傳用戶：shjgzh
基于FPGA的數字中頻收發信機的設計與實現.rar

軟件無線電（Software　Defined Radio）是無線通信系統收發信機的發展方向，它使得通信系統的設計者可以將主要精力集中到收發機的數字處理上，而不必過多關注電路實現。在進行數字處理時，常用的方案包括現場可編程門陣列（FPGA）、數字信號處理器（DSP）和專用集成電路（ASIC）。FPGA以其相對較低的功耗和相對較低廉的成本，成為許多通信系統的首先方案。正是在這樣的前提下，本課題結合軟件無線電技術，研究并實現基于FPGA的數字收發信機。 @@ 本論文主要研究了發射機和接收機的結構和相關的硬件實現問題。首先，從理論上對發射機和接收機結構進行研究，找到收發信機設計中關鍵問題。其次，在理論上有深刻認識的基礎上，以FPGA為手段，將反饋控制算法、反饋補償算法和前饋補償算法落實到硬件電路上。同步一直是數字通信系統中的關鍵問題，它也是本文的研究重點。本文在研究了已有各種同步方法的基礎上，設計了一種新的同步方法和相應的接收機結構，并以硬件電路將其實現。最后，針對所設計的硬件系統，本文還進行了充分的硬件系統測試。硬件測試的各項數據結果表明系統設計方案是可行的，基本實現了數字中頻收發機系統的設計要求。 @@ 本文中發射機系統是以Altera公司EP2C70F672C6為硬件平臺，接收機系統以Altera公司EP2S180F1020C3為硬件平臺。收發系統均是在Ouartus Ⅱ 8．0環境下，通過編寫Verilog HDL代碼和調用Altera IP core加以實現。在將設計方案落實到硬件電路實現之前，各種算法均使用MATLAB進行原理仿真，并在MATLAB仿真得到正確結果的基礎上，使用Quartus Ⅱ 8．0中的功能仿真工具和時序仿真工具進行了前仿真和后仿真。所有仿真結果無誤后，可下載至硬件平臺進行調試，通過Quartus Ⅱ 8．0中集成的SignalTap邏輯分析儀，可以實時觀察電路中各點信號的變化情況，并結合示波器和頻譜儀，得到硬件測試結果。 @@關鍵詞：SDR；數字收發機；FPGA；載波同步；符號同步

標簽： FPGA 數字中頻收發信機

上傳時間： 2013-04-24

上傳用戶：diaorunze
基于FPGA全數字OFDM收發信機

正交頻分復用(OFDM，Orthogonal Frequency Division Multiplexing)技術作為一種可以有效對抗信號波形間干擾的高速傳輸技術，引起了廣泛關注。它利用許多并行的、傳輸低速率數據的子載波來實現高速率的通信。它的特點是各子載波相互正交，所以擴頻調制后的頻譜可以相互重疊，不但減小了子載波問的相互干擾，還大大提高了頻譜利用率。由于OFDM的高頻譜利用率、易于硬件實現、對抗頻率選擇性衰落和窄帶干擾的能力突出等優點，它成為第四代移動通信的首選技術，是當前移動通信技術研究的熱點問題。本文概括的介紹了OFDM系統的基本概念、基本工作原理和關鍵技術，重點討論了如何在FPGA上實現OFDM低中頻收發信機。基于這些理論知識，確定了OFDM低中頻收發信機系統實現方案，并選擇ALTERA公司的Cyclone

標簽： FPGA OFDM 全數字收發信機

上傳時間： 2013-06-29

上傳用戶：水瓶kmoon5
Debussy是NOVAS Software, Inc(思源科技)發展的HDL Debug & Analysis tool

Debussy是NOVAS Software, Inc(思源科技)發展的HDL Debug & Analysis tool，這套軟體主要不是用來跑模擬或看波形，它最強大的功能是：能夠在HDL source code、schematic diagram、waveform、state bubble diagram之間，即時做trace，協助工程師debug。可能您會覺的：只要有simulator如ModelSim就可以做debug了，我何必再學這套軟體呢? 其實Debussy v5.0以後的新版本，還提供了nLint -- check coding style & synthesizable，這蠻有用的，可以協助工程師了解如何寫好coding style，並養成習慣。下圖所示為整個Debussy的原理架構，可歸納幾個結論：

標簽： Analysis Software Debussy Debug

上傳時間： 2014-01-14

上傳用戶：hustfanenze
使用C#程式語言開發

使用C#程式語言開發，並執行於.NET Framework下；是研習「蟻拓尋優法」不可或缺的軟體工具。系統使用ACO (Ant Colony Optimization)演算公式模擬螞蟻的覓食行徑抉擇。使用者可以設定費洛蒙和食物氣味強度等相關參數以及動態設定障礙物的位置和形狀，研習螞蟻覓食的最短路徑形成過程。研習各種參數設定對螞蟻覓食行為的影響，了解費落蒙機制對蟻拓尋優化法的影響。本系統可支援柔性計算教學，研習蟻拓優化法中人工螞蟻的隨機搜尋模式和啟發式法則設計原理。

標簽： 程式

上傳時間： 2013-12-24

上傳用戶：anng
針對開發嵌入式系統硬體有詳細描述

針對開發嵌入式系統硬體有詳細描述，使期能了結遷入式系統硬體原理

標簽： 嵌入式系統

上傳時間： 2014-01-11

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出租車計費系統的設計 2.1 出租車計費器工作原理實際中出租車的計費工作原理一般分成3個階段：（1）車起步開始計費。首先顯示起步價（本次設計起步費為7.00元）,車在

出租車計費系統的設計 2.1 出租車計費器工作原理實際中出租車的計費工作原理一般分成3個階段：（1）車起步開始計費。首先顯示起步價（本次設計起步費為7.00元）,車在行駛3 km以內，只收起步價7.00元。（2）車行駛超過3 km后,按每公里2.2元計費（在7.00元基礎上每行駛1 km車費加2.2元）,車費依次累加。（3）行駛路程達到或超過9 km后(車費達到20元)，每公里加收50 的車費,車費變成按每公里3.3元開始計費。車暫時停止（行駛中遇紅燈或中途暫時停車）不計費，

標簽： 7.00 2.1 工作原理計費

上傳時間： 2017-05-28

上傳用戶：ynwbosss