是一個用verilog寫成的加法器電路,可把七個元件加起來
標簽： verilog 加法器 元件
上傳時間： 2014-01-07
上傳用戶：zhangzhenyu
使用硬體描述語言HDL 設計硬體電路，臺灣人寫的PPT講義，非常不錯。VHDL硬件設計入門學習。VHDL基本語法架構，VHDL的零件庫(Library)及包裝(Package)等內容。
標簽： HDL
上傳時間： 2014-01-22
上傳用戶：cxl274287265
5 bits 的加法器與減法器合併電路之原始程式製作
標簽： bits 加法器 法器 程式
上傳時間： 2016-05-18
上傳用戶：ippler8
用VC編的數碼相機仿真程序 包括圖像的預處理 DCT變換 壓縮等 最后可用verify.exe做比較
標簽： verify DCT exe 仿真程序
上傳時間： 2014-01-16
上傳用戶：Pzj
verilog除頻器可用於編碼段運用可以穩定電路設計
標簽： verilog
上傳時間： 2013-12-26
上傳用戶：372825274
內含fulladder結構檔,電路檔,測試檔(testbench)以及執行檔(.do)
標簽： fulladder testbench do
上傳時間： 2016-11-25
上傳用戶：wxhwjf
應用程式可將et44主機讀 取的圖檔存入展示板的Flash記憶體上, 也可讀 取Flash內的圖檔顯示在主機LCD上.
標簽： 63834 Flash LCD et
上傳時間： 2016-12-02
上傳用戶：皇族傳媒
S3C44B0-ARM應用板(電路+PCB+程序).rar
標簽： ARM PCB 44
上傳時間： 2013-12-27
上傳用戶：cuiyashuo
可以自行開發ATMEL系列燒錄器,內容原理圖線路圖以及gerberfile提供自己做過可行
標簽： gerberfile ATMEL
上傳時間： 2017-01-17
上傳用戶：小碼農lz
SONET 教學V1.0_方便使用者在學習射頻電路模擬上遇到的問題解決方式
標簽： SONET 1.0 模 方式
上傳用戶：hasan2015
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