本書結(jié)合 目前高壓電器的運行、操作、維護、檢修中存在的問題, 系統(tǒng)地介 紹了電流互感器、電流互感器的故障診斷與處理, 電壓互感器、電壓互感器的故 障診斷與處理、互感器的檢測與試驗、現(xiàn)代互感器、少油斷路器、真空斷路器、真 空斷路器的故障診斷與處理、真空斷路器操作過電壓、SF6 斷路器、SF6 斷路器的 故障診斷與處理、斷路器操作機構(gòu)等 內(nèi)容, 以問答形式深入淺出地闡述了高壓 電器運行、維護、檢修中經(jīng)常涉及的電工理論知識和實際操作技能。
上傳時間: 2013-05-28
上傳用戶:RedLeaves1995
基于微處理器的數(shù)字PID控制器改變了傳統(tǒng)模擬PID控制器參數(shù)整定不靈活的問題。但是常規(guī)微處理器容易在環(huán)境惡劣的情況下出現(xiàn)程序跑飛的問題,如果實現(xiàn)PID軟算法的微處理器因為強干擾或其他原因而出現(xiàn)故障,會引起輸出值的大幅度變化或停止響應。而FPGA的應用可以從本質(zhì)上解決這個問題。因此,利用FPGA開發(fā)技術,實現(xiàn)智能控制器算法的芯片化,使之能夠廣泛的用于各種場合,具有很大的應用意義。 首先分析FPGA的內(nèi)部結(jié)構(gòu)特點,總結(jié)FPGA設計技術及開發(fā)流程,指出實現(xiàn)結(jié)構(gòu)優(yōu)化設計,降低設計難度,是擴展設計功能、提高芯片性能和產(chǎn)品性價比的關鍵。控制系統(tǒng)由四個模塊組成,主要包括核心控制器模塊、輸入輸出模塊以及人機接口。其中控制器部分為系統(tǒng)的關鍵部件。在分析FPGA設計結(jié)構(gòu)類型和特點的基礎上,提出一種基于FPGA改進型并行結(jié)構(gòu)的PID溫度控制器設計方法。在PID算法與FPGA的運算器邏輯映像過程中,采用將補碼的加法器代替減法器設計,增加整數(shù)運算結(jié)果的位擴展處理,進行不同數(shù)據(jù)類型的整數(shù)歸一化等不同角度的處理方法融合為一體,可以有效地減少邏輯運算部件。應用Ouartus Ⅱ圖形輸入與Verilog HDL語言相結(jié)合設計實現(xiàn)了PID控制器,用Modelsim仿真驗證了設計結(jié)果的正確性,用Synplify Pro進行電路綜合,在Quaitus Ⅱ軟件中實現(xiàn)布局布線,最后生成FPGA的編程文件。根據(jù)控制系統(tǒng)的要求,論文設計完成了12位模數(shù)AD轉(zhuǎn)換器、數(shù)據(jù)顯示器、按鍵等相關外圍接口電路。 將一階、純滯后、大慣性電阻爐溫作為控制對象,以EP1C3T144 FPGA為核心,構(gòu)建PID控制系統(tǒng)。在采用Pt100溫度傳感器、分辨率為2℃、最大溫度控制范圍0~400℃的條件下,實驗結(jié)果表明,達到無超調(diào)的穩(wěn)定控制要求,為降低FPGA實現(xiàn)PID控制器的設計難度提供了有效的方法。
上傳時間: 2013-05-24
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該論文基于NIOS Ⅱ軟核處理器和Altera的FPGA技術,設計了一種便攜式的振動頻譜分析儀,用于旋轉(zhuǎn)機械的故障監(jiān)測和診斷。以SOPC技術為手段,將信號采集和信號處理電路通過可編程片上系統(tǒng)來實現(xiàn),其特點是將對ADC的控制、數(shù)字信號的濾波、快速傅立葉變換的設計,通過FPGA芯片集成在一起,以NIOS Ⅱ來完成32位CPU的狀態(tài)控制功能。工程機械、汽車車輛中都存在諸如發(fā)動機類的旋轉(zhuǎn)機械,這類設備的異常振動往往會影響正常工作,嚴重時還會出現(xiàn)各種重大事故,該分析儀可以實時地或定期地對發(fā)動機、齒輪箱等旋轉(zhuǎn)機械進行振動頻譜分析和監(jiān)測,運用于民用機械能產(chǎn)生非常好的經(jīng)濟效益。 該論文從四個方面進行了研究工作。其一,利用FPGA對ADC芯片的工作進行控制,使其在規(guī)定的時間內(nèi)與DSP模塊進行數(shù)據(jù)交換,并對ADC各引腳時序進行控制,使兩者協(xié)調(diào)同步工作,編制了相應的VHDL語言程序。其二,采用SOPC Builder設計開發(fā),實現(xiàn)了基于NIOS Ⅱ的32位CPU軟核,創(chuàng)建了相應的C/C++和匯編的宏代碼,使得軟件可以訪問用戶自定義邏輯。對頂層設計產(chǎn)生的VHDL的RTL代碼和仿真文件進行了綜合、編譯適配以及仿真。其三,配合Matlab和DSP Builder的強大功能進行DSP模塊設計,開發(fā)出了FIR和FFT等功能模塊,并且添加到SOPC系統(tǒng)中,使其可以由NIOS Ⅱ很容易的調(diào)用。其四,在NIOS Ⅱ系統(tǒng)中添加了uC/OS Ⅱ操作系統(tǒng),提高了整個系統(tǒng)的穩(wěn)定性,并且降低了開發(fā)難度,提高了系統(tǒng)升級的能力。由于整個設計是基于FPGA開發(fā)的,所以該系統(tǒng)包括了所有FPGA系統(tǒng)的特點,包括并行的DSP處理、在系統(tǒng)可編程、升級簡單等特點,極易使設計產(chǎn)品化。
上傳時間: 2013-04-24
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ChipScope Pro具有傳統(tǒng)邏輯分析儀的功能,是針對Xilinx Virtex Pro等系列FPGA的在線片內(nèi)信號分析工具,主要功能是通過JTAG口,實時、在線、方便地觀察到FPGA內(nèi)部的信號,給調(diào)試、故障定位提供極大的方便。ChipScope Pro的基本原理是利用FPGA中未使用的BlockRam,根據(jù)用戶設定的觸發(fā)條件將信號實時的保存到這些BlockRam中,然后通過JTAG口傳送到計算機,最后在計算機屏幕上顯示出時序波形。
上傳時間: 2013-05-22
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筆者在火災自動報警系統(tǒng)的聯(lián)網(wǎng)設計中,經(jīng)大量試驗,發(fā)現(xiàn)在使用RS-485總線時,如果簡單地按常規(guī)方式設計電路,那么在實際工程中可能存在以下兩個問題:一是通信數(shù)據(jù)收發(fā)不可靠;二是在多機通信方式下,一個節(jié)點的故障(如死機)往往會使得整個系統(tǒng)的通信框架崩潰,而且給故障的排查帶來困難。針對上述問題,對485總線接口的軟硬件設計采取了有效的改進措施,大大提高了聯(lián)網(wǎng)系統(tǒng)的可靠性和穩(wěn)定性。
上傳時間: 2013-05-28
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FPGA(Field Programmable Gate Arrays)是目前廣泛使用的一種可編程器件,F(xiàn)PGA的出現(xiàn)使得ASIC(Application Specific Integrated Circuits)產(chǎn)品的上市周期大大縮短,并且節(jié)省了大量的開發(fā)成本。目前FPGA的功能越來越強大,滿足了目前集成電路發(fā)展的新需求,但是其結(jié)構(gòu)同益復雜,規(guī)模也越來越大,內(nèi)部資源的種類也R益豐富,但同時也給測試帶來了困難,F(xiàn)PGA的發(fā)展對測試的要求越來越高,對FPGA測試的研究也就顯得異常重要。 本文的主要工作是提出一種開關盒布線資源的可測性設計,通過在FPGA內(nèi)部加入一條移位寄存器鏈對開關盒進行配置編程,使得開關盒布線資源測試時間和測試成本減少了99%以上,而且所增加的芯片面積僅僅在5%左右,增加的邏輯資源對FPGA芯片的使用不會造成任何影響,這種方案采用了小規(guī)模電路進行了驗證,取得了很好的結(jié)果,是一種可行的測試方案。 本文的另一工作是采用一種FPGA邏輯資源的測試算法對自主研發(fā)的FPGA芯片F(xiàn)DP250K的邏輯資源進行了嚴格、充分的測試,從FPGA最小的邏輯單元LC開始,首先得到一個LC的測試配置,再結(jié)合SLICE內(nèi)部兩個LC的連接關系得到一個SLICE邏輯單元的4種測試配置,并且采用陣列化的測試方案,同時測試芯片內(nèi)部所有的邏輯單元,使得FPGA內(nèi)部的邏輯資源得完全充分的測試,測試的故障覆蓋率可達100%,測試配置由配套編程工具產(chǎn)生,測試取得了完滿的結(jié)果。
上傳時間: 2013-06-29
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隨著數(shù)字技術、大規(guī)模集成電路及計算機的大量普及和快速發(fā)展,邏輯分析儀(Logic Analyzer,簡稱LA)作為數(shù)字系統(tǒng)的數(shù)據(jù)域測試儀器中應用最為廣泛、最有代表性的一種通用測試儀器,為解決越來越復雜的數(shù)字系統(tǒng)的檢測和故障診...
上傳時間: 2013-05-17
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電視技術習題集(問答題)一、 單項選擇題 1.彩色電視機出現(xiàn)無光柵、無圖像、無伴音故障現(xiàn)象的可能部位是( )。
上傳時間: 2013-07-29
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本文提出了一種由單片微機控制的火災自動探測報警控制器.將煙感、溫度探測器接入單片微機,經(jīng)單片微機邏輯判斷,經(jīng)專用聲光報警集成電路來進行火災報警、異常報警(煙感、溫感其中之一動作)、故障報警,并發(fā)出不同的聲光信號、顯示出事故類型及位置.本控制器適用于總建筑面積不超過1000m2的各種地方,如圖書館、檔案館、計算機房等處.
上傳時間: 2013-05-26
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·作者:[美]Michael D.Ciletti出版社:電子工業(yè)出版社 內(nèi)容簡介:本書通過大量完整的實例講解了使用VerilogHDL進行超大規(guī)模集成電路設計的結(jié)構(gòu)化建模方法、關鍵步驟和設計驗證方法等實用內(nèi)容。全書共分11章,涵蓋了建模、結(jié)構(gòu)平衡、功能驗證、故障模擬和邏輯合成等關鍵問題,還有合成后設計確認、定時分析及可測性設計等內(nèi)容。
標簽: Verilog nbsp HDL 數(shù)字設計
上傳時間: 2013-06-19
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