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效率分析

  • 集成運(yùn)放線性應(yīng)用電路分析方法的研究.rar

    集成運(yùn)放線性應(yīng)用電路分析方法的研究 集成運(yùn)放線性應(yīng)用電路分析方法的研究

    標(biāo)簽: 集成運(yùn)放 線性應(yīng)用 電路分析

    上傳時(shí)間: 2013-06-06

    上傳用戶:gxf2016

  • 常用運(yùn)放電路范例及分析.rar

    一些常用的運(yùn)放電路及分析。國家半導(dǎo)體公司的應(yīng)用筆記。

    標(biāo)簽: 運(yùn)放電路 范例

    上傳時(shí)間: 2013-05-28

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  • PT4107提高大功率LED驅(qū)動(dòng)電路的效率

    大功率照明驅(qū)動(dòng)電路 PT4107 在系統(tǒng)設(shè)計(jì)中,最具挑戰(zhàn)性的工作是如何提高整機(jī)效率。在圖 1典􀩟應(yīng)用電路中電路中除了芯片的固定消耗外,主要有 5 個(gè)元件會(huì)影響效率,它們是整流二極管、

    標(biāo)簽: 4107 LED PT 大功率

    上傳時(shí)間: 2013-06-19

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  • OrCAD/PSpice9偏壓點(diǎn)和直流掃描分析(歐姆定律)

    OrCAD/PSpice9偏壓點(diǎn)和直流掃描分析(歐姆定律)一、學(xué)習(xí)目的:1、使用電路繪制程序Capture繪制所須要的電路圖2、學(xué)習(xí)偏壓點(diǎn)分析

    標(biāo)簽: PSpice OrCAD 偏壓 直流掃描分析

    上傳時(shí)間: 2013-04-24

    上傳用戶:xfbs821

  • 應(yīng)用EDA 技術(shù)仿真電子線路分析

    應(yīng)用EDA 技術(shù)仿真電子線路分析 摘 要 介紹了電子電路仿真軟件Elect ronicsWo rkbench 在EDA 中的應(yīng)用, 給出了仿真實(shí)

    標(biāo)簽: EDA 仿真 電子線路

    上傳時(shí)間: 2013-07-27

    上傳用戶:變形金剛

  • 基于運(yùn)動(dòng)補(bǔ)償?shù)娜ジ粜邢到y(tǒng)的研究與FPGA設(shè)計(jì)

    本文采用基于運(yùn)動(dòng)補(bǔ)償?shù)乃惴?對去隔行系統(tǒng)及其FPGA設(shè)計(jì)作了深入的研究.該系統(tǒng)包括三個(gè)關(guān)鍵模塊運(yùn)動(dòng)估計(jì)模塊是去隔行系統(tǒng)的設(shè)計(jì)重點(diǎn),設(shè)計(jì)為雙向運(yùn)動(dòng)估計(jì),采用菱形快速搜索算法,主要分為計(jì)算和控制兩大部分.計(jì)算部分為SAD計(jì)算模塊,采用累加樹和流水線技術(shù);控制部分根據(jù)菱形搜索算法的第三步搜索的特點(diǎn),對比較模塊、SAD暫存器等模塊做了具體的設(shè)計(jì).對于運(yùn)動(dòng)補(bǔ)償模塊采用雙向補(bǔ)償?shù)乃惴?補(bǔ)償精度為半像素.根據(jù)半像素點(diǎn)的位置將運(yùn)動(dòng)補(bǔ)償計(jì)算分為四個(gè)狀態(tài),并通過對四個(gè)狀態(tài)計(jì)算特點(diǎn)的分析設(shè)計(jì)了加法器的結(jié)構(gòu)復(fù)用.同時(shí)基于視頻數(shù)據(jù)處理的需要,設(shè)計(jì)了四個(gè)具有雙體存儲(chǔ)結(jié)構(gòu)的內(nèi)部緩存器,由FPGA內(nèi)部的嵌入式陣列塊實(shí)現(xiàn).根據(jù)運(yùn)動(dòng)估計(jì)模塊和運(yùn)動(dòng)補(bǔ)償模塊的計(jì)算特點(diǎn),分別對緩存器的結(jié)構(gòu)、讀寫時(shí)序和列序號控制進(jìn)行設(shè)計(jì),有效提高了數(shù)據(jù)的存取效率.本文對于這三個(gè)去隔行系統(tǒng)的關(guān)鍵模塊都給出了RTL級設(shè)計(jì)和模塊的功能仿真,并在最后一章中給出了去隔行系統(tǒng)的FPGA設(shè)計(jì).

    標(biāo)簽: FPGA 補(bǔ)償 去隔行

    上傳時(shí)間: 2013-06-11

    上傳用戶:han_zh

  • G.729語音編碼算法及其關(guān)鍵部分FPGA設(shè)計(jì)的研究

    本文對G.729語音編碼算法的基本原理和實(shí)現(xiàn)系統(tǒng)開發(fā)方面進(jìn)行了深入研究。針對G.729語音編碼算法在實(shí)際應(yīng)用中存在的一些問題,在大量分析和實(shí)驗(yàn)的基礎(chǔ)上,提出了新的改進(jìn)算法。G.729語音編碼算法硬件實(shí)現(xiàn)方面,國內(nèi)外現(xiàn)在主要以DSP為實(shí)現(xiàn)平臺(tái),這是由于DSP以其卓越的運(yùn)算能力為數(shù)字語音信號處理領(lǐng)域的研究及開發(fā)提供了有力的工具。但G.729語音編碼算法具有計(jì)算復(fù)雜和數(shù)據(jù)存儲(chǔ)量大的固有缺陷,隨著通信量的不斷增加和服務(wù)的擴(kuò)展,對G.729語音編碼實(shí)時(shí)性的要求也越來越高。隨著微電子制造工藝的發(fā)展,越來越多的語音編碼平臺(tái)采用DSP與FPGA或MCU相互結(jié)合的系統(tǒng),通過進(jìn)行軟硬件協(xié)同設(shè)計(jì)提高編碼效率。

    標(biāo)簽: FPGA 729 語音編碼 算法

    上傳時(shí)間: 2013-06-30

    上傳用戶:ccclll

  • MPEG-4解碼關(guān)鍵技術(shù)研究及FPGA實(shí)現(xiàn)

      本論文將在對MPEG-4解碼中的幾種關(guān)鍵技術(shù)的充分理解和算法分析的基礎(chǔ)之上,結(jié)合FPGA的靈活性,采用VHDL語言對幾種關(guān)鍵技術(shù)在應(yīng)用層面上進(jìn)行結(jié)構(gòu)設(shè)計(jì)并仿真驗(yàn)證。 本文討論了一種高吞吐量流水方式構(gòu)建的MPEG-4可變長解碼器的設(shè)計(jì)。在這種解碼器中,我們采用了基于PLA的并行  解碼算法,這種算法能夠?qū)崿F(xiàn)每個(gè)時(shí)鐘解碼一個(gè)碼字。同時(shí),為了提高解碼的效率,降低操作的延遲,我們在設(shè)計(jì)中還引入了流水線操作方式、碼表分割等技術(shù),這些技術(shù)有利于并行操作的實(shí)現(xiàn)。 本論文的設(shè)計(jì)充分利用IDCT算法對稱性,用高度的并行結(jié)構(gòu)來加速處理,采用一維IDCT單元復(fù)用的方式來實(shí)現(xiàn)二維IDCT運(yùn)算,并提出一種基于加法操作的結(jié)構(gòu)來取代乘法操作,實(shí)現(xiàn)了一種高效二維逆DCT變換處理器。  

    標(biāo)簽: MPEG FPGA 解碼 關(guān)鍵技術(shù)

    上傳時(shí)間: 2013-06-02

    上傳用戶:MATAIYES

  • 圖象壓縮系統(tǒng)中熵編解碼器的FPGA設(shè)計(jì)及實(shí)現(xiàn)

    隨著移動(dòng)終端、多媒體、Internet網(wǎng)絡(luò)、通信,圖像掃描技術(shù)的發(fā)展,以及人們對圖象分辨率,質(zhì)量要求的不斷提高,用軟件壓縮難以達(dá)到實(shí)時(shí)性要求,而且會(huì)帶來因傳輸大量原始圖象數(shù)據(jù)帶來的帶寬要求,因此采用硬件實(shí)現(xiàn)圖象壓縮已成為一種必然趨勢。而熵編碼單元作為圖像變換,量化后的處理環(huán)節(jié),是圖像壓縮中必不可少的部分。研究熵編解碼器的硬件實(shí)現(xiàn),具有廣闊的應(yīng)用背景。本文以星載視頻圖像壓縮的硬件實(shí)現(xiàn)項(xiàng)目為背景,對熵編碼器和解碼器的硬件實(shí)現(xiàn)進(jìn)行探討,給出了并行熵編碼和解碼器的實(shí)現(xiàn)方案。熵編解碼器中的難點(diǎn)是huffman編解碼器的實(shí)現(xiàn)。在設(shè)計(jì)并行huffman編碼方案時(shí)通過改善Huffman編碼器中變長碼流向定長碼流轉(zhuǎn)換時(shí)的控制邏輯,避免了因數(shù)據(jù)處理不及時(shí)造成數(shù)據(jù)丟失的可能性,從而保證了編碼的正確性。而在實(shí)現(xiàn)并行的huffman解碼器時(shí),解碼算法充分利用了規(guī)則化碼書帶來的碼字的單調(diào)性,及在特定長度碼字集內(nèi)碼字變化的連續(xù)性,將并行解碼由模式匹配轉(zhuǎn)換為算術(shù)運(yùn)算,提高了存儲(chǔ)器的利用率、系統(tǒng)的解碼效率和速度。在實(shí)現(xiàn)并行huffman編碼的基礎(chǔ)上,結(jié)合針對DC子帶的預(yù)測編碼,針對直流子帶的游程編碼,能夠?qū)D像壓縮系統(tǒng)中經(jīng)過DWT變換,量化,掃描后的數(shù)據(jù)進(jìn)行正確的編碼。同時(shí),在并行huffman解碼基礎(chǔ)上的熵解碼器也可以解碼出正確的數(shù)據(jù)提供給解碼系統(tǒng)的后續(xù)反量化模塊,進(jìn)一步處理。在本文介紹的設(shè)計(jì)方案中,按照自頂向下的設(shè)計(jì)方法,對星載圖像壓縮系統(tǒng)中的熵編解碼器進(jìn)行分析,進(jìn)而進(jìn)行邏輯功能分割及模塊劃分,然后分別實(shí)現(xiàn)各子模塊,并最終完成整個(gè)系統(tǒng)。在設(shè)計(jì)過程中,用高級硬件描述語言verilogHDL進(jìn)行RTL級描述。利用了Altera公司的QuartusII開發(fā)平臺(tái)進(jìn)行設(shè)計(jì)輸入、編譯、仿真,同時(shí)還采用modelsim仿真工具和symplicity的綜合工具,驗(yàn)證了設(shè)計(jì)的正確性。通過系統(tǒng)波形仿真和下板驗(yàn)證熵編碼器最高頻率可以達(dá)到127M,在62.5M的情況下工作正常。而熵解碼器也可正常工作在62.5M,吞吐量可達(dá)到2500Mbps,也能滿足性能要求。仿真驗(yàn)證的結(jié)果表明:設(shè)計(jì)能夠滿足性能要求,并具有一定的使用價(jià)值。

    標(biāo)簽: FPGA 圖象壓縮

    上傳時(shí)間: 2013-05-19

    上傳用戶:吳之波123

  • μCOS-II微小內(nèi)核分析

    周立功公司做的一個(gè)μCOS-II微小內(nèi)核分析的PPT.是初學(xué)很好一個(gè)資料,多的就不說了,下了就知道.

    標(biāo)簽: COS-II 內(nèi)核分析

    上傳時(shí)間: 2013-07-07

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