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數(shù)據(jù)采集模塊

數(shù)據(jù)采集是計(jì)算機(jī)與外部物理世界連接的橋梁。數(shù)據(jù)采集模塊由傳感器、控制器等其它單元組成。數(shù)據(jù)采集卡,數(shù)據(jù)采集模塊,數(shù)據(jù)采集儀表等,都是數(shù)據(jù)采集工具。
  • 高精度地震勘探數(shù)據(jù)采集系統(tǒng)

    本文分析了當(dāng)代高精度地震勘探數(shù)據(jù)采集系統(tǒng)的發(fā)展現(xiàn)狀,研究了數(shù)據(jù)采集的A/D方法及理論、現(xiàn)場可編程門陣列(Field Programmable GateArray,F(xiàn)PGA)技術(shù)的發(fā)展及原理,串口通信的原理及實(shí)現(xiàn)。在此基礎(chǔ)上,探討了采用FPGA控制24位△∑模數(shù)轉(zhuǎn)換器來實(shí)現(xiàn)高精度地震勘探數(shù)據(jù)采集系統(tǒng)的實(shí)現(xiàn)思路,對(duì)探測傳感器或檢波器后端數(shù)據(jù)采集系統(tǒng)的信號(hào)A/D轉(zhuǎn)換、FPGA與外部接口設(shè)計(jì)、串口數(shù)據(jù)通信做了詳細(xì)的研究,尤其是在用FPGA來完成與外部ADC的接口控制上做了深入的開發(fā)和設(shè)計(jì),整個(gè)接口控制模塊采用VHDL語言編寫,并同時(shí)將ROM、FIFO等數(shù)字邏輯模塊一起集成到一片F(xiàn)PGA芯片當(dāng)中,并在Quartus Ⅱ6.0的開發(fā)平臺(tái)上通過了軟件仿真,時(shí)序仿真結(jié)果達(dá)到了系統(tǒng)要求。

    標(biāo)簽: 高精度 地震勘探 數(shù)據(jù)采集系統(tǒng)

    上傳時(shí)間: 2013-05-21

    上傳用戶:yuele0123

  • 基于FPGA的數(shù)據(jù)采集與處理技術(shù)的研究

    目前,數(shù)字信號(hào)處理廣泛應(yīng)用于通信、雷達(dá)、聲納、語音與圖像處理等領(lǐng)域,信號(hào)處理算法理論己趨于成熟,但其具體硬件實(shí)現(xiàn)方法卻值得探討。FPGA是近年來廣泛應(yīng)用的超大規(guī)模、超高速的可編程邏輯器件,由于其具有高集成度、高速、可編程等優(yōu)點(diǎn),大大推動(dòng)了數(shù)字系統(tǒng)設(shè)計(jì)的單片化、自動(dòng)化,縮短了單片數(shù)字系統(tǒng)的設(shè)計(jì)周期、提高了設(shè)計(jì)的靈活性和可靠性,在超高速信號(hào)處理和實(shí)時(shí)測控方面有非常廣泛的應(yīng)用。本文對(duì)FPGA的數(shù)據(jù)采集與處理技術(shù)進(jìn)行研究,基于FPGA在數(shù)據(jù)采樣控制和信號(hào)處理方面的高性能和單片系統(tǒng)發(fā)展的新熱點(diǎn),把FPGA作為整個(gè)數(shù)據(jù)采集與處理系統(tǒng)的控制核心。主要研究內(nèi)容如下: FPGA的單片系統(tǒng)研究。針對(duì)數(shù)據(jù)采集與處理,對(duì)FPGA進(jìn)行選型,設(shè)計(jì)了基于FPGA的單片系統(tǒng)的結(jié)構(gòu)。把整個(gè)控制系統(tǒng)分為三個(gè)部分:多通道采樣控制模塊,數(shù)據(jù)處理模塊,存儲(chǔ)控制模塊。 多通道采樣控制模塊的設(shè)計(jì)。利用4片AD7506和一片AD7862對(duì)64路模擬量進(jìn)行周期采樣,分別設(shè)計(jì)了通道選擇控制模塊和A/D轉(zhuǎn)換控制模塊,并進(jìn)行了仿真,完成了基于FPGA的多通道采樣控制。 數(shù)據(jù)處理模塊的設(shè)計(jì)。FFT算法在數(shù)字信號(hào)處理中占有重要的地位,因此本文研究了FFT的硬件實(shí)現(xiàn)結(jié)構(gòu),提出了用FPGA實(shí)現(xiàn)FFT的一種設(shè)計(jì)思想,給出了總體實(shí)現(xiàn)框圖。分別設(shè)計(jì)了旋轉(zhuǎn)因子復(fù)數(shù)乘法器,碟形運(yùn)算單元,存儲(chǔ)器,控制器,并分別進(jìn)行了仿真。重點(diǎn)設(shè)計(jì)實(shí)現(xiàn)了FFT算法中的蝶形處理單元,采用了一種高效乘法器算法設(shè)計(jì)實(shí)現(xiàn)了蝶形處理單元中的旋轉(zhuǎn)因子乘法器,從而提高了蝶形處理器的運(yùn)算速度,降低了運(yùn)算復(fù)雜度。理論分析和仿真結(jié)果表明,狀態(tài)機(jī)控制器成功地對(duì)各個(gè)模塊進(jìn)行了有序、協(xié)調(diào)的控制。 存儲(chǔ)控制模塊的設(shè)計(jì)。利用閃存芯片K9K1G08UOA對(duì)采集處理后的數(shù)據(jù)進(jìn)行存儲(chǔ),設(shè)計(jì)了FPGA與閃存的硬件連接,設(shè)計(jì)了存儲(chǔ)控制模塊。 本文對(duì)FFT算法的硬件實(shí)現(xiàn)進(jìn)行了研究,結(jié)合單片系統(tǒng)的特點(diǎn),把整個(gè)系統(tǒng)分為多通道采樣控制模塊,數(shù)據(jù)處理模塊,存儲(chǔ)控制模塊進(jìn)行設(shè)計(jì)和仿真。設(shè)計(jì)采用VHDL編寫程序的源代碼。仿真測試結(jié)果表明,此FPGA單片系統(tǒng)可完成對(duì)實(shí)時(shí)信號(hào)的高速采集與處理。

    標(biāo)簽: FPGA 數(shù)據(jù)采集 處理技術(shù)

    上傳時(shí)間: 2013-07-06

    上傳用戶:eclipse

  • 四路同步數(shù)據(jù)采集和處理系統(tǒng)的設(shè)計(jì)

    數(shù)字信號(hào)處理是信息科學(xué)中近幾十年來發(fā)展最為迅速的學(xué)科之一。常用的實(shí)現(xiàn)高速數(shù)字信號(hào)處理的器件有DSP和FPGA。FPGA具有集成度高、邏輯實(shí)現(xiàn)能力強(qiáng)、速度快、設(shè)計(jì)靈活性好等眾多優(yōu)點(diǎn),尤其在并行信號(hào)處理能力方面比DSP更具優(yōu)勢。在信號(hào)處理領(lǐng)域,經(jīng)常需要對(duì)多路信號(hào)進(jìn)行采集和實(shí)時(shí)處理,為解決這一問題,本文設(shè)計(jì)了基于FPGA的數(shù)據(jù)采集和處理系統(tǒng)。 本文首先介紹數(shù)字信號(hào)處理系統(tǒng)的組成和數(shù)字信號(hào)處理的優(yōu)點(diǎn),然后通過FFT算法的比較選擇和硬件實(shí)現(xiàn)方案的比較選擇,進(jìn)行總體方案的設(shè)計(jì)。在硬件方面,特別討論了信號(hào)調(diào)理模塊、模數(shù)轉(zhuǎn)換模塊、FPGA芯片配置等功能模塊的設(shè)計(jì)方案和硬件電路實(shí)現(xiàn)方法。信號(hào)處理單元的設(shè)計(jì)以Xilinx ISE為軟件平臺(tái),采用VHDL和IP核的方法,設(shè)計(jì)了時(shí)鐘產(chǎn)生模塊、數(shù)據(jù)滑動(dòng)模塊、FFT運(yùn)算模塊、求模運(yùn)算模塊、信號(hào)控制模塊,完成信號(hào)處理單元的設(shè)計(jì),并采用ModelSim仿真工具進(jìn)行相關(guān)的時(shí)序仿真。最后利用MATLAB對(duì)設(shè)計(jì)進(jìn)行驗(yàn)證,達(dá)到技術(shù)指標(biāo)要求。

    標(biāo)簽: 同步數(shù)據(jù)采集 處理系統(tǒng)

    上傳時(shí)間: 2013-07-07

    上傳用戶:小火車?yán)怖怖?/p>

  • 動(dòng)態(tài)光譜數(shù)據(jù)采集與預(yù)處理

    人體血液成份的無創(chuàng)檢測是生物醫(yī)學(xué)領(lǐng)域尚未攻克的前沿課題之一,動(dòng)態(tài)光譜法在理論上克服了其它檢測方法難以逾越的障礙——個(gè)體差異和測量條件對(duì)檢測結(jié)果的影響。實(shí)現(xiàn)動(dòng)態(tài)光譜檢測,其關(guān)鍵在于采集多波長的光電容積脈搏波信號(hào),并對(duì)其進(jìn)行處理。針對(duì)動(dòng)態(tài)光譜檢測中信號(hào)微弱、信噪比低、處理數(shù)據(jù)量大的特點(diǎn),本文設(shè)計(jì)了基于FPGA和面陣CCD攝像頭的動(dòng)態(tài)光譜數(shù)據(jù)采集與預(yù)處理系統(tǒng),提高檢測精度,采集出滿足動(dòng)態(tài)光譜信號(hào)提取要求的光電脈搏波;并對(duì)動(dòng)態(tài)光譜頻域提取法的核心算法FFT的FPGA實(shí)現(xiàn)進(jìn)行研究。 課題提出用高靈敏度的面陣CCD攝像頭替代常規(guī)光柵光譜儀中的光電接收器,實(shí)現(xiàn)對(duì)多波長的光電容積脈搏波的檢測。結(jié)合面陣CCD的二維圖像特點(diǎn),采用信號(hào)累加法去除噪聲,提高信號(hào)的信噪比。 創(chuàng)新性的提出一種不同于以往的信號(hào)累加方法——將處于同一行的視頻信號(hào)在采樣過程中直接累加,然后再進(jìn)行傳輸和存儲(chǔ)。不同于幀累加和異行累加,這種同行累加方式不但大大的提高了信號(hào)的信噪比,同時(shí)減小了數(shù)據(jù)的傳輸速度和傳輸量,降低了對(duì)存儲(chǔ)器容量的要求,改善了動(dòng)態(tài)光譜信號(hào)檢測系統(tǒng)的性能。 針對(duì)面陣CCD攝像頭輸出的復(fù)合視頻信號(hào)的特點(diǎn),設(shè)計(jì)視頻信號(hào)解調(diào)電路,得到高速、高精度的數(shù)字視頻信號(hào)和準(zhǔn)確的視頻同步信號(hào),用于后續(xù)的視頻信號(hào)采集與處理。 根據(jù)動(dòng)態(tài)光譜信號(hào)檢測和視頻信號(hào)采集的要求,選擇可編程邏輯器件FPGA作為硬件平臺(tái),設(shè)計(jì)并實(shí)現(xiàn)了基于FPGA和面陣CCD攝像頭的光電脈搏波采集與預(yù)處理系統(tǒng)。該系統(tǒng)實(shí)現(xiàn)了視頻信號(hào)的精確定位,通過光譜信號(hào)的高速同行累加,實(shí)現(xiàn)了光電脈搏波信號(hào)的高精度檢測。系統(tǒng)采用基于FPGA的Nios II嵌入式處理器系統(tǒng),通過對(duì)其應(yīng)用程序的開發(fā),可靠的實(shí)現(xiàn)了數(shù)據(jù)的采集、傳輸和存儲(chǔ),提高了系統(tǒng)的集成度,降低了開發(fā)成本。 為實(shí)現(xiàn)動(dòng)態(tài)光譜信號(hào)的頻域提取,研究了基于FPGA的FFT實(shí)現(xiàn)方案,對(duì)各關(guān)鍵模塊進(jìn)行設(shè)計(jì),為動(dòng)態(tài)光譜信號(hào)的進(jìn)一步處理打下良好的基礎(chǔ)。 最后,通過實(shí)驗(yàn)證明了系統(tǒng)數(shù)據(jù)采集的正確性和信號(hào)預(yù)處理的可行性,得到了符合動(dòng)態(tài)光譜信號(hào)提取要求的脈搏波信號(hào)。

    標(biāo)簽: 動(dòng)態(tài) 光譜數(shù)據(jù)采集 預(yù)處理

    上傳時(shí)間: 2013-04-24

    上傳用戶:cknck

  • 基于FPGA控制的高速數(shù)據(jù)采集系統(tǒng)

    數(shù)據(jù)采集系統(tǒng)是信號(hào)與信息處理系統(tǒng)中不可缺少的重要組成部分,同時(shí)也是軟件無線電系統(tǒng)中的核心模塊,在現(xiàn)代雷達(dá)系統(tǒng)以及無線基站系統(tǒng)中的應(yīng)用越來越廣泛。為了能夠滿足目前對(duì)軟件無線電接收機(jī)自適應(yīng)性及靈活性的要求,并充分體現(xiàn)在高性能FPGA平臺(tái)上設(shè)計(jì)SOC系統(tǒng)的思路,本文提出了由高速高精度A/D轉(zhuǎn)換芯片、高性能FPGA、PCI總線接口、DB25并行接口組成的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)方案及實(shí)現(xiàn)方法。其中FPGA作為本系統(tǒng)的控制核心和傳輸橋梁,發(fā)揮了極其重要的作用。通過FPGA不僅完成了系統(tǒng)中全部數(shù)字電路部分的設(shè)計(jì),并且使系統(tǒng)具有了較高的可適應(yīng)性、可擴(kuò)展性和可調(diào)試性。 在時(shí)序數(shù)字邏輯設(shè)計(jì)上,充分利用FPGA中豐富的時(shí)序資源,如鎖相環(huán)PLL、觸發(fā)器,緩沖器FIFO、計(jì)數(shù)器等,能夠方便的完成對(duì)系統(tǒng)輸入輸出時(shí)鐘的精確控制以及根據(jù)系統(tǒng)需要對(duì)各處時(shí)序延時(shí)進(jìn)行修正。 在存儲(chǔ)器設(shè)計(jì)上,采用FPGA片內(nèi)存儲(chǔ)器。可根據(jù)系統(tǒng)需要隨時(shí)進(jìn)行設(shè)置,并且能夠方便的完成數(shù)據(jù)格式的合并、拆分以及數(shù)據(jù)傳輸率的調(diào)整。 在傳輸接口設(shè)計(jì)上,采用并行接口和PCI總線接口的兩種數(shù)據(jù)傳輸模式。通過FPGA中的宏功能模塊和IP資源實(shí)現(xiàn)了對(duì)這兩種接口的邏輯控制,可使系統(tǒng)方便的在兩種傳輸模式下進(jìn)行切換。 在系統(tǒng)工作過程控制上,通過VB程序編寫了應(yīng)用于PC端的上層控制軟件。并通過并行接口實(shí)現(xiàn)了PC和FPGA之間的交互,從而能夠方便的在PC機(jī)上完成對(duì)系統(tǒng)工作過程的控制和工作模式的選擇。 在系統(tǒng)調(diào)試方面,充分利用QuartuslI軟件中自帶的嵌入式邏輯分析儀SignalTaplI,實(shí)時(shí)準(zhǔn)確的驗(yàn)證了在系統(tǒng)整個(gè)傳輸過程中數(shù)據(jù)的正確性和時(shí)序性,并極大的降低了用常規(guī)儀器觀測FPGA中眾多待測引腳的難度。 本文第四章針對(duì)FPGA中各功能模塊的邏輯設(shè)計(jì)進(jìn)行了詳細(xì)分析,并對(duì)每個(gè)模塊都給出了精確的仿真結(jié)果。同時(shí),文中還在其它章節(jié)詳細(xì)介紹了系統(tǒng)的硬件電路設(shè)計(jì)、并行接口設(shè)計(jì)、PCI接口設(shè)計(jì)、PC端控制軟件設(shè)計(jì)以及用于調(diào)試過程中的SignalTapⅡ嵌入式邏輯分析儀的使用方法,并且也對(duì)系統(tǒng)的仿真結(jié)果和測試結(jié)果給出了分析及討論。最后還附上了系統(tǒng)的PCB版圖、FPGA邏輯設(shè)計(jì)圖、實(shí)物圖及注釋詳細(xì)的相關(guān)源程序清單。

    標(biāo)簽: FPGA 控制 高速數(shù)據(jù) 采集系統(tǒng)

    上傳時(shí)間: 2013-06-09

    上傳用戶:lh25584

  • 應(yīng)用FPGA的高速數(shù)據(jù)采集

    隨著計(jì)算機(jī)技術(shù)的突飛猛進(jìn)以及移動(dòng)通訊技術(shù)在日常生活中的不斷深入,數(shù)據(jù)采集不斷地向多路、高速、智能化的方向發(fā)展。本文針對(duì)此需求,實(shí)現(xiàn)了一種應(yīng)用FPGA的多路、高速的數(shù)據(jù)采集系統(tǒng),從而為測量儀器提供良好的采集數(shù)據(jù)。    本文設(shè)計(jì)了一種基于AD+FPGA+DSP的多路數(shù)據(jù)采集處理系統(tǒng),針對(duì)此系統(tǒng)設(shè)計(jì)了基于AD9446的模數(shù)轉(zhuǎn)換采集板,再將模數(shù)轉(zhuǎn)換采集板的數(shù)據(jù)傳送至基于FPGA的采集控制模塊進(jìn)行數(shù)據(jù)的壓縮以及緩沖存儲(chǔ),最后由DSP調(diào)入數(shù)據(jù)進(jìn)行數(shù)據(jù)的處理。本文的設(shè)計(jì)主要分為兩部分,一部分為模數(shù)轉(zhuǎn)換采集板的設(shè)計(jì)與調(diào)試,另一部分為采集控制模塊的設(shè)計(jì)與仿真。    經(jīng)設(shè)計(jì)與調(diào)試,模數(shù)轉(zhuǎn)換模塊可為系統(tǒng)提供穩(wěn)定可靠的數(shù)據(jù),能穩(wěn)定工作在百兆的頻率下;采集控制模塊能實(shí)時(shí)地完成數(shù)據(jù)壓縮與數(shù)據(jù)緩沖,并能通過時(shí)鐘管理模塊來控制前端AD的采樣,該模塊也能穩(wěn)定工作在百兆的頻率下。該系統(tǒng)為多路、高速的數(shù)據(jù)采集系統(tǒng),并能穩(wěn)定工作,從而能滿足電子測量儀器的要求。

    標(biāo)簽: FPGA 高速數(shù)據(jù) 采集

    上傳時(shí)間: 2013-05-24

    上傳用戶:chuckbassboy

  • 激光掃描車身坐標(biāo)測量數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)

    本文對(duì)激光掃描車身坐標(biāo)測量系統(tǒng)的數(shù)據(jù)采集部分進(jìn)行了深入研究,設(shè)計(jì)了基于“AVR+FIFO+CPLD”的數(shù)據(jù)采集及處理模塊;解決了當(dāng)多路信號(hào)有數(shù)據(jù)同時(shí)傳輸時(shí),如何將數(shù)據(jù)完整地寫入FIFO的問題,實(shí)現(xiàn)了數(shù)據(jù)的有效采集;編寫了完整的CPLD控制程序和AVR數(shù)據(jù)采集程序,為準(zhǔn)確測量待測點(diǎn)的坐標(biāo)提供了可靠的數(shù)據(jù)來源。

    標(biāo)簽: 激光掃描 坐標(biāo)測量 數(shù)據(jù)采集系統(tǒng) 車身

    上傳時(shí)間: 2013-10-29

    上傳用戶:asaqq

  • 單片機(jī)實(shí)時(shí)數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)

    摘要:介紹了基于AT89C52和ADS774的實(shí)時(shí)數(shù)據(jù)采集系統(tǒng),對(duì)系統(tǒng)硬件結(jié)構(gòu)、工作原理和軟件主要模塊功能和流程作了較詳細(xì)的論述,同時(shí)給出了核心程序。關(guān)鍵詞:單片機(jī);A/D轉(zhuǎn)換;實(shí)時(shí)數(shù)據(jù)采集

    標(biāo)簽: 單片機(jī) 實(shí)時(shí)數(shù)據(jù)采集 系統(tǒng)設(shè)計(jì)

    上傳時(shí)間: 2014-12-27

    上傳用戶:ifree2016

  • 基于以太網(wǎng)分布式的數(shù)據(jù)采集控制系統(tǒng)

    針對(duì)飛行模擬器座艙數(shù)據(jù)采集的復(fù)雜性,設(shè)計(jì)了一種基于以太網(wǎng)分布式的數(shù)據(jù)采集控制系統(tǒng),該系統(tǒng)是RCM5700微處理器模塊上的以太網(wǎng)應(yīng)用。在系統(tǒng)的基礎(chǔ)上具體討論了PoE技術(shù)的應(yīng)用,在傳輸數(shù)據(jù)的網(wǎng)線上同時(shí)提供電流,提出并實(shí)現(xiàn)了一種包括輔助電源在內(nèi)的完整可靠的PoE供電方案。設(shè)計(jì)采用美國國家半導(dǎo)體的LM5073和LM5576并根據(jù)不同的負(fù)載情況,進(jìn)行穩(wěn)定可靠的電壓轉(zhuǎn)換,以滿足數(shù)據(jù)采集電路的要求。實(shí)驗(yàn)結(jié)果表明:該設(shè)計(jì)穩(wěn)定可靠,滿足低于13 W的采集節(jié)點(diǎn)供電要求,提高了模擬器信號(hào)采集系統(tǒng)的通用性和標(biāo)準(zhǔn)化程度,避免了以往數(shù)據(jù)采集節(jié)點(diǎn)單獨(dú)繁瑣的電源設(shè)計(jì)。 Abstract:  Aiming at the complexity of large avion simulation and controlling,the simulator cabin distribute data collecting and control system was designed. This system is the application of RCM5700 on Ethernet. Based on this system,PoE technique that makes Ethernet can also provide power were expounded with emphasis and included FAUX design the PoE resolution was realized. To achieve the requirement of this system,LM5073 and LM5576 were used to DC-DC switch. From the data of experiment,the design filled the requirement of power-need of node whose power was lower than 13W. The application of the technique can advance the degree of simulation data collections currency and standardization and avoid designing additional power system.

    標(biāo)簽: 以太網(wǎng) 分布式 數(shù)據(jù)采集 控制系統(tǒng)

    上傳時(shí)間: 2013-11-09

    上傳用戶:xyipie

  • 基于FPGA和UART的MCU總線數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)

    為了實(shí)現(xiàn)某生產(chǎn)線上MCU的數(shù)據(jù)采集,設(shè)計(jì)了一種基于FPGA和UART的數(shù)據(jù)采集系統(tǒng),并完成系統(tǒng)的軟硬件設(shè)計(jì)。整個(gè)設(shè)計(jì)完全采用硬件邏輯VHDL語言,集成在一枚Altera的cyclone芯片內(nèi),設(shè)計(jì)了單片機(jī)總線與FPGA接口邏輯,數(shù)據(jù)緩存的雙端口RAM、FIFO和UART串行發(fā)送模塊。通過仿真和實(shí)際應(yīng)用證明系統(tǒng)的準(zhǔn)確性,該方法和理念具有一定的通用性,為數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)提供了一個(gè)新思路,使系統(tǒng)更緊湊,易維護(hù),更可靠。

    標(biāo)簽: FPGA UART MCU 總線

    上傳時(shí)間: 2013-10-11

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