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數(shù)(shù)字復(fù)接器

低功耗10Gbs CMOS 1∶ 4 分接器

0281、低功耗10Gbs CMOS 1∶ 4 分接器

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上傳時間： 2014-04-09

上傳用戶：JGR2013
電子連接器設(shè)計基礎(chǔ) 35頁 1.3M.ppt

實用電子技術(shù)專輯 385冊 3.609G電子連接器設(shè)計基礎(chǔ) 35頁 1.3M.ppt

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上傳時間： 2014-05-05

上傳用戶：時代將軍
適用于H.264視頻解碼器的VLD設(shè)計

設(shè)計了一種適合于H.264 的變字長解碼器根據(jù)碼流特點進行模塊劃分減少硬件開銷采用并行結(jié)構(gòu)解NAL 包解碼效率高采用了桶形移位器進行并行解碼每個時鐘解一個碼字采用Verilog 語言進行設(shè)計仿真并通過

標簽： 264 VLD 視頻解碼器

上傳時間： 2013-07-15

上傳用戶：shen007yue
數(shù)字復(fù)接器的FPGA設(shè)計與實現(xiàn)

該文首先分析了線路碼的一般問題;其次分析了正碼速調(diào)整的基本原理及所涉及的一般問題,并說明了用FPGA進行電路設(shè)計的一般方法;最后分析了該系統(tǒng)所產(chǎn)生的抖動,如抖動的產(chǎn)生,分類以及如何減小抖動等,并對該課題所產(chǎn)生的兩類抖動即正碼速調(diào)整引入的侯時抖動和平滑鎖相環(huán)引入的抖動進行了分析,并用Matlab仿真工具對鎖相環(huán)的抖動與其環(huán)路帶寬之間的關(guān)系進行了仿真與計算. 作者的工作主要包括: 1.利用FPGA完成了復(fù)接、分接系統(tǒng)的設(shè)計和調(diào)試.2.利用FPGA完成了HDB3線路碼的設(shè)計與調(diào)試.3.利用鎖相環(huán)完成了碼速恢復(fù).4,對該復(fù)接分接系統(tǒng)所產(chǎn)生的抖動進行了理論分析和仿真.5.對FPGA進行了誤碼率測試,誤碼性能優(yōu)于10

標簽： FPGA 數(shù)字復(fù)接器

上傳時間： 2013-04-24

上傳用戶：songnanhua
基于FPGA采用PCM通信實現(xiàn)多路數(shù)據(jù)采集器的研制

本文研制的數(shù)據(jù)采集器，用于采集導(dǎo)彈過載模擬試車臺的各種參數(shù),來評價導(dǎo)彈在飛行過程中的性能，由于試車臺是高速旋轉(zhuǎn)體，其工作環(huán)境惡劣，受電磁干擾大，而且設(shè)備要求高，如果遇到設(shè)備故障或設(shè)備事故，其損失相當巨大，保證設(shè)備的安全性和可靠性較為困難。本文在分析數(shù)字通信技術(shù)的基礎(chǔ)上，選用了基于現(xiàn)場可編程邏輯陣列(FPGA)采用脈沖編碼調(diào)制(PCM)通信實現(xiàn)多路數(shù)據(jù)采集器的設(shè)計，其優(yōu)點是FPGA技術(shù)在數(shù)據(jù)采集器中可以進行模塊化設(shè)計，增加了系統(tǒng)的抗干擾性、靈活性和適應(yīng)性，并且可以將整個PCM通信系統(tǒng)設(shè)計成可編程序系統(tǒng)，用戶只要稍加變更程序，則系統(tǒng)的被測路數(shù)、幀結(jié)構(gòu)、碼速率、標度等均可改變以適應(yīng)任何場合。并且采用合理的糾錯和加密編碼能夠?qū)崿F(xiàn)數(shù)據(jù)在傳輸工程中的完整性和安全性。通過對PCM通信的特點研究，研制了一套集采集與傳輸?shù)南到y(tǒng)。文章給出了各個模塊的具體建模與設(shè)計，系統(tǒng)采用的是FPGA技術(shù)來實現(xiàn)數(shù)據(jù)采集和信號處理，采用VHDL實現(xiàn)了數(shù)字復(fù)接器和分接器、編解碼器、調(diào)制與解調(diào)模塊的建模與設(shè)計。采用基于NiosII實現(xiàn)串口通訊，構(gòu)建了實時性和準確性通信網(wǎng)絡(luò)，實現(xiàn)了數(shù)據(jù)的采集。測試數(shù)據(jù)和數(shù)據(jù)采集的實驗結(jié)果證明，采用FPGA技術(shù)實現(xiàn)PCM信號的編碼、傳輸、解碼，能夠有較強的抗干擾性、抗噪聲性能好、差錯可控、易加密、易與現(xiàn)代技術(shù)結(jié)合，并且誤碼率較低，要遠遠優(yōu)于傳統(tǒng)的方法。

標簽： FPGA PCM 通信實現(xiàn) 多路

上傳時間： 2013-04-24

上傳用戶：com1com2
基于FPGA的DAB信道編碼器輸入接口的設(shè)計與實現(xiàn)

電臺廣播在我們的社會生活中占有重要的地位。隨著我國廣播事業(yè)的發(fā)展，對我國廣播業(yè)開發(fā)技術(shù)、信號的傳輸質(zhì)量和速度提出了更高更新的要求，促使廣播科研人員不斷更新現(xiàn)有技術(shù)，以滿足人民群眾日益增長的需求。本論文主要分析了現(xiàn)行廣播發(fā)射臺的數(shù)字廣播激勵器輸入接口的不足之處，根據(jù)歐洲ETS300799標準，實現(xiàn)了一種激勵器輸入接口的解決方案，這種方案將復(fù)接器送來的ETI(NA,G704)格式的碼流轉(zhuǎn)換成符合ETS300799標準ETI(NI)的標準碼流，并送往后面的信道編碼器。ETI(NA,G704)格式與現(xiàn)行的ETI(NI,G703)格式相比，主要加入了交織和RS糾錯編碼，使得信號抗干擾能力大大加強，提高了節(jié)目從演播室到發(fā)射臺的傳輸質(zhì)量，特別是實時直播節(jié)目要求信號質(zhì)量比較好時具有更大的作用。本論文利用校驗位為奇數(shù)個的RS碼，對可檢不可糾的錯誤發(fā)出報警信號，通過其它方法替代原有信號，對音質(zhì)影響不大，節(jié)省了糾正這個錯誤的資源和開發(fā)成本。同時，我們采用FPGA硬件開發(fā)平臺和VHDL硬件描述語言編寫代碼實現(xiàn)硬件功能，而不采用專用芯片實現(xiàn)功能，使得修改電路和升級變得異常方便，大大提高了開發(fā)產(chǎn)品的效率，降低了成本。經(jīng)過軟件仿真和硬件驗證，本系統(tǒng)已經(jīng)基本實現(xiàn)了預(yù)想的功能，擴展性較好，硬件資源開銷較小，具有實用價值。

標簽： FPGA DAB 信道編碼器

上傳時間： 2013-07-15

上傳用戶：afeiafei309
使用向量訊號產(chǎn)生器來提升收發(fā)器測試速度

收發(fā)器乃新型通訊系統(tǒng)的基本組件，可以用於各種不同裝置包括手機、收發(fā)器乃新型通訊系統(tǒng)的基本組件，可以用於各種不同裝置包括手機、收發(fā)器乃新型通訊系統(tǒng)的基本組件，可以用於各種不同裝置包括手機、 WLANWLANWLANWLAN網(wǎng)路橋接器與蜂巢式基礎(chǔ)建設(shè)。

標簽： 向量訊號產(chǎn)生器收發(fā)器測試速度

上傳時間： 2013-10-12

上傳用戶：ligi201200
一個成語接龍的PERL程序

一個成語接龍的PERL程序，由電腦自動出成語，然后用戶根據(jù)成語的最后一個字進行接龍，如接不上，可選擇由電腦給出

標簽： PERL 程序

上傳時間： 2013-12-20

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Cygnal 集成開發(fā)環(huán)境(IDE)是一套完整獨立的軟件程序它為設(shè)計者提供了用于開發(fā)和測試項目的所有工具程序的主要特點包括項目界面全功能窗口字體可配置的編輯器調(diào)試器具有設(shè)置斷

Cygnal 集成開發(fā)環(huán)境(IDE)是一套完整獨立的軟件程序它為設(shè)計者提供了用于開發(fā)和測試項目的所有工具程序的主要特點包括項目界面全功能窗口字體可配置的編輯器調(diào)試器具有設(shè)置斷點觀察點單步等功能工具鏈接集成支持匯編器編譯器和鏈接器可定制的工具菜單用于集成其它編譯器或開發(fā)工具 CYGNAL 配置向?qū)Э蔀橹付ǖ哪繕谁h(huán)境產(chǎn)生配置代碼

標簽： Cygnal IDE 程序項目

上傳時間： 2015-12-05

上傳用戶：wys0120
動態(tài)鏈接庫DLL編程資料.chm 動態(tài)鏈接庫(DLLs)是從C語言函數(shù)庫和Pascal庫單元的概念發(fā)展而來的。所有的C語言標準庫函數(shù)都存放在某一函數(shù)庫中

動態(tài)鏈接庫DLL編程資料.chm 動態(tài)鏈接庫(DLLs)是從C語言函數(shù)庫和Pascal庫單元的概念發(fā)展而來的。所有的C語言標準庫函數(shù)都存放在某一函數(shù)庫中，同時用戶也可以用LIB程序創(chuàng)建自己的函數(shù)庫。在鏈接應(yīng)用程序的過程中，鏈接器從庫文件中拷貝程序調(diào)用的函數(shù)代碼，并把這些函數(shù)代碼添加到可執(zhí)行文件中。這種方法同只把函數(shù)儲存在已編譯的.OBJ文件中相比更有利于代碼的重用。

標簽： Pascal DLLs DLL chm

上傳時間： 2016-03-26

上傳用戶：陽光少年2016

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