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數(shù)(shù)字簽名算法

  • FPGA低功耗布局布線算法的研究與改進(jìn).rar

    本文對(duì)嵌入硬核的FPGA布線通道寬度分布和改進(jìn)FPGA布局算法進(jìn)行了研究。文章在嵌入硬核的FPGA布線通道寬度分布研究中,引入了四種架構(gòu),其布線通道寬度分布函數(shù)分別為均勻、脈沖、高斯和三角分布。通過(guò)修改VPR工具的源代碼,使平臺(tái)適用于具有嵌入硬核的FPGA架構(gòu),利用MCNC基準(zhǔn)電路來(lái)測(cè)試這四種架構(gòu)的性能。實(shí)驗(yàn)結(jié)果表明:在以網(wǎng)線平均長(zhǎng)度作為指標(biāo)的測(cè)試中,通道寬度均勻分布的架構(gòu)具有更短的布線長(zhǎng)度、更優(yōu)的性能。

    標(biāo)簽: FPGA 低功耗 布局布線

    上傳時(shí)間: 2013-06-01

    上傳用戶:JGR2013

  • MP3音頻編解碼運(yùn)算中IMDCT算法研究及其FPGA實(shí)現(xiàn).rar

    近年來(lái),隨著多媒體技術(shù)的迅猛發(fā)展,電子、計(jì)算機(jī)、通訊和娛樂(lè)之間的相互融合、滲透越來(lái)越多,而數(shù)字音頻技術(shù)則是應(yīng)用最為廣泛的技術(shù)之一。MP3(MPEG-1 Audio LayerⅢ)編解碼算法作為數(shù)字音頻的解決方案,在便攜式多媒體產(chǎn)品中得到了廣泛流行。 在已有的便攜式MP3系統(tǒng)實(shí)現(xiàn)方案中,低速處理器與專用硬件結(jié)合的SOC設(shè)計(jì)方案結(jié)合了硬件實(shí)現(xiàn)方式和軟件實(shí)現(xiàn)方式的優(yōu)點(diǎn),具有成本低、升級(jí)容易、功能豐富等特點(diǎn)。IMDCT(反向改進(jìn)離散余弦變換)是編解碼算法中一個(gè)運(yùn)算量大調(diào)用頻率高的運(yùn)算步驟,因此適于硬件實(shí)現(xiàn),以降低處理器的開(kāi)銷和功耗,來(lái)提高整個(gè)系統(tǒng)的性能。 本文首先闡述了MP3音頻編解碼標(biāo)準(zhǔn)和流程,以及IMDCT常用的各種實(shí)現(xiàn)算法。在此基礎(chǔ)上選擇了適于硬件實(shí)現(xiàn)的遞歸循環(huán)實(shí)現(xiàn)方法,并在已有算法的基礎(chǔ)上進(jìn)行了改進(jìn),減小了所需硬件資源需求并保持了運(yùn)算速度。接著提出了模塊總體設(shè)計(jì)方案,結(jié)合算法進(jìn)行了實(shí)現(xiàn)結(jié)構(gòu)的優(yōu)化,并在EDA環(huán)境下具體實(shí)現(xiàn),用硬件描述語(yǔ)言設(shè)計(jì)、綜合、仿真,且下載到Xilinx公司的VirtexⅡ系列xc2v1000FPGA器件中,在減小硬件資源的同時(shí)快速地實(shí)現(xiàn)了IMDCT,經(jīng)驗(yàn)證功能正確。

    標(biāo)簽: IMDCT FPGA MP3

    上傳時(shí)間: 2013-05-31

    上傳用戶:Minly

  • H.264幀內(nèi)預(yù)測(cè)算法優(yōu)化及幾個(gè)重要模塊的FPGA實(shí)現(xiàn).rar

    H.264作為新一代視頻編碼標(biāo)準(zhǔn),相比上一代視頻編碼標(biāo)準(zhǔn)MPEG2,在相同畫質(zhì)下,平均節(jié)約64﹪的碼流。該標(biāo)準(zhǔn)僅設(shè)定了碼流的語(yǔ)法結(jié)構(gòu)和解碼器結(jié)構(gòu),實(shí)現(xiàn)靈活性極大,其規(guī)定了三個(gè)檔次,每個(gè)檔次支持一組特定的編碼功能,并支持一類特定的應(yīng)用,因此。H.264的編碼器的設(shè)計(jì)可以根據(jù)需求的不同而不同。 H.264雖然具有優(yōu)異的壓縮性能,但是其復(fù)雜度卻比一般編碼器高的多。本文對(duì)H.264進(jìn)行了編碼復(fù)雜度分析,并統(tǒng)計(jì)了整個(gè)軟件編碼中計(jì)算量的分布。H.264中采用了率失真優(yōu)化算法,提高了幀內(nèi)預(yù)測(cè)編碼的效率。在該算法下進(jìn)行幀內(nèi)預(yù)測(cè)時(shí),為了得到一個(gè)宏塊的預(yù)測(cè)模式,需要進(jìn)行592次率失真代價(jià)計(jì)算。因此為了降低幀內(nèi)預(yù)測(cè)模式選擇的計(jì)算復(fù)雜度,本文改進(jìn)了幀內(nèi)預(yù)測(cè)模式選擇算法。實(shí)踐證明,在PSNR值的損失可以忽略不計(jì)的情況下,該算法相比原算法,幀內(nèi)編碼時(shí)間平均節(jié)約60﹪以上,對(duì)編碼的實(shí)時(shí)性有較大幫助。 為了實(shí)現(xiàn)實(shí)時(shí)編碼,考慮到FPGA的高效運(yùn)算速度和使用靈活性,本文還研究了H.264編碼器基本檔次的FPGA實(shí)現(xiàn)。首先研究了H.264編碼器硬件實(shí)現(xiàn)架構(gòu),并對(duì)影響編碼速度,且具有硬件實(shí)現(xiàn)優(yōu)越性的幾個(gè)重要部分進(jìn)行了算法研究和FPGA.實(shí)現(xiàn)。本文主要研究了H.264編碼器中整數(shù)DCT變換、量化、Zig-Zag掃描、CAVLC編碼以及反量化、逆整數(shù)DCT變換等部分。分別對(duì)這些模塊進(jìn)行了綜合和時(shí)序仿真,并將驗(yàn)證后通過(guò)的系統(tǒng)模塊下載到Xilinx virtex-Ⅱ Pro的FPGA中,進(jìn)行了在線測(cè)試,驗(yàn)證了該系統(tǒng)對(duì)輸入的殘差數(shù)據(jù)實(shí)時(shí)壓縮編碼的功能。 本文對(duì)H.264編碼器幀內(nèi)預(yù)測(cè)模式選擇算法的改進(jìn),算法實(shí)現(xiàn)簡(jiǎn)單,對(duì)軟件編碼的實(shí)時(shí)性有很大幫助。本文對(duì)在單片F(xiàn)PGA上實(shí)現(xiàn)H.264編碼器做出了探索性嘗試,這對(duì)H.264編碼器芯片的設(shè)計(jì)有著積極的借鑒性。

    標(biāo)簽: FPGA 264 幀內(nèi)預(yù)測(cè)

    上傳時(shí)間: 2013-06-13

    上傳用戶:夜月十二橋

  • c語(yǔ)言經(jīng)典算法100例.rar

    C語(yǔ)言編程算法經(jīng)典案例100個(gè),可以拿來(lái)作為編程參考案例

    標(biāo)簽: 100 c語(yǔ)言 算法

    上傳時(shí)間: 2013-05-30

    上傳用戶:15853744528

  • 基于H.264編解碼的算法優(yōu)化研究及FPGA的硬件實(shí)現(xiàn).rar

    H.264/AVC是由ITU和ISO兩大組織聯(lián)合組成的JVT共同制定的一項(xiàng)新的視頻壓縮技術(shù)標(biāo)準(zhǔn),在較低帶寬上提供高質(zhì)量的圖像傳輸是H.264/AVC的應(yīng)用亮點(diǎn)。在同樣的視覺(jué)質(zhì)量前提下,H.264/AVC比H.263和MPEG-4節(jié)約了50%的碼率。但H.264獲得優(yōu)越性能的代價(jià)是計(jì)算復(fù)雜度的增加,據(jù)估計(jì)其編碼的計(jì)算復(fù)雜度大約為H.263的3倍,因此很難應(yīng)用于實(shí)時(shí)視頻處理領(lǐng)域。針對(duì)這一現(xiàn)狀,業(yè)內(nèi)做了大量的研究工作,力圖降低其計(jì)算復(fù)雜度和提高運(yùn)行效率。比如在運(yùn)動(dòng)估計(jì)方面,國(guó)內(nèi)外在這方面的研究已經(jīng)很成熟。而針對(duì)幀內(nèi)/幀間預(yù)測(cè)編碼的研究卻較少。因此研究預(yù)測(cè)模式的快速算法具有理論意義和應(yīng)用價(jià)值。 本文在詳細(xì)研究H.264標(biāo)準(zhǔn)視頻壓縮編碼特點(diǎn)基礎(chǔ)上,分析了H.264幀內(nèi)編碼, 幀間編碼及變換,量化技術(shù)的原理及特點(diǎn),提出了一種基于局部邊緣方向信息的快速幀內(nèi)模式判決算法,通過(guò)結(jié)合SAD的模式選擇方法來(lái)減少模式選擇數(shù)目。它采用了Sobel梯度算子計(jì)算當(dāng)前塊的邊緣信息,累加當(dāng)前塊中屬于同一方向像素點(diǎn)的邊緣矢量構(gòu)造不同模式下的邊緣方向直方圖,以便確定最可能的預(yù)測(cè)模式。該算法有效降低了編碼器的運(yùn)算復(fù)雜度,在并未顯著降低編碼性能的情況下提升了編碼器效率。仿真表明:Foreman 圖像序列編碼性能有了提高,其中PSNR平均降低了0.06dB,Bitrate平均降低了19.4%,這大大提高了視頻傳輸?shù)馁|(zhì)量。 另外在幀間預(yù)測(cè)模式選擇算法方面進(jìn)行了改進(jìn)研究:按順序?qū)Σ煌愋瓦M(jìn)行判決,有選擇地去比較可能模式,使得在有效減少需判決的模式數(shù)量的同時(shí),結(jié)合小塊模式搜索中途停止準(zhǔn)則來(lái)確定最優(yōu)模式。仿真表明:改進(jìn)算法相對(duì)與原來(lái)算法能夠節(jié)省很多的編碼時(shí)間(平均下降了49.3%),但帶來(lái)的圖像質(zhì)星的下降(平均下降0.08dB,可以忽略)和碼率較少的增加。 同時(shí)在整數(shù)DCT變換模塊中,提出了一種快速蝶形算法,使得對(duì)4×4點(diǎn)數(shù)據(jù)做一次變換,只需通過(guò)8×8次加法和2×8次移位運(yùn)算便可完成,與原來(lái)12×8次加法和4×8次移位相比,新算法大大降低了運(yùn)算復(fù)雜度。 最后介紹FPGA的特點(diǎn)及設(shè)計(jì)流程,并實(shí)現(xiàn)了H.264編解碼器中變換編碼及量化和熵解碼模塊的硬件。這種基于FPGA所實(shí)現(xiàn)的H.264編碼視頻處理模塊設(shè)計(jì)具備了成本低,周期短,設(shè)計(jì)方法靈活等優(yōu)點(diǎn),具有廣闊的市場(chǎng)應(yīng)用前景。 仿真表明,通過(guò)使用本文提出的幀內(nèi)/幀間速算法方法可使得H.264編碼速度獲得顯著的提高,使H.264 Baseline編碼器能在PC平臺(tái)上實(shí)現(xiàn)實(shí)時(shí)編碼。

    標(biāo)簽: FPGA 264 編解碼

    上傳時(shí)間: 2013-07-18

    上傳用戶:zukfu

  • 視頻格式轉(zhuǎn)換算法研究及FPGA實(shí)現(xiàn)——去隔行、幀頻轉(zhuǎn)換、分辨率變換.rar

    在當(dāng)今的廣播系統(tǒng)中,絕大部分的視頻信號(hào)是隔行采樣的。采用這種掃描格式,能夠大幅度地減少視頻的帶寬,但也會(huì)引起彩色爬行、畫面閃爍、邊緣模糊及鋸齒等現(xiàn)象。這種缺陷經(jīng)人尺寸屏幕放大后就更加明顯。為改善畫面的視覺(jué)效果,去隔行技術(shù)應(yīng)運(yùn)而生。同時(shí),視頻信號(hào)本身的低幀頻也會(huì)導(dǎo)致行抖動(dòng)、線爬行以及大面積閃爍等視覺(jué)效果上的缺陷。增加掃描頻率會(huì)把這些視覺(jué)缺陷搬移到人眼不敏感的高頻區(qū)域上去從而產(chǎn)生較好的主觀圖象質(zhì)量。而為了適應(yīng)不同顯示終端以及對(duì)圖像大小變化的要求就必須對(duì)原始信號(hào)分辨率即每幀行數(shù)和每行像素?cái)?shù)進(jìn)行變換。因此去隔行、幀頻轉(zhuǎn)換、分辨率變換成為視頻格式轉(zhuǎn)換的基本內(nèi)容。 FPGA 的出現(xiàn)是VLSI技術(shù)和EDA技術(shù)發(fā)展的結(jié)果。FPGA器件集成度高、體積小,具有通過(guò)用戶編程實(shí)現(xiàn)專門應(yīng)用的功能。它允許電路設(shè)計(jì)者利用基于計(jì)算機(jī)的開(kāi)發(fā)平臺(tái),經(jīng)過(guò)設(shè)計(jì)輸入、仿真、測(cè)試和校驗(yàn),直到達(dá)到預(yù)期的結(jié)果。使用FPGA器件可以大大縮短系統(tǒng)的研制周期,減少資金投入。另外采用FPGA器件可以將原來(lái)的電路板級(jí)產(chǎn)品集成芯片級(jí)產(chǎn)品,從而降低了功耗,提高了可靠性,同時(shí)還可以很方便的對(duì)設(shè)計(jì)進(jìn)行在線修改。 該文在介紹了視頻格式轉(zhuǎn)換中的主要算法后,重點(diǎn)對(duì)去隔行、幀頻轉(zhuǎn)換、分辨率變換的FPGA綜合實(shí)現(xiàn)方案進(jìn)行了由簡(jiǎn)單到復(fù)雜的深入研究,分別給出了最簡(jiǎn)解決方案、基于非線性算法的解決方案和基于運(yùn)動(dòng)補(bǔ)償?shù)慕鉀Q方案。最簡(jiǎn)解決方案利用線性算法將去隔行,幀頻轉(zhuǎn)換,分辨率變換三項(xiàng)處理同時(shí)實(shí)現(xiàn),達(dá)到FPGA內(nèi)部資源和外部RAM耗用量都為最小的要求,是后續(xù)復(fù)雜方案的基礎(chǔ)。其中去隔行采用場(chǎng)合并方式,幀頻轉(zhuǎn)換采用幀重復(fù)方式,分辨率變換采用均勻插值方式。基于非線性算法的解決方案中加入了對(duì)靜止區(qū)域的判斷,靜止區(qū)域的輸出像素值直接選用相應(yīng)位置的已存輸入數(shù)據(jù),非靜止區(qū)域的輸出像素值通過(guò)對(duì)已存輸入數(shù)據(jù)進(jìn)行非線性運(yùn)算得出。基于運(yùn)動(dòng)補(bǔ)償?shù)慕鉀Q方案在對(duì)靜止區(qū)域進(jìn)行判斷和處理的基礎(chǔ)上,對(duì)欲生成的變頻后的場(chǎng)間插值幀進(jìn)行運(yùn)動(dòng)估計(jì),根據(jù)運(yùn)動(dòng)矢量得出非靜止區(qū)域的輸出像素值。其中為求得輸入場(chǎng)間相應(yīng)時(shí)間位置上的插值幀輸出數(shù)據(jù),該方案采用了自定義的前后向塊匹配運(yùn)動(dòng)估計(jì)方式,通過(guò)對(duì)三步搜索算法的高效實(shí)現(xiàn),將SAD 值進(jìn)行比較得出運(yùn)動(dòng)矢量。

    標(biāo)簽: FPGA 視頻格式轉(zhuǎn)換 算法研究

    上傳時(shí)間: 2013-07-19

    上傳用戶:米卡

  • 基于FPGA的圖像處理算法的研究與硬件設(shè)計(jì).rar

    隨著微電子技術(shù)的高速發(fā)展,實(shí)時(shí)圖像處理在多媒體、圖像通信等領(lǐng)域有著越來(lái)越廣泛的應(yīng)用。FPGA就是硬件處理實(shí)時(shí)圖像數(shù)據(jù)的理想選擇,基于FPGA的圖像處理專用芯片的研究將成為信息產(chǎn)業(yè)的新熱點(diǎn)。 本文以FPGA為平臺(tái),使用VHDL硬件描述語(yǔ)言設(shè)計(jì)并實(shí)現(xiàn)了中值濾波、順序?yàn)V波、數(shù)學(xué)形態(tài)學(xué)、卷積運(yùn)算和高斯濾波等圖像處理算法。在設(shè)計(jì)過(guò)程中,通過(guò)改進(jìn)算法和優(yōu)化結(jié)構(gòu),在合理地利用硬件資源的條件下,有效地挖掘出算法內(nèi)在的并行性,采用流水線結(jié)構(gòu)優(yōu)化算法,提高了頂層濾波模塊的處理速度。在中值濾波器的硬件設(shè)計(jì)中,本文提出了一種快速中值濾波算法,該算法大大節(jié)省了硬件資源,處理速度也很快。在數(shù)學(xué)形態(tài)學(xué)算法的硬件實(shí)現(xiàn)中,本文提出的最大值濾波和最小值濾波算法大大減少了硬件資源的占用率,適應(yīng)了流水線設(shè)計(jì)的要求,提高了圖像處理速度。 整個(gè)設(shè)計(jì)及各個(gè)模塊都在Altera公司的開(kāi)發(fā)環(huán)境QuartusⅡ以及第三方仿真軟件Modelsim上進(jìn)行了邏輯綜合以及仿真。綜合和仿真的結(jié)果表明,使用FPGA硬件處理圖像數(shù)據(jù)不僅能夠獲得很好的處理效果,達(dá)到較高的工作頻率,處理速度也遠(yuǎn)遠(yuǎn)高于軟件法處理圖像,可滿足實(shí)時(shí)圖像處理的要求。 本課題為圖像處理專用FPGA芯片的設(shè)計(jì)做了有益的探索性嘗試,對(duì)今后完成以FPGA圖像處理芯片為核心的實(shí)時(shí)圖像處理系統(tǒng)的設(shè)計(jì)有著積極的意義。

    標(biāo)簽: FPGA 圖像處理 法的研究

    上傳時(shí)間: 2013-06-08

    上傳用戶:shuiyuehen1987

  • 軟件無(wú)線電中FIR濾波器的Matlab設(shè)計(jì)及FPGA實(shí)現(xiàn).rar

    軟件無(wú)線電作為一種新的無(wú)線通信概念和體制,近年來(lái)隨著3G標(biāo)準(zhǔn)的提出,日益受到國(guó)內(nèi)外相關(guān)通信廠商的重視。尤其是基于軟件無(wú)線電和智能天線技術(shù)的TD-SCDMA作為通信史上第一個(gè)“中國(guó)標(biāo)準(zhǔn)”,有望扭轉(zhuǎn)多年來(lái)我國(guó)移動(dòng)通信制造業(yè)的被動(dòng)局面,是實(shí)現(xiàn)信息產(chǎn)業(yè)騰飛的一個(gè)絕好機(jī)會(huì)。軟件無(wú)線電使得通信體制具有很好的通用性、靈活性和可配置性,并使系統(tǒng)互聯(lián)和升級(jí)變得容易。本文以軟件無(wú)線電中的FIR濾波器為線索,貫穿了信號(hào)重構(gòu)、多抽樣率信號(hào)處理、積分梳狀濾波器等理論分析,重點(diǎn)闡釋了FIR濾波器的設(shè)計(jì)方法及濾波器的FPGA實(shí)現(xiàn)等技術(shù)問(wèn)題。 本文首先針對(duì)軟件無(wú)線電中的多抽樣率信號(hào)處理理論進(jìn)行了討論和分析。討論了軟件無(wú)線電中如何實(shí)現(xiàn)整數(shù)倍抽取、整數(shù)倍內(nèi)插、分?jǐn)?shù)倍抽樣率變換,并分析了網(wǎng)絡(luò)結(jié)構(gòu)的等效變換、多相濾波及積分梳狀濾波器的設(shè)計(jì)理論。 緊接著重點(diǎn)闡述了軟件無(wú)線電中FIR濾波器的設(shè)計(jì)理論,包括窗函數(shù)法、頻率抽樣法及等紋波法。分析了各種設(shè)計(jì)方法所能達(dá)到的性能指標(biāo)及優(yōu)缺點(diǎn),并結(jié)合工程實(shí)例給出了相關(guān)的Matlab程序。并對(duì)FIR濾波器結(jié)構(gòu)的選擇及系數(shù)字長(zhǎng)的確定等問(wèn)題進(jìn)行了分析。此外,也介紹了在Matlab進(jìn)行輔助設(shè)計(jì)時(shí)一些常用函數(shù)和命令的用法。 本文選用FPGA來(lái)實(shí)現(xiàn)中頻軟件無(wú)線電,F(xiàn)PGA與參數(shù)化ASIC、DSP比較有很多優(yōu)勢(shì),它不但在功耗、體積、成本方面優(yōu)于參數(shù)化ASIC、DSP,而且處理效率高、現(xiàn)場(chǎng)可編程性能良好。不同于DSP的單流處理方式,F(xiàn)PGA是多流并行處理,這種處理方式使FPGA能完成DSP難以實(shí)現(xiàn)的許多功能。在簡(jiǎn)單介紹了FPGA的一般原理,以及FPGA設(shè)計(jì)中的關(guān)鍵技術(shù)和在信號(hào)處理中的設(shè)計(jì)原則以后,重點(diǎn)介紹了FIR濾波器的FPGA實(shí)現(xiàn)方法。提出了分布式算法、加法器網(wǎng)絡(luò)法以及分段FIFO等實(shí)現(xiàn)方法。最后,提出了一種QuartusII與MATLAB聯(lián)合仿真的方法。此方法能夠直觀的檢驗(yàn)濾波器的濾波效果,提高設(shè)計(jì)效率。并結(jié)合工程實(shí)例詳盡的介紹了FIR濾波器的設(shè)計(jì)開(kāi)發(fā)流程。

    標(biāo)簽: Matlab FPGA FIR

    上傳時(shí)間: 2013-04-24

    上傳用戶:gengxiaochao

  • 基于FPGA的通用加擾算法(CSA)的設(shè)計(jì)和實(shí)現(xiàn).rar

    隨著數(shù)字視頻廣播的發(fā)展,觀眾將會(huì)面對(duì)越來(lái)越多綜合或?qū)iT頻道的選擇,欣賞到更高品質(zhì),更多服務(wù)的節(jié)目。而廣播業(yè)者則要為這些節(jié)目的版權(quán)購(gòu)買,制作而承受更高的成本,單純的廣告收入已經(jīng)不夠。要求對(duì)用戶收取一定的收視費(fèi)用,而另一方面,調(diào)查也顯示用戶是愿意預(yù)付一定費(fèi)用以獲得更好服務(wù)的。條件接受系統(tǒng)(Conditional Access system)就是為了商業(yè)目的而對(duì)某些廣播服務(wù)實(shí)施接入控制,決定一個(gè)數(shù)字接受設(shè)備能否將特定的廣播節(jié)目展現(xiàn)給最終用戶的系統(tǒng)。CA技術(shù)要求既能使用戶自由選擇收看節(jié)目又能保護(hù)廣播業(yè)者的利益,確算只有已支付了或即將支付費(fèi)用的用戶才能收看到所選的電視節(jié)目。在數(shù)字電視領(lǐng)域中,CA系統(tǒng)無(wú)疑將成為發(fā)展新服務(wù)的必需條件。但是在不同的運(yùn)營(yíng)商可能會(huì)使用不同的CA系統(tǒng),在不同的CA系統(tǒng)之間進(jìn)行互操作所必需共同遵守的最基本條件是:通用的加擾算法。每個(gè)用戶接收設(shè)備中應(yīng)集成相應(yīng)的解擾模塊。在我國(guó)國(guó)家標(biāo)準(zhǔn)--數(shù)字電視條件接收系統(tǒng)GY/Z 175-2001的附錄H中有詳細(xì)的描述。 FPGA是英文Field Programmable Gate Array的縮寫,即現(xiàn)場(chǎng)可編程門陣列,它是在PAL、GAL、EPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。可以說(shuō),F(xiàn)PGA芯片是小批量系統(tǒng)提高系統(tǒng)集成度、可靠性的最佳選擇之一。 首先本文簡(jiǎn)要介紹CA系統(tǒng)的目的和組成,F(xiàn)PGA的結(jié)構(gòu)和原理,優(yōu)勢(shì)。然后介紹了利用FPGA來(lái)實(shí)現(xiàn)CA系統(tǒng)主要組成部分即加擾的原理和步驟,分析算法,劃分邏輯結(jié)構(gòu),軟件仿真,劃分硬件模塊,硬件性能分析,驗(yàn)證平臺(tái)構(gòu)建,硬件實(shí)現(xiàn)等。 然后對(duì)以上各個(gè)部分做詳細(xì)的闡述。同時(shí)為了指導(dǎo)FPGA設(shè)計(jì),給出了FPGA的結(jié)構(gòu)和原理與FPGA設(shè)計(jì)的基本原則、設(shè)計(jì)的基本技巧、設(shè)計(jì)的基本流程; 最后給出了該加擾系統(tǒng)的測(cè)試與驗(yàn)證方法以及驗(yàn)證和測(cè)試結(jié)果。

    標(biāo)簽: FPGA CSA 算法

    上傳時(shí)間: 2013-06-22

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  • 圖像縮放算法研究及其FPGA實(shí)現(xiàn).rar

    圖像縮放在圖像處理領(lǐng)域中,發(fā)揮著重要作用。圖像的分辨率調(diào)整和格式變換,都需要用到圖像縮放技術(shù)。隨著多媒體技術(shù)和大規(guī)模集成電路的發(fā)展,利用硬件實(shí)現(xiàn)視頻圖像無(wú)級(jí)縮放已成為圖像處理研究的一個(gè)重要課題。 圖像縮放通常由插值算法實(shí)現(xiàn)。傳統(tǒng)的插值算法由于實(shí)現(xiàn)原理的局限性,在縮放時(shí)容易引起邊緣鋸齒或細(xì)節(jié)模糊現(xiàn)象。針對(duì)傳統(tǒng)插值算法的這個(gè)不足,出現(xiàn)了許多基于邊緣改進(jìn)的算法。但這些算法一般只能完成2k倍數(shù)插值,無(wú)法真正做到基于邊緣的無(wú)級(jí)縮放。 為了實(shí)現(xiàn)基于邊緣改進(jìn)的無(wú)級(jí)縮放,本文做了如下五個(gè)方面的研究工作: 1.系統(tǒng)回顧了圖像縮放技術(shù),包括傳統(tǒng)圖像縮放技術(shù)和多邊緣檢測(cè)插值,分析了這些圖像縮放技術(shù)的優(yōu)缺點(diǎn)。 2.重點(diǎn)研究了新興的方向多項(xiàng)式插值算法,該算法能夠真正完成基于邊緣改進(jìn)的無(wú)級(jí)縮放。 3.提出改進(jìn)的方向多項(xiàng)式插值算法(IOPI算法),該算法針對(duì)硬件實(shí)現(xiàn),做了兩個(gè)方面改進(jìn):提出EDV算法,簡(jiǎn)化邊緣方向的確定;提出Cubic6逼近插值算法(A-Cubic6算法),改善平坦區(qū)域縮放效果。其中的EDV算法通過(guò)加減、比較模塊,完成邊緣方向的確定。相比原算法中的乘除法、直方圖計(jì)算,大大簡(jiǎn)化了硬件實(shí)現(xiàn),降低了硬件實(shí)現(xiàn)成本。A-Cubic6算法利用查找表簡(jiǎn)化了Cubic6點(diǎn)插值算法的實(shí)現(xiàn),而且明顯改善了非邊緣區(qū)域的縮放效果。 4.研究縮放算法與圖像質(zhì)量的評(píng)價(jià)方法。比較、分析各算法的軟件仿真結(jié)果,得出結(jié)論:本文提出的IOPI算法在平坦區(qū)域和邊緣區(qū)域都具有比其它算法更突出的效果。 5.結(jié)合實(shí)時(shí)視頻處理要求,研究了IOPI算法的FPGA實(shí)現(xiàn)。已完成最近鄰域插值和A-Cubic6算法的FPGA實(shí)現(xiàn),可以在硬件平臺(tái)上穩(wěn)定工作。

    標(biāo)簽: FPGA 圖像 算法研究

    上傳時(shí)間: 2013-06-05

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