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數(shù)字簽名算法

  • 匯編語言程序設計基礎

     將正數n插入一個已整序的字數組的正確位置。算法:  將數組中數逐個與N比較,Si為指針若N<Ki,則Ki下移一個單元若NKi,則插在Ki的下一個單元,并結束臨界條件:若NKn,則插入Kn的下一個單元若N<K1,則K1~Kn后移一個單元, N插在第一個單元循環控制:計數控制元素個數=((字末地址-字首地址) / 2) +1            字數                = (字節末地址-字節首地址) +1           字節數地址邊界控制結束地址為ARRAY_HEAD特征值控制:   表示結束條件的值

    標簽: 匯編語言 程序設計

    上傳時間: 2013-12-26

    上傳用戶:haiya2000

  • PCtoLCD2002完美版_漢字字模生成軟件

    更新說明:   1。界面采用新的字體,不會再有那種難看的黑色粗體字,比以前的要漂亮多了。   2。加入全面的提示幫助,盡量減少普通用戶的各種疑惑。   3。修正生成文件的擴展名的一些BUG,不會總是加上FON的擴展名了。   4。修正生成字模數據的一些格式BUG,現在生成的C51格式字模數據基本上可以直接粘貼到源程序中使用而不需要修改了   5。加入新的字模數據格式調整項,允許用戶更自由的定制自己需要的數據格式   6。最重要的更新:全面支持保存當前設置功能,用戶設置的字模格式,主窗口狀態和字庫生成窗口選項信息均可保存,下一次打開窗口時不用重新設置(由于要全面更改程序使用的變量結構,所以這部分化了很多時間)。   7。修正了新建圖象時會自動跳到圖形模式的BUG   8。增加輸出緊湊格式數據選項,可以生成不包含空白行的字模數據。   9。完善了每行數據顯示個數的功能,可以任意設置每行顯示的數據個數,并同時可以設置每行索引數據顯示個數。   10。修正了取模說明的一些錯誤,并改動了格式。   11。現在當用戶選擇10進制輸出時,會自動去掉生成字模數據前的“0x",或后面的“H”,選擇16進制時則會自動加上。   12。對各個窗體重新設計以全面適應最大化的需要,如果您覺得當前窗口不夠大,可以最大化使用。   13。增加生成英文點陣字庫功能,可自動生成ASCII碼從0-127的任意點陣字庫,使用方法同生成國標點陣字庫功能。   14。再次優化代碼,去掉各種調試信息,使程序速度再快一些。   15。還有一些細微的調整我記不清了…… 需要注意的地方:  在測試的過程中我發現了一個問題:在WIN98或WINME下當用戶需要生成特大點陣的字模時(例如320*320,1024*768的漢字字模),此時由于數據量非常龐大,而WIN98/WINME會有64K的數據容量限制,所以在主窗口中是無法得到全部的字模數據的,這時您需要使用字庫生成功能,通過形成一個數據文件才能得到完整的字模數據。   另外生成特大字模時如果出現“內存不足”的提示,請把液晶仿真面板的像素點改小一些,這樣可以節省內存。

    標簽: PCtoLCD 2002 漢字 字模生成

    上傳時間: 2013-10-17

    上傳用戶:fengzimili

  • 基于DSP的H.264運動估計算法研究

    采用基于TI公司高性能Davinci系列TMS320DM6437處理器的SEED-DEC6437 EVM板作為主要硬件平臺,在DSP開發環境CCS3.3中采用C語言和匯編語言混合編程實現運動估計算法的DSP移植,并加入人機接口,使用DSP/BIOS調度多個任務,從而實現了從軟件平臺到硬件平臺的移植,成功搭建了一個基于運動估計算法的DSP應用系統。研究結果表明,使用DSP平臺可以使得運動估計算法的實時性更好。

    標簽: DSP 264 運動估計 算法研究

    上傳時間: 2014-11-18

    上傳用戶:萍水相逢

  • 改進的Max-Log-Map譯碼算法的DSP實現

    針對傳統的Max-Log-Map譯碼算法時效性差、存儲空間開銷大的特點,本文對傳統的Max-Log-Map譯碼算法進行了改進。改進的算法對前、后向度量使用了蝶形結構圖,便于DSP實現;將原始幀均分為多個子塊,設計子塊間的并行運算以減小系統延遲;子塊內采取進一步地優化措施,以減小數據存儲量并提高譯碼速率。在DSP C6416平臺上的仿真結果表明了算法的可實現性與可靠性。

    標簽: Max-Log-Map DSP 譯碼算法

    上傳時間: 2013-11-08

    上傳用戶:a296386173

  • 數字常規調幅解調器的DSP算法及實現

    文中基于帶通信號的低通等效原理,采用數字希爾伯特濾波器實現了數字包絡檢波器,并在CCS中實現了軟件調試。其中,通過使用LinkforCCS和DSP的函數庫DSPLIB縮短了程序的開發時間,提高了算法的實現效率。

    標簽: DSP 數字 調幅解調器 算法

    上傳時間: 2013-10-09

    上傳用戶:gaoqinwu

  • 基于CCS的DSP算法仿真實驗設計

    摘要:簡要介紹了CCS軟件的主要功能,利用CCS軟件,設計數字信號處理實驗課程,實現了FFT算法的譜分析和FIR濾波器。

    標簽: CCS DSP 算法 仿真實驗

    上傳時間: 2013-10-22

    上傳用戶:huanglang

  • DSP算法大全C語言版本

    DSP算法大全C語言版本

    標簽: DSP C語言 算法 版本

    上傳時間: 2013-10-27

    上傳用戶:zhyiroy

  • 數字信號處理選擇指南pdf

    德州儀器 (TI) 處理器幾乎能滿足您所能想到的各種應用需求。我們陣營強大的處理器系列擁有各種價位、性能及功耗的產品可供選擇,能滿足幾乎任何數字電子設計的要求。利用 TI 廣博的系統專業知識、針對外設設計的全方位支持以及隨時可方便獲得的全套軟件與配套模擬組件,您能夠實現無窮無盡的設計方案。德州儀器 2008 年第二季度 數字信號處理選擇指南TI 數字信號處理技術介紹1Ô數字媒體處理器OMAP應用處理器C6000數字信號處理器C5000數字信號處理器C2000數字信號處理器MSP430微控制器音頻汽車通信工業醫療安全監控視頻無線主要特性完整的定制型視頻解決方案低功耗與高性能高性能低功耗與高性能結合高性能與高集成度可實現更環保的工業應用超低功耗達芬奇數字媒體處理器:針對數字視頻而精心優化達芬奇 (DaVinci) 技術包括可擴展的可編程信號處理片上系統 (SoC)、加速器與外設,專為滿足各種視頻終端設備在性價比與特性方面的要求進行了優化。最新的 OMAP™ 應用處理器:最佳的通用多媒體與圖形功能TI 高度可擴展的 OMAP 平臺能夠以任何單芯片組合實現業界通用多媒體與圖形處理功能的最佳組合。最新推出的四款 OMAP35x 器件的目標應用非常廣泛,其中包括便攜式導航設備、因特網設備、便攜式媒體播放器以及個人醫療設備等。最高性能:TMS320C6000™ DSP平臺C6000™ DSP 平臺可提供業界最高性能的定點與浮點 DSP,理想適用于視頻、影像、寬帶基礎局端以及高性能音頻等應用領域。低功耗與高性能相結合:TMS320C5000™ DSP 平臺C5000™ DSP 平臺不僅可提供業界最低的待機功耗,同時還支持高級自動化電源管理,能夠充分滿足諸如數字音樂播放器、VoIP、免提終端附件、GPS 接收機以及便攜式醫療設備等個人及便攜式產品的需求。結合類似 MCU 的控制功能與DSP 的高性能:TMS320C2000™數字信號控制器C2000™ 數字信號控制器 (DSC) 平臺融合了控制外設的集成功能與微控制器 (MCU) 的易用性,以及 TI 先進DSP 技術的處理能力和 C 語言編程效率。C2000 DSC 理想適用于嵌入式工業應用,如數字馬達控制、數字電源以及智能傳感器等。MSP430 超低功耗微控制器平臺TI MSP430 系列超低功耗 16 位 RISC 混合信號處理器可為電池供電的測量應用提供具有終極性能的解決方案。TI充分發揮自身在混合信號與數字技術領域卓越的領先優勢, 推出的MSP430 使系統設計人員不僅能夠同時實現與模擬信號、傳感器與數字組件的接口相連,而且還能實現無與倫比的低功耗。輕松易用的軟件與開發工具對于加速 DSP 產品開發而言,TMS320™ DSP 獲得了 eXpressDSP™ 軟件與開發工具的支持,其中包括Code Composer Studio™ IDE、DSP/BIOS™內核、TMS320 DSP 算法標準以及眾多可重復使用的模塊化軟件等,均來自業界最大規模開發商網絡。配套模擬產品TI 可提供各種配套的數據轉換器、電源管理、放大器、接口與邏輯產品,能夠充分滿足您設計的整體需求。

    標簽: 數字信號處理 選擇指南

    上傳時間: 2013-10-14

    上傳用戶:jasson5678

  • 一種在FPGA上實現的FIR濾波器的資源優化算法

    在數字濾波器中,FIR濾波器是一種結構簡單且總是穩定的濾波器,同時也只有FIR濾波器擁有線性相位的特性。傳統的直接型濾波器運算速度過慢,而改進型的DA結構的濾波器需要過高的芯片面積消耗大量的邏輯資源很難達到運算速度以及邏輯資源節約的整體優化。本文提出了一種基于RAG算法的FIR濾波器,與傳統的基于DA算法的濾波器結構的濾波器相比,RAG算法簡化了FIR濾波器乘法模塊的結構,減少了邏輯資源的消耗和硬件實現面積,提高了計算速度。本文設計的16階FIR濾波器用VerilogHDL進行描述,并綜合到Altera公司的CycloneⅡ系列FPGA中。仿真實驗表明基于RAG算法的FIR濾波器達到了邏輯資源的節約和運算速度的提高的整體優化效果。

    標簽: FPGA FIR 濾波器 優化算法

    上傳時間: 2014-12-28

    上傳用戶:feilinhan

  • 算法設計到硬件邏輯的實現 - 實驗練習與Verilog語法手冊

    算法設計到硬件邏輯的實現 - 實驗練習與Verilog語法手冊

    標簽: Verilog 算法設計 硬件 實驗

    上傳時間: 2014-01-27

    上傳用戶:dddddd55

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