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數(shù)(shù)字頻率計(jì)(jì)的設(shè)(shè)計(jì)(jì)與制作

差分線對的PCB設(shè)計(jì)要點(diǎn)

信號完整性是高速數(shù)字系統(tǒng)中要解決的一個首要問題之一，如何在高速PCB 設(shè)計(jì)過程中充分考慮信號完整性因素,并采取有效的控制措施,已經(jīng)成為當(dāng)今系統(tǒng)設(shè)計(jì)能否成功的關(guān)鍵。在這方面，差分線對具有很多優(yōu)勢，比如更高的比特率 ,更低的功耗 ,更好的噪聲性能和更穩(wěn)定的可靠性等。目前，差分線對在高速數(shù)字電路設(shè)計(jì)中的應(yīng)用越來越廣泛，電路中最關(guān)鍵的信號往往都要采用差分線對設(shè)計(jì)。介紹了差分線對在PCB 設(shè)計(jì)中的一些要點(diǎn)，并給出具體設(shè)計(jì)方案。

標(biāo)簽： PCB 差分線

上傳時間： 2014-12-24

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PCB設(shè)計(jì)中SI的仿真與分析

討論了高速PCB 設(shè)計(jì)中涉及的定時、反射、串?dāng)_、振鈴等信號完整性( SI)問題,結(jié)合CA2DENCE公司提供的高速PCB設(shè)計(jì)工具Specctraquest和Sigxp,對一采樣率為125MHz的AD /DAC印制板進(jìn)行了仿真和分析,根據(jù)布線前和布線后的仿真結(jié)果設(shè)置適當(dāng)?shù)募s束條件來控制高速PCB的布局布線,從各個環(huán)節(jié)上保證高速電路的信號完整性。

標(biāo)簽： PCB 仿真分

上傳時間： 2013-11-06

上傳用戶：zhang97080564
DDR記憶體電源

CMOS 邏輯系統(tǒng)的功耗主要與時脈頻率、系統(tǒng)內(nèi)各閘極輸入電容及電源電壓有關(guān)，裝置尺寸縮小後，電源電壓也隨之降低，使得閘極大幅降低功耗。這種低電壓裝置擁有更低的功耗和更高的運(yùn)作速度，因此系統(tǒng)時脈頻率可升高至 Ghz 範(fàn)圍。

標(biāo)簽： DDR 記憶體電源

上傳時間： 2013-10-14

上傳用戶：immanuel2006
光伏并網(wǎng)逆變器的定頻滯環(huán)電流控制新方法

提出一種用于光伏發(fā)電系統(tǒng)與公用電網(wǎng)并網(wǎng)的逆變器定頻滯環(huán)電流控制新方法, 該方法首先基于電網(wǎng)線電壓空間矢量將復(fù)平面分為6 個扇區(qū), 在每個扇區(qū)內(nèi)實(shí)現(xiàn)兩相開關(guān)解耦分別控制相應(yīng)的線電流; 然后, 在控制相的下一個線電流誤差周期到來時, 計(jì)算并調(diào)節(jié)下一周期的滯環(huán)寬度以達(dá)到定頻滯環(huán)電流跟蹤, 改善輸出電流波形, 提高控制精度。該方法的主要特點(diǎn)是不需要額外的模擬電路便可以實(shí)現(xiàn)開關(guān)頻率的穩(wěn)定。利用Matlab 進(jìn)行建模, 仿真結(jié)果證明了該方法對穩(wěn)定滯環(huán)開關(guān)頻率是有效的, 同時也表明該方法應(yīng)用于光伏并網(wǎng)逆變器是可行的。

標(biāo)簽： 光伏并網(wǎng) 逆變器定頻電流控制

上傳時間： 2013-10-28

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用單片機(jī)AT89C51改造普通雙桶洗衣機(jī)

用單片機(jī)AT89C51改造普通雙桶洗衣機(jī)：AT89C2051作為AT89C51的簡化版雖然去掉了P0、P2等端口，使I/O口減少了，但是卻增加了一個電壓比較器，因此其功能在某些方面反而有所增強(qiáng)，如能用來處理模擬量、進(jìn)行簡單的模數(shù)轉(zhuǎn)換等。本文利用這一功能設(shè)計(jì)了一個數(shù)字電容表，可測量容量小于2微法的電容器的容量，采用3位半數(shù)字顯示，最大顯示值為1999，讀數(shù)單位統(tǒng)一采用毫微法（nf），量程分四檔，讀數(shù)分別乘以相應(yīng)的倍率。電路工作原理本數(shù)字電容表以電容器的充電規(guī)律作為測量依據(jù)，測試原理見圖1。電源電路圖。壓E+經(jīng)電阻R給被測電容CX充電，CX兩端原電壓隨充電時間的增加而上升。當(dāng)充電時間t等于RC時間常數(shù)τ時，CX兩端電壓約為電源電壓的63.2%，即0.632E+。數(shù)字電容表就是以該電壓作為測試基準(zhǔn)電壓，測量電容器充電達(dá)到該電壓的時間，便能知道電容器的容量。例如，設(shè)電阻R的阻值為1千歐，CX兩端電壓上升到0.632E+所需的時間為1毫秒，那么由公式τ=RC可知CX的容量為1微法。測量電路如圖2所示。A為AT89C2051內(nèi)部構(gòu)造的電壓比較器，AT89C2051 圖2 的P1.0和P1.1口除了作I/O口外，還有一個功能是作為電壓比較器的輸入端，P1.0為同相輸入端，P1.1為反相輸入端，電壓比較器的比較結(jié)果存入P3.6口對應(yīng)的寄存器，P3.6口在AT89C2051外部無引腳。電壓比較器的基準(zhǔn)電壓設(shè)定為0.632E+，在CX兩端電壓從0升到0.632E+的過程中，P3.6口輸出為0，當(dāng)電池電壓CX兩端電壓一旦超過0.632E+時，P3.6口輸出變?yōu)?。以P3.6口的輸出電平為依據(jù)，用AT89C2051內(nèi)部的定時器T0對充電時間進(jìn)行計(jì)數(shù)，再將計(jì)數(shù)結(jié)果顯示出來即得出測量結(jié)果。整機(jī)電路見圖3。電路由單片機(jī)電路、電容充電測量電路和數(shù)碼顯示電路等圖3 部分組成。AT89C2051內(nèi)部的電壓比較器和電阻R2-R7等組成測量電路，其中R2-R5為量程電阻，由波段開關(guān)S1選擇使用，電壓比較器的基準(zhǔn)電壓由5V電源電壓經(jīng)R6、RP1、R7分壓后得到，調(diào)節(jié)RP1可調(diào)整基準(zhǔn)電壓。當(dāng)P1.2口在程序的控制下輸出高電平時，電容CX即開始充電。量程電阻R2-R5每檔以10倍遞減，故每檔顯示讀數(shù)以10倍遞增。由于單片機(jī)內(nèi)部P1.2口的上拉電阻經(jīng)實(shí)測約為200K，其輸出電平不能作為充電電壓用，故用R5兼作其上拉電阻，由于其它三個充電電阻和R5是串聯(lián)關(guān)系，因此R2、R3、R4應(yīng)由標(biāo)準(zhǔn)值減去1K，分別為999K、99K、9K。由于999K和1M相對誤差較小，所以R2還是取1M。數(shù)碼管DS1-DS4、電阻R8-R14等組成數(shù)碼顯示電路。本機(jī)采用動態(tài)掃描顯示的方式，用軟件對字形碼譯碼。P3.0-P3.5、P3.7口作數(shù)碼顯示七段筆劃字形碼的輸出，P1.3-P1.6口作四個數(shù)碼管的動態(tài)掃描位驅(qū)動碼輸出。這里采用了共陰數(shù)碼管，由于AT89C2051的P1.3-P1.6口有25mA的下拉電流能力，所以不用三極管就能驅(qū)動數(shù)碼管。R8-R14為P3.0-P3.5、P3.7口的上拉電阻，用以驅(qū)動數(shù)碼管的各字段，當(dāng)P3的某一端口輸出低電平時其對應(yīng)的字段筆劃不點(diǎn)亮，而當(dāng)其輸出高電平時，則對應(yīng)的上拉電阻即能點(diǎn)亮相應(yīng)的字段筆劃。

標(biāo)簽： 89C C51 AT 89

上傳時間： 2013-12-31

上傳用戶：ming529
MCS-51并行口的擴(kuò)展

MCS51單片機(jī)內(nèi)部有4個并行口，當(dāng)內(nèi)部并行口不夠用時可以外擴(kuò)并行口芯片。可外擴(kuò)的并行口芯片很多，分成2類：不可編程的并行口芯片（74LS3734和74LS245）和可編程的并行口芯片（8255）。7.1 不可編程并行口芯片的擴(kuò)展7.1.1 74LS373的擴(kuò)展1、 74LS245的結(jié)構(gòu)2、 74LS245的引腳3、 74LS245與89C51的連接 7.1.2 74LS245的擴(kuò)展 7.2 可編程并行口芯片的擴(kuò)展 7.2.1 8255的結(jié)構(gòu)7.2.2 8255的引腳7.2.3 8255的工作方式7.2.4 8255的控制字7.2.5 8255的應(yīng)用

標(biāo)簽： MCS 51 并行口擴(kuò)展

上傳時間： 2013-11-13

上傳用戶：lnnn30
基于Socket網(wǎng)絡(luò)編程的遠(yuǎn)程物流防偽系統(tǒng)的設(shè)計(jì)

為了實(shí)現(xiàn)數(shù)據(jù)采集終端與遠(yuǎn)程服務(wù)器即時通信的需求，提出了一種基于Socket網(wǎng)絡(luò)編程的遠(yuǎn)程物流防偽系統(tǒng)。該系統(tǒng)在Visual Studio結(jié)合SQL Server的開發(fā)平臺下，采用Socket套接字以及GPRS無線通信的方式實(shí)現(xiàn)數(shù)據(jù)采集終端對遠(yuǎn)程服務(wù)器的查詢功能。運(yùn)行結(jié)果表明：該系統(tǒng)具有操作方便、使用成本低和安裝容易等多項(xiàng)優(yōu)點(diǎn)。在商品物流中，用戶能快速、及時查詢到商品的物流信息以及真?zhèn)涡畔ⅲ?該系統(tǒng)對企業(yè)物流跟蹤有著重要的意義。

標(biāo)簽： Socket 網(wǎng)絡(luò)編程遠(yuǎn)程防偽系統(tǒng)

上傳時間： 2013-12-20

上傳用戶：windypsm
基于IP無線網(wǎng)絡(luò)FGS視頻傳輸?shù)亩喑朔e碼方案

研究基于IP 無線網(wǎng)絡(luò)中精細(xì)粒度可伸縮性( FGS) 視頻的傳輸。基于包交換的IP 無線網(wǎng)絡(luò)通常由兩段鏈路組成: 有線鏈路和無線鏈路。為了處理這種混合網(wǎng)絡(luò)中不同類型數(shù)據(jù)包的丟失情況, 對FGS 視頻增強(qiáng)層數(shù)據(jù)運(yùn)用了一個具有比特平面間不平等差錯保護(hù)(BPUEP) 的多乘積碼前向糾錯(MPFEC) 方案進(jìn)行信道編碼。對FGS 增強(qiáng)層每一個比特平面(BP) , 在傳輸層, 采用里德—索羅蒙碼(RS) 提供比特平面間的保護(hù); 而在鏈路層, 則運(yùn)用循環(huán)冗余校驗(yàn)碼(CRC) 串聯(lián)率兼容穿孔卷積碼(RCPC) 提供數(shù)據(jù)包內(nèi)保護(hù)。還提出了一個率失真優(yōu)化的信源—信道聯(lián)合編碼的碼率配置方案, 仿真結(jié)果顯示出該方案在提高接收端視頻質(zhì)量方面的優(yōu)勢。

標(biāo)簽： FGS 無線網(wǎng)絡(luò) 乘積碼方案

上傳時間： 2013-11-14

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6位數(shù)自動定位控制計(jì)數(shù)器（72*72mm）

特點(diǎn) 顯示值范圍-199999至999999位數(shù) 最高輸入頻率 5KHz 90度相位差加減算具有提高解析度4倍功能輸入脈波具有預(yù)設(shè)刻度功能定位基準(zhǔn)值可任意設(shè)定比較磁滯值可任意設(shè)定數(shù)位化指撥設(shè)定操作簡易 3組繼電器輸出功能 2:主要規(guī)格脈波輸入型式: Jump-pin selectable current sourcing(NPN) or current sinking (PNP) 脈波觸發(fā)電位: HI bias (CMOS) (VIH=7.5V, VIL=5.5V) LO bias (TTL) (VIH=3.7V, VIL=2.0V) 最高輸入頻率: <5KHz 定位置范圍: -199999 to 999999 second adjustabl 比較磁滯范圍: 0 to 9999 adjustable 繼電器容量: AC 250V-5A, DC 30V-7A 顯示值范圍: -199999 to 999999 顯示幕: Red high efficiency LEDs high 9.2mm (.36") 參數(shù)設(shè)定方式: Touch switches 感應(yīng)器電源: 12VDC +/-3%(<60mA) 記憶方式: Non-volatile E2PROM memory 絕緣耐壓能力: 2KVac/1 min. (input/output/power) 1600Vdc (input/output) 使用環(huán)境條件: 0-50℃(20 to 90% RH non-condensed) 存放環(huán)境條件: 0-70℃(20 to 90% RH non-condensed) CE認(rèn)證: EN 55022:1998/A1:2000 Class A EN 61000-3-2:2000 EN 61000-3-3:1995/A1:2001 EN 55024:1998/A1:2001

標(biāo)簽： 72 mm 自動定位控制

上傳時間： 2014-12-03

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AAC高級音頻解碼基于FPGA上的SOC設(shè)計(jì)與實(shí)現(xiàn)

本文從數(shù)字音頻壓縮技術(shù)和VLSI 技術(shù)近些年的發(fā)展介紹出發(fā)，強(qiáng)調(diào)了數(shù)字音頻壓縮技術(shù)的發(fā)展離不開VLSI 設(shè)計(jì)，同時也促進(jìn)VLSI的發(fā)展。這才使得現(xiàn)在音頻的壓縮率越來越高的同時，音樂的質(zhì)量也得到了很大的提升，而本文就主要介紹了一種壓縮率非常高的最新音頻格式：AAC 的音頻解碼器在FPGA 上的設(shè)計(jì)以及實(shí)現(xiàn)。

標(biāo)簽： FPGA AAC SOC 音頻解碼

上傳時間： 2013-10-26

上傳用戶：邶刖