隨著半導體制造技術不斷的進步，SOC(System On a Chip)是未來IC產業技術研究關注的重點。由于SOC設計的日趨復雜化，芯片的面積增大，芯片功能復雜程度增大，其設計驗證工作也愈加繁瑣。復雜ASIC設計功能驗證已經成為整個設計中最大的瓶頸。 使用FPGA系統對ASIC設計進行功能驗證，就是利用FPGA器件實現用戶待驗證的IC設計。利用測試向量或通過真實目標系統產生激勵，驗證和測試芯片的邏輯功能。通過使用FPGA系統，可在ASIC設計的早期，驗證芯片設計功能，支持硬件、軟件及整個系統的并行開發，并能檢查硬件和軟件兼容性，同時還可在目標系統中同時測試系統中運行的實際軟件。FPGA仿真的突出優點是速度快，能夠實時仿真用戶設計所需的對各種輸入激勵。由于一些SOC驗證需要處理大量實時數據，而FPGA作為硬件系統，突出優點是速度快，實時性好。可以將SOC軟件調試系統的開發和ASIC的開發同時進行。 此設計以ALTERA公司的FPGA為主體來構建驗證系統硬件平臺，在FPGA中通過加入嵌入式軟核處理器NIOS II和定制的JTAG(Joint Test ActionGroup)邏輯來構建與PC的調試驗證數據鏈路，并采用定制的JTAG邏輯產生測試向量，通過JTAG控制SOC目標系統，達到對SOC內部和其他IP(IntellectualProperty)的在線測試與驗證。同時，該驗證平臺還可以支持SOC目標系統后續軟件的開發和調試。 本文介紹了芯片驗證系統，包括系統的性能、組成、功能以及系統的工作原理；搭建了基于JTAG和FPGA的嵌入式SOC驗證系統的硬件平臺，提出了驗證系統的總體設計方案，重點對驗證系統的數據鏈路的實現進行了闡述；詳細研究了嵌入式軟核處理器NIOS II系統，并將定制的JTAG邏輯與處理器NIOS II相結合，構建出調試與驗證數據鏈路；根據芯片驗證的要求，設計出軟核處理器NIOS II系統與PC建立數據鏈路的軟件系統，并完成芯片在線測試與驗證。 本課題的整體任務主要是利用FPGA和定制的JTAG掃描鏈技術，完成對國產某型DSP芯片的驗證與測試，研究如何構建一種通用的SOC芯片驗證平臺，解決SOC驗證系統的可重用性和驗證數據發送、傳輸、采集的實時性、準確性、可測性問題。本文在SOC驗證系統在芯片驗證與測試應用研究領域，有較高的理論和實踐研究價值。
上傳時間： 2013-05-25
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SOC(System On a Chip)又稱為片上系統，是指將微處理器、模擬IP核、數字IP核和存儲器（或片外存儲器接口）集成在單一芯片上。SOC產品不斷朝著體積小、功能強的方向發展，芯片內部整合越來越多的功能。ARM架構作為嵌入式系統流行的應用，其應用的擴展面臨軟件擴充的問題，而X86平臺上卻有很多軟件資源。若將已有的X86軟件移植到ARM平臺，則可以在一定程度上解決軟件擴充的問題。 本論文針對X86指令在ARM中兼容的應用，以智能手機的應用為例，提出了基于ARM嵌入式平臺，使用X86指令到ARM指令的二進制翻譯模塊，達到對X86指令的兼容。主要研究ARM公司的片上總線系統——AMBA AHB和AMBA APB片上總線標準。對Multi-layer總線結構進行研究，分析了Multi-layer AHB系統中使用的Bus Matrix模塊的結構，從Bus Matrix模塊的內部矩陣結構和系統架構兩方面針對系統的特點作出優化。 最后介紹了論文采用的事物級模型與Verilog HDL協同仿真的方法和系統的控制過程，通過仿真結果的比較，驗證了利用二進制翻譯模塊實現X86指令執行的可行性和優化后的架構較適合于X86翻譯系統的應用。
上傳時間： 2013-06-28
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隨著半導體技術與數字集成電路(微處理器、存貯器以及標準邏輯門電路等)技術的迅速發展，特別是隨著計算機技術的發展，在工業生產和科學技術研究的各行各業中，人們利用PC機的強大處理功能代替傳統儀器的某些部件，開發出各種測量儀器(虛擬儀器)，傳統儀器的數字邏輯部分多是采用分立集成電路(IC)組成，分立IC愈多，給系統的電路設計、調試及維護帶來諸多不便。而隨著EDA技術的飛速發展，大規模可編程邏輯芯片CPLD / FPGA應運而生。這類芯片可以替代幾十甚至上百塊通用IC芯片，而且，因其可用硬件描述語言進行芯片設計、支持在線編程和在系統編程等優點而備受青睞。本課題主要是用FPGA實現一個驗證平臺。用于SOC及IPCore的驗證。用FPGA系統驗證板實現在實際硬件環境中的驗證可以彌補ASIC 設計流程中仿真的不足, 通過該驗證也可以加快ASIC設計且降低由于邏輯問題所造成ASIC 開發中的成本損耗。本文首先介紹了EDA技術的發展，然后介紹了FPGA，SOC,和IPCore的一些基本概念，分析了FPGA在現代集成電路設計領域的一些應用。最后，具體設計了一塊用設計驗證的開發板，并討論了其設計結構，流程及驗證方法。
上傳時間： 2013-05-16
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隨著系統芯片(SOC)設計復雜度不斷增加，使得縮短面市時間的壓力越來越大。雖然IP核復用大大減少了SOC的設計時間，但是SOC的驗證仍然非常復雜耗時。SOC和ASIC的最大不同之處在于它的規模和復雜的系統性，除了大量硬件模塊之外，SOC還需要大量的同件和軟件，如操作系統，驅動程序以及應用程序等。面對SOC數目眾多的硬件模塊，復雜的嵌入式軟件，由于軟件仿真速度和仿真模犁的局限性，驗證往往難以達到令人滿意的要求，耗費了大最的時間，將給系統芯片的上市帶來嚴重的影響。為了減少此類情況的發生，在流樣片之前，進行基于FPGA的系統原型驗證，即在FPGA上快速地實現SOC設計中的硬件模塊，讓軟件模塊在真正的硬件環境中高速運行，從而實現SOC設計的軟硬件協同驗證。這種方法已經成為SOC設計流程前期階段常用的驗證方法。 在簡要分析幾種業內常用的驗證技術的基礎上，本文重點闡述了基于FPGA的SOC驗證流程與技術。結合Mojox數碼相機系統芯片(以下簡稱為Mojox SOC)的FPGA原型驗證平臺的設計，介紹了Mojox FPGA原型驗證平臺的硬件設計過程和Mojox SOC的FPGA原型實現，并采用基于模塊的FPGA設計實現方法，加快了原型驗證的工作進程。 本文還介紹了Mojox SOC中ARM固件和PC應用軟件等原型軟件的設計實現以及原型驗證平臺的軟硬協同驗證的過程。通過軟硬協同驗證，本文實現了PC機對整個驗證平臺的摔制，達到了良好的驗證效果，且滿足了預期的設計要求。
上傳時間： 2013-07-02
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C8051F單片機是完全集成的混合信號系統級芯片（SOC），具有與8051完全兼容的指令內核，該單片機采用流水線處理技術，能在執行指令期間預處理下一條指令，提高了效率。而且大部分型號的C8051F單片機，片內集成了數據采集和控制系統中常用的模擬和數字外設及其他功能部件，內置FLASH程序存儲器和RAM數據存儲器，部分芯片上還集成了外部數據存儲器，即XRAM。C8051F單片機具有片內調試電路，通過4腳的JTAG接口可以進行非侵入式、全速的在系統調試。下表為C8051F系列具有代表性的型號的主要特性:
上傳時間： 2013-10-29
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高速SOC單片機 基于半導體集成技術的突飛猛進的發展各種類型的單片機正日新月異的涌向市場為單片機技術的應用人員提供了極大的方便INTEL公司在MCS48系列的基礎上推出高性能的MCS51系列八位單片機而今三十二位單片機又以其強大的片內功能提供給應用者無論是那一種位數的單片機也無論是那一種系列的單片機都為新產品的開發應用系統的研制智能控制器的研究高新技術的應用創造了極其有力的硬件環境當前可以說由于世界各生產廠家生產通用型以及衍生出的五花八門的系列及型號的單片機使其單片機技術的應用已達到了無孔不入的地步當初面向工業控制功能的單片機現已遠遠超出了原設計者的想像然而占全球單片機銷量60%65%左右的八位單片機仍是當前應用的主流就國內應用實踐而言使用單片機數量最大的是八位單片機應用范圍最廣的是八位單片機八位單片機仍具有時代的魅力.
上傳時間： 2013-12-18
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SOC與單片機應用技術的發展:本文討論SOC和單片機應用技術的發展；介紹SOC的基本技術特點和應用概念；分析作為IP家庭重要成員的單片機在SOC應用設計中的特點。通過討論指出以嵌入技術為基礎，單片機再次成為現代電子應用技術的核心之一，為SOC應用技術提供了堅實的基礎。 關鍵字：SOC；單片機；嵌入式系統 引言 現場電子技術應用中包含了硬件（HW）、硬件加軟件（HW+SW）、固件（FW）3個層次。這3個層次也可以說是現代電子技術應用的3人發展階段。自1997年以來，電子技術應用又增加了一個新的層次??片上系統（SOC）層次。SOC技術概念和應用技術層次的出現，標志著現代電子技術應用進入了SOC階段。 從各個發展階段看，自HW+SW階段開始，電子技術應用就與單片機緊密地聯系在一起。在FW階段，作為固件系統的重要核心技術，單片機又以嵌入式技術為基礎，再次成為現代電子應用技術的核心技術之一，并為SOC應用技術提供了緊實的基礎。 SOC為各種應用提供了一個新的實現技術。這種新的電子系統實現技術促使工業界在近3年中發生了巨大的變化，為信息技術的應用提供堅實的基礎，因此，完全可以稱之為SOC革命。同時，SOC也為單片機技術提供了更廣闊的應用領域，使單片機應用技術發生了革命性的變化。
上傳時間： 2013-10-31
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本文是關于Altera公司SOC FPGA 的用戶手冊（英文版） 。文中主要介紹了什么是SOC FPGA、SOC FPGA相關知識介紹、為什么要使用SOC FPGA以及SOC FPGA都應用到哪些方面。
上傳時間： 2013-10-14
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Altera公司SOC FPGA產品簡介高級信息摘要(英文資料) 圖 硬件處理系統
上傳時間： 2014-12-28
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Prakash Rashinkar has over 15 years experience in system design and verificationof embedded systems for communication satellites, launch vehicles and spacecraftground systems, high-performance computing, switching, multimedia, and wirelessapplications. Prakash graduated with an MSEE from Regional Engineering College,Warangal, in India. He lead the team that was responsible for delivering themethodologies for SOC verification at Cadence Design Systems. Prakash is anactive member of the VSIA Functional Verification DWG. He is currently Architectin the Vertical Markets and Design Environments Group at Cadence.
上傳時間： 2014-01-24
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